"논리회로"의 검색결과 입니다.

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디지털논리회로 논리회로과제 FPGA 사칙연산 전전설2 stopwatch 설계

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"논리회로" 검색결과 1,261-1,280 / 9,767건

[A+자료] 논리회로 4비트 가감산기 설계 입니다.

할 수 있다.2. 4비트 가감산기 논리회로설계3. VHDL을 이용한 4비트 가감산기1) 소스entity fouurbit_lsi isPort ( C0 : in STD_LOGIC;A

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| 리포트 | 4페이지 | 3,000원 | 등록일 2012.06.17

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아주대 논리회로실험 실험예비7 복호기와 부호기 (Decoder & Encoder)

) 신호와 같은 성분이므로 필터를 통하여 연속된 원래의 아날로그 신호로 변환한다. 통상의 부호화와 복호화는 하나의 칩으로 구성된 인터페이스 집적 회로(IC) 등을 이용한다.(2) 복호기 ... (Decoder)컴퓨터 내부에서 디지털로 코드화된 데이터를 해독하여 그에 대응되는 아날로그 신호로 바꿔주는 컴퓨터 회로로 인코더의 반대개념으로 디코더라고도 하고 데이터를 본래 형태 ... 화(Encoding)인코딩은 디코딩의 반대를 의미하며 10진수를 2진수로 변환하는 것이다. 인코딩할 때는 출력코드의 각 비트에 대해 논리 연산 OR가 필요하다. OR gate

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| 리포트 | 12페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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[논리회로과제]해밍코드 4 Input 7 Output ENCODER,DECODER 만들기

4비트의 입력을 받아 7비트의 해밍코드를 출력하는 인코더를 만든다.A,B,C,D는 정보비트, H1에서 H7는 해밍코드이다. 왼쪽 그림의 entity와 entity안의 architecture을 구성하여 해밍코드가 출력되도록 하는 vhdl을 구성하고 testbench fi..

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| 리포트 | 15페이지 | 4,000원 | 등록일 2013.01.21

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논리회로설계실험 스텝모터 제어기의 설계

1.VHDL 코드library ieee;use ieee.std_logic_1164.all;use ieee.std_logic_arith.all;use ieee.std_logic_unsigned.all;entity motor2_rot isport (CLK_4M : In s..

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| 리포트 | 6페이지 | 3,000원 | 등록일 2010.12.22

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[논리회로실험] Mux and Demux (예비)

, 74HC139 1개3. 실험관련 이론1) 3상태 버퍼(3Stated Buffer)지금까지 논리회로는 출력으로 반드시 "1"또는 "0" 이외에는 "하이 임피던스"나 "플로팅 ... X1 멀티플렉서를 74HC20과 74HC04를 이용하여 다음 회로와 같이 구성한다. 여기서, E가 enable 입력이고 S0, S1은 선택입력, 그리고 D0~D3이 4개의 데이터 ... 멀티플렉서 IC인 74HC153을 이용하여 다음 회로를 구성한다.4) 다음 표와 같이 입력을 가한 뒤에 출력 Y를 측정하여 기록하라. 선택입력 값에 따라 멀티플렉싱 기능이 이루

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| 리포트 | 10페이지 | 1,500원 | 등록일 2009.03.20

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[아주대] 논리회로실험 6장 예비(Latch & Flip-Flop)

Experiment 6 Latch & Flip-FlopOBJECTIVES실험을 통해 여러 가지의 flip-flop 회로를 구성하고 filp-flop의 동작과 원리를 알아본다 ... 이 달라지는 회로를 말한다. enable입력이 없게 되면 Reset입력과 Set입력이 달라져도 출력은 이전의 상태를 계속 유지하게 된다. enable입력이 들어갈 때는 Reset ... 입력과 Set입력에 따라 출력이 달라지게 되는데, 모두 0으로 입력이 걸리게 되면 출력은 이전의 상태를 계속 유지한다. 회로의 구조에 따라 enable일 때 Set은 0이고

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| 리포트 | 10페이지 | 2,000원 | 등록일 2013.09.25

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[논리회로실험] 래치와 플립플롭 (결과)

1. 실험목표1) 여러 종류의 flip-flop을 구성하여 그 동작 특성을 알아본다.2) Latch의 특성을 확인하고 회로를 구성할 수 있도록 한다.3) Latch와 flip ... (1) 예비과제 (1)에서 구한 R-S latch를 구성한 후 출력을 측정하라.회로도구성한 회로INPUTOUTPUTSRQ(t)Q'00사용금지0110100111변화없음결과값▶ 실험 ... 다.(2) 클럭 입력을 가진 R-S F/F을 구성한 후 출력을 측정하고 결과를 검토하라.회로도INPUTOUTPUTSRCQ(t)001Q(t-1)0110:Reset1011:Set1111

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| 리포트 | 4페이지 | 1,500원 | 등록일 2009.03.20

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[논리회로실험] 시프트레지스터와 카운터 (예비)

하는 회로이며, 이 기능을 이용하여 곱셈, 나눗셈, 데이터의 변형, 편집 등에 이용.시프트 레지스터의 동작 상태를 살펴보면, 만약 6비트의 데이터 101101 이 쉬프트 레지스터에 축적 ... 씩 이동하면 2로 나눈셈이 된다. 또 이것을 왼쪽으로 한 비트씩 이동해 보면 2로 곱해지는 것을 알 수 있게 된다.4. 실험방법1) 시프트 레지스터(1) 그림 1의 회로를 구성하라 ... 4를 완성하라.Shift PulseL0L1L2L3L40LLDDD12345표 4B. Circulating Shift Register - Truth Table그림 3의 회로에서 SER

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| 리포트 | 16페이지 | 1,500원 | 등록일 2009.03.20

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[디지탈 논리회로]디지탈 논리회로

디지털 논리회로부호의 코드화BCD 코드(Binary Coded Decimal) 3초과 코드(Excess-3 Code) 그레이 코드(Gray Code)BCD 코드(Binary ... 음NOR 게이트식 :2입력 NOR 게이트의 진리표NOR 게이트인버터와 버퍼정의 1개의 입력과 1개의 출력을 갖도록 구현한 논리 회로 입력 = 1 and 출력 = 0 입력 = 0 and ... · y변수의 수에 따른 카르노 도카르노 도에 의한 함수의 간략화조합 논리회로가산기(Adder) -반가산기(Half Adder) -전가산기(Full Adder) 감산기

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| 리포트 | 52페이지 | 1,000원 | 등록일 2004.03.29

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논리회로실험 - 제 2장 가산기 및 감산기 결과 보고서

과 목 : 논리회로설계과 제 명 : 결과보고서 1담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 4 / 21 ... 한다.VHDL이라는 디지털 회로를 설계하는데 사용되는 하드웨어 기술 언어를 통해 M에 따라서 덧셈과 뺄셈을 달리하는 가/감산기를 설계하고 출력 값을 확인하여 이론값과 비교해 본다 ... .2. Design(1)어떠한 회로를 설계할 것인가1)4bit 가/감산기모드 M의 값에 따라 가산기모드나 감산기모드를 결정한다.M이 0인 경우 가산기 모드이고, M이 1인 경우 감산

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| 리포트 | 10페이지 | 1,000원 | 등록일 2014.08.15

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아주대 논리회로실험 실험예비3 가산기와 감산기(Adder & Subtractor)

(Carry) C를 출력하는 조합논리 회로입력출력xyCS0*************10(2) 전가산기(Full adder)두 개의 2진수와 아랫자리의 자리 올림을 더하여 합(Sum) S ... 와 자리 올림(Carry) C를 출력하는 조합논리 회로입력출력xyzCS0000000101010010111010001101101101011111(3) 반감산기(Half-s ... ubstractors)두 개의 2진수를 빼서 차(Difference) D와 빌림(Borrow) B를 출력하는 조합논리 회로입력출력xyBD0000011110011100(4) 전감산기(Full-s

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| 리포트 | 8페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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아주대 논리회로실험 실험결과7 복호기와 부호기 (Decoder & Encoder)

와 디코더 실험중 Decimal-to-excess 3 encoder 실험으로 우리가 일상 에서 사용하는 10진수를 회로설계와 논리회로에서 유용하게 사용하는 excess 3 code ... 으로 부호화라고 한다. 이번 실험에서는 십진수를 단순히 BCD의 2진수가아닌 BCD에 더 업그레이드된 논리회로 시간에 배운 excess 3 code로 인코딩 하는회로를 구성해서 동작 ... 실험 7. 디코더와 인코더 결과보고서● 실험 결과 분석실험 1. 2단 2진 카운터 (시뮬레이션 대체)그림 2의 회로를 구성하여 그림 3에 다음의 파형을 그리시오.1) 출력 A

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| 리포트 | 9페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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아주대 논리회로실험 실험결과6 시프트레지스터와 카운터 (Shift Register & Counter)

번seL0L1L2L3L40LLDDD1DLLDD2DDLLD3DDDLD4DDDDL5DDDDDSimulationComent : 이번 실험은 7496 집적회로를 이용해 실험1-1에서 진행 ... 하였던 Parallel In/Serial Out 시프트레지스터의 동작을 확인해보는 실험이었다. 실험1에서는 7476소자(J-K F/F)을 3개(J-K는 6개)를 이용하여 회로 ... 를 구성하였지만 이번 실험에서는 7476 소자 하나만을 이용하여 회로를 구성하여서 아주 간단한 회로가 되었다. 회로 구성후 DS(9번핀)와 PE(8번핀)를 접지시킨다. 그리고 CLR

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| 리포트 | 10페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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[A+ 예비보고서] 아주대 논리회로실험 실험4 '멀티플렉서 & 디멀티플렉스'

멀티플렉서-멀티플렉서와는 반대로, 디멀티플렉서(DEMUX)는 한 개의 입력을 여러 개의 출력 중 하나에 연결하는 회로가 된다.●Active high 신호와 Active low 신호-논리 ... 을 출력으로 내보내는 데이터 선택기이다. 먹스에는 아날로그먹스와 디지털먹스가 있는데, 완전하게 결선된 회로 상태에서 원하는 데이터 입력원을 선택하는 응용에 자주 사용된다.●디 ... 회로에서 다루는 신호는 크게 active high와 active low로 구분되는데, Active high 신호는 그 값이 High일 때 그 신호가 가진 특정한 기능을 수행할 수

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| 리포트 | 5페이지 | 1,000원 | 등록일 2015.03.27

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논리회로실험 실험6 Latch & Flip-Flop 결과보고서

7주차 결과보고서실험 6 Latch & Flip-Flop▶실험과정 및 결과◈ 실험 1 : R-S F/F구성 사진 :- 74HC00게이트 4개를 사용하여 결손도를 참고하여 회로 ... 하는 실험결과를 얻었다.- S-R F/F에서 R을 인버터에 통과시킨 후 S와 합친 회로라고 할 수 있다. 따라서 S-R F/F에서 S와 R이 서로 반대의 입력을 가질 때라고 생각하면 쉽 ... 하여 실험하였다. 실험실에서 데이터시트를 보고 바로 브레드보드에 회로를 설계, 설치하였다.- LED는 왼쪽이 Q, 오른쪽이 Q’이다.- IC를 이용한 F/F은 실제 클럭을 입력

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| 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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[A+ 결과보고서] 아주대 논리회로실험 실험4 '멀티플렉서 & 디멀티플렉서'

를 이용하여 데이터를 선택하는 역할이다. S1, S0가 각각 0,0일때는 회로도에서 맨 윗부분의 AND를 지나는 입력을 출력하게되는것이고, 0,1 일때는 두 번째, 1,0일때는 세 번 ... 이 일치하였다. 사실 이 실험은 어떠한 양을 측정하는 실험이 아니고 단순히 회로도에 입력을 가했을 때, 생기는 결과가 명확히 정해져 있는 실험이므로, 실험값이 예비보고서와 이론적인 ... 결과값이 같을 경우에는 실험진행시 회로를 올바르게 구성했다는 것 밖에 분석할 수 없는것같다.●디멀티플렉서 실험결과DEMUX입력출력DS1S0Y3Y2Y1Y00XX0000+500000

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| 리포트 | 6페이지 | 1,000원 | 등록일 2015.03.27

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디지털 논리회로 시계 타이머 스탑 와치 알람 만들기 maxplus이용 (코드, 보고서)

module digitalclock(swbutton1, swbutton2,set,reset,clk,segment1,segment2,segment3,segment4,segment5,segment6,led1,led2,led3,led16);input swbutton1;inp..

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| 리포트 | 21페이지 | 3,000원 | 등록일 2014.01.12

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논리 회로 설계 및 실험 디지털 시계 기말과제

논리 회로 설계 및 실험기말 과제[Digital Watch]INDEXSession1. (Introduction)The name of this project (과제 이름)Why ... 들 활용해 나의 기량을 향상 시킬 수 있을 것이라고 생각 하였다.카운터를 이용해 설계할 수 있는 가장 기본이자 대표적인 순차논리회로의 하나이다. 기말과제의 목표에 적당한 것 같 ... circuit diagram & a Device Plan (회로도와 소자배치도)session3. (Conclusion)Choosing this project (과제 선정)Difficult

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| 리포트 | 15페이지 | 1,000원 | 등록일 2010.10.19

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C언어 논리회로 Quine-Mcluscky Map_entered variable 간략화표현 프로그래밍

#include #include #include #define TERM_MAX 5typedef struct terms{char *name; // 수 스트링 (ex. 1,3,4,5)char *binary; // 이진 표현int *binterms; // minterm 수 ..

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| 리포트 | 18페이지 | 3,000원 | 등록일 2013.06.09

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[논리회로실험설계] 한 자리 십진수 가산기

(필요부품, AND, OR, NOT, 4-bit adder 2개)조건: 8421 코드 사용, Carry-in 고려, 합이 9보다 큰 경우만 고려→논리회로교재(Marcovitz)계산 ... 하는 논리 회로이다.이 회로를 만들기 위해 1번 가산기에서 가산 합이 10 이상이 될 수 있는 경우를 생각해 보아야 한다.① 1번 가산기의 Cout이 1인 경우=> A1 + B1 ... .3-1번] 15 [1111] + 4 [0100] = 19[1 1001] => BCD 코드 [1 1001]7) 회로 뒷면6. 결과 및 고찰마지막으로 논리 회로 실험에서 하는 프로젝트

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| 리포트 | 14페이지 | 2,000원 | 등록일 2011.07.14

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