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"논리회로설계" 검색결과 41-60 / 4,395건

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    논리회로실험 프로젝트 2, stop watch 설계
    논리회로설계실험 프로젝트 #2Stop watch 설계1. 설계 목표BCD, 7 segment, 카운터, Debouncing 등에 대해 조사해보고, 지금까지 학습해왔던 논리회로 ... 그림과 같다.4) Counter- Counter란 반복해서 일어나는 현상의 수를 셈하는 장치로 클록 펄스에 따라 수를 세는 계수능력을 갖는 논리회로이다. Counter는 2개 이상 ... 설계기술을 이용하여, 분 : 초 : 1/100초를 나타내고 리셋기능과 일시정지가 가능한 Stop Watch를 설계한다. 그리고 RoV-Lab3000기기를 사용하여 LED에 나오
    리포트 | 14페이지 | 1,500원 | 등록일 2021.10.01
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    아날로그및디지털회로설계실습 논리함수와게이트
    아날로그 및 디지털회로 설계실습예비 REPORT7. 논리함수와 게이트분 반교 수 명실험 날짜제출 날짜조학 번이 름요약 : 여러 종류의 게이트의 기능을 측정하여 실험적으로 이해 ... 의 회로도롤 설계한다.XNOR 진리표입력출력ABY001010100111NAND gateNOR gateXOR gateXNOR gate(B) AND 게이트와 OR 게이트 각각의 입출력 ... 시간 딜레이를 측정할 수 있는 방법에 대해 조사하고, 딜레이를 가장 정확하게 측정할 수 있는 방법의 실험 방법을 설계한다.입력신호가 가해지고 게이트의 종류에 따른 논리연산 결과
    리포트 | 5페이지 | 1,000원 | 등록일 2021.12.15
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    아날로그 및 디지털회로설계실습 10 조합논리 회로의 예 (7-segmentDecoder 회로 설계) 과제
    실습 10. 조합논리 회로의 예 (7-segment/Decoder 회로 설계) 과제7-segment LED의 특성을 확인하였을 때 Common Cathode type이라면, 7
    리포트 | 1페이지 | 1,000원 | 등록일 2021.09.02
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    논리회로설계실험_비교기,MUX,ALU 결과레포트
    논리회로설계 실험 결과보고서 #3실험 3. 비교기_MUX_ALU1. 실험 목표비교기, MUX, ALU를 설계해 본 후, 8가지 기능을 가진 ALU를 설계해본다. 시뮬레이션을 통해 ... , n bit 비교기 설계동작적 모델링자료 흐름 모델링진리표에 따라 작성해보자. A와B가 입력이므로, process의 sensitivity list에 A와B를 넣는다. A>B인 경우 ... 됐음을 알 수 있다.3. 고찰(1)이번에는 실습할 문제들이 상당히 많았다. 비교기 mux demux alu를 직접 설계해보는 시간이었는데 저 중 익숙한 것은 비교기와 mux밖에 없
    리포트 | 17페이지 | 2,500원 | 등록일 2021.10.09
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    논리회로설계실험 - 디코더/엔코더 예비레포트
    논리회로설계 실험 예비보고서 #4실험 4. 디코더& 엔코더 설계1. 실험 목표디코더와 엔코더의 원리를 이해하고 3x8 디코더와 8x3 엔코더를 VHDL에서 동작적 모델링과 자료 ... 는 디코더 논리회로를 설계할 수 있다. 입력을 a~d, 출력을 A~G라고 하면 그 결과는 다음과 같다.A=c` prime a prime +`ca+`d`+c` prime b`B=b ... 공통적으로 사용되는 유형의 집적 회로이다. 이진수 디코더는 부호화된 2진수 정수를 부호화되기 전으로 되돌리는 조합논리회로이다.n TIMES 2 ^{n} 디코더는 2진수로 된 n개
    리포트 | 9페이지 | 2,000원 | 등록일 2021.10.09
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    7장 순차논리회로 설계 및 구현(1) 예비
    디지털공학실험 ? 7장, 순차논리회로 설계 및 구현(1) 예비보고서1. 목적가. 4상태를 가진 상태도를 회로로 구현하고 동작을 확인한다.나. T-플립플롭을 이용한 4비트 리플 ... 카운터를 설계하고 구현한다.다. 최대 동장 주파수와 전달 지연을 측정한다.2. 이론가. 4상태를 가진 상태도에 대응하는 회로상태도는 순차회로의 현재 상태와 입력 값으로부터 출력 값 ... 머신은 출력이 원안에 표시된다.[그림 7-1] 4상태를 가진 상태도일반적으로 상태로부터 순차회로를 설계하는 방식은 다음과 같은 절차를 갖는다.① 상태도를 해석한다.② 상태도로부터 천
    리포트 | 10페이지 | 1,000원 | 등록일 2021.01.06
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    7장 순차논리회로 설계 및 구현(1) 결과
    디지털공학실험 ? 7장, 순차논리회로 설계 및 구현(1) 결과 보고서◈ 실험 결과 및 검토가. 그림 7-9의 회로를 설계하고 다음의 천이표를 완성하라.☞ 그림 7-9 상태도를 보 ... 을 구하고 그 식을 통해 D플립플롭으로 회로를 설계한 뒤, 그 회로를 브레드보드에 구성하여 결과값을 얻는 복잡하고 어려운 실험이었다. 디지털공학 수업을 듣지 않았더라면 실험을 시작 ... 의 결과를 얻을 수 있었다.☞ 위의 식에 따라 D 플립플롭으로 회로를 구성한 그림이다.☞ 위의 회로를 브레드보드에 구성한 모습이다.현재 상태입력다음 상태
    리포트 | 4페이지 | 1,000원 | 등록일 2021.01.06
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    8장 순차논리회로 설계 및 구현(2) 예비
    디지털공학실험 ? 8장, 순차논리회로 설계 및 구현(2) 예비보고서1. 목적가. 4비트 동기 카운터를 설계하고 구현한다.나. 4비트 레지스터를 설계하고 구현한다.다. 3비트 ... 시프트 레지스터를 설계하고 구현한다.2. 이론가. 동기식 카운터(Synchronous Counter)1) T 플립플롭을 이용한 동기식 카운터동기식 카운터는 모든 플립플롭의 클럭 입력 ... 논리의 출력에 의해 상승에지에서 그 플립플롭이 반전할지가 결정된다. 그림과 같이Q_{ 0}의 EN을 이용하면 매스터 카운터 인에이블 신호(CNTEN)로 사용할 수 있다. CNTEN
    리포트 | 7페이지 | 1,000원 | 등록일 2021.01.06
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    아날로그 및 디지털회로설계실습 10 조합논리 회로의 예 (7-segmentDecoder 회로 설계) 예비 리포트
    설계실습 10. 조합논리 회로의 예(7-segmemt/Decoder 회로 설계)요약: 이번 보고서에서는 조합논리회로를 학습했다. 7-segment/Decoder 진리표를 완성 ... 했으며 진리표를 통해 Karnaugh과 간소화 된 형태의 불리언 식을 구했다. 그 후에 Decoder와 7-segment를 이용한 7-segment 구동 회로를 설계했다.서론: 7-s ... 을 구해 7-segment/Decoder회로를 설계하는 실험을 했다.실험결과:7-segment/Decoder 진리표아래 7-segment/Decoder 진리표를 작성한다.입력출력
    리포트 | 4페이지 | 1,000원 | 등록일 2021.09.02
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    전류모드 CMOS 4치 논리회로를 이용한 64×64-비트 변형된 Booth 곱셈기 설계 (Design of a 64x64-Bit Modified Booth Multiplier Using Current-Mode CMOS Quarternary Logic Circuits)
    한국정보처리학회 김정범
    논문 | 6페이지 | 무료 | 등록일 2025.03.21 | 수정일 2025.03.28
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    8장 순차논리회로 설계 및 구현(2) 결과
    디지털공학실험 ? 8장, 순차논리회로 설계 및 구현(2) 결과보고서◈ 실험 결과 및 검토가. 4비트 동기식 상향 카운터를 설계하고 출력을 확인하여 다음의 표를 완성하라.☞ 회로 ... 의 모습이다. 7478 IC 2개와 7408 IC인 AND gate 2개를 이용하였다.☞ 힘겹게 브레드보드에 회로를 구성하고 초기화시킨 상태의 모습. 왼쪽에 솟아있는 하얀색 리드선 ... 가 1씩 올라 갈 때 마다 십진수도 1씩 증가하도록 출력값이 나왔고 십진수가 15가 되었을 때 다시 0으로 되돌아가 반복됨을 볼 수 있다.나. 4비트 동기식 하향 카운터를 설계
    리포트 | 6페이지 | 1,000원 | 등록일 2021.01.06
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    아날로그및디지털회로설계실습 (예비)설계실습 7. 논리함수와 게이트 A+
    7-3-1 XNOR 게이트 설계 및 특성 분석(A) AND, OR, NOT 게이트를 사용하여 NAND, NOR, XOR 게이트의 기능을 갖는 회로도를 그리고, XNOR ... (Excllulsive NOR)의 진리표를 사용하여 AND, OR, NOT 게이트로 XNOR의 회로도를 설계한다.회로를 설계하고, 위상차를 주지 않았을 때 입력이 (0,0), (1,1)인
    리포트 | 6페이지 | 1,000원 | 등록일 2024.12.23
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  • 판매자 표지 자료 표지
    디지털 논리회로 실험 및 설계 4주차 예비보고서
    디지털 논리실험 및 설계 4주차 예비보고서실험 준비1.1 멀티플렉서와 부호기(encoder)의 차이를 설명하시오.부호기는 4개의 입력값 중에 1이 단 1개만 있어야하는 반면 ... 을 Address에 대해서 OUTPUT으로 출력해주는 Demultiplexer의 역할과 Address INPUT의 값을 decode해주는 Decoder의 회로가 완성된다.1.5 응용 ... 되어야 회로가 정상작동하기에 , I가 0일 경우에 S에 따른 번호의 출력값에서 입력값 이 출력 될 것이다., 일 경우엔 에, , 일 경우엔 에, , 일 경우엔 에, , 일 경우엔 에
    리포트 | 5페이지 | 2,000원 | 등록일 2023.01.31
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    디지털 논리 회로 설계 실험 최종프로젝트 레포트 A+ 타이밍게임(회로도있음)
    디지털 논리 회로 설계-타이밍게임_20180619000 교수님000 조교님금요일 2,3교시B000000 000-목차-(1) 설계 아이디어(2) 설계 방법(3) 전체 회로도(4 ... ) 평가1.설계 아이디어1)Stage 1상태에서 “CLK” switch를 누를 때 마다5개의 LED가 “1-2-3-4-5-4-3-2-1-2-3-4-5- ? (반복)”의 순서로 켜진다 ... .>> 7개의 LED로 설계도를 만들기 위해 10진 카운터(74190)를 사용한다. up/down 인풋을 이용해 1일 때 업 7일 때 다운을 걸어준다.(2) Nice Timing
    리포트 | 11페이지 | 2,000원 | 등록일 2021.07.09
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    아날로그 및 디지털회로설계실습 9 부울대수 및 조합논리회로 과제
    4-bit Adder 회로 설계 과제1. 다음의 진리표를 보고 입력 x, y, z와 출력 f를 Karnaugh맵을 이용하여 간소화하여 부울 대수식으로 표현하시오.입력출력xyzF ... HC86 XOR gate의 Vcc와 GND가 몇 번 pin인지 쓰시오.Vcc는 14번 pin이고 GND는 7번 pin 이다.3. XOR gate를 이용한 Full Adder 회로를 Pspice를 사용하여 직접 설계하시오.
    리포트 | 2페이지 | 1,000원 | 등록일 2021.09.02
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    다치 논리 함수 연산 알고리즘에 기초한 MOVAG 구성과 T-gate를 이용한 회로 설계에 관한 연구 (A Study on the Constructions MOVAGs based on Operation Algorithm for Multiple Valued Logic Function and Circuits Design using T-gate)
    MOVAG의 구성 알고리즘과 입력행렬선정 알고리즘을 제안하고 T-gate를 사용하여 다치 논리 회로를 설계, 모의 실험을 통해 그 결과를 검증하였다. In this paper, we ... 의 함수에서 회로 설계까지 많은 처리시간과 노력이 요구되므로 본 논문에서는 MDD의 단점을 보완하여 데이터 처리시간의 단축과 적은 복잡도를 갖도록 MOVAG를 설계하였다. 또한 ... graphs)를 이용한 다치논리함수의 구성방법을 제안하였다. D.M.Miller에 의해 제안된 MDD(Multiple-valued Decision Diagram)는 주어진 다변수
    논문 | 11페이지 | 무료 | 등록일 2025.07.11 | 수정일 2025.07.19
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    원전용 IC를 위한 CMOS 디지털 논리회로의 내방사선 모델 설계 및 누적방사선 손상 분석 (A Radiation-hardened Model Design of CMOS Digital Logic Circuit for Nuclear Power Plant IC and its Total Radiation Damage Analysis)
    ICs(Integrated circuits) for nuclear power plant exposed to radiation environment occur malfunctions and data errors by the TID(Total ionizing dose) e..
    논문 | 8페이지 | 무료 | 등록일 2025.05.22 | 수정일 2025.05.26
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    아날로그 및 디지털회로설계실습 9 부울대수 및 조합논리회로 예비 리포트
    설계실습 9. 부울대수 및 조합논리회로요약: 이번 보고서를 통해 부울대수 및 조합논리회로를 학습했다. 전가산기의 진리표를 작성하고 Karmaugh 맵을 통해 불리언식을 알아보 ... -NOR) 로직 회로를 설계한다.XOR gate를 이용하여 보다 간소화된 다단계 조합 논리회로를 설계한다.S의 식은 XOR gate로 표현하면 A⊕B⊕이고의 식은 XOR gate ... 은 n개의 1비트 가산기를 서로 연결해주는 것이다.위의 회로들을 이용하여 2Bit 가산기 회로를 설계하면결론: 이번 보고서를 통해 부울대수 및 조합논리회로를 학습했다. 전가산기
    리포트 | 4페이지 | 1,000원 | 등록일 2021.09.02
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    [A+]중앙대 아날로그및디지털회로설계실습 과제 동기순서 논리회로 (Stopwatch 설계) (15주차)
    아날로그 및 디지털 회로설계실습15주차 동기순서 논리회로 (Stopwatch 설계) 과제05분반 20161163 박성은1.- 16진 동기 카운터 회로도- 10진 동기 카운터 회로
    리포트 | 2페이지 | 1,000원 | 등록일 2021.10.09
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    A+ 아날로그및디지털회로설계 실습 예보_논리함수와 게이트
    리포트 | 4페이지 | 1,000원 | 등록일 2022.03.27
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2025년 08월 12일 화요일
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