"논리회로실험"의 검색결과 입니다.

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verilog 전전설2 레포트 논리회로 텀프로젝트 실험12 멀티플렉서 vhdl 논리회로실험 디지털회로실험 라인트레이서

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"논리회로실험" 검색결과 481-500 / 4,713건

논리회로실험 실험9 ram 결과보고서

write, read을 두 번씩 진행하였다.◈ 실험 2 : 64-bit IC RAM? 구성 사진 :- 74LS89를 사용하여 동기식 64BIT RAM을 결손도에 설계하고 브레드보드에 회로 ... 10주차 결과보고서실험 9 Ram▶실험과정 및 결과◈ 실험1 - 2-bit RAM? 구성 사진 :- 74HC00과 74HC03을 사용하여 2BIT RAM을 결손도에 설계하고 설계 ... 를 참고하여 브레드보드에 회로를 설치했다.- 주의사항? 한번에 하나의 bit(A or B)에 하나의 데이터(1 or 0)만 써야 한다.? Write 과정을 한 이후에는 접지

리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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논리회로실험 15주차 결과보고서

결 과 보 고 서15주차P r o j e c t분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ Project ]? Quartus Ⅱ ... *************11001200100100100300110110000401000011001501010010010601100000010701111011000810000000000910010010000[ 실험 2-1 ]? Quartus Ⅱ에서 Schematic을 작성한다.? FPGA의 동작을 확인한다.보드 동작을 실행 ... 이 1Hz 동작을 하는 구동 회로가 되고, 버튼을 위로 올리면 3Hz 동작을 하는 구동 회로가 된다.)3. KEY3번 버튼을 눌렀을 때는 보드가 어떤 동작을 하는지 작성하시오.KEY3

리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 5주차 예비보고서

예 비 보 고 서5주차부울대수의 간소화(2)Verilog HDL code 이용분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- Verilog ... 하여 합성하고 Programming 하는 방법을 이해한다.2. 기본 이론1) Verilog HDL란?? 단순 논리 게이트나 플립플롭과 같은 기본적인 소자에서부터 제어회로, 통신용 모뎀 ... 과 Verilog HDL로 두 가지의 종류가 있다. HDL은 설계의 효율을 극대화함과 동시에 설계 기간을 단축, 검증 정확도를 향상시킨 언어이다. 디자인 재사용이 가능하며 회로 기능

리포트 | 4페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 2주차 결과보고서

.008 v0 V5 V4.004 v5 V0 V4.003 v5 V5 V4.002 v실험고찰1. 실험과정 3, 4, 5 표의 결과 값(v)을 논리 값으로 바꾸시오[표 10] 3개의 Not ... 결 과 보 고 서2주차(실험1)NOT Gate를 이용한 실험장비 사용법분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.00과정 1[표 4] 1개 Not ... inputoutputBAF000011101111실험간 오차 원인이번 실험에서 사용된 ‘디지털 멀티미터’는 높은 정확도로 전압, 전류, 전기저항 등을 측정하는 전자 계측기임에도 불구

리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 12주차 예비보고서

이 있는 2X4 NAND 디코더 회로② (Decade) Counter [10진 카운터]이전 실험들을 통해 카운터에 대해 학습하였고, 다음과 같이 정리해 볼 수 있다.클럭펄스인가방식비 ... 예 비 보 고 서12주차7-segment LED Decoder/10진수 Counter분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- 7-s ... decode의 동작을 실험을 통해 익힌다.2. 기본 이론① 디코더 (decoder)디코더(decoder)란 n비트의 2진 코드(code) 값을 입력으로 받아들여 최대 2n개의 서로 다른

리포트 | 4페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로설계실험 반가산기전가산기설계 결과보고서

논리회로설계 실험 결과보고서 #2실험 2. 조합 회로 설계-전가산기실험목표전가산기의 동작을 이해하고 진리표를 작성해 본다. 작성한 진리표를 바탕으로 최소화된 논리식을 사용하여 전 ... 가산기 회로를 동작적 모델링, 자료 흐름 모델링, 그리고 구조적 모델링 방식으로 코드를 작성해 본다. 또한 Schematic design을 이용하여 전가산기의 논리회로를 구성 ... 해 본다. 최종적으로 테스트 벤치 코드를 작성하여 시뮬레이션을 통해 전가산기 코드가 정상적으로 작동하는지 확인해 본다.실험 결과 전가산기 회로를 동작적 모델링, 자료 흐름 모델링

리포트 | 6페이지 | 1,500원 | 등록일 2018.01.10

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기본 논리게이트(AND, OR, NOT 게이트) 회로실험 결과 레포트

기본 논리 게이트디지털 공학 실험1. 실습내용 : 기본 논리 게이트2. 실습날짜 :3. 실 습 조 :4. 실습개요ⅰ. 논리회로의 기본이 되는 NOT, AND, OR 게이트의 논리 ... 를 구성할 수 있다.실험3. 3입력 AND 게이트(7411 사용)7411 게이트의 논리기호1) 7411 게이트를 이용, 회로를 구성한다.2) 실험 4와 같은 방법으로 X의 출력을 확인 ... 으로 연결하지 않아도 3입력 AND게이트의 논리회로를 구성할 수 있다.실험3. OR 게이트OR 게이트를 비교한 스위치 회로도1) A,B(입력)에 전압을 가하지 않고, 접지(Ground

리포트 | 8페이지 | 1,000원 | 등록일 2016.03.29

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논리회로실험 8주차 결과보고서

결 과 보 고 서8주차Latch / Flip Flop분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1 ]1.D latch의 회로 ... 로 전달하여 출력하지 않음을 알 수 있다.? en=0일 때 입력된 d값은 출력 q로 전달되지 않는다.[ 실험 2 ]1. D Flip Flop의 회로를 구현하기 위해 Quartus Ⅱ ... 결과를 나타내는 사진이다. enable=0이고, 입력 d=1을 받아 q=0을 출력했으므로, enable=0일 때는 이전 실험과는 달리 d의 값을 저장하여 q로 전달하여 출력하지 않

리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 15주차 결과보고서

, Decoder, 7-Segment - LED driver 등 그동안 실험에서 배운 블록을 이용하여 회로 블록을 설계하여 본다.- 기본적인 디지털 로직 블록을 이용하여 복잡한 로직회로 ... 결 과 보 고 서15주차P r o j e c t분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.00[ Project ]? 실 험 목 적- Counter ... 를 설계하고 Modelsim과 FPGA 보드를 이용하여 회로를 검증하는 방법을 이해한다.? Quartus Ⅱ에서 Schematic을 작성한다.(13주차 종합설계프로젝트

리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 11주차 예비보고서

요소를 익힌다.- ALU의 작동 원리를 실험을 통해 익힌다.2. 기본이론? ALU의 개요대부분의 컴퓨터의 동작은 산술논리장치가 처리한다. 산술논리장치는 프로세서 레지스터로부터 데이터 ... 는 상태 출력이다.산술논리 연산장치(Arithmetic logic unit)는 두 숫자의 덧셈, 뺄셈과 같은 산술연산과 배타적 논리합, 논리곱과 같은 논리연산을 계산하는 디지털 회로이 ... 에 의해 통제되는데, 게이트 회로는 다시 각 연산코드에 대해 특별한 알고리즘이나 순서를 사용하는 순차 논리장치에 의해 통제 된다.? ALU의 구성요소ALU는 ‘전가산기’(직렬연결 시 1

리포트 | 3페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 12주차 결과보고서

100의 값을 받아 논리연산장치인 AND가 작동하여 000111의 값을 출력하였다.[ 실험 2-2 ]1. Quartus Ⅱ에서 ALU의 회로를 작성하고 Modelsim의 결과 ... 결 과 보 고 서12주차ALU분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1 ]1. Quartus Ⅱ에서 ALU의 회로를 작성 ... 하는 그림이다. 000101과 001111을 입력해준 상태이고 selection 11의 값을 받아 논리연산장치인 or block이 작동하여 001111의 값을 출력하였다.[ 실험 2-1

리포트 | 7페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 6주차 예비보고서

)멀티플렉서(MUX : multiplexer)는 복수개의 입력 선으로부터 필요한 데이터를 선택하여 하나의 출력 선으로 내보내는 조합논리회로이다. n개의 입력들과 1개의 출력이 있 ... DEMUX디멀티플렉서는 입력의 논리 값을 여러 개의 출력라인 가운데 하나를 선택하여 입력의 2진 값을 선택제어신호(Select_input)에 의해 선택된 출력라인으로 전환하는 디지털 회로 ... 예 비 보 고 서6주차MUX and DEMUX분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- 멀티 플랙서의 구조와 동작 원리를 이해한다.

리포트 | 4페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 9주차 예비보고서

예 비 보 고 서9주차Register / Shift Register분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- register와 s ... hift register, ring counter, johnson counter의 의미와 특징을 이해한다.- register와 shift register, ring counter를 실험

리포트 | 3페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 7주차 결과보고서

므로, LED1과 LED2 양쪽에 모두 불이 들어오게 된다.[ 실험 2 ]1. 2x4 decoder의 회로를 구현하기 위해 Quartus Ⅱ를 이용하여 구현하고, Modelsim 값 ... 하고 switch로 입력 값을 변화하며 LED의 변화를 살펴보면 다음과 같은 결과 값을 얻을 수 있다.[ 실험 3 ]1. 7-segment LED의 회로를 구현하기 위해 Quartus Ⅱ ... 결 과 보 고 서7주차Decoder / Encoder /7-segment LED분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1

리포트 | 8페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로설계실험 반가산기 전가산기설계 예비보고서

논리회로설계 실험 예비보고서 #2실험 2. 조합 회로 설계-반가산기실험 목표반가산기의 작동을 이해하고 진리표를 작성하여 논리식을 구하여 본다. 이를 바탕으로 Xilinx 프로그램 ... 를 확인한다.반가산기진리표논리식과 논리회로논리식논리회로소스코드동작적 모델링(Behavioral modeling)자료 흐름 모델링(Dataflow modeling)구조적 모델링 ... 를 사용한다.실험 내용실험1. 반가산기를 Behavioral modeling, Dataflow modeling, Structural modeling 방식으로 코딩하여 시뮬레이션 결과

리포트 | 7페이지 | 1,000원 | 등록일 2018.01.10

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논리회로설계실험 ALU & multiplier (결과보고서)

논리 연산 장치(기구).[네이버 지식백과] ALU [Arithmetic and Logic Unit] (용어해설)이번 실험에서는 산술연산, 논리연산, 시프트연산을 수행하는 8비트 ... , 감소), 논리연산(AND, OR, XOR, NOT), 시프트연산을 수행할 수 있는 회로로, 총 12가지의 연산을 할 수 있게 만들어 준다. 그 연산의 종류는 다음과 같은데 어떤 ... 에 실험에서 설계할 때 사용해보았던 것들을 다양하게 활용해보았던 점에 있어서 큰 의의가 있다고 생각한다. 먼저 ALU는 if와 case문을 활용하여 회로를 설계하게 되는데 ALU

리포트 | 19페이지 | 1,000원 | 등록일 2015.08.25

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논리회로설계실험 FSM moore LCD (결과보고서)

한 기계. 현재의 컴퓨터는 이 유한 상태 기계에 속한다.②유한 개의 상태와 이런 상태들 간의 변환으로 구성된 계산 모형.③동기 순차 회로를 기술하는 추상화 모델. 입력에 의해 상태 ... 를 바꾸면서 출력을 갖는다.[전화교환] 축적 프로그램 교환기의 프로그램을 구성하는 순차적 활동. 이러한 활동들은 논리적인 상태들의 진행으로 기술되는 호출 과정을 가진다. 유한 상태 ... 기계라고도 한다. 이 기계는 공(空)계열의 입력에 대하여 반드시 공계열이 아닌 기호를 출력한다. 순서 회로의 경우, 그림에 표시한 바와 같이 현재의 출력이 현재의 입력에 의하지 않

리포트 | 19페이지 | 1,000원 | 등록일 2015.08.25

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08 논리회로설계실험 결과보고서(카운터)

논리회로설계 실험 결과보고서 #8실험 8. 카운터 설계1. 실험 목표VHDL을 이용하여 카운터를 설계한다.설계한 카운터를 이용하여 RoV-Lab3000의 led와 7segment ... 실험을 하기 전 작성했던 예비보고서에서 설계했던 존슨카운터를 응용하여 설계하였다.실험의 목표는 클락 주파수가 2Hz인 회로이다. 이를 위해 첫 번째 process 문에서 클락 ... 가 정해진 동작을 수행하도록 한다.2. 실험 결과실험 1. 8비트 비동기식 업카운터 설계(1) 설계 내용1) 소스 코드2) 핀할당3) 7segment 표시결과4) 결과 분석이번

리포트 | 5페이지 | 2,000원 | 등록일 2014.09.27 | 수정일 2016.03.26

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논리회로실험 8주차 예비보고서

예 비 보 고 서8주차Latch & Flip Flop분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- 순서논리회로의 의미와 특징을 이해한다. ... 한다.- SR Flip Flop, D Flip Flop, T Flip Flop, JK Flip Flop의 동작을 이해한다.2. 기본이론1) 순서논리회로의 의미순서논리회로는 조합논리 ... 회로와는 달리 현재의 입력뿐만 아니라 과거의 입력과 시간에도 출력이 영향을 받게 되며, 조합논리회로와 피드백을 구성하는 기억소자로 구성된다. 이러한 순서논리회로는 회로의 상태

리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 4주차 예비보고서

과 정리를 이해한다.- 부울대수식을 이용한 간소화 방법을 이해한다.- 부울대수를 symbol의 형태로 표현하는 방법을 이해한다.2. 기본 이론논리 회로를 설계함에 있어 부울대수의 특성 ... 을 이해하고 이용하면 복잡한 논리회로를 정확하고 간결하게 표현 가능하다. 부울대수의 기본 법칙으로는 교환, 결합, 분배법칙이 있으며 추가적으로 드모르간의 법칙이 있다.* 부울대수 ... 다.이를 기호화 하면,(A + B )` = A` · B`(AB)` = A` + B` 등으로 표현가능하다.드모르간의 법칙은 논리회로 연산자들로도 표현이 가능한데, 다음과 같이 표기할 수 있다.

리포트 | 3페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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