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레포트 전전설2 verilog 논리회로실험2 논리회로 설계 FPGA 사칙연산 텀프로젝트 회로 논리회로실험 7 세그먼트
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"논리회로실험" 검색결과 481-500 / 4,958건

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    아주대 논리회로실험 실험결과1 Basic Gates
    는 실험이 었다. 우선 이 실험은 논리회로실험 수업의 첫 실험으로 실험가운데 많은 어려움이 있었지만대부분의 실험이 예측했던 대로 Pspice simulation 값과 일치하는 결과 ... -input NAND gate를 구성하는 실험을 했는데 1개의 2-input AND gate와 2-input NAND gate 이용하여 회로를 구성하였고 Boolean equation Y ... )에서는 3-input NOR gate를 구성하는 실험을 했는데 1개의 2-input OR gate와 2-input NOR gate 이용하여 회로를 구성하였고 Boolean
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03
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    아주대 논리회로실험 실험예비1 Basic Gates
    ollector 출력에서는 직접적으로 H, L의 논리 레벨이나 기타 출력을 얻을 수 없고 다른 회로에 종속되어서 어떤 값을 취하거나 신호를 전달 할 수 있게 된다.- pull-up 저항 ... 실험 1. Basic Gates 예비보고서● 예비보고서 문제(1) 실험방법 (1)에서처럼 2-input gate를 이용하여 3-input OR, NAND, NOR gate를 실험 ... 의 simulation(2) 실험(3)의 logic diagram에서 출력 X,Y,Z에 대한 Bloolean equation을 두 입력 A, B 로 나타내고 이 식의 truth
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03
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    성균관대 논리회로 설계실험 VHDL을 이용한 8bit decimal Counter
    성균관대 논리회로 설계실험 VHDL을 이용한 8bit decimal Counter입니다.당시 한태희 교수님이셨고, 두번째 과제였습니다.8bit decimal Counter schematic 및 소스코드 첨부합니다.modelsim 상에서 VHDL파일로 실행가능합니다.
    Non-Ai HUMAN
    | 리포트 | 1,000원 | 등록일 2017.05.23
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    논리회로설계실험 프로젝트 8Bit 계산기
    논리회로설계 설계 보고서 #11. 설계 배경 및 목표논리회로설계 수업을 진행하며 학습한 내용을 활용하여 목표에 따른 논리회로를 설계한다.8bit 덧셈기를 구현하고 결과를 7 s ... egment로 출력하는 회로를 설계하는 것이 이번 설계의 목표이다.설계된 회로로 수행할 덧셈은 다음과 같다.1) 93 + 772) 27 + 643) 51 + 984) 43 + 325 ... 로 나타내기 위해서는 나눗셈을 시행하는 복잡한 회로가 요구되기 때문에, BCD코드는 10진 출력을 요하는 회로나, 마이크로프로세서에 주로 사용된다.10진법0123456789BCD0
    Non-Ai HUMAN
    | 리포트 | 11페이지 | 2,000원 | 등록일 2015.04.17
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    <논리회로실험>단안정 및 비안정 멀티바이브레이터
    _{1} ,`A _{2} ,`B에 필요한 연결을 결정하여라. 실험 결과에 입력 논리 레벨과 펄스 발생기 연결에 대하여 목록을 작성하고 회로를 구성하여라. 원-숏은 잡음(noise ... },C _{EXT}의 값을 실험 결과의 표 1에 기록하여라.그림 4. 74121을 사용한 단안정 멀티바이브레이터그림 5. 단안정 멀티바이브레이터 회로 구성R _{T}와C _{EXT ... (Astable, 연속되는 구형파 펄스 발진기) 이렇게 세가지 종류가 있다.1.2 단안정 멀티바이브레이터트리거될 때 하나의 단일 펄스를 발생시키는 회로 이며 원숏(One-shot)이
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    | 리포트 | 5페이지 | 1,500원 | 등록일 2015.12.15
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    논리회로실험 결과보고서6 Latch & Flip-Flop
    까지의 실험과는 그 성격이 달랐는데, 지금까지 구성해왔던 조합논리회로가 아닌 순차논리회로를 구성해보는 것이었다. 따라서 두 논리회로의 특성과 차이점을 알아보았고, 그 과정에서 클럭 신호 ... 능력이 없다. 지금까지 실험해온 가산기, 감산기, 디코더 등이 해당된다고 할 수 있다.? 순차논리회로란 상태 값을 저장하여 그 상태 값이 다시 입력으로 전해져, 다음 상태 값 ... 6. Latch & Flip-Flop실험 과정 및 결과Part 1. R-S Latch with Enable74HC00을 이용하여 만든 R-S Latch 회로이다. Enable
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,500원 | 등록일 2017.03.09 | 수정일 2017.05.30
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    논리회로실험 실험9 ram 결과보고서
    write, read을 두 번씩 진행하였다.◈ 실험 2 : 64-bit IC RAM? 구성 사진 :- 74LS89를 사용하여 동기식 64BIT RAM을 결손도에 설계하고 브레드보드에 회로 ... 10주차 결과보고서실험 9 Ram▶실험과정 및 결과◈ 실험1 - 2-bit RAM? 구성 사진 :- 74HC00과 74HC03을 사용하여 2BIT RAM을 결손도에 설계하고 설계 ... 를 참고하여 브레드보드에 회로를 설치했다.- 주의사항? 한번에 하나의 bit(A or B)에 하나의 데이터(1 or 0)만 써야 한다.? Write 과정을 한 이후에는 접지
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08
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    디지털 회로실험 2장 기본 논리 게이트
    02장. 기본 논리 게이트목차●실험목적●이론●실험방법●실험데이터●검토 및 고찰실험목적1. NOT, OR/NOR, AND/NAND 게이트의 동작을 이해하고 NOR 및 NAND ... 같았고, 심화과정으로 더 파헤쳐 볼 수 있었다. 처음 실험을 하면서 회로도도 어색하게만 느껴졌고, 어색한 감이 없지 않았다. 그래서 그런지 회로도 하나 가지고 ... 게이트를 이용한 NOT, OR, AND 게이트의 구성법을 익힌다.이론1. NOT 게이트 또는 인버터-입력 전압이 반전되어 출력으로 나타나는 논리 게이트2. OR와 NOR게이트-OR
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 1,000원 | 등록일 2014.03.17 | 수정일 2014.04.07
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  • 자료 표지
    아주대 논리회로실험 5 예비보고서 Decoder & Encoder
    을 이수하는데 최선을 다할 것을 서약합니다.학 부: 전자공학부제출일: 2015/04/10과목명: 논리회로실험교수명: 이정원분 반: 5조학 번:성 명:실험5. Decoder ... 과정 및 예상결과실험1 2X4 DECODER위 회로를 구성하고 모든 입력에 대하여 결과 값을 확인한다. 아래의 진리표와 같게 나올 것이라 예상한다.INPUTOUTPUTSW2SW1D4 ... D3D2D10*************0010110001실험 2 BCD to Decimal Decoder위 회로를 구성하고 모든 입력에 대하여 결과 값을 확인한다. 아래의 진리표
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2016.12.24
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    논리회로설계실험 ALU & multiplier (결과보고서)
    논리 연산 장치(기구).[네이버 지식백과] ALU [Arithmetic and Logic Unit] (용어해설)이번 실험에서는 산술연산, 논리연산, 시프트연산을 수행하는 8비트 ... , 감소), 논리연산(AND, OR, XOR, NOT), 시프트연산을 수행할 수 있는 회로로, 총 12가지의 연산을 할 수 있게 만들어 준다. 그 연산의 종류는 다음과 같은데 어떤 ... 에 실험에서 설계할 때 사용해보았던 것들을 다양하게 활용해보았던 점에 있어서 큰 의의가 있다고 생각한다. 먼저 ALU는 if와 case문을 활용하여 회로를 설계하게 되는데 ALU
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    | 리포트 | 19페이지 | 1,000원 | 등록일 2015.08.25
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    논리회로설계실험 FSM moore LCD (결과보고서)
    한 기계. 현재의 컴퓨터는 이 유한 상태 기계에 속한다.②유한 개의 상태와 이런 상태들 간의 변환으로 구성된 계산 모형.③동기 순차 회로를 기술하는 추상화 모델. 입력에 의해 상태 ... 를 바꾸면서 출력을 갖는다.[전화교환] 축적 프로그램 교환기의 프로그램을 구성하는 순차적 활동. 이러한 활동들은 논리적인 상태들의 진행으로 기술되는 호출 과정을 가진다. 유한 상태 ... 기계라고도 한다. 이 기계는 공(空)계열의 입력에 대하여 반드시 공계열이 아닌 기호를 출력한다. 순서 회로의 경우, 그림에 표시한 바와 같이 현재의 출력이 현재의 입력에 의하지 않
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    | 리포트 | 19페이지 | 1,000원 | 등록일 2015.08.25
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    논리회로실험 15주차 결과보고서
    결 과 보 고 서15주차P r o j e c t분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ Project ]? Quartus Ⅱ ... *************11001200100100100300110110000401000011001501010010010601100000010701111011000810000000000910010010000[ 실험 2-1 ]? Quartus Ⅱ에서 Schematic을 작성한다.? FPGA의 동작을 확인한다.보드 동작을 실행 ... 이 1Hz 동작을 하는 구동 회로가 되고, 버튼을 위로 올리면 3Hz 동작을 하는 구동 회로가 된다.)3. KEY3번 버튼을 눌렀을 때는 보드가 어떤 동작을 하는지 작성하시오.KEY3
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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    논리회로실험 5주차 예비보고서
    예 비 보 고 서5주차부울대수의 간소화(2)Verilog HDL code 이용분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- Verilog ... 하여 합성하고 Programming 하는 방법을 이해한다.2. 기본 이론1) Verilog HDL란?? 단순 논리 게이트나 플립플롭과 같은 기본적인 소자에서부터 제어회로, 통신용 모뎀 ... 과 Verilog HDL로 두 가지의 종류가 있다. HDL은 설계의 효율을 극대화함과 동시에 설계 기간을 단축, 검증 정확도를 향상시킨 언어이다. 디자인 재사용이 가능하며 회로 기능
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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    논리회로실험 2주차 결과보고서
    .008 v0 V5 V4.004 v5 V0 V4.003 v5 V5 V4.002 v실험고찰1. 실험과정 3, 4, 5 표의 결과 값(v)을 논리 값으로 바꾸시오[표 10] 3개의 Not ... 결 과 보 고 서2주차(실험1)NOT Gate를 이용한 실험장비 사용법분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.00과정 1[표 4] 1개 Not ... inputoutputBAF000011101111실험간 오차 원인이번 실험에서 사용된 ‘디지털 멀티미터’는 높은 정확도로 전압, 전류, 전기저항 등을 측정하는 전자 계측기임에도 불구
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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    논리회로실험 12주차 예비보고서
    이 있는 2X4 NAND 디코더 회로② (Decade) Counter [10진 카운터]이전 실험들을 통해 카운터에 대해 학습하였고, 다음과 같이 정리해 볼 수 있다.클럭펄스인가방식비 ... 예 비 보 고 서12주차7-segment LED Decoder/10진수 Counter분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- 7-s ... decode의 동작을 실험을 통해 익힌다.2. 기본 이론① 디코더 (decoder)디코더(decoder)란 n비트의 2진 코드(code) 값을 입력으로 받아들여 최대 2n개의 서로 다른
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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    논리회로실험 8주차 예비보고서
    예 비 보 고 서8주차Latch & Flip Flop분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- 순서논리회로의 의미와 특징을 이해한다. ... 한다.- SR Flip Flop, D Flip Flop, T Flip Flop, JK Flip Flop의 동작을 이해한다.2. 기본이론1) 순서논리회로의 의미순서논리회로는 조합논리 ... 회로와는 달리 현재의 입력뿐만 아니라 과거의 입력과 시간에도 출력이 영향을 받게 되며, 조합논리회로와 피드백을 구성하는 기억소자로 구성된다. 이러한 순서논리회로는 회로의 상태
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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    논리회로실험 4주차 예비보고서
    과 정리를 이해한다.- 부울대수식을 이용한 간소화 방법을 이해한다.- 부울대수를 symbol의 형태로 표현하는 방법을 이해한다.2. 기본 이론논리 회로를 설계함에 있어 부울대수의 특성 ... 을 이해하고 이용하면 복잡한 논리회로를 정확하고 간결하게 표현 가능하다. 부울대수의 기본 법칙으로는 교환, 결합, 분배법칙이 있으며 추가적으로 드모르간의 법칙이 있다.* 부울대수 ... 다.이를 기호화 하면,(A + B )` = A` · B`(AB)` = A` + B` 등으로 표현가능하다.드모르간의 법칙은 논리회로 연산자들로도 표현이 가능한데, 다음과 같이 표기할 수 있다.
    Non-Ai HUMAN
    | 리포트 | 3페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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    논리회로실험 6주차 결과보고서
    => sw[16]=sw[17]=1[ ?번 경우 ]Multiplxer는 여러 입력선 중에서 하나를 선택하여 해당 입력선의 2진 정보를 출력선에 연결하는 조합논리회로이다.i0[1]=0 ... [0] 모두 0이므로 각각에 해당하는 LED에 불이 들어오지 않는다.[ 실험 3 ]1X2 demultiplexer의 회로를 구현하기 위해 Quartus Ⅱ를 이용하여 회로를 구현 ... 결 과 보 고 서7주차multiplexer / demultiplexer분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1, 2 ]1
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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    논리회로실험 5주차 결과보고서
    결 과 보 고 서5주차부울대수의 간소화(2)Verilog HDL code 이용분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1 ... - 1 + 2]지난 4주차 실험에서 F = AB` + A`B`C , S = B`( A+C ) 라는 두 개의 부울식을 Quartus Ⅱ Schematic을 이용하여 구현하고, 두 식 ... F와 S의 결과 값이 서로 일치하는지 Modelsim과 Quartus Ⅱ를 이용하여 증명하였었다.이번 실험에서는 F = AB` + A`B`C , S = B`( A+C ) 라는 두
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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    논리회로실험 7주차 예비보고서
    예 비 보 고 서7주차Decoder / Encoder/ 7-segment LED분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- Encoder ... 와 Decoder의 기능을 이해하고, 특성을 실험으로 익힌다.- 7-segment LED decoder를 이해하고, 특성을 실험으로 익힌다.2. 기본 이론① 디코더 (decoder ... )디코더(decoder)란 n비트의 2진 코드(code) 값을 입력으로 받아들여 최대 2n개의 서로 다른 정보로 바꿔 주는 조합 회로를 말한다. 일반적으로 디코더는 n개의 입력선
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30
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2025년 11월 27일 목요일
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