"논리회로실험"의 검색결과 입니다.

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"논리회로실험" 검색결과 281-300 / 4,713건

논리회로실험 결과 3

: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번: 201220754성 명: 조윤성1. 실험결과이번 실험은 기본적인 Gate의 조합논리회로인 가산기와 감산기를 실험 ... 수 있는 감산기를 실험했다. 컴퓨터의 논리회로에서 뺄셈은 일반적인 연산으로 힘들기 때문에 보수의 덧셈으로 계산한다. 따라서 A입력에 NOT Gate를 취해줌으로써 뺄셈 연산 ... 하게 만족스런 결과를 얻을 수 있었다.2. 결과 고찰3주차 실험은 기본적인 Gate의 조합논리회로 중 가장 기초가 되는 가산기와 감산기의 동작을 확인했다. 1bit의 반가산기와 반

리포트 | 7페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2020.09.23

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논리회로실험 예비 4

합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번: 201220754성 명: 조윤성1. 실험 목적- 멀티플렉서(Multiplexer ? MUX)와 디멀티플렉서 ... (Demultiplexer ? DMUX)의 회로를 구성하고 입력과 출력을 확인하여 이를 이해한다.2. 실험 이론① 멀티플렉서(Multiplexer ? MUX)멀티플렉서는 디지털 ... 지만, 이미 제작된 칩을 이용해 쉽게 이를 확인할 수 있다. 이런 칩이 74HC153이다. 이를 이용하여 멀티플렉서를 구현할 수 있다.실험이론에 적은 내용이나, 아래의 회로도를 보

리포트 | 11페이지 | 1,500원 | 등록일 2016.09.24 | 수정일 2020.09.23

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논리회로실험 예비 8

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번 ... 하는 동작을 이해한다.2. 실험 이론① 카운터카운터라는 이름은 상태도(S1, S2, ...Sn)가 하나의 사이클을 포함하는 모든 순차회로에 일반적으로 사용된다. 가장 널리 이용 ... 할 수 있게 한다. BCD에 해당하는 수를 On하여 표시하게 된다. 예를 들면 3일 경우 a, b, c, d, g가 On되어 표시된다.4. 실험 예상① 2단 2진 카운터(비동기식)회로

리포트 | 10페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2021.10.31

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논리회로실험 결과 2

을 썻으며, 2개의 칩을 사용하여 inverting을 연쇄적으로 실시하였 다. 예상 결선도를 토대로 실험의 회로를 구성하였다. ... 실험 결과실험1 실험1에서 우리가 관심있는 인버터는 74HC04중 단 하나의 인버터였다. 그래서 필요없는 부분은 Pull up/down 시키고 1A와 입력과 1Y의 출력을 인가 ... 하여 예상 결선도와 동일하게, 아래와 같은 결선도를 구성했다. 실험4 실험4에선 인버터가 입력으로부터 출력을 내보낼 때, 필연적으로 발생하는 시간지연을 확인

리포트 | 9페이지 | 2,000원 | 등록일 2016.09.04 | 수정일 2019.09.26

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디지틀 논리회로 실험8 멀티플렉서와 디멀티플렉서

을 익혀 각종 플렉서를 만들 수 있는 능력을 키운다 .이 론실험 순서 7408,7420 회로를 사용해 4x1 멀티플렉서 회로를 구성한다 . 74151 회로를 사용해 4x1 멀티플렉서 ... 었다 . 그리고 74151 IC 두개를 사용해 앞선 실험에선 복잡하게 여러가지 IC 로 만들었던 전가산기 회로를 간단하게 만들어보았고 , 응용실험으로는 I0~I7 의 회로상의 인풋과 아웃풋 ... 을 바꾸어 전감산기를 만들어보는 실험을 했는데 처음에는 회로에서 규칙성을 찾기도하고 전감산기의 진리표를 작성해 보는등 여러가지 시도를 했는데 결국 진리표에서 0 이면 GND, 1 이면

리포트 | 15페이지 | 4,000원 | 등록일 2019.10.11 | 수정일 2021.11.15

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논리회로실험 결과 10

하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번: 201220754성 명: 조윤성1. 실험 결과이번 실험은 마지막 실험으로 DAC와 ADC를 공부 ... 는 지점을 파악함으로써 현재 아날로그 신호에 대한 디지털 신호를 유추할 수 있었다.2. 실험 고찰이번 실험은 논리회로실험의 마지막 실험으로서 DAC와 ADC를 동작시켜보았다. DAC ... 동작은 샘플링, 양자화 그리고 부호화를 통해 아날로그 신호를 완전한 디지털 신호로 변경한다. 하지만, 우리 실험에선 한정된 소자와 회로 면적에서 진행되기 때문에 정확한 ADC

리포트 | 8페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2019.11.22

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논리회로실험 예비 7

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번 ... 으로 시프트 레지스터를 구현하게 된다. 진리표는 아래와 같이 구현되며, 회로가 동작할 경우 A, B, C, D, E 출력이 하나씩 밀리는 것을 확인할 수 있다.4. 실험 예상① J-K ... F/F(74HC76)을 이용한 시프트 레지스터우선 순차 논리회로에서 가장 중요한 것은 값을 초기화 시키는 것이다. 이를 위해 CLR을 1로 두어 모든 정보를 없앤다. 다음으로 두

리포트 | 9페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2021.10.31

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논리회로실험 결과 9

: 논리회로실험교수명: 이정원 교수님학 번: 201220754성 명: 조윤성1. 실험 결과이번 주차는 플립플롭을 이용해 2bit, 16bit 램(RAM)을 구현하였다. 램은 원 ... 여러 블록을 이용해 정보를 저장하고 읽어내는 것이다. 따라서 이에 대한 기본적인 실험으로 2bit 램을 NAND gate만을 이용해 램을 구현할 수 있었다. 출력부의 74HC03 ... 은로도를 확인해 볼 수 있듯이, 출력이 입력으로 피드백 되는 플립플롭을 확인해 볼 수 있다.회로도예상 결선도결선이 복잡해 보였지만 OE, In, WR 입력을 차례차례 연결하여 혼동

리포트 | 8페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2019.11.11

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논리회로실험 결과 5

technolo실험 결과4주차 실험은2 ^{n}개 출력에 대한 1개 입력을 내보내는 MUX와 1개 입력에 대해2 ^{n}개 출력을 내보내는 DEMUX를 이해했다. 반면, 이번 실험은2 ^{n ... 을 수 있었다. 원하는 값에 1을 넣고, 원하는 출력은 LED에 불이 들어왔따. 아래는 2X4 디코더에 대한 Logic circuit, 예상 결선도 그리고 진리표이다.회로도예상 결선 ... 도진리표입력출력S2S1D3D2D1D*************100100111000회로도와 동일하게 Not gate(74HC04), AND gate(74HC08)을 이용해 구현할 수 있

리포트 | 11페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2020.10.01

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울산대학교 전자실험예비23 디지털 조합 논리회로와 순서 논리회로

실험23 디지털 조합 논리회로와 순서 논리회로학번 : 이름 :1. 실험목적조합회로와 논리회로를 구현해보고 동작원리를 확인한다.2. 이론조합회로는 입력과 출력을 가진 논리 게이트 ... 들의 집합으로서 출력의 값은 입력한 값 0과 1의 조합에 의해 결정된다. 따라서 이 회로는 기억 능력이 없다는 것이 특징이다. 조합 회로의 소자로는 게이트 그 자체가 기본이고 반가산 ... 기, 전가산기, 감산기 종류, 디코더, 멀티플렉서 등이 있다. 조합 논리 소자란 적어도 하나 이상의 출력 채널과 두 개 이상의 입력 채널을 가지면, 입출력 모두 이산 상태의 값

리포트 | 1페이지 | 1,000원 | 등록일 2019.10.18

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논리회로실험 예비1

한 논리식을 간단히 줄일 수 있음을 확인한다.2) 실험이론1. Gate논리회로에서 가장 기본적인 디지털 소자를 Gate라고 부른다. 하나의 게이트는 하나 이상의 입력을 가지 ... 1) 실험목적- Basic Logic Gate의 논리연산을 익히고, 실제 실험을 통해 AND, OR, NAND, NOR, XOR 등 Gate의 진리표를 작성하여 이와 비교하여본다 ... . 또한 이와같은 Gate를 이용하여 다른 Gate를 구성해본다.- 집합론에 등장하는 De Morgan의 법칙이 논리 회로에서 사용됨을 확인한다.- Boolean 대수를 통해 복잡

리포트 | 8페이지 | 1,500원 | 등록일 2016.09.04 | 수정일 2021.03.10

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논리회로실험 예비 2

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번 ... MOSFET 드레인 사이에 연결한 집적 회로의 구조이다. TTL 논리 소자에 비해 소비 전력이 적은 논리 회로를 구현할 수 있고, 부하를 면적을 많이 차지하는 저항이 아닌 ... 이 작은 슈미트 트리거 인버터이다.INPUTOUTPUTxAxYLHHL4. 실험예상실험 1회로를 구성한 뒤 Vcc에 5V, Vin에 사인파(Vpp 5V, offset 2.5V)를 인가

리포트 | 11페이지 | 1,500원 | 등록일 2016.09.04 | 수정일 2021.03.10

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논리회로실험 결과 8

them in following this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교 ... 때 이전 값이 toggle된 결과가 나오는 사실을 이용하였다. 카운터란 일정한 상태도 내에서 반복적으로 상태를 옮겨가는 회로를 말한다. 우리 실험에선 우선적으로 비동기성 카운터 ... 수명: 이정원 교수님학 번: 201220754성 명: 조윤성1. 실험 결과이번 실험은 카운터를 구성하였으며 J-K F/F을 이용하였다. J-K F/F의 입출력 특성 중 J=K=1일

리포트 | 11페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2020.11.07

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논리회로실험 결과 6

ode of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번 ... : 201220754성 명: 조윤성1. 실험 결과이번 실험은 여태 까지의 실험했던 조합(Combination)논리 회로와 다르게, 현재의 출력이 과거의 입력에 의해서도 변하는 순서 ... (Sequence)논리회로를 실험하였다.실험에선 순서 논리 중 Latch(래치)와 Filp-Flop을 공부하였다. 래치와 플립플롭은 모두 기억소자로, 값을 저장하기 위해 사용된다. 입력방식이 같

리포트 | 10페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2020.10.12

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논리회로실험 예비 5

ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번: 201220754성 명: 조윤성 ... (Decoder)디코더(Decoder)는 부호화된 입력을 부호화된 출력으로 변환하는 다중 입력, 다중 출력 논리회로이다. 일반적으로 입력 코드는 출력 코드보다 적은 비트수를 가지 ... 며, 각nting code)라고 부르며, 논리 연산에서의 뺄셈을 용이하게 해준다.3. 실험 부품① 74HC04단일 입력을 가진 인버터 6쌍으로 구성

리포트 | 12페이지 | 1,500원 | 등록일 2016.09.24 | 수정일 2021.04.08

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논리회로실험 예비 6

of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번: 201220754 ... 성 명: 조윤성1. 실험목적- Latch와 Flip-Flop를 이해하고 그 차이점을 확인한다.- 각 회로를 구현하고 출력을 통해 이론의 회로가 타당한지 확인한다.2. 실험이론 ... ① Latch(래치)와 Flip-Flop(플립플롭)래치와 플립플롭은 순차 논리 회로를 구성하는 기본적인 요소이며, 기억소자이다. 표준 IC에서 래치와 플립플롭은 독자적인 논리게이트

리포트 | 13페이지 | 1,500원 | 등록일 2016.09.24 | 수정일 2021.04.08

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논리회로실험 결과 7

합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번: 201220754성 명: 조윤성1. 실험 결과이번 실험은 플립플롭의 실용적 예인 시프트 레지스터(Shift ... 하였다. 이에 대한 회로도와 예상 결선도는 아래와 같으며 실제 실험에서 둘은 동일하게 결선되었다.회로도예상결선도각 입력을 설명하자면 PR은 Preset으로 F/F의 활성에 기여한다. CLR ... 을 연결해 구성한 5 bit 시프트 레지스터이다.회로도예상결선도각 입력을 보자면 SER은 실험 1과 동일하게 앞쪽 F/F에 어떠한 값을 채워질지 결정한다. CLR는 회로의 초기

리포트 | 12페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2021.10.31

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논리회로실험 예비 9

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번 ... : 201220754성 명: 조윤성1. 실험 목적- 반도체 Memory의 기본적인 동작 원리를 알아본다.- 2bit와 16bit RAM을 구성하여 메모리를 이해한다.2. 실험 이론RAM ... 은 대량의 기억장소를 집적하기 용이하여 주기억장치로 사용된다.1bit RAM회로를 통해 간단한 1bit RAM을 구현하면 위와 같다. SRAM을 구현하기 때문에 플립플롭이 사용

리포트 | 8페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2021.10.31

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논리회로실험 예비 10

정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험교수명: 이정원 교수님학 번: 201220754성 명: 조윤성1. 실험 목적- DAC ... 와 ADC 회로의 구성과 동작 원리를 이해한다.- 실제 변환기 구성을 통해 구동 결과를 확인한다.2. 실험 이론① DAC와 ADC의 사용 이유실생활 대부분의 입력신호는 연속적인 값 ... 하게 된다. 반면, Ladder 구조는 병렬연결을 특성으로 하여 동일한 저항을 이용해 이를 구성할 수 있다.3. 실험 부품① 74HC04단일 입력을 가진 인버터 6쌍으로 구성

리포트 | 8페이지 | 2,000원 | 등록일 2016.09.24 | 수정일 2021.10.31

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논리회로실험 예비 3

1. 실험 목표 - 기본적인 Gate의 조합논리회로로써 반가산기, 전가산기, 반감산기, 전감산기를 구성해본다. - 진리표와 비교하여 결과를 확인해본다.2. 실험이론① 반가산기 ... 다.표현식에 따른 반가산기의 게이트수준 회로도와 진리표는 아래와 같다.② 전가산기 반가산기가 존재하지만, 실제로 한 비트만을 더하는 연산은 비중이 작다. 한 비트 이상을 갖는 오퍼랜드

리포트 | 10페이지 | 1,500원 | 등록일 2016.09.24 | 수정일 2018.10.08

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