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디지털논리회로 논리회로 과제 FPGA 사칙연산 전전설2 stopwatch 설계
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"논리회로" 검색결과 1,021-1,040 / 9,764건

  • 자료 표지
    CMOS회로와 응용논리회로
    ◎ 목차Ⅲ부 CMOS회로와 응용논리회로1. CMOS논리소자의 기본특성 --------------------- 11) MOSFET ---------------------- 12 ... ) NMOS 논리회로 ---------------------- 13) CMOS 논리회로 ---------------------- 24) CMOS 게이트의 특성 ------------- ... --------------------- 14※ 참고문헌 ------------------- 16Ⅲ부 CMOS회로와 응용논리회로1.CMOS논리소자의 기본특성1) MOSFETMOS
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    | 리포트 | 17페이지 | 1,000원 | 등록일 2007.06.12
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    논리회로실험) 가산기 감산기 결과보고서
    결 과 보 고 서10 주차실험 9 : 가산기 & 감산기1. 실험 과정- 본 실험의 목적은 가산기와 감산기를 이론적으로 먼저 이해하고, 그것을 Quartus II을 이용하여 회로 ... 를 구현하고, ModelSim 값과 DE2-115에서의 동작을 확인함으로써 특징과 원리를 이해하고 익숙해지는데 있다.* 이번 실험은 실험과정 1의 반가산기의 회로와 3의 4bit ... ADD의 회로를 구현한다. 실험과정 1의 반가산기인 경우는 직접 Schematic/Diagram에서 회로를 직접 구현하고, 실험과정 3의 4bit ADD 회로의 구현은 지난 실험
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    | 리포트 | 10페이지 | 2,000원 | 등록일 2014.01.06
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    서강대학교 디지털논리회로실험 6주차결과
    디지털논리회로실험실험6.Flip-flops and ShiftRegisters담당교수 : 김 영 록제 출 일 : 2013. 10. 29 (화)학 과 : 전자공학과성 명 ... , JK flip-flop의 동작원리를 이해한다.3) Shift register의 동작원리를 이해한다.2. 실험 결과1. SR latch의 회로를 TTL로 구현하고 입력값을 조작하여 그 ... S/W와 달리 안정된 신호를 주지 못한다. 이 때문에 latch에서 Oscillate 가 발생 할 수 도 있다.2. Gated D latch의 회로를 TTL로 구현하고 그 동작
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 4주차결과
    디지털논리회로실험실험4. Mux, Demux, Comparator담당교수 : 김 영 록제 출 일 : 2013. 10. 08.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... 한 회로Tri-state buffer를 CMOS로 구현하면 Input과 Enable 단자가 NAND와 NOR gate를 통해서 PMOS, NMOS gate에 입력으로 들어가게 된다 ... buffer의 Output에서 바라본 회로에서 아무것도 연결되어있지 않으므로 High-Impedance상태로 동작하게 된다. EN단자에 1을 넣어주면 위의 회로는 Input을 그대로
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    | 리포트 | 9페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 3주차결과
    디지털논리회로실험실험3. Decoders and Encoders담당교수 : 김 영 록제 출 일 : 2013. 10. 01.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... 의 코드체계를 다른 코드체계로 변환하는 논리회로이다. 위의 회로에서는 n-bit binary code가 사용되는데, n개의 Input에 따른2 ^{n}가지의 output을 내보낼 수 ... encoder의 동작 원리를 이해한다.● FPGA와 VHDL을 이용한 회로의 구현방식을 이해한다.3. Quiz 및 이론① EI = 0, Input이 10110010일 때의 Output
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    | 리포트 | 8페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 9주차결과
    디지털논리회로실험실험9. Memory elements : ROM/RAM담당교수 : 김 영 록제 출 일 : 2013. 11. 19.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... . 실험 내용 및 결과분석① Step 1~7● 구현한 회로는 다음과 같다. 여기에서 중요하게 살펴봐야 할 신호는 DIP_SW[3..0]으로 입력해주는 FPGA[3..0]신호이다. 이 ... 하였다. 실제 7-segment에 ROM의 data를 읽어 display하는 실험을 진행하기 위해 구현한 회로는 다음과 같다. LED7-0까지의 data값을 hexa로 바꾸어주는 과정은 앞
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    | 리포트 | 7페이지 | 2,000원 | 등록일 2014.01.02
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    04 논리회로설계실험 예비보고서(인코더,디코더)
    논리회로설계 실험 예비보고서 #4실험 4. 디코더 엔코더 설계1. 실험 목표VHDL 코드를 이용해 Decoder, Encoder 비교기를 설계하는 방법을 익힌다.두 비교기 ... 은 코드로 변환해 주는 조합논리회로이다. 인코더는 2의 n승 개의 입력과 n개의 출력을 갖고 있다. 10진 BCD 인코더 10진 인코더 진리표 10진 인코더 내부회로(3) 7 s ... 는 Behavioral 표현 방식과 Data Flow 표현 방식으로 설계 한다.2. 예비 이론(1) 디코더복호기라고도 한다. 디코딩을 수행하는 회로, 장치, 소프트웨어, 알고리즘을 말
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    | 리포트 | 9페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15
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    실험1 실험(1) 프로젝트 디지털논리회로 도어락 설계
    실험(1)FINAL PROJECT 보고서소 속학 번이 름담당 교수 / 조교제 출 일 자1. PROJECT 개요한 학기동안 디지털논리회로 과목에서 배운 전반적인 이론들을(기본논리 ... 하면 3이되는 순한 B세그먼트에 전원이 들어오게 된다.LOSIG WORK‘S로 회로도 구현4. 고 찰1학기 동안 디지털논리회로 수업에서 습득한 이론으로 실험수업을 하면서 사용 ... 게이트, 카운터 jk플립플롭, d플립플롭 등을 )을 사용하여 실험했던 관련 이론들을 복합적으로 사용하여 수행하는 프로젝트이다.2. 관련이론 및 사용부품(1) 레귤레이터회로도에 5V
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    | 리포트 | 12페이지 | 2,000원 | 등록일 2014.09.21
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    서강대학교 디지털논리회로실험 5주차결과
    하는 회로이다. 각 bit은 Logic으로 1 또는 0이기 때문에 세 bit에 대하여 일치하는지 여부를 판단하여야 한다. 이 때 세 bit가 일치해야만 A=B가 된다.XNOR
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    | 리포트 | 9페이지 | 2,000원 | 등록일 2014.01.02
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    논리회로실험) register/ shift register 예비보고서
    논리 소자이고, 2진수 데이터를 처리하는데 기본이 되는 회로이다. Flip Flop은 clock에 따라 정해진 시점에서 입력을 주고, 출력에 저장하는 동기 식 순서논리소자이다. 이러 ... register는 정보를 저장하고, 거쳐 가는 단계로 생각되는 flipflop들의 상태변화에 영향을 주는 논리조합회로라고 할 수 있다. 일반적으로 register는 외부의 데이터 ... 를 저장하거나 이동시키는 목적으로 사용된다. 이동에 관련해서는 실생활에서 곱셈과 나눗셈을 할 때 숫자의 위 자리 혹은 아래 자리 쪽으로 임의의 자리 수만큼 벗어나게 하는 회로의 경우
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    | 리포트 | 3페이지 | 2,000원 | 등록일 2014.01.06
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    서강대학교 디지털논리회로실험 7주차결과
    디지털논리회로실험실험7. Finite State Machines담당교수 : 김 영 록제 출 일 : 2013. 11. 05.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... Finite State Machines2. 실험 목적● Finite State Machine (FSM) 회로를 설계하고 분석할 수 있는 능력을 갖춘다.● Mealy와 Moore State ... 에 아래 회로의 gate를 추가하여 사용할 경우 JK Flip-flop으로 동작하게 된다.▲ D Flip-flop to JK Flip-flop ConversionD Flip-flop
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    | 리포트 | 8페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 8주차결과
    디지털논리회로실험실험8. Multiplier Design담당교수 : 김 영 록제 출 일 : 2013. 11. 12.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... 를 이용하여 구현할 수 있고, add기능은 ALU를 통해 간단히 선택해줄 수 있다. 회로에서는 Multiplicand에 들어온 값이 multiplier와 자리수에 맞추어 하나씩 더해지 ... 고 회로구조 역시 간단하다는 장점이 있다. 그러나 현대의 신호처리 시스템에서 Shift-and-add보다 Booth algorithm을 사용하는 이유는 연산 speed 때문이
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2014.01.02
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    논리회로실험) Decoder / Encoder / 7-segment LED
    .2) 입력선에 나타나는 n비트 2진 코드를 최대 2ⁿ 가지 정보로 바꿔 주는 조합논리회로이다.3) 입력 개수에 따라 1 x 2 Decoder , 2 x 4 Decoder- n x ... decoder를 이해하고 실험을 하는 과정이다 . Quartus II를 이용하여 회로를 구현하고, ModelSim 에서의 파형과 DE2- 115 기기를 이용하여 동작을 확인 ... 한다 . 이에 비해 Encoder 는 여러 개의 입력 신호 중에서 어느 신호가 활성화 되었는지 , 또는 입력되었는지를 출력으로 알려주는 회로이다 . Encoder 는 다음과 같
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2014.01.06
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    논리회로 실험 결과
    가 High일 때, 5V Low일 때, 0V로 매우 피크한 값을 출력하였다.실험결과 값을 회로도와 비교해 설명하면초기상태 A bit와 B bit 부분의 S0=Low, S1=High이고 ... =High 임을 유추할 수 있고, 실제 데이터 값에서도 같은 결과값을 얻을 수 있었다.여기서 W1, W0는 각 비트를 담당하는 회로에 Input Data의 역할을 하고, bit A ... 와 bit B 단자는 각각 A와 B로 명명되어진 비트자리를 선택하는 Selection Input의 역할을 한다. 그리고 각 회로의 출력단자는 Output, 그리고 비트마다 S0값
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    | 리포트 | 3페이지 | 1,500원 | 등록일 2008.01.17
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    [논리회로실험] 드모르간의 법칙
    De Morgan's Theorem목적1. 드모르간법칙을 이용하여 부울 논리식을 수정하여 간단하게 만든다. 목적2. CMOS를 사용하여 논리회로를 구성하고, logic ... tester를 이용하여 드모르간 법칙을 실험적으로 증명한다.드모르간■ 드모르간 [Augustus de Morgan, 1806.06.27~1871.03.18] - 영국의 수학자·논리학자·서지 ... 학자 - 근대적인 대수학 개척자의 한 사람으로 유명 - 특히 논리학적 측면을 개척하여 선각자로서의 역할을 하였으며, 확률론에도 공헌부울대수의 공리와 정리X´Y´=X´+Y´(X´+Y
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    | 리포트 | 12페이지 | 1,500원 | 등록일 2009.05.14
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    2019년도 중앙대학교 전자전기공학부 3학년 2학기 아날로그및디지털회로설계실습 예비7 논리함수와 게이트
    신호가 가해진 후 논리연산 결과가 게이트의 출력으로 나올 때까지 아주 짧은 시간이 지연되는데 이 시간을 전파 지연시간이라고 한다.
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2020.09.05
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    논리회로-디지털시계 설계 텀프로젝트 발표자료
    ..PAGE:12Step 7 : implementation▲ 오전 오후 표시부▲ 시간 표시부..PAGE:13Step 7 : implementation▲ 단발 펄스 회로(시간 조절 회로)
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    | 리포트 | 15페이지 | 1,000원 | 등록일 2013.12.22
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    세다로직으로 구현한 카세트 논리 회로
    세다로직으로 구현한 카세트 논리 회로
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    | 리포트 | 13페이지 | 2,000원 | 등록일 2010.06.19
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    [디지털논리회로] 커피자동판매기 설계
    diagram) 상태표 (State table) 간소화 ( 카르노맵 이용 ) 회로 설계 시뮬레이션 Case 1. 250 원에서 50 원이 입력되었을 때 Case 2. 250 원 ... -Flop 의 회로도와 진리표 및 여기표 Q(t) Q(t+1) J K 0 0 0 X 0 1 1 X 1 0 X 1 1 1 X 0상태도 (State diagram) 0 (000) 50 ... 01 10 11 000 001 011 010 110 111 101 100 C = wH + wyF D = wyH - 12 -회로구성 - 13 - F w H F F+wH w’ H F
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    | 리포트 | 25페이지 | 2,000원 | 등록일 2011.06.29
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    Lab(2) 논리게이트 회로 실습
    ]논리 게이트 IC회로 실습[1]학습목표a)AND, NAND, OR, NOR, XOR, XNOR, INVERTER 게이트의 논리를 확인한다.b)IC data sheet 인터넷 검색 ... 과 자료 보는 법을 익힌다.c)논리 게이트의 조합 논리 입출력에 대하여 이해하고 실습한다.d)주어진 회로도를 보고 breadboard에 회로를 구성하고 부품을 연결하는 능력을 배양 ... 고, 사용하는 IC의 전원(+5V), GND, 입력과 출력 핀 번호를 회로도에 기입한 후 하나하나 확인하면서 breadboard에 부품을 연결한다.?각 회로의 입력과 출력의 논리 결과
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    | 리포트 | 16페이지 | 1,500원 | 등록일 2010.06.23
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