"논리회로"의 검색결과 입니다.

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디지털논리회로 논리회로과제 FPGA 사칙연산 전전설2 stopwatch 설계

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"논리회로" 검색결과 1,001-1,020 / 9,760건

[논리회로설계실험]1bit 비교기 와 4bit 비교기

1. 실험 내용 1) 1bit 비교기두 입력이 서로 같은지 또는 다른지를 비교하여 알려주는 회로로써 두 입력이 같으면 '1'을 출력하고, 다르면 '0'을 출력하는 회로 ... td_logic ; component comp_1bit -- 이용할 회로 지정 port( a : in std_logic ... ; begin key : comp_1bit -- 지정된 회로에 선을 연결 port map(input_a,input_b,output_eq

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| 리포트 | 5페이지 | 1,000원 | 등록일 2015.07.07

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논리회로설계실험 FND(Flexible Numeric Display)제어 7 segments

Lec #8. FND(Flexible Numeric Display) 제어- 7 segments -1. 실험 내용1) 7개의 조각으로 나뉘어진 LED에 입력신호에 따라 숫자나 간단한 기호 점등2) 제어 데이터에 따른 숫자 점등표시할 숫자Segment 제어 데이터(MSB ..

Non-Ai HUMAN
| 리포트 | 5페이지 | 1,500원 | 등록일 2015.07.07

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[VHDL][논리회로] Halfadder 이용한 multiplier(2진 곱셈기)

[VHDL][논리회로] Halfadder 이용한 multiplier(2진 곱셈기)A+받은 설계 입니다

Non-Ai HUMAN
| 리포트 | 1,000원 | 등록일 2014.11.15

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[디지털 논리회로 실험] 12장. 동기식 RS 플립플롭 예비레포트

논리회로실험 A반예비12장비동기식 RS 플립플롭5조이름학번실험일15.05.12제출일15.05.121. 이 장의 실험 목적에 대하여 기술하시오.- 동기식 플립플롭의 동작원리를 이해 ... 한다.- 동기식 RS 플립플롭의 동작원리와 응용회로에 대해 이해한다.- 동기식 JK 플립플롭의 동작원리와 응용회로에 대해 이해한다.2. 비동기식 플립플롭과 동기식 플립플롭의 특징 ... 01?10셋 상태10?01리셋 상태11?XX불확실 상태- 상승모서리 RS 플립플롭 -위 그림과 표는 상승모서리 RS 플립플롭의 회로도, 심벌 및 진리표이다. 상승모서리 RS 플립

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| 리포트 | 3페이지 | 1,000원 | 등록일 2016.01.14 | 수정일 2022.10.13

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논리회로 설계실험 mux

Multiplexer 설계1. Introduction1) Encoder와 Decoder의 원리를 이해한다.2) MUX(멀티플렉서)의 작동 원리를 이해한다.3) 8x1 MUX를 VHDL언어로 구현 할 수 있다.4) 2x1 MUX를 이용하여 8x1 MUX를 구현 할 수 있..

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| 리포트 | 7페이지 | 1,000원 | 등록일 2009.07.10

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아주대 논리회로실험 프로젝트 FPGA를 통한 VHDL 구현 프로젝트 - 비밀번호

는 Appendix에만 기재, vhd 파일은 제출하지 않음)① Shifting function-. Shifting function은 이미 프로젝트 이전 논리회로실험에서 구현해 본 바 ... 에 대한 문제 해결 과정은 coding에 대한 정확한 이해도 같이 동반되었다. 더불어 신호의 저장, shifting, 7 segment 등 기존 논리회로실험에서 실험한 내용들을 직접

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| 리포트 | 28페이지 | 3,500원 | 등록일 2016.07.09

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논리대수와 드모르간 정리, 간소화⦁논리회로 간소화 실험

(논리대수와 드모르간 정리, 간소화?논리회로 간소화 )7. 대수논리와 드모르간 정리, 간소화? 실험목적? 실험적으로 Boolean 대수의 여러 법칙을 증명한다.? 규칙 10과 ... 는 “?” 기호를 포함한다. 논리적이 표시될 때 도트는 종종 생략된다. 즉로 종종 쓰여진다.표 7-1에 제시된 부울 법칙들은 실제적인 회로에 적용될 수 있다. 예로 규칙 1은 그림 7 ... 을 보면 두 입력(0과 A)의 OR동작을 나타낸다. 이 실험에서 구성하는 회로는 CMOS논리를 사용한다. IC의 파손을 피하기 위해 실험 6에 설명된 정전기 예방법을 사용해야 한다

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| 리포트 | 13페이지 | 1,000원 | 등록일 2010.08.23

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01 논리회로설계실험 결과보고서(And, or gate)

논리회로설계 실험 결과보고서 #1실험 1. 기본게이트 설계1. 실험 목표VHDL을 이용하여 AND gate와 OR gate를 설계한다.각 게이트를 설계 할 때, 동작적 모델링 ... 진리표에 맞는 논리회로를 설계하였다. 논리회로 설계 시에는 동작적 모델링과 자료 흐름 모델링 2가지 방법을 이용하여 설계한다. 두 방법을 이용하여 AND, OR 게이트를 설계

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| 리포트 | 7페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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01 논리회로설계실험 예비보고서(And,or gate)

논리회로설계 실험 예비보고서 #1실험 1. 기본게이트 설계1. 실험 목표VHDL을 이용하여 AND gate와 OR gate를 설계한다.각 게이트를 설계 할 때, 동작적 모델링 ... logic device, 제조 후 사용자가 내부 논리 회로의 구조를 변경할 수 있는 집적 회로)와 같은 기능을 갖는 논리 블록들과 그것을 서로 연결하여주는 스위치, 행렬 등이 칩 내부 ... 에 내장된 소자- FPGA(field programmable gate array)산업 현장에서 엔지니어가 직접 디바이스를 프로그래밍하여 설계한 회로를 반도체 칩 상에 구현할 수 있

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| 리포트 | 8페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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논리회로실험 - 제 1장 기본 논리 게이트 (AND, OR, NOT) 결과 보고서

과 목 : 논리회로설계과 제 명 : 결과보고서 1담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 3 / 271 ... 가해졌을 때만 출력 단자에 1이 나타나도록 구성된 회로이다. OR gate의 진리표와 기호는 다음과 같다.3)XOR gate상태 1일 때, 출력이 논리 상태 1이 되는 소자이 ... . Introduction기본 gate를 설계한다. 2진 논리 함수인 AND-gate, OR-gate, XOR-gate를 한 architecture에서 구현하여 각 gate가 올바르게 작동

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| 리포트 | 8페이지 | 1,000원 | 등록일 2014.08.15

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아주대 논리회로 VHDL 두 번째 과제 door lock

(1) 문제 설명 및, 예상결과. 설정한 비밀번호가 5017인데, 입력한 비트 4비트 4개와 각 자리의 비밀번호를 비교해봐서 같으면 wrong이 0이 출력이 되고, 다르면 1이 출력이 된다.5017의 값을 넣지 않는 이상 wrong이 1이 하나라도 존재할 것이며, 따..

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| 리포트 | 3페이지 | 4,000원 | 등록일 2014.03.23

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04 논리회로설계실험 예비보고서(인코더,디코더)

논리회로설계 실험 예비보고서 #4실험 4. 디코더 엔코더 설계1. 실험 목표VHDL 코드를 이용해 Decoder, Encoder 비교기를 설계하는 방법을 익힌다.두 비교기 ... 은 코드로 변환해 주는 조합논리회로이다. 인코더는 2의 n승 개의 입력과 n개의 출력을 갖고 있다. 10진 BCD 인코더 10진 인코더 진리표 10진 인코더 내부회로(3) 7 s ... 는 Behavioral 표현 방식과 Data Flow 표현 방식으로 설계 한다.2. 예비 이론(1) 디코더복호기라고도 한다. 디코딩을 수행하는 회로, 장치, 소프트웨어, 알고리즘을 말

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| 리포트 | 9페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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실험1 실험(1) 프로젝트 디지털논리회로 도어락 설계

실험(1)FINAL PROJECT 보고서소 속학 번이 름담당 교수 / 조교제 출 일 자1. PROJECT 개요한 학기동안 디지털논리회로 과목에서 배운 전반적인 이론들을(기본논리 ... 하면 3이되는 순한 B세그먼트에 전원이 들어오게 된다.LOSIG WORK‘S로 회로도 구현4. 고 찰1학기 동안 디지털논리회로 수업에서 습득한 이론으로 실험수업을 하면서 사용 ... 게이트, 카운터 jk플립플롭, d플립플롭 등을 )을 사용하여 실험했던 관련 이론들을 복합적으로 사용하여 수행하는 프로젝트이다.2. 관련이론 및 사용부품(1) 레귤레이터회로도에 5V

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| 리포트 | 12페이지 | 2,000원 | 등록일 2014.09.21

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논리회로실험) register/ shift register 예비보고서

논리 소자이고, 2진수 데이터를 처리하는데 기본이 되는 회로이다. Flip Flop은 clock에 따라 정해진 시점에서 입력을 주고, 출력에 저장하는 동기 식 순서논리소자이다. 이러 ... register는 정보를 저장하고, 거쳐 가는 단계로 생각되는 flipflop들의 상태변화에 영향을 주는 논리조합회로라고 할 수 있다. 일반적으로 register는 외부의 데이터 ... 를 저장하거나 이동시키는 목적으로 사용된다. 이동에 관련해서는 실생활에서 곱셈과 나눗셈을 할 때 숫자의 위 자리 혹은 아래 자리 쪽으로 임의의 자리 수만큼 벗어나게 하는 회로의 경우

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| 리포트 | 3페이지 | 2,000원 | 등록일 2014.01.06

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CMOS회로와 응용논리회로

◎ 목차Ⅲ부 CMOS회로와 응용논리회로1. CMOS논리소자의 기본특성 --------------------- 11) MOSFET ---------------------- 12 ... ) NMOS 논리회로 ---------------------- 13) CMOS 논리회로 ---------------------- 24) CMOS 게이트의 특성 ------------- ... --------------------- 14※ 참고문헌 ------------------- 16Ⅲ부 CMOS회로와 응용논리회로1.CMOS논리소자의 기본특성1) MOSFETMOS

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| 리포트 | 17페이지 | 1,000원 | 등록일 2007.06.12

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교과교육론 - PPT를 이용한 논리회로 수업교재

3. 논리회로과 목 명 :교과 교육론 학 과 : 정보통신공학과 학 번 : 99741187 이 름 : 이 라 라 담당교수: 이 경 숙 제 출 일 : 02.10.17 ... ReportPower Point를 이용한 수업교재다음조합 논리회로조합 논리 회로의 기능을 이해하고 분석할 수 있다. 논리 함수를 조합 논리회로로 표기할 수 있다 논리 함수를 불 대수식과 카르노도 ... 로 간소화 시킬 수 있다. 복잡한 회로를 동일한 기능의 간소화된 회로로 바꿀 수 있다. 논리 회로를 설계할 수 있다.학습목표www.daejin.or.kr참고자료 :다음조합 논리회로

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| 리포트 | 20페이지 | 2,000원 | 등록일 2013.06.08

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서강대학교 디지털논리회로실험 7주차결과

디지털논리회로실험실험7. Finite State Machines담당교수 : 김 영 록제 출 일 : 2013. 11. 05.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... Finite State Machines2. 실험 목적● Finite State Machine (FSM) 회로를 설계하고 분석할 수 있는 능력을 갖춘다.● Mealy와 Moore State ... 에 아래 회로의 gate를 추가하여 사용할 경우 JK Flip-flop으로 동작하게 된다.▲ D Flip-flop to JK Flip-flop ConversionD Flip-flop

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| 리포트 | 8페이지 | 2,000원 | 등록일 2014.01.02

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서강대학교 디지털논리회로실험 8주차결과

디지털논리회로실험실험8. Multiplier Design담당교수 : 김 영 록제 출 일 : 2013. 11. 12.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... 를 이용하여 구현할 수 있고, add기능은 ALU를 통해 간단히 선택해줄 수 있다. 회로에서는 Multiplicand에 들어온 값이 multiplier와 자리수에 맞추어 하나씩 더해지 ... 고 회로구조 역시 간단하다는 장점이 있다. 그러나 현대의 신호처리 시스템에서 Shift-and-add보다 Booth algorithm을 사용하는 이유는 연산 speed 때문이

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| 리포트 | 5페이지 | 2,000원 | 등록일 2014.01.02

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조합논리회로의 설계방법을 이해하고 조합논리회로의 한 예로 가산기 회로를 설계

설계실습101.목적조합논리회로의 설계방법을 이해하고 조합논리회로의 한 예로 가산기 회로를 설계한다.2.준비물직류전원장치 1대멀티미터 또는 오실로스코프 1대Bread board 1 ... -NOR)로직 회로를 설계하여라.(4)XOR gate를 이용하여 보다 간소화된 다단계 조합 논리 회로를 설계하여라.(5)4-bit 가산기 회로를 위의 전가산기 회로를 이용해 설계하여라.->S=0인 경우 가산기가 된다.

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| 리포트 | 2페이지 | 1,500원 | 등록일 2010.11.12

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논리회로실험) Decoder / Encoder / 7-segment LED

.2) 입력선에 나타나는 n비트 2진 코드를 최대 2ⁿ 가지 정보로 바꿔 주는 조합논리회로이다.3) 입력 개수에 따라 1 x 2 Decoder , 2 x 4 Decoder- n x ... decoder를 이해하고 실험을 하는 과정이다 . Quartus II를 이용하여 회로를 구현하고, ModelSim 에서의 파형과 DE2- 115 기기를 이용하여 동작을 확인 ... 한다 . 이에 비해 Encoder 는 여러 개의 입력 신호 중에서 어느 신호가 활성화 되었는지 , 또는 입력되었는지를 출력으로 알려주는 회로이다 . Encoder 는 다음과 같

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| 리포트 | 5페이지 | 2,000원 | 등록일 2014.01.06

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