"논리회로보고서"의 검색결과 입니다.

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"논리회로보고서" 검색결과 501-520 / 2,330건

[논리회로실험]실험5예비보고서 래치와 플립플롭

NAND gate를 이용하여 클럭화되지 않은 R-S latch 회로를 구성하고 그 동작을 설명하시오< Q 출력 논리값 >< Q’ 출력 논리값>SRQ(t)00Q(t-1 ... ) : Latch010 : RESET101 : SET111NAND gate로 된 flip-flop회로에서는, 두 입력이 모두 1일 때 flip-flop 상태는 전 상태를 그대로 기억하여 그 ... 에는 슬레이브를 동작시킨다.이 플립플롭에는 입력과 출력이 분리되어있어 레이스 문제가 최소화 되며 클릭펄스가 가해지고 있는 동안 입력이 변한다면 플립플롭 회로가 원치 않는 결과를 낼 수

리포트 | 4페이지 | 1,000원 | 등록일 2010.04.12

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논리회로실험 스텝모터 결과보고서

실험제목 : 스텝모터(결과보고서)? 목 차1. 예비조사 및 실험 내용의 이해1.1 스텝모터의 의미1.2 스텝모터의 특징2. 실험내용 및 결과2.1 1상 여자방식2.1.1 s ... 이 출력되었다. 각 비트가 겹치지 않고 term마다 하나씩뜨는 것을 알 수 있다.2.2 1-2상 여자방식2.1.1 source2.1.2 source 분석파형을 그려보고서는 어떻게 해야 ... 를 좁혀주고 test bench의end time을 3000ns까지 잡았다.3. 결과 검토 및 의견이번 학기에 논리회로 과목을 듣는중이라 아직 클럭과 순서논리회로의개념이 잡히지 않

리포트 | 8페이지 | 1,000원 | 등록일 2008.01.14

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[논리회로실험]실험5결과보고서 래치와 플립플롭

>( S = 1 , R = 0 ) ( S = 1 , R = 1 )이번 실험은 S-R latch 회로의 결과 논리값을 확인하였는데 먼저 S-R latch회로의 동작 원리는 S입력 ... 하였다. 이는 서로 보수 값을 가지는 출력값인데 논리값을 1로 가지는 것을 확인하였다. 이렇기 때문에 S-R latch회로에서는 두 입력값이 모두 1인 회로를 구성할 수 없다. 또한 ... 은 값을 가진다. 논리값의 변화를 보기 위하여 클럭 입력을 1로 하게 되면 위의 회로와 같은 결과값을 가지게 된다. 간단히 동작 원리를 보면 워크 밴치 시뮬레이션에서 클럭 입력 값

리포트 | 7페이지 | 1,000원 | 등록일 2010.04.12

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2016년도 중앙대학교 전자전기공학부 3학년 2학기 아날로그및디지털회로설계실습 결과보고서 8장 논리함수와 게이트

아날로그 및 디지털 회로 설계 실습결과 보고서실습 8. 논리함수와 게이트조제출일작성자조원8-4. 설계실습 내용 및 분석8-4-1 설계한 논리게이트 구현 및 동작(A) Low(0 ... 0010101001103. XOR입력출력입력 A입력 B출력 X000011101110출력이 High(1)일 때의 출력출력이 Low(0)일 때의 출력논리 회로의 구현위의 그림처럼 AND, OR, NOT ... 한 다음, NAND, NOT 게이트를 사용하여 3입력 NAND 게이트의 등가회로를 구성하였다. 출력은 모두 진리표대로 정상으로 나오는 걸 확인하였다.논리 회로의 구현AND 게이트(8

리포트 | 9페이지 | 1,000원 | 등록일 2016.12.23 | 수정일 2017.06.25

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2016년도 중앙대학교 전자전기공학부 3학년 2학기 아날로그및디지털회로설계실습 예비보고서 8장 논리함수와게이트

아날로그 및 디지털 회로 설계 실습예비 보고서실습 8. 논리함수와 게이트조7조제출일2016-11-17학번, 이름8-1. 실습목적여러 종류의 게이트의 기능을 측정하여 실험 ... 74HC021개XOR gate 74HC861개사용장비오실로스코프1대브레드보드1개파워서플라이1대함수발생기1대점퍼선다수8-3. 설계실습 계획서8-3-1 XNOR 게이트 설계 및 특성 ... 분석(A) AND, OR, NOT 게이트를 사용하여 NAND, NOR, XOR 게이트의 기능을 갖는 회로도를 그리고, XNOR (Exclusive NOR)의 진리표를 사용하여 AND

리포트 | 5페이지 | 1,000원 | 등록일 2016.12.23 | 수정일 2017.06.25

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논리회로실험- 램(RAM) 예비보고서

RAM)- 셀의 구조를 플립플롭을 이용하여 회로를 구성한 것으로 소자의 집적도는 떨어지는 편이지만 리프레시 동작이 필요하지 않아서 디지털 시스템의 하드웨어 구현이 용이하다. 정적 ... ) 정적 RAM의 내부구조- SRAM 내의 각 메모리 비트(또는 SRAM cell)들은 위의 회로와 같은 동일한 기능의 동작을 한다. 각 셀에서의 기억소자는 D 래치이다. 셀 ... 을 형성하기 위해서 부가적인 제어논리와 함께 SRAM 셀들은 어레이로 결합된다. 간단한 ROM에서와 마찬가지로, 어드레스 디코더가 어느 순간에 접근하고자 하는 SRAM의 특정 행

리포트 | 7페이지 | 1,000원 | 등록일 2008.04.30

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[논리회로실험] 실험10. 시프트 레지스터 및 링 카운터 예비보고서

면서 동시에 이 전단의 상태(데이타)를 받게된다. 그러므로 시프트 펄스가 들어오면 레지스터 내부의 데이터가 다른 위치로 시프트되게 된다.시프트 레지스터의 회로구성 방향을 바꾸면 데이터 ... (CRO) : dc 결합된 입력과 전압측정 가능한 것4. 실험과정1. 시프트 레지스터그림 10-1의 회로를 Altera MAX_ plus program을 이용하여 구현하시오. 여기 ... 서 CRL (clear)과 PR(preset) 단자들은 논리 1값을 갖게 하고, 직렬 데이터는 모두 0을 갖게 하시오.펄스 발생기를 단일 펄스가 발생되도록 세팅하시오(여기서는 단일펄스

리포트 | 14페이지 | 1,000원 | 등록일 2010.12.05

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[논리회로실험]실험3결과보고서 가산기,감산기

예비보고서에서 구상한 반가산기를 구성하고 그 결과를 확인하라.XYCS0*************10 이 실험은 두 출력값의 가산을 하는 회로로써 단순히 2개를 더하는 값이 출력 ... 7400으로만 구성하라고 하여 이렇게 회로를 구성하여 실험을 하였다. 이번 실험 역시 시뮬레이션을 돌려보았는데 그 결과 논리값과 실험에서 나온 논리값이 완벽히 일치함을 확인 ... 하였다.예비보고서 문제 5에서 구한 전감산기를 구성하여 동작 결과를 확인하라.XYZBD0000000111010110111010001101001100011111< (X,Y,Z) = (0,0

리포트 | 7페이지 | 1,000원 | 등록일 2010.04.12

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[논리회로실험]실험7예비보고서 복호기와 부호기

에 ‘1’이 입력되면 Excess-3 코드화 시켜 3이 더해진 8인 논리값이 ‘1000’이 출력됨을 확인하였다.2단 2진 카운터의 출력을 다음 코드로 인코딩할 수 있는 회로를 그려라.Normal CountEncoded output0*************0010110001 ... 는 각 비트를 반전하여 보수를 취하면 10진수에서 9의 보수값이 되므로, 자기 보수 코드라고도 불린다. 먼저 Excess-3코드의 결과값을 유추하고 회로를 해석해 보 ... 에서는 하나의 값이 0으로 입력되면 입력 단자의 개수에 상관없이 그 출력값은 1이 나오게 된다. 이를 이용하여 회로를 해석하면 먼저 첫번째 Decimal이 5일 때, 맨 위의 스위치

리포트 | 4페이지 | 1,000원 | 등록일 2010.04.12

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논리회로실험-CMOS회로의 전기적 특성 결과보고서

실험2. CMOS회로의 전기적 특성 결과보고서1. 실험목적-High-speed Logic Family 인 74HC시리즈의 전기적 특성을 이해하고 실험을 통해 동작을 확인한다.2 ... (Pull Up/Pull Down). 정해주지 않으면 실험에 사용한 Inverter도 노이즈가 발생할 수 있으니 주의하여야 한다. 다음 회로와 같이 꾸미면 된다.실험 1. Logic ... 하여 다음과 같이 회로를 구성한다.(2) 오실로스코프에 프루브 2개를 설치한 다음 CH1,2 VDIV는 1V로 맞추고, CH1 Voffset = 0V, CH2의 Voffset =-1V

리포트 | 12페이지 | 1,000원 | 등록일 2007.12.29

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순서 논리 회로 플립플롭( flip-flop) 실험보고서

순서 논리 회로 플립플롭( flip-flop) 실험보고서1. 실험목적순서논리회로의 기반이 되는 플립플롭을 RS, D, T, JK, 플립플롭 등을 대상으로 하여 동작 원리를 살펴보 ... 고, 전반적인 이해를 한다.2. 이론디지털 회로는 조합(combinational) 논리회로와 순서(sequential) 논리회로 나뉜다. 조합 논리회로는 간단하게 말해서 그냥 ... AND,OR gate로 구성된 회로이다.순서논리회로는 쉽게 말해 플립플랍이라는 동기소자가 들어가있는 회로를 말하는 것이다.또 다시 순서논리회로는 크게 비동기(asynchronous

리포트 | 3페이지 | 1,000원 | 등록일 2009.08.06

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[논리회로실험]실험3예비보고서 가산기,감산기

에는 serial과 parallel 2가지의 방법이 있다. 이 두 방법의 특징과 논리회로 설계 방식을 설명하시오. 또한 이 두 방법을 이용하여 4-bit serial adder와 4 ... 되며 이 단점을 보완키 위해 look-ahead Carry 가산기가 있다.< 4-bit 병렬 회로> 이론의 반감산기의 진리표를 참고하여 부울 함수를 구하고 논리회로를 구성하시오 ... .YX01001100YX01001110 B = X’YD = X’Y + XY’ 이론의 전감산기의 진리표를 참고하여 카노맵을 통해 부울 함수를 구하고 논리 회로를 구성하시오.ZXY

리포트 | 8페이지 | 1,000원 | 등록일 2010.04.12

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[논리회로실험]실험7결과보고서 복호기와 부호기

의 회로를 구성하여 그림 3에 다음의 파형을 그리시오.출력 A의 파형출력 A’의 파형출력 B의 파형출력 B’의 파형7420의 NAND gate의 4, 5번핀은 연결하지 않고 다음의 파형 ... 였다.3진 카운터이 실험에서는 카운터 각각의 카운트 상태를 디코딩할 것이다. 그림 4의 회로를 연결하고 다음의 파형을 그림 5에 그려라.출력 A의 파형출력 A’의 파형출력 B ... 토의 >인코딩 – 10진 / Excess-3 코드(1) 인코딩 - 10진 / Excess - 3코드그림 7의 회로를 구성하라. 출력 D, C, B, A의 전압을 측정하여 표 2

리포트 | 10페이지 | 1,000원 | 등록일 2010.04.12

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논리회로실험- RAM (램) 결과보고서

실험 8. RAM 결과보고서1. 2-bit RAMWrite(bit0) Read (bit1)OUTPUTSENSE0SENSE1SENSE0SENSE1AB10011X01XX0X10101 ... 하고 WE를 접지시킨다.d. 출력단 DO4-DO1에서 입력 데이터를 읽는다.e. ME와 WE를 +5V에 연결시킨다.이와 같은 실험과정에서 +2.5V보다 높으면 논리 “1”이고 +0 ... .5V보다 낮으면 논리 “0”이라고 가정하였다. 측정된 데이터(0과 1)를 기록한다.5) 동작, DRO/NDRO에 대한 검사, Volatilitya. 5V를 16번 핀에 연결하기 전

리포트 | 9페이지 | 1,000원 | 등록일 2008.02.25

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실험 예비보고서 3주차 논리 및 연산회로

◇ 반가산기 및 전가산기 이론반가산기전가산기컴퓨터 내에서 2진 비트를 덧셈하기 위해서 사용되는 논리 회로의 하나로 반 덧셈기라고도 한다. 2개의 디지털 입력(비트)을 받고, 2개 ... 의 덧셈으로부터 자리 올림 비트를 덧셈 하는 것은 전 가산기의 기능이다.boolean 함수 : S=A?BC out=A?B컴퓨터 내에서 2진 숫자(비트)를 덧셈하기 위한 논리 회로 ... 게이트를 사용하여 회로구성을 한다.5. 실험하여 위의 1.항의 출력표와 같은지를 확인한다.◇ K-map을 이용한 최소화 기법카르노 맵은 간단하면서도 체계적인 과정으로 논리 식을 간략히

리포트 | 4페이지 | 1,500원 | 등록일 2008.11.08

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논리회로실험 디코더,인코더예비보고서

실험제목: 디코더, 인코더(예비보고서)1. 예비조사 및 실험 내용의 이해1.1 디코더디코더(decoder)란 n비트의 2진 코드(code) 값을 입력으로 받아들여최대 2n개 ... 의 서로 다른 정보로 바꿔 주는 조합 회로를 말한다. 일반적으로 디코더는 n개의 입력선과 최대 2n개의 출력선을 가지며, 입력값에 따라 선택된 하나의 출력선이 나머지 출력선들과 반대값 ... 은 0으로 바뀌었음을 알 수있는데, 이 디코더 역시 입력 값의 각 조합에 대해 한 출력선이 나머지 출력선들과 반대값을 가짐을 확인할 수 있다. 또한 회로를 비교해보면 그림 1-1

리포트 | 6페이지 | 1,000원 | 등록일 2008.01.14

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논리회로실험 플립플랍 예비보고서

실험제목: 플립플롭, 레지스터, 계수기(예비보고서)1. 예비조사 및 실험 내용의 이해■ 조합 논리 회로- 출력이 입력에 의해서만 정해지는 회로■ 조합논리회로의 예- 가산기 ... , 디코더, 인코더, 멀티플렉서, 디멀티플렉서■ 순서 논리 회로- 플립플롭(기억회로)과 게이트(조합 논리 회로)들로 구성되며, 출력은 외부 입력과플립플롭의 현재 상태에 의해서 결정 ... 되는 논리 회로1.1 래치(latch)와 플립플롭(flip-flop)■ 래치와 플립플롭 - 두 개의 안정 상태를 갖는 일종의 기억 회로■ 안정 상태 - 회로의 외부로부터 입력을 가하지 않

리포트 | 8페이지 | 1,500원 | 등록일 2008.01.14

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기본 GATE 설계 예비 보고서입니다 - 논리회로설계

실험제목: 기본 GATE 설계(예비보고서)- 목 차 -1. 예비조사 및 실험 내용의 이해1.1 기본게이트란? (정의)1.1.1 AND 게이트1.1.2 OR 게이트1.1.3 NOT ... 1.1.4 NAND1.1.5 NOR1.1.6 XOR1.1.7 XNOR1.2 기본게이트의 특징 (논리기호)1.2.1 AND 게이트1.2.2 OR 게이트1.2.3 NOT1.2.4 ... XNOR1. 예비조사 및 실험내용의 이해1.1 기본게이트란?1.1.1 AND 게이트AND 게이트는 2개 이상의 입력과 1개의 출력으로 구성된 논리게이트이며, 출력 신호는 입력 신호

리포트 | 5페이지 | 1,000원 | 등록일 2009.04.12

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[논리회로실험] 실험8. 전가산기와 전감산기 예비보고서

실험 8. 전가산기와 전감산기1. 실험 목적전가산과 전감산의 산술연산을 실행하는 회로의 설계법에 대해 공부한다.2. 기본 이론전가산기와 전감산기는 3비트를 더하거나 뺄 수 있 ... 는 논리 블록이다. 이들 논리 블록은 가산과 감산을 위한 논리식에 따라 직접 실행할 수 있지만, 이것이 이들 연산을 실행하는 최선의 방법은 아니다. 합 S와 차 D의 논리식은 기본 ... 적으로 부울대수를 이용하여 간소화 할 수는 없으나, 변형할 수는 있다. 이것을 실행하기 위한 한 방법은 같은 EOR회로를 이용하여 합와 차로 표시된다. 자리올림와 자리내림의 논리식

리포트 | 10페이지 | 1,000원 | 등록일 2010.12.05

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[공학기술]Digital 논리회로 실험에 관한 보고서(결과보고서)

12. Digital 논리회로 실험에 관한 보고서학과전자전기공학부학번20021296조성명김완섭점수표 1. NAND gate의 입출력 관계 특성그래프의 꺾인 점에서의 vi값Q3 ... 결론1학년 때 기초논리회로 시간에 배운 TTL NAND gate의 동작원리를 알아 볼 수 있었고, 부하를 점점 늘려서 달아봄으로써, 출력측에 같은 소자를 몇 개나 부하로 연결 될 ... 소자들을 통해 디지털 회로가 어떻게 구성되어지는지 실험을 통해 알아 볼 수 있었다. 오실로스코프상에서 XY PLAN으로 그래프가 점으로 구성이 되어 변화되는 기울기가 심하여 정확

리포트 | 2페이지 | 1,000원 | 등록일 2007.07.29

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