"Digital Logic Circuit Simulator"의 검색결과 입니다.

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"Digital Logic Circuit Simulator" 검색결과 341-360 / 561건

<VHDL>Pre lab - BCD to Excess3 code converter !! (A+리포트 보장)

Behavioral VHDL Model을 작성하고 Test bench도 작성하여 Simulation 상태를 확인한다.Assignment 2에서는 Dataflow Model를 사용 ... Circuits) Hardware Description Language의 약어이며 VHDL은 알고리즘 레벨(algorithm level)에서 게이트 레벨(gate level ... )에 이르기까지 여러 레벨에서 디지털 시스템을 모델링 하는 데 사용될 수 있는 하드웨어 기술 언어를 말한다.모델링 되는 디지털 시스템은 게이트 처럼 간단하거나 완전한 디지털 전자 시스템

리포트 | 28페이지 | 3,000원 | 등록일 2009.06.29

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실험7예비.Decoder&Encoder

각 핀에 가중치를 부여해서 우선순위가 높은 핀의 입력에 맞는 결과를 내보내는 Encoder를 Priority Encoder라고 부른다.3. 실 험 - Simulation2단 2진 ... -excess 3 encoder (DCBA) for decimal digits 0 to 5그림 SEQ 그림 \* ARABIC 6. 출력 파형7 Segment 표시기를 갖는 BCD 카운터 ... 카운터이다. 5와 6을 각각 디코딩하기 위한 logic diagram을 그려라.(디코딩된 출력은 logic '1'이 되게 한다)그림. 3-stage binary counter- 먼저

리포트 | 8페이지 | 1,000원 | 등록일 2011.06.27

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VHDL기초강의

3 circuit)순차 논리(sequential logic) : 출력이 외부입력과 현재상태의 함수로서 결정 순차 논리는 조합논리와 클럭에 의해 구동되는 메모리 소자(주로 flip ... ombinational circuit) 설계 및 실습 Adder Multiplexer Decoder 순차 회로(sequential circuit) 설계 및 실습 F/F, Latch Shift ... register Counter Stop watch Max Plus Ⅱ를 이용한 VHDL 프로그래밍 Digital training kit을 이용한 실습*VHDL이란?VHDL(Very

리포트 | 106페이지 | 1,000원 | 등록일 2010.05.11

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전기전자 응용실험_10주차 예비 보고서

line. Light that has been detected by the comparator is digitized, and is transmitted to the CPU ... onnected to the control, apply logic low(0V) to turn on the sensor and logic high(+5V) to turn it off ... . Remember that, since the resistance of the emitting circuit is low, continuous emission will

리포트 | 3페이지 | 1,000원 | 등록일 2011.07.09

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실험3예비[1].가산기와감산기

1. 목 적Logic gates를 이용하여 가산기와 감산기 회로를 구성하고 동작을 확인한다.디지털 시스템의 기본인 가산기와 감산기의 구조 및 동작 원리를 실험을 통해 이해한다.2 ... . 이 론가산기이진수의 덧셈을 하는 논리 회로현대의 가산기(adder)는 주로 ALU(arithmetic logic unit)의 구성요소로 컴퓨터 내에 장착되어 사용가산기의 종류반 ... 진리표와 동일)3. 실 험 - Simulation예비보고서에서 구상한 반가산기를 구성하고 그 결과를 확인하라.그림 SEQ 그림 \* ARABIC 1. 반가산기 출력 파형반가산기

리포트 | 9페이지 | 1,000원 | 등록일 2011.06.27

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전기전자기초실험 Flip-flop and Counter Design 예비보고서

its previous inputs. Such a circuit is described as sequential logic.SR latch/Bistable LatchWhen using ... signal. Logic gates between each stage of the circuit control data flow from stage to stage so that ... digit binary encoded (that is, it may count in binary-coded decimal, as the 7490 integrated circuit did

리포트 | 11페이지 | 1,000원 | 등록일 2009.09.08

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[Digital Logic Design Project] Full adder

Digital Logic Design Project #2Full adderProject #1 Gray Code Converter개요3개의 입력과 2개의 출력을 가지는 full ... 000111100001010111Cout = ab + bc + ac작성한 표를 이용하여 logic circuit를 설계한다.VHDL을 이용하여 full adder을 설계한다.ENTITY adder

리포트 | 5페이지 | 1,000원 | 등록일 2010.01.20

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연세대 전기전자 기초실험 09년도 A+ 레포트 예비 12

Electric Circuit Experiment Pre-ReportChapter 12" Digital clock design "DepartmentYearStudnt ... provide a stable clock signal for digital integrated circuits, and to stabilize frequencies for radio ... & Common-Anode type(right)The internal circuitry and logic gates for the display is shown below

리포트 | 7페이지 | 1,000원 | 등록일 2009.12.17

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AFCI(Arc fault Circuit interrupter)

은 증폭기를 거쳐 논리회로(Logic Circuit)로 보내진다. 논리회로에서는 불안전한 파형의 존재 여부를 판단하여 회로를 차단해야 한다고 판단되면 차단기 접점을 개방하기 위한 ... AFCI (Arc Fault Circuit Interrupter)전기화재의 많은 원인이 전기선로 및 배선기기에서 아크현상으로 나타나고 있으나, 기존 보호기기로 일반적으로 사용 ... 하게 되어 있어 회로구성방식이 점차 논리회로 구성 및 디지털 회로방식으로 옮겨가고 있는 경향이다.< 단상 아크 차단기의 구성도 >그림에서 열 센서(Thermal Sensor)와 자기

리포트 | 5페이지 | 1,000원 | 등록일 2011.06.17

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xilinx를 이용한 FSM설계

Simulation 파형은 현재 상태와 출력 값을 명시한다는 전제 하 에 자율적으로 표현한다.4-state Mealy 상태도2. 관련 기술 및 이론◊ State Machine - 순차회로 ... machine중에서도 유한한 개수의 상태를 가진 것 - 디지털 하드웨어를 설계할 때 제어 신호를 생성하는 제어기는 FSM으로 규정하며 FSM 에 대한 동작 표현은 state diagram ... 설정이 요구됨.상태(State)클럭(Clock)다음상태(Next State)조합회로(Combinational Circuit)상태레지스터(State Register)출력(Z)입력

리포트 | 11페이지 | 1,500원 | 등록일 2010.06.24

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lab5-pre OP amp Circuit.hwp

) DVM (Digital Voltammeter)3) LCR 미터4) Metal Resistor 10(1), 1k(1), 4.7M(1), 1M(1) (괄호 안은 개수)5 ... 으로 Pspice Simulation을 하고 Vin, Vo1, Vout의 파형을 출력하시오. 위의 출력화면을 살펴보면 세 개의 입력의 덧셈도 가능하다는 것을 볼 수 있다.즉,임을 알 ... 를 이론적으로 계산한 값과 Pspice Simulation에서 얻은 값을 구하시오.그림 cut-off frequency 찾기Magnitude가 -3dB만큼 drop하는 cutoff

리포트 | 10페이지 | 1,000원 | 등록일 2010.08.29

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디코더 인코더 설계

이용2 장 . 관련 기술 및 이론 디코더 (Decoder) - 컴퓨터 내부에서 디지털로 코드화된 데이터를 해독하여 그에 대응되는 아날로그 신호로 바꿔주는 컴퓨터 회로 - 인코더 ... STD_LOGIC_VECTOR (7 downto 0); a : out STD_LOGIC_VECTOR (2 downto 0)); end encoder_if ; architecture ... 은 3 비트이기 때문에 비트 벡터 ( STD_LOGIC_VECTOR) 로 선언하고 , 범위는 각각 7 downto 0 //2 downto 0 으로 한다 . If 문은 process

리포트 | 26페이지 | 2,000원 | 등록일 2010.09.09

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결과보고서-Exp 1. Combinational Logic Design,Flip-Flop, and Counter.hwp

- Understand the operation of flip-flop.- Implement simple digital logic circuits.2. Problem Statement1 ... combinational logic circuits- Understand how to simplify the Boolean function using Karnaugh map ... Exp 1. Combinational Logic Design, Flip-Flop, and Counter1. Objectives- Understand the operation of

리포트 | 11페이지 | 2,000원 | 등록일 2010.10.11

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HILSSAT을 이용한 인공위성 지상 자세제어

데이터를 디지털 데이터로 변환하는 ADC블록, 각각의 Gain이나 클럭 등을 조절하거나 외부 인터페이스를 하기 위한 Control Logic으로 구성된다. 이렇게 구성된 3축 가속 ... 을 이용한 실험을 통하여 새로운 자세제어 로직을 개발·검증해 왔다. 또한, 이를 위해 해석적 시뮬레이션 (HILS : Hardware In Loop Simulation)에 관한 연구 ... 도 활발히 진행되고 있다.본 실험에서는 이러한 실물 하드웨어 시뮬레이션의 한 종류로 HILSSAT(Hardware In Loop Simulation Single Axis Testbed

리포트 | 9페이지 | 2,500원 | 등록일 2013.03.27

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[전자회로] cascode 회로를 이용한 증폭기 (설계)

반도체 전계효과 트랜지스터 (metal-oxide-semiconductor field-effect transistor)는 디지털 회로와 아날로그 회로에서 가장 일반적인 전계효과 ... region :※Circuit Symbols and Conventions (n-channel MOS)ⅱ)Multistage Amplifier : Cascode circuit: Common ... 였습니다.아래에는 MOSFET PSpice Parameters 에 대한 설명들을 참조하였습니다.4.세부사항(PSpice Simulation)ⅰ)회로구성Bias전압은 +10V, -10를 인가

리포트 | 8페이지 | 1,000원 | 등록일 2010.11.25

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다이오드를 이용한 반파정류 실험

(Diode Logic Gate) 다이오드를 이용한 OR게이트다이오드와 저항을 이용하여 디지탈 논리 함수를 구현할 수 있다. 그림 13-1(a)는 OR 게이트를 나타낸다. "0"은 0V ... V보다 낮은 4.3V정도밖에 되지 않는다. 이 값은 +5V에 가까우므로 논리 1로서 정확하게 표시될 수 있다. 그러나 복잡한 디지탈 시스템에서 처럼, 이런 게이트들 몇 개가 직렬 ... 가 된다.(b)이번의 회로는 다이오드의 방향이 역방향이므로 오픈 서킷이 된다. 그러므로 이론치는 5V로 예상된다. 측정치는 약 4.94V이었다. 약간의 오차가 발생했지만 파워

리포트 | 7페이지 | 1,000원 | 등록일 2012.06.10

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전기전자기초실험 Combination Logic Circuit Design 예비보고서

Topic : Combination Logic Circuit Design- Theory『 Multiplexer and Demultiplexer 』In electronics, a ... of a multiple-input, multiple-output logic circuit that converts coded inputs into coded outputs ... digital input signals and forwards the selected input into a single line. A multiplexer of 2n inputs has

리포트 | 13페이지 | 1,000원 | 등록일 2009.09.08

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예비보고서-Exp 1. Combinational Logic Design,Flip-Flop, and Counter.hwp

- Understand the operation of flip-flop.- Implement simple digital logic circuits.2. Problem Statement1 ... combinational logic circuits- Understand how to simplify the Boolean function using Karnaugh map ... Exp 1. Combinational Logic Design,Flip-Flop, and Counter1. Objectives- Understand the operation of

리포트 | 10페이지 | 2,000원 | 등록일 2010.10.11

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제휴를 통한 사업확장- Mips 사례

et computing(CISC: 복합병렬시스템)에 비해 회로(circuitry)가 덜 들어가기 때문에 설계와 최초 시험단계가 단축되고 제조비용도 절감되는 장점을 지녔다. 당시 ... 과 라이센싱을 체결하는 한편, 디지털 이퀴프먼드사, 실리콘 그래픽스, 불, 닉스도르프, 올리베티 및 여타 기업들에게 이 칩의 사용을 권장하였으며, 다수의 소프트웨어 기업, 시스템 통합 ... 하였다. 1987년에 세개의 작은 기업(LSI logic, IDT, Performance Semiconductor)과의 라이센싱 체결에 성공하였다. 일본 Kubota 사와는 지분참여 대가

리포트 | 9페이지 | 2,000원 | 등록일 2012.10.14

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[Lab#1]Logic Unit 사용법 LED 555IC 실습

Digital Engineering and Lab/ 디지털공학 및 설계_2011_기계공학과Dept. of Mechanical Engineering.('11.3.17(목))(오전 ... , 오후)반, 성명: 신호영 학번: 200810211 제출마감: '11.4.1 (금)20:00[Lab.1]ED-1000BS Logic Lab Unit 사용법, LED구동, 555 ... timer IC의 Astable MV회로 실습[1]학습목표a)ED-1000BS Logic Lab Unit 사용법을 익힌다.b)555 timer IC를 사용하여 Astable MV 펄스

리포트 | 7페이지 | 1,000원 | 등록일 2011.06.18

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