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d플립플롭cadenc 기초 전자 실험 FPGA 전전설3 12주차 전전설2 Lab03 디지털논리회로 전전설3 RC pspice 모듈형 10진 카운터 100진
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"Digital Logic Circuit Simulator" 검색결과 421-440 / 589건

  • 자료 표지
    예비보고서-Exp9.Inverse DCT Hardware Module Design
    Verilog HDL are basic tools for describing digital circuits which performs specified functionalities. In ... ombinational and sequential logic blocks to implement simple arithmetic and logic operations.2. Problem s ... Verilog.3) Verify the operation of the designed hardware with a logic simulator (e.g., Modelsim).3
    리포트 | 11페이지 | 2,000원 | 등록일 2010.10.09
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  • 자료 표지
    32bit ALU(연산기) 베릴로그(Verilog) 소스코드, 시뮬레이션 분석, 블록다이어그램, 고찰
    1. 프로젝트소개Project #1 : ALU (Arithmetic Logic Unit) 설계1.1. 목적: 본 과목에서 최종적으로 수행할 MIPS 프로세서의 설계를 위한 첫 번 ... 째 단계로, Verilog HDL 언어로 32비트 ALU(Arithmetic Logic Unit)을 설계한다. 이를 통해 범용 프로세서의 핵심 코어인 32비트 ALU의 구조 및 ... Tool (혹은 Altera Quartus Tool) 의 사용법 습득- FPGA 환경에서의 디지털 로직 설계 개념 이해 및 설계된 로직의 합성과 검증 과정 확인- 범용 32 비트
    리포트 | 12페이지 | 1,500원 | 등록일 2009.07.22
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  • 자료 표지
    FPGA를 이용한 신호등구현
    기술의 급격한 발달은 디지털 분야에 커다란 영향을 주게 되었으며, 하나의 IC(Intergrated Circuit)에 수천에서 수 만개의 트랜지스터가 집적되게 되었다. 이에 따라 ... 주문형 반도체인 ASIC(Application Specific Intergrated Circuit)의 시장이 날로 증가하고 있는 추세이다. 이와 같은 ASIC의 개발은 디지털 ... . 만약 ASIC 제작시 한 번이라도 실수 한다면 많은 비용과 시간을 낭비하는 결과를 초래하게 되므로 디지털 시스템을 미리 FPGA(Field Programmable Gate
    리포트 | 52페이지 | 1,500원 | 등록일 2007.08.08
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  • 자료 표지
    기계실험-[실험4] 10진 카운터 제작
    게 빠른 속도로 엄청나게 복잡한 연산들을 수행할 수 있는 디지털 장치의 진화가 진행되고 있는 것으로 나타난다,그밖의 논리회로이른바 논리게이트(Logic gate)는 디지털 언어인 ... [실험4] 10진 카운터 제작1. 목적디지털 칩의 가장 기본이 되는 74시리즈를 다루어 봄으로서 디지털 이론을 공부해 본다. 실험에서는 7세그먼트를 구동하기위한 10진 카운터 ... 74LS90 그리고 2진수를 입력 받아 7세그먼트를 구동 시켜주는 74LS47를 사용하여 세그먼트 LED를 구동해본다.2. 이론- 디지털의 이해 (논리 게이트 OR, AND, NOT
    리포트 | 14페이지 | 2,500원 | 등록일 2008.09.19
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    Pspice 사용법 발표자료
    . ReferenceWhat is SPICESPICE – Simulation Program with Integrated Circuit Emphasis 1972년 켈리포니아대학에서 개발 전기 ... SPICE20020929 하인석 20051125 송태엽 20051127 윤승현Contents1. What is SPICE2. Schematic3. Simulation4 ... , 전자, 디지털회로의 해석 및 설계 R L C (수동소자), Diode, TR…(능동소자)의 모델을 자료화 → 회로설계 검증What is P-SPICEP-SPICE
    리포트 | 17페이지 | 1,000원 | 등록일 2008.03.17
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  • 자료 표지
    삼성전자 기업분석.
    부 >-S/W개발(희망직무!)< 무선 사업부 소개 >▶ 관련분야『H/W 개발』CDMA, GPRS, UMTS, GSM, Mits 단말기 회로설계 및 RF/Logic, 안테나 관련 ... , Linux『기구개발』CAE/CAD, 3D Simulation등▶ 주요기술CDMA2000 1x EV-D0/DV, GPRS, UMTS, GPS, RF IC, ASIC, Radio ... 세계적인 제품 리더십과 마켓 리더십을 확보하고 디지털 TV, 인터넷 가전, 차세대 이동통신 단말기 등 첨단 디지털 제품을 선출시킴으로써 세계 전자 정보 통신 산업의 새로운 미래
    리포트 | 6페이지 | 2,000원 | 등록일 2012.01.23
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  • 자료 표지
    Shift Register & Division Circuit
    6주차 기초전자공학실험2기초전자공학실험2실험날짜: 2008, 10, 31조 : 금요일 오전 10 조1.TitleShift Register & Division Circuit2 ... .Name금요일 오전 10조3.Abstract플립플롭을 이용하여 shift register와 division circuit을 제작하여 비트의 이동을 확인하고, 이해한다.4 ... out)01?① →①1①1?→2①1? →?3?①1 →141?① →①< 우측순환 레지스터의 동작 >6주차 기초전자공학실험25.Simulation실험 1. 74LS161을 사용하여 100
    리포트 | 29페이지 | 3,000원 | 등록일 2010.10.16
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  • 자료 표지
    [전파공학실험]최종_Power Amplifier Design
    Circuit 설계1)Load, Source 정합 회로망2)Linear Simulation3)Non-linear Simulation1)Linear Simulation2)Non ... )Matching Network Design5)ADS를 이용한 Simulation6)Detuned Matching Network7)Tuned Matching Network8)Bias ... -linear Simulation4.결론 및 후기Power Amplifier Design제출일전공조원1. 프로젝트 주제 및 선정 배경○ 주제전력 증폭기 설계.○ 설계목표- ADS
    리포트 | 34페이지 | 3,000원 | 등록일 2009.03.01
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  • 자료 표지
    Lab(5) 플립플롭 래치 IC 실습
    .2) 각 실습 회로에 대하여 MultiSIM Simulation 결과를 첨부한다.3) 실습 소감을 적어 본다.개인적으로 디지털의 꽃이라 생각하는 카운터의 기초인 플립-플롭을 배우 ... 2010년도 1학기Digital Engineering and Lab.Dept. of Mechanical Engineering2010.05.11(화)제출마감: 2010. 5. 24 ... 량부 품수량ED1000BS Logic Lab Unit1setIC: 74LS75 4-bit Latch1eaIC: 74LS00 Quad 2-input NAND gate1eaIC: 74
    리포트 | 16페이지 | 1,500원 | 등록일 2010.06.23
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  • 자료 표지
    실험 - Gate와 Flipflop을 이용한 comparator & counter & 7-segment 구현
    function을 간소화, 그리고 flip- flop 동작을 이해하고 이를 바탕으로 간단한 Digital logic circuit을 구현하는 것이었다.이 목표를 위해 실험에서는 다음 ... 1. Purpose of the lab이번 실험의 목표는 크게 Combinational logic circuit에 대한 이해, Karnaugh map을 이용한 Boolean ... chematicJ-K FF 를 이용한 asynchronous counter와는 다르게, 이번 synchronous counter 는 추가적인 combinational logic
    리포트 | 21페이지 | 6,000원 | 등록일 2009.12.23
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  • 자료 표지
    논리회로실험 부울대수 및 조합논리회로 설계.hwp
    - 디지털 시스템을 구성하는 논리 회로는 크게 나누어 조합 논리 회로(Combinational logic circuits)와 순서 논리 회로(Sequential logic circuits ... 나 기하학에서와 같이 부울 대수도 일련의 공리를 전제로 새로운 정리를 유도할 수 있다. 또한 부울 대수는 0(False)과 1(True) 두 개의 값만을 가지는 대수체계로써 디지털 ... 과 승산은 논리회로에 있어서 OR과 AND동작과 같으며, OR 연산을 논리합(Logical Sum), AND 연산을 논리곱(Logical Product)이라 한다. 논리 변수
    리포트 | 3페이지 | 1,000원 | 등록일 2008.09.19
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  • 자료 표지
    FPGA 구조와 응용
    FPGA 구조와 응용FPGA를 알기 전에FPGA를 알기 전에 그보다 큰 범주인 PLD와 ASIC이란 단어에 대해 알아보면,PLD(Programmable Logic Design ... ) 란 사용자가 필요로 하는 논리 기능을 직접 만들어 쓸 수 있는 IC로서, 현재 ASIC(Application Specific Integrated Circuit )등의 내부에 사용 ... 되고 있는 PLA(Programmable Logic Array)와 같이 급속히 발전하고 있다. 그래서 대표적인 MMI사(현재는 AMD사)의 PAL (Programmable Array
    리포트 | 20페이지 | 2,000원 | 등록일 2007.03.23
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  • 자료 표지
    [회로실험] 논리게이트를 이용한 가, 감산기 설계
    #회로실험1실 험 일 자2005년 4 월 6 일제 출 일 자2005년 4 월 5 일조 별 명 단담당 교수명pre reportDigital circuit Simulation ... 출력 가능 = 4 \* GB3 ④ Logic Analazer디지털 16bit data를 입력받아 파형 출력 = 5 \* GB3 ⑤ Logic converter논리회로를 진리표 ... Generator, Word Generator, Logic Analyzer, Logic Converter 등의 계측기의 사용법을 익히는 것이 이번 실험의 목적이다. Multisim
    리포트 | 11페이지 | 1,000원 | 등록일 2005.06.30
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  • 자료 표지
    트랜지스터 응용 회로 실험(2)(예비)
    의 Switch로서의 동작을 이해하고, 이를 이용하여 간단한 Digital Logic을 구현해 본다.Name금(오전) 4조 김성준 200411253전재하 200411310문은혁 ... 한다. 나머지 두 영역, Cut Off 영역과 Triode 영역은 전위차를 이용하여 Digital 논리 회로에 이용된다.2. Common Source Amplifier(with ... ModelHigh Frequency Equivalent CircuitEquivalent Circuit For Simple Analysiso 증폭기로서 MOSFET의 고주파 동작에 대한 성능 지수
    리포트 | 13페이지 | 2,000원 | 등록일 2009.07.08
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  • 자료 표지
    전자계산기 기사 필기 요약
    Pagen 논리 회로 설계n 논리 회로(logic circuits)디지털 컴퓨터에서 논리 회로는 2진 정보에 의해서 동작되는 회로이다. 이는 두 개 이상의 입력단자와 하나의 출력 ... ombinational logic circuits)와 순서 논리 회로(sequential logic circuits)로 구분된다.n 논리 게이트2진 정보의 처리는 게이트(gate)라고 하는 논리 ... 단자를 갖는 게이트(gate)와, 여러 게이트들로 이루어진 플립플롭(flip-flop)으로 구성된다. 디지털 논리 회로는 이들의 작동원리에 따라 조합 논리 회로(c
    시험자료 | 54페이지 | 3,500원 | 등록일 2009.12.03
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  • 자료 표지
    [전기회로]【A+】회로이론
    여라.논리회로(Logic Circuit)1. NOT 회로 :0110인버터 Inverter 7404[사용 소자 ]① 디지털클럭 : Place/Source/DSTM1, OFFTIME=0 ... 변경 ] DSTM1->A1 으로, OFFPAGELEF-L ->OUT 으로 변경디지털 클럭 입력 A1의 특성정보를 보이지 않게 하기위해 마우스로 영역을 둘러싼 다음에 Delete 키 ... 며, 입력 신호 A1이 1 일때, 출력 OUT의 결과는 0이 되는 것을 볼 수 있다.2. AND 회로ABAB000010100111Gate 7408[사용 소자 ]① 디지털클럭
    리포트 | 26페이지 | 1,000원 | 등록일 2011.07.15
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  • 자료 표지
    Quartus 툴을 이용하여 verilog로 가감산기.간단한 ALU 구현하기
    circuit function is specified typically by text or a hardware description language(HDL), plus constraints ... on cost, performance, and reliability. At high levels of the design, the circuit is then repeatedly ... divided into blocks as necessary until the blocks are small enough to perform logic design. For
    리포트 | 18페이지 | 9,000원 | 등록일 2007.12.09
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  • 자료 표지
    반도체 산업의 특징
    의 하나이며 특히 정보통신산업이 한 국가의 국부창출의 원동력이 되는 디지털경제 체제하에서는 더욱 그 중요성이 부각된다고 할 수 있다.우리나라에서도 1980년대 초반부터 반도체 산업 ... 에 지나치게 편중된 반도체 산업 혁신체제의 특성으로 인해 시스템 IC분야나 ASIC (Application Specific Integrated Circuit) 등과 같이 향후 세계 ... 하고 있고 뒤를 이어 MOS Memory 21%, MOS Logic 15%, Analog 14%, Discrete 12%의 순으로 제품별 점유율을 나타내고 있다. 1997년
    리포트 | 5페이지 | 1,000원 | 등록일 2011.04.16
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  • 자료 표지
    [예비레포트] 10진 카운터 제작
    1-4] NOR GATE2. 디지털 IC의 종류와 특징논리 게이트들은 IC(Integrated Circuit)로 만들어 사용하고 있는데 하나의 IC package속에는 여러개 ... 1. 논리게이트디지털 논리 회로는 일정한 입력에 대하여 논리적인 판단을 할 수 있는 전자적인 회로로 구성되어 있으며 시스템의 목적에 맞게 입력된 2진 논리 신호들에 대해 적당 ... 한 2진 신호를 출력한다. 디지털 논리 회로를 구성하는 논리 게이트들의 종류와 역할은 다음과 같다.(1) AND GATEAND 게이트는 2개 이상의 입력 단자와 1개의 출력단자로 구성
    리포트 | 4페이지 | 1,000원 | 등록일 2009.03.08
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  • 자료 표지
    PSCAD / EMTDC 자료
    breakers? Diodes, thyristors and GTO's? Analogue and digital control functions? Ac machines, exciters ... on? Investigation of new circuit and control concepts? Studies to determine the worst case over ... 고 있으며, 이 device는 timed fault logic을 통하여 사고 기간을 설정할 수 있다.그림 2-6 Fault Device(6) MetersPSCAD/EMTDC
    리포트 | 22페이지 | 1,000원 | 등록일 2012.07.18
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2025년 08월 17일 일요일
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