"논리회로실험"의 검색결과 입니다.

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verilog 전전설2 레포트 논리회로 텀프로젝트 실험12 멀티플렉서 vhdl 논리회로실험 디지털회로실험 라인트레이서

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"논리회로실험" 검색결과 641-660 / 4,713건

[아주대] 논리회로실험 1장 결과(Basic Gates)

The Resulting ReportExperiment 1 - Basic gatesOBJECTIVES (실험을 통하여 확인 할 수 있는 것에 중점)논리 기호로만 구성되어있던 회로 ... 를 사용해 구성하였다. 실험 1-1/1-2/1-3/1-4 에서 위 가상 논리 기호 회로에서는 두 개의 2-input AND/OR/NAND/NOR gate로 구성되어 있지만, 실제로 ... 하나만을 이용하여 위 회로를 구성했다. 우리는 이 비슷한 회로 4개를 논리연산 입력 값을 바꾸어 실험하여 각각 논리연산에 알맞은 결과를 얻을 수 있었다.2번 실험은 2-input

리포트 | 5페이지 | 2,000원 | 등록일 2013.09.15

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[논리회로실험] RAM (예비)

) 저항 : 680Ω(2개), 5.6㏀(2개)3. 실험관련 이론1) RAM 회로의 설계그림 1에 4x3비트 용량을 갖는 RAM의 내부회로를 나타내었다. RAM의 내부회로는 그림 1 ... 비트이다.그림 2. 메모리 셀 회로도2) 실험에 사용되는 IC(7489)3) 실험에 사용되는 IC(7486)4. 실험방법(1) 2-bit RAM (그림 3)그림 3. 2-bit ... 은 실험과정에서 +2.5V보다 높으면 논리 “1”이고 +0.5V보다 낮으면 논리 “0”이라고 가정하였다. 측정된 데이터(0과 1)를 기록한다.5) 동작, DRO/NDRO에 대한 검사

리포트 | 9페이지 | 1,500원 | 등록일 2009.03.20

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논리회로설계실험_비교기

1.1비트 비교기 (1bit comparator)1)HDL코드library ieee;Use IEEE.STD_logic_1164.all;entity one_bit_comparator isport ( A, B : in std_logic;EQ : out std_logic);..

리포트 | 8페이지 | 1,000원 | 등록일 2010.04.10

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아주대 논리회로실험 실험결과4 멀티플렉서와 디멀티플렉서(Multiplexer & Demultiplexer)

있다.실험 2. 디멀티플렉서(1) Enable을 갖는 1x4 디멀티플렉서를 74HC11과 74HC04를 이용하여 다음 회로와 같이 구성한다. 데이터 입력 D는 enable 입력 ... 멀티플렉서 IC인 74HC139소자를 이용하여 회로 구성하여 본 결과 이번에 는 2-(1) 실험과는 다르게 enable 단자에 5V(High)를 주면 S0,S1에 상관없이 Y0~Y3 ... 로 동작했고 4x1 멀티플렉서 IC인 74HC153를 이용한 실험은 소자 1개를 이용하여 같은 기능을 수행하는 것을 확인 하였는데 이는 회로도 매우 간단했으며 진행하는 시간도 짧

리포트 | 7페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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논리회로실험)기본논리회로

1.실험목적1.AND,OR,NOT,NAND,NOR게이트의 기본적인 논리함수를 이해한다.2.기본 논리회로의 측정방법과 구성방법을 익힌다.2.실험내용실험1)p.12 그림1.6그림1 ... 만 끝까지 포기하지않고 하여서원하는 결과값을 얻어내었다.처음하는 실험이라 좀 어색했지만 앞으로는재미있는 실험수업이 될수있을것같습니다.결과레포트1.기본논리회로 ... .6의 회로를 구성하고 입력A,B를 변화시키면서 표1.6의 축력전압 Y를ABY000010100111측정하시오. Vcc:핀14, GND:핀7번실험2)p.12 그림1.7그림1.7의 회로

리포트 | 4페이지 | 2,000원 | 등록일 2007.03.14

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논리회로 실험 시프트레지스터와 카운터

실험 6. 시프트레지스터와 카운터 (Shift Register & Counter)Ⅰ. 목 적시프트 레지스터와 링 카운터의 동작 원리와 특성을 이해한다. 또한 2진 시스템 ... 의 J, K 입력에 연결된다면 다음 단의 쌍안정 회로는 이동 명령(shift pulse)에 의해 이전 단의 쌍안정 회로가 가지고 있던 데이터를 지니게 된다. 이러한 연속적인 이동명령 ... 하게 되며 한 상태와 다음 상태에 사이에 일시적인 중간 상태가 존재할 수 있어 논리상의 에러를 유발할 수 있게 된다.이러한 전송지연을 없애기 위해서 모든 F/F들은 같은 clock 펄스

리포트 | 17페이지 | 1,500원 | 등록일 2010.03.20

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[A+ 예비보고서] 아주대 논리회로실험 실험6 '래치와 플립플롭'

실험6. 예비보고서실험목적-여러 종류의 flip-flop을 구성하여 그 동작 특성을 알아본다.-R-S Flip-Flop과 그의 변형형은 D F/F, J-K F/F를 구성해보 ... 소자로써, 클럭에 따라 입력이 출력에 반영된다.-플리플롭은 1개의 bit 정보를 기억할 수 있는 기억 회로로써, 외부신호가 인가되기전까지 원래 상태를 유지한다.-플리플롭의 종류 ... Q(t-1)′: togglexx0Q(t-1)3.실험방법실험 1 R-S F/F- C가 High 인 동안에 입력이 출력에 반영된다.SRCQ(t)001Q(t-1)0110:Reset

리포트 | 5페이지 | 1,000원 | 등록일 2015.03.27

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[아주대] 논리회로실험 7장 결과(Shift Register)

을 사용했다.< 실험 1 >< 실험 1 > 회로도실험 결과 구성한회로 사진위와 같이 회로를 구성하였다. 데이터의 저장과 이동을 보기 위해서 6개의 플립플롭의 출력 Q에 저항과 다이오드 ... 은 시간이 걸린 실험이었다.모두 출력된 경우< 관찰된 오류 >< 실험 2 >< 실험 2 > 회로도실험1에서 플립플롭소자를 이용하여 시프트 레지스터를 구성하고 데이터의 저장과 이동 ... 을 살펴보았다면 2번 실험에서는 직접 시프트 레지스터 소자인 74HC96소자(5bit Shift Register)를 이용하여 위와 같이 회로를 구성하였다. 각각의 입력에 대응

리포트 | 6페이지 | 2,000원 | 등록일 2013.09.25

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논리회로실험 counter 예비보고서

실험1 : 2단 2진 counter – 비동기식 Counter- J-K F/F 을 통한 2단의 2진 값을 AND 게이트를 이용하여 확인한다.- 4개의 출력이 가능하므로 AND ... 게이트를 4개를 사용한다.-> 실험23진 Counter – 동기식 Counter- J-K F/F 을 통한 3진 값을 AND 게이트를 이용하여 확인한다. 3개의 출력이 존재하므로 3개 ... 의 AND gate를 사용한다.실험3-1(7-segment 표시기를 갖는 BCD Counter)-7490을 이용한 BCD Counter를 통해 0~9까지의 값을 얻음-스위치를 이용

리포트 | 5페이지 | 2,000원 | 등록일 2012.03.08

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[디지털 논리회로 실험] 11장. 비동기식 RS 플립플롭 예비레포트

논리회로실험 A반예비11장비동기식 RS 플립플롭5조이름학번실험일15.04.28제출일15.04.281. 이 장의 실험 목적에 대하여 기술하시오.- 플립플롭의 동작원리를 이해한다. ... - 비동기식 플립플롭과 동기식 플립플롭의 차이에 대해 이해한다.- 동기식 RS 플립플롭의 동작을 이해한다.2. 플립플롭의 기능에 대하여 기술하시오.디지털 논리회로는 조합논리회로 ... 와 순서논리회로로 크게 구분할 수 있다. 조합논리회로는 출력이 현재 입력 값에 의해서 결정된다. 이것은 조합논리회로의 특성이다. 즉, 회로의 출력은 입력이 인가되는 순서 및 입력이 인가

리포트 | 3페이지 | 1,000원 | 등록일 2016.01.14 | 수정일 2022.10.09

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아주대 논리회로실험 실험예비4 멀티플렉서와 디멀티플렉서(Multiplexer & Demultiplexer)

실험 4. 멀티플렉서와 디멀티플렉서( Multiplexer & Demultiplexer) 예비보고서● 이론(1) multiplexer멀티플렉서(이하 먹스, MUX)는 여러 개 ... 의 입력 중 원하는 입력을 출력으로 내보내는 일종의 데이터 선택기(switch or selector)이다. 이것은 완전하게 결선된 회로 상태에서 원하는 데이터 입력원(input s ... , DEMUX)는 먹스와 반대의 기능을 한다. 즉 한 개의 입력을 여러 개의 출력 중 하나에 연결하는 회로가 된다. 다음의 그림은 1x4 디먹스의 회로도와 진리표이다.선택입력출력S1S

리포트 | 7페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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[A+ 결과보고서] 아주대 논리회로실험 실험6 '래치와 플립플롭'

과 Reset값이 일치하는걸로 보아 회로 연결에는 문제가 없었던것같다.실험 2 D F/F(Gate 이용)- R-S F/F의 변형- 입력값이 출력값이 된다.DCQ(t)010111x0Q(t ... 과 Reset의 값이 이론적인 값과 일치하였다. Set값과 Reset값이 일치하는걸로 보아 회로 연결에는 문제가 없었던것같다.실험 4 J-K F/F(Gate 이용)- J와 K가 1이 ... 실험목적-여러 종류의 flip-flop을 구성하여 그 동작 특성을 알아본다.-R-S Flip-Flop과 그의 변형형은 D F/F, J-K F/F를 구성해보고 동작특성을 이해해본다

리포트 | 5페이지 | 1,000원 | 등록일 2015.03.27

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[A+ 결과보고서] 아주대 논리회로실험 실험5 'Decoder & Encoder'

.실험1실험2-예비보고서 결과와 실제 실험결과와 이론적으로 나오는 결과값이 일치하였다. 사실 이 실험은 어떠한 양을 측정하는 실험이 아니고 단순히 회로도에 입력을 가했을 때, 생기 ... 는 결과가 명확히 정해져 있는 실험이므로, 실험값이 예비보고서와 이론적인 결과값이 같을 경우에는 실험진행시 회로를 올바르게 구성했다는 것 밖에 분석할 수 없는것같다.●Encoder실험 ... 결과값과 비교분석실험3실험4-예비보고서 결과와 실제 실험결과와 이론적으로 나오는 결과값이 일치하였다. 사실 이 실험은 어떠한 양을 측정하는 실험이 아니고 단순히 회로도에 입력을 가했

리포트 | 5페이지 | 1,000원 | 등록일 2015.03.27

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논리회로설계실험 프로젝트_digital door rock

과 목 : 논리회로설계실험과 제 명 : 프로젝트 결과보고서(P_6조)담당교수 : 조준동 교수님학 과 : 전자전기공학과학 년 : 3학년학 번 : 2006312687 ... , 2006312117이 름 : 서 영 진, 김 현 기학 번 : 2007310623, 2007313531이 름 : 정 광 수, 손 계 익제 출 일 : 2011. 6. 2111_1학기_논리회로설계 ... 실험 프로젝트 결과보고서 제출 (P_6조) - Digital Doorlock43 -Digital Doorlock 설계1. Digital Doorlock의 개요☞ 주변에서 흔히 볼 수

리포트 | 44페이지 | 4,000원 | 등록일 2012.03.20

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[아주대] 논리회로실험 7장 예비(Shift Register)

, 74HC96, LED, 330Ω저항 PROCEDURES< 실험1 >위와 같이 J-K 플립플롭소자를 이용하여 6bit 시프트 레지스터 회로를 구성하고 clock신호에 따른 데이터 ... 의 이동을 관찰한다.< 실험2 >시프트 레지스터 소자인 74HC96소자를 이용하여 위와 같이 회로를 구성하고 clock generator를 사용하여 데이터의 이동을 관찰한다. 출력 ... Experiment 7 Shift RegisterOBJECTIVES- 실험을 통해 시프트 레지스터의 특성과 동작 원리를 이해하고 flip-flop소자를 이용해 구현해보아 원래

리포트 | 6페이지 | 2,000원 | 등록일 2013.09.25

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논리회로) 자판기를 제어하는 조합 논리회로설계 (Pro_VSM 시뮬, 진리표, 실험사진)

1. 실험 제목 : 자판기를 제어하는 조합 논리회로설계2. 실험 목적 : 조합 논리회로를 이용해서 음료수 자판기를 직접 설계한다.3. 실험 내용 600원 짜리와 700원

리포트 | 1페이지 | 1,500원 | 등록일 2013.06.09

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아주대 논리회로실험 실험2 결과보고서

윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2011.9.21과목명: 논리회로실험교수명 ... : 박성진 교수님분 반: 수 8.5~11.5학 번: 200820126성 명: 안효중< Chap.2 결과보고서 >[1] 실험 의의CMOS 회로를 구성해 입출력 특성을 알아본다. 입력 ... 것이다. 앞으로 할 실험에서는 회로도를 정확히 파악해서 전압을 측정해야 겠다는 생각을 했다.

리포트 | 7페이지 | 1,000원 | 등록일 2012.02.29

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아주대 논리회로실험 실험4 결과보고서

윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2011.10.5과목명: 논리회로실험교수명 ... 04 1개를 이용해서 멀티플렉서를 구성하는 실험이다. 회로도대로 IC를 빵판에 결선한다. 입력선으로는 2개의 선택입력(S0, S1), 1개의 enable(E), 4개의 데이터 입력 ... 멀티플렉서 기능을 하는 IC로써, 1번 실험과는 다르게 한 개의 IC로 멀티플렉서를 구성하였기 때문에 매우 간단하게 결선을 할 수 있었다. 입력선 들을 회로도대로 연결해주고 출력선

리포트 | 7페이지 | 1,000원 | 등록일 2012.02.29

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아주대 논리회로실험 실험6 결과보고서

윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2011.10.26과목명: 논리회로실험교수명 ... 을 통해 그 동작의 특성을 확인한다.[2] 실험 수행 과정① R-S F/FR-S F/F을 74HC00을 가지고 구성해 보는 실험이다. IC를 한 개만 사용하는 실험이라 회로도의 구성 ... (Gate 이용)실험 1과 유사하지만 약간은 다른 형태의 회로를 구성하였다. 이번에는 IC를 2개 이용했기 때문에 실험 1보다는 복잡했지만 그래도 크게 어렵지 않은 결선이었다. 회로

리포트 | 7페이지 | 1,000원 | 등록일 2012.02.29

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논리회로실험 -카운터 예비

실험8. 카운터① 목적2진 계수와 2진수 시스템에서의 숫자표시를 이해하고 2진 카운터에 대해 알아본다. 또, 비동기식카운터(Asynchronous Counter)와 동기식 카운터 ... (Synchronous Counter)에 대해 익히고, 여러가지 카운터의 구성 방법도 알아본다.② 이론2진 계수 회로는 모든 계수회로의 기본으로서 입력펄스는 LSB부터 차례로 채워 ... 지고 원하는 지수에 이르렀을 때는 회로 내의 모든 F/F의 출력이 0으로 환원된다. 만일 카운터가 n stage인 경우에는카운터 = Bn2n-1+Bn-12n-2

리포트 | 8페이지 | 1,000원 | 등록일 2010.03.20

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