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논리회로 전전설2 7400 산술논리연산회로 두더지 잡기 아날로그 FPGA 사칙연산 8비트 병렬 가산기 bcd to 7 segment 10진 ALU
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"논리회로결과" 검색결과 341-360 / 5,719건

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    디지털공학실험 8장 논리회로의 간소화 (결과)
    만 연결이 되어 있고, 다른것은 연결이 되어 있지 않다면 상식적으로는 Low레벨이 들어가야 하는데 이 회로는 마음대로 동작을 하게 된 것이다. 아마도 TTL논리레벨을 제대로 맞춰주 ... 은 식:X = D ( B + C )실험순서 5: 무효 BCD-코드 감지기 회로 :표 8-3 실험순서 6에서 구성한 무효 BCD-코드 감지기에 대한 진리표입 력출 력D C B AX0 ... 를 출력하게 되어 있기 때문에 전혀 불이 들어 올수가 없다.결과 및 토론이번실험의 목적은 진리표를 작성을 할수 있고, 카르노맵을 이용해서 표현식의 간소화를 할줄 알며, 간소화된 식
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    | 리포트 | 10페이지 | 2,500원 | 등록일 2010.04.06
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    아주대 논리회로실험 실험결과9 D/A & A/D Converter (DAC & ADC)
    을 통해 디지털 출력을 얻는 결과를 확인해 보는 실험이다. 회로도를 보면 실험1에서 사용한 D/A converter 회로에 출력을 OP-AMP를 한 단 더 거쳐 그OP-AMP ... 의 기준전압을 넘을때와 넘지않을때 이렇게 2가지로만 구분하여 출력하므로 그 결과값이 디지 털 값이되는 원리를 이용한 회로이다. 그리고 기준이 되는값 이상이면 1, 이하이면 0 이렇게 ... 를 이용하여 회로를 구성하였다. 그런데 우리는 회로를 다 구성한 후 결과를 확인했는데 원하는 결과값이 나오지 않아 소자도 바꿔보고 여러 문제점을 확인해본 끝에 결국 문제를 찾
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03
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    논리회로[예비레포트][결과레포트]
    (HA : Half Adder)반가산기는 [그림 1]과 같이 2개의 1 Bit 2진수 A, B를 더하여 그의 합(S)과 자리올림수(C)를 출력하는 논리 연산회로이다.반가산기의 진리표 ... , 논리식, 논리회로는 다음과 같다.< 그림 1. 반가산기의 블록선도 >InputOutputABSC*************101(a) 진리표(c) 논리회로도1-3 전가산기(FA ... 하는 3개의 비트를 가산할 수 있는 논리연산회로이다. 전가산기의 진리표, 논리식, 논리회로는 다음과 같다.< 그림 2. 전가산기의 블록선도 >InputOutputABCSCo
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2007.05.11
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    11_1학기_논리회로설계실험 프로젝트 결과보고서
    하려고 한다. 이를 위 해서 플레이어간 밸런스를 잘 맞추고 다양한 변수를 게임 내에 갖출 것이다.세 번째로 논리회로 설계 때 배운 내용들 내에서 설계하고자 하였다.결론 적으로 보 ... ongayer가 소지한 돈- pX_hotel : player가 소유한 호텔 개수- city_X : 후에 도시들의 소유 여부를 판별하기 위하여 설정하였다. 결과파형에서 어떤 도시가 어떤
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    | 리포트 | 52페이지 | 3,000원 | 등록일 2011.08.10
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    [논리회로실험] DAC and ADC Conv (결과)
    Ω, 4.7KΩ6) 오실로스코프3. 실험방법 및 결과(1) D/A converter1) 그림 4의 회로를 구성한다.그림 4. D/A converter ? Decade BCD2 ... 1. 실험목표1) D/A 컨버터와 A/D 컨버터 회로의 구성과 동작 원리에 대해 이해한다.2. 실험 장비 및 부품1) 저주파 함수 발진기2) DC 전원 : ±15V(2개)3 ... ) 논리 소자 : 7490, 7405, 74044) OP amp : 7415) 저항 : 500Ω(가변 저항), 11KΩ(2개), 1.5KΩ(5개), 10.5KΩ, 22.6KΩ, 4.5K
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    | 리포트 | 5페이지 | 1,500원 | 등록일 2009.03.20
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    결과보고서 // 3.기본적인 논리게이트 4.간략화기법과 다단논리회로
    논리게이트 소자들의 구조와 사용법에 대해서 익힐 수 있었던 실험이었다.회로를 구현하는것은 그리 어렵지 않았는데, 전선이 너무 복잡하게 얽히는 것이 실험을 헷갈리게 하는 방해요소 ... 진리표7402(NOR)소자 두개로 회로를 구성하였다.왼쪽은 입력010을 주었을 떄 불이 들어온 모습이고 오른쪽은 입력을 111로 주었을 때이다.*2주차 실험 결론 및 고찰여러가지 ... 였던것 같다.다음부터는 전선을 용도에 맞는 길이로 잘 정리하여 깔끔한 회로구성을 할 수 있도록 하여야 겠다.
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,000원 | 등록일 2010.11.17 | 수정일 2018.09.10
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    논리회로실험 디코더 결과보고서
    정보로 바꿔 주는 조합 회로를 말한다. 일반 적으로 디코더는 n개의 입력선과 최대 2n개의 출력선을 가지며, 입력 값에 따라 선택된 하나의 출력선이 나머지 출력선
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2008.01.14
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    [A+ 결과보고서] 아주대 논리회로실험 실험10 'D/A & A/D converter'
    실험 10. 결과보고서1.실험목적.-DAC와 ADC 회로의 구성과 동작 원리에 대해 이해한다.-주파수 발생기를 이용하여 DAC를 실험하고 다양한 조건에서의 파형을 관찰한다.-주파 ... 수 발생기를 이용하여 ADC를 실험하고 다양한 조건에서의 파형을 관찰한다.2.실험결과실험1. DAC계단파형 확인(1KHz) Rf=4.5kΩ계단파형 확인(1KHz) Rf=2.7k10 ... 한모양의 계단파형이 나타날 수밖에 없다.●예비보고서 SPICE 결과값 비교실험1single pulse1KHz1KHz, Rf = 2.7KΩ1KHz, Rf = 4.7KΩ, 다음핀 개방
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2015.03.27
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    [논리회로실험]실험1결과보고서 Basic Gates
    gate에서는 하나의 AND gate와 하나의 NAND gate를 이용하여 회로를 구성하여 출력 논리값을 얻었다. 3-input NOR gate는 하나의 OR gate와 하나 ... (a)를 보면 X와 Y의 결과값이 같음을 확인 할 수 있다. 밑의 (b)를 보면 X,Y값이 완전히 반대인 것을 확인할 수 있는데 이는 (b)회로 X나 Y에 NOT gate 한 개 차이로 정 반대의 값이 나온 것으로 확인된다. 편하게 (a)로 드 모르간 법칙을 설명하려지만 ... 3-input AND gate인데, A,B두 입력이 AND gate로 들어가 그 출력값과 C값이 AND gate로 들어가 그 출력을 구하는 실험이
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2010.04.12
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    논리회로실험 - 제 9장 KIT의 출력방식 중 하나인 LCD display 결과보고서
    과 목 : 논리회로설계과 제 명 : 결과보고서 9담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 6 / 31 ... . IntroductionVHDL의 순차 논리 회로 설계에서 KIT의 출력방식 중 하나인 LCD display에 대해서 이론적으로 공부해보고 이를 KIT에 올려서 실습해보는 실험이다. LCD는 5*8 ... 를 해 보도록 한다.2. Design(1)어떠한 회로를 설계할 것인가 1)1)LCD ModuleLCD Module은 디스플레이 장치의 하나로 간편하면서 손쉽게 쓸 수 있는 표시 장치이
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    | 리포트 | 22페이지 | 1,000원 | 등록일 2014.08.15
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    [아주대] 논리회로실험 10장 결과(DA & AD converter(DAC & ADC))
    기를 이용하여 계단 파형(1KHz)이 나오는지 관찰하고 파형을 그려라.< 실험1 > 실험 결과 사진구성한 회로 사진Rf=1.5k OMEGA Rf=2.7k OMEGA실험1은 위 ... 되었는지 DAC output을 오실로스코프를 이용하여 관찰하였다. 결과 값이 처음에는 계단 형 파형이긴 한데 사이사이에 값이 최하로 떨어지는 값이 나와 계속 수정하다가 회로의 IC소자 ... 한 전압PROCEDURES & RESULTS위 사진에서 볼 수 있듯이 기본적인 회로에 공급한 공급전류원은 5V DC 전압을 사용했다. 하지만 OP amp에 공급한 전압은 15V DC
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    | 리포트 | 7페이지 | 2,000원 | 등록일 2013.09.25
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    2장 논리회로와 간략화 실험결과 및 3장 오픈컬렉터와 3상태 버퍼
    실험 2. 논리회로의 간략화 결과 레포트(a) NOT 게이트PSPICE 시뮬레이션 결과*실험결과*AY0110(b) AND 게이트PSPICE 시뮬레이션 결과*실험결과*ABY ... 000010100111(c) OR 게이트PSPICE 시뮬레이션 결과*실험결과*ABY000011101111(d) NOR 게이트PSPICE 시뮬레이션 결과*실험결과*ABY ... 001010100110(a) NOT 게이트PSPICE 시뮬레이션 결과*실험결과*AY0110(b) OR 게이트PSPICE 시뮬레이션 결과*실험결과*ABY000011101111(c) AND 게이트
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    | 리포트 | 10페이지 | 2,000원 | 등록일 2012.12.10
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    논리회로 실험 Bistable or flip-flop[예비 + 결과] 레포트
    한다. 다. J-K 마스터-슬레이브 플립플롭의 동작특성을 이해한다2. 기본 이론(배경 이론) 플립플롭이란 Clock 신호에 의해 입력신호에 의한 출력을 얻을 수 있는 회로 ... 로 CLK이 인가되기 전에는 전에 상태를 그래도 유지하는 기억회로이다. 또, 플립플롭의 입력 신호가 교류 결합 회로를 통하여 인가되는 형식의 것을 교류 결합 플립플롭, 직류 ... 결합 회로를 통하여 인가되는 형식을 직류 결합 플립플롭이라고 한다. 클록 펄스 입력 단자로 클록에 동기시켜 입력 신호를 주는 동기식의 플립플롭과 클록을 이용하지 않고 입력 신호
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2011.03.28
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    논리회로실험 - 제 7장 3비트 updown counter로 binary와 gray 코드로 설계 결과보고서
    과 목 : 논리회로설계과 제 명 : 결과보고서 7담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 5 / 221 ... . IntroductionVDHL의 순차 논리 회로 설계에서 Mealy machine과 Moor machine을 이해하고 이를 3비트 up/down counter로 binary와 gray 코드 ... 로 설계한다.2. Design(1)어떠한 회로를 설계할 것인가 1)1)FSMFSM이란 Finite state machine의 약자로 일정한 천이 가능한 상태 내에서만 동작하는 순차 논리
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    | 리포트 | 20페이지 | 1,000원 | 등록일 2014.08.15
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    논리회로실험 - 제 3장 4bit Carry Lookahead Adder를 이용한 가산기 설계 결과 보고서
    과 목 : 논리회로설계과 제 명 : 결과보고서 3담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 4 / 101 ... 번에 모든 비트를 계산하는 방법을 설계해보도록 한다. 4bit Carry Lookahead Adder를 이용하여 가산기를 설계해 본다. 설계한 후 이론값과 결과값을 비교하여 설계 ... 가 제대로 되었는지 확인해본다.2. Design(1)어떠한 회로를 설계할 것인가-4bit Carry Lookahead Adder1)우리가 오늘 설계할 가산기이다. 크게 세 가지
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    | 리포트 | 17페이지 | 1,000원 | 등록일 2014.08.15
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    전자공학실험1 실험4장 결과보고서 : 논리게이트의 특성 및 연산회로
    결과보고서전자공학실험논리게이트의 특성 및 연산회로조원 :담당교수 :실험일자 : 2012.4.6제출일자 : 2012.4.13.1.실험목적논리게이트는 디지털 회로를 구성하는 기본 ... 아야 하지만, 측정값의 오차나, 가변저항값의 오차가 커서 이러한 결과가 나왔다.5) 실험 7에서 구성한 회로의 논리식을 각각 구하라. 실험 결과로 얻은 진리표를 통하여 두 논리식이 등 ... 단위이다. 논리게이트(TTL 74LS04) 입출력의 전기적 특성을 실험을 통해 알아본다. 그리고 논리식을 조합논리회로로 구현하고 실험을 통해 진리표를 얻어 본다.2.실험내용2.1
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2013.01.31
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    디코더&인코더 에 관한 논리회로 실험 결과 보고서
    의 정수를 카운터 할 수 있는 회로 구성이다. 위 결과 그래프에서 A는 CLOCK의 2주기가 한주기 이며, B는 CLOCK의 3주기가 한주기가 된다는 것을 알 수 있는데①구간을 보 ... 면 BA②구간 BA③구간 BA00:0 01:1 10:2가 나왔고, 그 이후에도 순차적으로 반복한다는 것을 알 수 있었다. 시뮬레이션에서의 결과가 나왔기 때문에 이 회로는 정상적인 동작 ... 까지 반복해보니 (표-2)와 같은 결과 값이 나왔는데, 이는 예상한 이론치와 일치 했다는 것을 확인 할 수 있었다.(2) 7segment 표시기를 갖는 BCD카운터⇒이 회로는 7490과
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2010.11.30
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    아주대 논리회로실험 결과5-래치와 플립플롭
    .98V)1(4.97V)? 실험 결과 Truth table※ 동작 원리R-S latch회로에서는 SR = 00일 때, 회로의 출력은 변하지 않고 Q(t-1)값을 갖으며 SR = 01 ... (2)에서 구한 J-K F/F을 구성한 뒤 출력을 측정하고 결과를 검토하라. 또 이결과를 7476 칩에 대한 측정 결과와 비교하라.< J-K F/F 회로도> < 74HC76 칩 ... -1)Q(t-1)`0101101011Q(t-1)`Q(t-1)? 실험 결과 Truth table (7476)※ 동작 원리J-K F/F은 R-S F/F를 보완한 회로로 R-S F/F
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2010.04.04
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    [논리회로실험]실험5결과보고서 래치와 플립플롭
    >( S = 1 , R = 0 ) ( S = 1 , R = 1 )이번 실험은 S-R latch 회로의 결과 논리값을 확인하였는데 먼저 S-R latch회로의 동작 원리는 S입력 ... 은 값을 가진다. 논리값의 변화를 보기 위하여 클럭 입력을 1로 하게 되면 위의 회로와 같은 결과값을 가지게 된다. 간단히 동작 원리를 보면 워크 밴치 시뮬레이션에서 클럭 입력 값 ... 하였다. 이는 서로 보수 값을 가지는 출력값인데 논리값을 1로 가지는 것을 확인하였다. 이렇기 때문에 S-R latch회로에서는 두 입력값이 모두 1인 회로를 구성할 수 없다. 또한
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2010.04.12
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    논리회로실험 스텝모터 결과보고서
    를 좁혀주고 test bench의end time을 3000ns까지 잡았다.3. 결과 검토 및 의견이번 학기에 논리회로 과목을 듣는중이라 아직 클럭과 순서논리회로의개념이 잡히지 않 ... 실험제목 : 스텝모터(결과보고서)? 목 차1. 예비조사 및 실험 내용의 이해1.1 스텝모터의 의미1.2 스텝모터의 특징2. 실험내용 및 결과2.1 1상 여자방식2.1.1 s ... . 결과 검토 및 의견1. 스텝모터1.1 스텝모터란?스텝 모터는 일정한 각도씩 회전 또는 직선 운동을 하는 디지털엑추에이터라 할 수 있다. 일반적으로 회전 운동을 하는 경우 스텝 모터
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2008.01.14
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2025년 12월 05일 금요일
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