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논리회로 전전설2 7400 산술논리연산회로 두더지 잡기 아날로그 FPGA 사칙연산 8비트 병렬 가산기 bcd to 7 segment 10진 ALU
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"논리회로결과" 검색결과 281-300 / 5,719건

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    논리회로실험 결과보고서11 D/A & A/D converter (DAC & ADC)
    10. D/A & A/D converter (DAC & ADC)실험 과정 및 결과Part 1. DAC(a) (b) (c-1)(a) 주파수 발생기를 이용하여 계단 파형(1KHz ... 한다.(d-1) 68KΩ을 병렬로 연결한 경우(d-2) 68KΩ을 제거한 경우(d-2)Part 2. ADC(a) Part 1의 회로 출력에 위의 비교기를 추가한다.(b) 주파수 발생기 ... /A와 A/D 변환기 회로의 구성과 동작 원리에 대해 이해하는 것이었다. 74HC90, 74HC04, 74HC05를 이용하여 D/A와 A/D 변환기 회로를 구성해보았고, 각 IC칩
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    | 리포트 | 4페이지 | 1,500원 | 등록일 2017.03.09 | 수정일 2017.05.30
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    아주대 논리회로실험 Multiplexer & Demultiplexer 결과보고서
    논리회로실험 결과보고서실험4. Multiplexer & Demultiplexer실험 1) MultiplexerEnable 입력을 갖는 4x1 멀티플렉서를 74HC20과 74HC ... 04를 이용하여 위의 회로를 구성실험 1 결과값INPUTOUTPUTES1S0D3D2D1D0Y1XXXXXX00011100 ... IC인 74HC153을 이용하여 위의 회로를 구성실험 2 결과값INPUTOUTPUTES1S0D3D2D1D0Y1XXXXXX
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 1,000원 | 등록일 2013.11.29
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    [아주대] 논리회로실험 5장 결과(Decoder & Encoder)
    1과는 반대로 끼고V _{cc}에 연결해주어L일 때 불빛이 나도록 출력 단에 연결하여 결과 값을 측정하였다. 역시 소자하나로만 구성된 회로여서 실험에는 별 어려움이 없었다.실험 전 ... 결과 아래의 사진에서 볼 수 있듯이 예측 값에 부합하는 결과가 나왔다.< 실험3 > 실험 결과 사진①②③④⑤⑥10진수를 excess-3 코드로 만들어주는 회로였으며 입력 단을 10 ... 이 출력되어 이 실험도 예상결과에 부합하는 실험이었다.< 실험 4 >회로도사진번호INPUTOUTPUTEIS _{0}S _{1}S _{2}S _{3}S _{4}S _{5}S _{6}S
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    | 리포트 | 7페이지 | 2,000원 | 등록일 2013.09.25
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    [아주대] 논리회로실험 4장 결과(Multiplexer & Demultiplexer)
    듯이 예측 값에 부합하는 결과가 나왔다.< 실험1 > 실험 결과 사진②③④⑤⑥⑦⑧⑨위의 회로는 NAND gate가 4개였으므로 4개의 출력 중 하나를 선택해 내보낼 수 있는 4x1 ... 다.< 실험2 > 실험 결과 사진②③④⑤⑥⑦⑧⑨구성한 회로는 위와 같았으며 4x1 Multiplexer소자 하나에다 입력만 가해줬으므로 회로의 구성도 굉장히 쉬웠으며 소자의 고장 ... 와 NAND로 구성한 회로와 결과는 차이가 없기 때문에 1과 같은 실험값을 얻을 수 있었다. 실험1회로와 실험2의 Logic diagram에서 Enable이 0일 때 작동하게 하면 따로
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    | 리포트 | 7페이지 | 2,000원 | 등록일 2013.09.25
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    논리회로실험 실험3 Adder & Subtracter 결과보고서
    4주차 결과보고서실험 3 Adder & Subtracter▶실험과정 및 결과◈ 실험 1 : 반가산기(Half adder)구성 사진 :- 결손도를 참고하여 회로를 구성하였다. ... 이 2 개뿐이기 때문에 비교적 회로가 간단하다.◈ 실험 2 : 전가산기(Full adder)회로구성 사진 :- 결손도를 참고하여 회로를 구성하였다.- led를 이용하여 결과를 쉽 ... 게 측정할 수 있다.- 반가산기 두개와 OR게이트도 사용하기 때문에 반가산기의 회로구성에 비해서 확연히 회로가 복잡하다.- 아래 led가 S이며 위의 led는 Co이다.실험 결과
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08
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    논리회로실험 실험4 Multiplexer & Demult 결과보고서
    하여 회로가독성을 향상시켰다.실험 결과 :예상 결과실험결과입력출력출력ES1S0D3D2D1D0YLED+5VXXXXXX000+5+5+500000000+5100+5+5+50+5000+500 ... 연결하여 회로가독성을 향상시켰다.실험 결과 :예상 결과실험 결과입력출력출력DS1S0Y3Y2Y1Y0LED0XXXXXX+5000001+50+50010+5+500100+5+5+51000 ... 다.- 이 회로에서는 입력신호가 Enable과 같이 작동하였다. 결과를 살펴보면 입력신호가 low일 때 어떤 출력도 high를 나타내지 않는다. 또 입력신호가 high일 때 한 출력
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08
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    논리회로실험 실험5 Decoder & Encoder 결과보고서
    에 5V와 접지를 모두 연결하여 회로가독성을 향상시켰다.- GS와 E0는 왼 쪽에 따로 구분하여 회로를 구성했다.실험 결과 :예상 결과실험 결과입력출력출력SW0SW1SW2SW3SW4 ... 에 따라서 출력이 변화했는데 2진수의 수와 같이 각 SW에 따라서 출력이 결정 되었다.실험결과 이 회로는 두 자리 2진수 입력을 10진수로 디코딩하는 디코더로 정상 작동하는 것을 알 ... 결과를 10개의 LED로 나타내는 회로이다.LED의 수가 많아서 소자배치와 정리정돈에 힘써 구별하기 쉽게 설치하였고, 도선을 서로 구분하기 쉽도록 양쪽 수직노드에 5V와 접지
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08
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  • 자료 표지
    [A+ 결과보고서] 아주대 논리회로실험 실험1 'Basic Gates'
    으로써 간단한 실험이지만, 앞으로 논리회로실험을 할 때 중요한 내용을 포함하는 실험이었다. 이번 실험에서 사용되었던 IC는 AND, OR, NOT 3종류 뿐이었지만, 이 3종류를 이용 ... 된 logic 회로에서의 Boolean equation과 De Morgan의 이론에 대하여 알아본다.- 2-input logic gate를 이용하여 3-input logic gate ... 를 구성한다.2. 실험수행실험11) 그림 1과 같이 2-input AND gate를 2개 이용하여 3-input AND gate를 구성하고 각각의 입력에 대한 출력의 결과를 토대
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2015.03.27
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    [A+ 결과보고서] 아주대 논리회로실험 실험7 'Shift Register'
    right register-예비보고서 결과와 실제 실험결과와 이론적으로 나오는 결과값이 일치하였다. 사실 이 실험은 어떠한 양을 측정하는 실험이 아니고 단순히 회로도에 입력을 가했 ... 을 때, 생기는 결과가 명확히 정해져 있는 실험이므로, 실험값이 예비보고서와 이론적인 결과값이 같을 경우에는 실험진행시 회로를 올바르게 구성했다는 것 밖에 분석할 수 없는것같다.실험 ... 가 전혀 상관없이 다르게 나왔다. 실험1에서 SPICE의 예상결과값이 문제가 없었던 것을 감안한다면, 시뮬레이션세팅에서는 문제가 없는 것 같다. 또한 회로도 강의노트에 나와있는데로 구성
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2015.03.27
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    [논리회로실험] Basic Gates (결과)
    3 (a)와 (b) 회로를 구성한 후 각 점(X, Y, U, V, W)의 값을 측정하여 입력에 대한 결과의 표를 만든 후 이 결과를 이용하여 De Morgan's theorem ... 위 회로를 분석하면이고이고 실험결과 X와 Y의 값이 같으므로 드모르간 법칙이 성립한다고 할 수 있다.나) 실험 B(b)구성한 회로도INPUTOUTPUTABCXYUVW ... gate의 logic diagram구성한 회로도INPUTOUTPUTABX000011101110Truth Table6) 그림 4와 같이 각각의 회로를 구성한 후 그 결과를 측정
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    | 리포트 | 11페이지 | 1,500원 | 등록일 2009.03.20
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    논리회로실험 - 제 6장 VDHL의 순차회로 중 shift를 설계 결과보고서
    과 목 : 논리회로설계과 제 명 : 결과보고서 6담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 5 / 151 ... . IntroductionVDHL의 순차회로 설계에서 Latch vs. Flip-Flop(FF), DFF, Synchronous reset vs. Asynchronous reset, Signal ... hifter가 있고, 이 3개의 shift종류를 코드를 구성하고 이를 KIT에 적용시켜 본다.2. Design(1)어떠한 회로를 설계할 것인가 1)1)Latch vs. Flip
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    | 리포트 | 15페이지 | 1,000원 | 등록일 2014.08.15
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    [논리회로실험] decoder와 encoder (결과)
    egment LED 1개3. 실험방법 및 결과1) 2단 2진 카운터그림 2. 2단 2진 카운터 decoding gate그림 2의 회로를 구성하여 그림 3에 다음의 파형을 그리 ... gate의 6번 핀 출력파형그림 3. 2단 2진 카운터 실험의 waveform2) 3진 카운터이 실험에서는 카운터 각각의 카운트 상태를 디코딩할 것이다. 그림 4의 회로를 연결 ... 는가를 점검해 보자. 이를 위해서 디코딩 게이트의 입력을 하나씩 제거하면서 출력을 관찰하여 변화가 있으면 그 입력은 필요한 것이고 다시 연결하여야만 한다. 이 결과를 표 1에 기록
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    | 리포트 | 7페이지 | 1,500원 | 등록일 2009.03.20
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    논리회로실험) 부울대수의 간소화(2) 결과보고서
    하다는 점이 있었고 , 그 결과 값은 두 식이 서로 같다는 결론이 나왔다 .2 . 실험 고찰1 . 아래의 회로도와 같은 결과 값이 나오는 부울 식을 완성하고 , Verilog HDL ... 로 변환하여 Quartus II 와 ModelSim을 참고해서 결과 값 확인1 ) 고찰 1 회로를 부울 식으로 고치시오.F = ( AㆍB' ) + ( A'ㆍB )2 ) 고찰 1 ... 의 부울식을 Quartus II Verilog HDL을 이용하여 구현하고, F와 S의 결과 값이 서로 일치 하는지 ModelSim과 Quartus II를 이용해서 증명한다.1 ) f
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    | 리포트 | 10페이지 | 2,000원 | 등록일 2014.01.06
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  • 자료 표지
    논리회로실험) 부울대수의 간소화(1) 결과보고서
    ) 라는 두 개의 부울식을 Quartus II Schematic을 이용하여 구현하고, 두식 F 와 S의 결과 값이 서로 일치하는지를 증명한다 .[ 사진 ] F = AB' + A'B'C ... ]YSW[2]CLEDG[0]F[ 표 ] FPGA Pin number[ 사진 ] FPGA Start Sucessful* ①FPGA 결과 값 확인[ 사진 ] FPGA 결과 값 확인 ... * Pin 설정에 따른 Input 에 ( A:1 , B:0 , C:0 )을 입력 했을 때와 ( 입력 스위치 위로 )Output 결과 ( X:1 , Y:0 , F:1) 값이 나타났
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    | 리포트 | 9페이지 | 2,000원 | 등록일 2014.01.06
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    아주대 논리회로실험 가산기, 감산기 결과보고서
    논리회로실험 결과보고서실험3. 가산기 & 감산기실험 1) 반가산기 회로를 구성XOR(IC 7486) gate 와 AND(IC 7408) gate 이용입력출력xyCS0 ... *************10실험 1 반가산기 결과값(결과는 LED를 이용하여 확인함)실험 1은 반가산기를 구성하는 실험이었다. 반가산기 회로는 2진수 덧셈에서 맨 오른쪽 자리 계산을 위해 사용 ... 2개의 비트 A와 B를 더해 합 S와 자리올림 Co를 출력하는 조합 회로이다. C출력에 불이 들어오면 올림수가 존재한다는 것이므로 예를 들어 출력이 C;1 S:0 이 나왔다면 결과
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2013.11.29
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  • 자료 표지
    RAM에 관한 논리회로 실험 결과 보고서
    수 있었다.ⅱ) 스위치조작 실수로 인한 잘못된 측정이 많이 있었다.ⅲ) WRITE과 READ 스위치의 조작에 신경을 써야 할 것 같다. 순서를 바꾸어 조작하면결과 값이 상이
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    | 리포트 | 3페이지 | 3,000원 | 등록일 2010.11.30
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    [논리회로실험] CMOS회로의 전기적 특성(결과)
    04N 2개, Schmitt trigger inverter TI SN74HC14 1개6) 1㏀ 1개3. 실험방법 및 결과1) Logic Levels & DC Noise ... Margins(1) DC 전원공급기는 VIN과 VCC를 위해 2개 채널을 모두 사용한다. 첫 단계로 VCC = 4.5V, VIN = 4.5V로 설정하여 다음과 같이 회로를 구성한다.구성 ... 한 회로도구성시 참고사항▶ 실험에 사용되는 1번,2번,7번,14번을 제외한 나머지 입력에 대하여 풀업/풀다운처리하였다.(2) 오실로스코프에 프루브 2개를 설치한 다음 CH1,2 VDIV
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2009.03.20
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  • 자료 표지
    CONVERTER에 관한 논리회로 실험 결과 보고서
    CONVERTER 회로의 OPAMP 출력에다가 741C 비교기를 연결하고, 또 가변저항을 연결한다. 그리고 D/A 출력전압값이 가변저항에 걸리는 전압보다 우세할 경우는 +15V를 가변
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2010.11.30
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    아주대 논리회로실험 실험결과4 멀티플렉서와 디멀티플렉서(Multiplexer & Demultiplexer)
    하여 1x4 디멀티플렉서를 구성하여 본 결과 enable 단자에 0V(low)를 주면 S0,S1에 상관없이 Y0~Y3의 모든 값이 0V이 나와 회로가 off 상태가 됬고 enable ... 멀티플렉서 IC인 74HC139소자를 이용하여 회로 구성하여 본 결과 이번에 는 2-(1) 실험과는 다르게 enable 단자에 5V(High)를 주면 S0,S1에 상관없이 Y0~Y3 ... 는 1x4 디멀티플렉서의 이론적인 결과값과 정확히 일치하여 위 회로들이 디멀티플 렉싱 기능을 정확히 수행하는 것을 확인 할 수 있었다. 그리고 74HC139소자의 입출력핀에 반전버블
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03
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    기본논리회로 실험 사전 결과 보고서
    기본 논리회로기본 논리회로1. 목적: 기본적인 논리회로 AND, OR, INVERT, NAND, NOR 회로에 대해서 알아본다.2. 실험장치: 오실로스코프 1개 직류전원(+5V ... ) 1개 IC 7400, 7402, 7408, 7420, 7432, 7451, 7468 각1개.3. 이론 ⑴논리 회로란? : 전압신호는 덧셈과 뺄셈과 같은 수학적 논리 연산이 전자 ... 과 같이 2진수 시스템을 사용하게 됩니다. 이러한 2진수 시스템 정보의 처리는 게이트(Gate)라고 불리는 논리 회로에서 처리 됩니다. 게이트는 입력 논리의 특정 조건을 만족할 때
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    | 리포트 | 19페이지 | 2,000원 | 등록일 2010.09.12
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2025년 12월 05일 금요일
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