"논리회로결과"의 검색결과 입니다.

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논리회로 전전설2 7400 산술논리연산회로 두더지 잡기 아날로그 FPGA 사칙연산 8비트 병렬 가산기 bcd to 7 segment 10진 ALU

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"논리회로결과" 검색결과 261-280 / 5,723건

논리회로실험 실험1 basic gate 결과보고서

2주차 결과보고서실험 1 Basic Gates▶실험과정 및 결과◈ 실험 1 [3-Input AND Gate 과정]- 예비보고서에 작성한 결선도와 같이 회로를 구성하였다.- 74 ... 였지만 3-Input NAND Gate에 맞는 결과가 나오지 않는다는 것을 알게 되었다.따라서 결선도를 수정하여 AND게이트와 NAND게이트를 사용하는 새로운 회로를 설계 ... 의 출력에 NOT gate만 붙이려 했으나 회로가 복잡하다고 생각했고 AND게이트와 NAND게이트를 사용한 방법을 생각할 수 있었다. 같은 결과를 나타낼지라도 회로가 단순하고 경제

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| 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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논리회로실험 실험10 converter 결과보고서

진 BCD카운터를 사용하였다. 따라서 파형은 10개의 표현형을 가지며 9번 떨어지는 계단 파형을 가진다.실험결과 파형은 음의 방향으로 10단계로 증가하는 전압을 나타냈다.실험회로 ... 11주차 결과보고서실험 10 D/A & A/D converter▶실험과정 및 결과◈ 실험1 - DAC구성 사진 :- 74HC90, 74HC04, 74HC05, LM741, 가변 ... 저항을 사용하여 DAC회로를 구성하였다.- 74HC05는 open drain으로 작동한다.- Op amp의 역할 : 반전가산증폭기 카운터의 digital 출력에 따라 입력 전류의 크

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| 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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논리회로실험 실험8 counter 결과보고서

적으로 점등하는 결과를 얻었다.- 3진 회로이기 때문에 표현형이 3개로 3가지의 경우만이 출력된다. 따라서 예비보고서의 예상은 4가지를 나타내기 때문에 성립할 수 없었다.- 1Hz ... 9주차 결과보고서실험 8 Counter▶실험과정 및 결과◈ 실험 1 : 2단 2진 Counter ? 비동기식 Counter? 구성 사진 :- 74HC76을 이용하여 2단의 2진 ... 카운터를 결손도에 설계하고 설계를 참고하여 브레드보드에 회로를 설치한다.- 2단 2진 카운터의 출력은 AND게이트를 사용하여 나타내려고 했으나 실험부품이 없어서 4개의 NAND

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| 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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아주대 논회실 논리회로실험 실험1 결과보고서

00101101110101011111-실험결과를 토대로 작성한 Truth table:이 회로의 Boolean equation은 X=A+(A’·B)’, Y=A+B, Z=(A’·B)’ 이다. 이 회로를 구성 ... 지만 이 세 개의 게이트로 NAND gate, NOR gate를 포함한 여러 가지 논리회로를 구성할 수 있었다.실험1)에선 두 개의 입력 값을 받는 게이트를 이용하여 세 개의 입력 값 ... 을 받는 논리회로를 구성하는 실험이었다. 한 개의 IC에는 네 개의 게이트가 포함되어 있으므로 논리회로에 사용되는 게이트의 종류가 같으면 한 개의 IC만으로도 여러 가지 회로를 구성

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| 리포트 | 6페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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아주대 논회실 논리회로실험 실험5 결과보고서

1. 실험 과정 및 결과-실험결과 기록 및 정리-2x4 Decoder이 회로를 브레드보드에 구현한 결과S1=0 S2=0 S1=0 S2=1S1=1 S2=0S1=1 S2=1S1S2D ... 1D2D3D*************100100111000:실험 결과가 예비보고서의 실험 예상과 일치한다. 2x4 Decoder는 2개의 입력을 받아 4개의 출력을 나타내는 회로인데 ... 로 나타내는데 사용할 수 있을것이다.-BCD to Decimal Decoder이 회로를 브레드보드에 구현한 결과S1=0 S2=0 S3=0 S4=1S1=0 S2=0 S3=1 S4=1

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| 리포트 | 9페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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아주대 논회실 논리회로실험 실험9 결과보고서

1. 실험 과정 및 결과-실험결과 기록 및 정리-DAC위 회로를 브레드보드에 구현한 결과실험 결과가 예비보고서의 실험예상과 일치한다. 이번 실험은 입력되는 펄스를 2진수 형태 ... 을 것이다. 또R _{f} 값을 4.5k OMEGA 에서 2.7k OMEGA 으로 바꿔 파형의 변화를 확인하였다.-ADC위에서 진행한 DAC회로 아래에 비교기를 부가하여 구현한 결과 ... 실험 결과가 예비보고서의 실험 예상과 일치한다. 이 실험은 위에서 실험한 DAC회로에 비교기를 추가한 실험이었는데, DAC 회로의 출력 값이 아날로그 파형을 보이기 때문에 여기

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| 리포트 | 7페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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아주대 논회실 논리회로실험 실험8 결과보고서

1. 실험 과정 및 결과-실험결과 기록 및 정리-2진 2단 Counter - 비동기식 Counter위 회로를 브레드보드에 구현한 결과실험결과가 예비보고서의 실험 예상과 일치 ... 의 클럭 입력에 연결시켜 앞단의 F/F에서 결과가 출력되면 그다음 F/F가 출력하는 방식으로 비동기식 Counter의 동작이었다.-3진 Counter - 동기식 Counter위 회로 ... Counter위 회로를 브레드보드에 구현한 결과실험 결과가 예비보고서의 실험 예상과 일치한다. 이번 실험은 74HC90을 이용하여 클럭 펄스에 따라 출력 값이 10진수로 표현할 때 0

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| 리포트 | 7페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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아주대 논회실 논리회로실험 실험2 결과보고서

1. 실험 과정 및 결과-실험결과 기록 및 정리실험 1) Inverter의 입출력 특성 확인이 회로를 브레드보드에 구성하고 오실로스코프로 입출력을 측정하는 모습실험 2 ... ) Schmitt-trigger의 입출력 특성 확인이 회로를 브레드보드에 구성하고 오실로스코프로 입출력을 측정하는 모습:실험1)과 실험2)는 NOT gate 논리소자를 74HC04 ... 실험에선 CMOS의 동작속도 중 전달지연(Propagation delay)를 확인하는 실험이었는데, 논리회로를 구성할 때 74HC04 IC에서 최대한 많은 NOT gate에 연결

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| 리포트 | 8페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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아주대 논회실 논리회로실험 실험6 결과보고서

1. 실험 과정 및 결과-실험결과 기록 및 정리- R-S F/F이 회로를 브레드보드에 구현한 결과S=0 R=1 C=1 S=1 R=0 C=1 S=1 R=1 C=1Q(t)=0 ... 가 0일 경우 입력 값은 출력 값에 영향을 주지 못한다.-D F/F위 회로를 브레드보드에 구현한 결과D=0 C=1 Q(t)=0D=1 C=1 Q(t)=1DCQ(t)010111x0Q ... 에 Q(t-1)인 경우 이전 출력 값을 출력하므로 C=0일 경우 이전 입력에 따라 출력 값이 결정된다.-J-K F/F위 회로를 브레드보드에 구현한 결과J=0 K=0 C=1 J=0 K

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| 리포트 | 9페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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아주대 논회실 논리회로실험 실험7 결과보고서

1. 실험 과정 및 결과-실험결과 기록 및 정리- 6bit Shift Right Register위 회로를 브레드보드에 구현한 결과PR1,2=0 Serial Data=0 CLR=0 ... 을 조정하여 기존에 회로에 저장된 값을 초기화하여 회로를 제어할 수 있었다. 시간에 따라 LED에 들어오는 출력 값이 하나씩 이동하는 결과를 확인하였다.-5bit Shift ... Right Register위 회로를 브레드보드에 구현한 결과SER=0 PE=0 CLR=0 A,B,C,D,E=1PE=1CLR=1 PE=0 클럭인가실험2는 실험1의 회로를 74HC96의 IC

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| 리포트 | 6페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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[디지털 논리회로 실험] 11장. 비동기식 RS 플립플롭 결과레포트

논리회로실험 A반결과12장비동기식 RS 플립플롭5조이름학번실험일15.05.12제출일15.05.12실험에 사용된 기기 및 부품 : HD74LS02P, HD74LS04P, HD74 ... LS00P실험 11.1 NOR 게이트를 이용한 비동기식 RS 플립플롭1. NOR 게이트를 이용하여 비동기식 RS 플립플롭을 구성한 회로도에 핀 번호를 작성하라.2. 다음과 같이 입력 ... ="11" 인 경우에는 출력 값을 결정할 수 없는 불확실(Unknown)상태가 된다.실험 11.2 NAND 게이트를 이용한 비동기식 RS 플립플롭1. 논리 게이트를 이용하여 비동기식

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| 리포트 | 2페이지 | 1,000원 | 등록일 2016.01.14 | 수정일 2017.10.17

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[디지털 논리회로 실험] 13장. 동기식 D, T 플립플롭 결과레포트

논리회로실험 A반결과13장동기식 D, T 플립플롭5조이름학번실험일15.05.26제출일15.06.02실험에 사용된 기기 및 부품 : 오실로스코프, HD74LS74AP, GD74LS ... 76AN,, 직류전원공급장치,디지털 실험장치, 전압계실험 13.2 D 플립플롭 응용(1) IC 7474를 이용한 지연회로의 회로도 이다. 회로도에 IC 핀번호를 작성하여라.(2 ... 력 Q=0이된다.실험 13.3 T 플립플롭 응용(1) IC 7476(Dual JK Flip-Flop)를 이용한 T 플립플롭의 회로도이다. 회로도에 IC핀 번호를 작성하라.(2) Q

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| 리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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아주대 논리회로실험 실험결과8 RAM(Random Access Memory)

를 그레이 코드로 변환시키는 회로에도 사용 할 수 있다.이러한 RAM실험을 내가 직접 한다는게 신기했고 과연 결과가 잘 나올까 걱정도 됬지만 역시 지난 실험들처럼 이번 실험에서도 성공 ... 적인 결과를 얻을 수 있었다. 처음에 회로를 다 구성하고 나서 원 하는 램의 기능이 잘 되지 않아 문제점을 찾고 있었는데 문제는 내가 구성한 스위치 들에 문제가 있 었다. 내가 1이 ... 실험 8. R A M 결과보고서● 실험 결과 분석실험 1. 2-bit RAM (시뮬레이션 대체)실험 2. 64-bit IC RAM-type 74897489 IC를 이용하여 구성

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| 리포트 | 4페이지 | 1,000원 | 등록일 2014.10.04

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논리회로실험 결과보고서

t..FILE:논리회로 실험보고서(예비,결과) 다 있음/logiclabunit.ppt..PAGE:1Logic Lab Unit: ED-1000B(1)실험 소자 (IC 칩) 를 꽂 ... 으로 연곱의 논리합과 합의 논리곱 형태 회로 실험 결과입 력출력 FABCD곱의 논리합합의 논리곱000 ... 이 있기 때문이다...FILE:논리회로 실험보고서(예비,결과) 다 있음/실험 3(예비2).hwp③ 여러분들이 구한 곱의 논리합 회로는 NAND 게이트만의 회로로, 그리고 합의 논리

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| 리포트 | 14페이지 | 4,000원 | 등록일 2009.12.10

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자판기 베릴로그코드 테스트벤치(testbench) 포함 / Vending machine / Verilog code / 베릴로그코드 설명 결과보고서 포함 / ASIC 설계 / 논리회로 / 디지털 설계

가격이 1000원 및 1500원인 콜라를 판매하는 자판기를 각각 Verilog code로 구현하였습니다.코드파일(.v)과 머신에 대한 설명 및 시뮬레이션 결과에 대한 파일

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| 리포트 | 3페이지 | 2,500원 | 등록일 2020.10.17 | 수정일 2020.10.22

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02 논리회로설계실험 결과보고서(전,반가산기)

논리회로설계 실험 결과보고서 #2실험 2. 반가산기와 전가산기 설계1. 실험 목표VHDL을 이용하여 반가산기와 전가산기를 설계한다.각 게이트를 설계 할 때, 동작적 모델링과 자료 ... ) Schematic Design1) Design2) Wave Form3) 결과 분석Schematic Design으로 설계하는 방법은 모델링 방식과는 다르게 논리회로를 그려 설계한다. 방법은 다르 ... 적 모델링 방식은 이미 설계된 두 두 논리 회로를 하나로 합쳐 설계하는 방법이다. Half Adder는 두 번 사용하고 OR gate는 한번 사용하여 설계하였다. waveform 결과

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| 리포트 | 9페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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논리회로실험 - 제 1장 기본 논리 게이트 (AND, OR, NOT) 결과 보고서

과 목 : 논리회로설계과 제 명 : 결과보고서 1담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 3 / 271 ... 가해졌을 때만 출력 단자에 1이 나타나도록 구성된 회로이다. OR gate의 진리표와 기호는 다음과 같다.3)XOR gate상태 1일 때, 출력이 논리 상태 1이 되는 소자이 ... . Introduction기본 gate를 설계한다. 2진 논리 함수인 AND-gate, OR-gate, XOR-gate를 한 architecture에서 구현하여 각 gate가 올바르게 작동

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| 리포트 | 8페이지 | 1,000원 | 등록일 2014.08.15

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논리회로실험 - 제 8장 VHDL의 순차 논리 회로 설계에서 Finite state machine을 설계 결과보고서

과 목 : 논리회로설계과 제 명 : 결과보고서 8담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 5 / 291 ... . IntroductionVHDL의 순차 논리 회로 설계에서 Finite state machine을 설계한다. Mealy machine과 Moor machine 두 가지 방법으로 설계를 구상할 수 ... 에서만 동작하는 순차 논리 회로이다. FSM의 출력과 다음 state는 현재 state와 출력에 의해서 결정된다.2)Mealy machine-밀리 머신은 클럭의 발생과 상관없이 출력이 즉시

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| 리포트 | 16페이지 | 1,000원 | 등록일 2014.08.15

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[A+ 결과보고서] 아주대 논리회로실험 실험9 'RAM'

실험9 결과보고서.실험목적-반도체 메모리의 기본적인 동작 원리를 알아보고 64비트 기억소자의 동작을 실험을 통해 확인한다.-실험을 통해 RAM을 소자를 이용하여 구성해보고 또한 ... IC를 이용하여 구성한다.-실험을 통해서 RAM의 동작을 이해한다.2. 실험결과●실험1은 생략●실험2 64-bit IC RAM1) 원하는 데이터 쓰고 읽기1 ... 던 값과는 전혀 다른 쓰레기값이 나오는 것을 확인하여 휘발성이라는 것을 확인했다.●예비보고서의 예상결과값과 비교분석실험 2.ME(pin2)WE(pin3)동작Condition of

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| 리포트 | 3페이지 | 1,000원 | 등록일 2015.03.27

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[A+ 결과보고서] 아주대 논리회로실험 실험8 'Counter'

이 존재했다.●예비보고서의 SPICE의 결과와 비교분석실험1 2단2진 카운터(비동기식)회로결과실험2 3진 카운터(동기식)-예비보고서 결과와 실제 실험결과와 이론적으로 나오는 결과값 ... 이 일치하였다. 사실 이 실험은 어떠한 양을 측정하는 실험이 아니고 단순히 회로도에 입력을 가했을 때, 생기는 결과가 명확히 정해져 있는 실험이므로, 실험값이 예비보고서와 이론적인 결과 ... 실험 8. 결과보고서.실험목적-카운터의 동작원리와 특성에 대해 이해한다.-2진 시스템에서의 숫자표시를 이해하고 2진 카운터에 대해 알아본다.-비동기식 카운터와 동기식 카운터

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| 리포트 | 2페이지 | 1,000원 | 등록일 2015.03.27

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