"아주대 논리회로"의 검색결과 입니다.

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74HC90 DAC 논리회로실험 논리회로실험 cmos Encoder Decoder 결과 4비트 dac 아주대 논회실 basic gates 아주대 논리회로 DAC hex inverter

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"아주대 논리회로" 검색결과 201-220 / 484건

[A+ 결과보고서] 아주대 논리회로실험 실험10 'D/A & A/D converter'

실험 10. 결과보고서1.실험목적.-DAC와 ADC 회로의 구성과 동작 원리에 대해 이해한다.-주파수 발생기를 이용하여 DAC를 실험하고 다양한 조건에서의 파형을 관찰한다.-주파

Non-Ai HUMAN
| 리포트 | 3페이지 | 1,000원 | 등록일 2015.03.27

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아주대_논리회로실험_예비5_래치와 플립플롭

한다.◆ LatchLatch는 하나 이상의 비트를 저장하기 위한 논리회로이다. 전기적으로 두개의 안정된 상태를 가지고 있어 입력된 하나의 비트 신호를 저장할 수 있고, 입력과 출력신호 변화 ... 7-6에 나타낸 것과 같이 제어신호와 클럭 신호를 입력으로 갖는 기억소자로, 다양한 종류(SR, JK, D, T 플립플롭 등)가 있다. 각 플립플롭에 대한 회로 및 동작 특성 ... 이 변하는 시점만 다를 뿐 출력의 논리 값을 결정하는 방법은 동일함으로 앞으로 플립플롭을 설명할 때는 편의상 주로 상승 모서리 트리거 방식 플립플롭을 기준으로 설명

Non-Ai HUMAN
| 리포트 | 6페이지 | 1,000원 | 등록일 2010.04.04

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[아주대] 논리회로실험 10장 예비(DA & AD converter(DAC & ADC))

analog 신호를 digital신호 혹은 digital 신호를 analog신호로 변환해 주는 회로를 말한다. DAC는 digital신호를 analog 신호로 만들어주는 회로를 말 ... 하며, ADC는 analog 신호를 digital 신호로 변환해주는 회로를 말한다.D/A converterD/A converter의 block diagram은 다음과 같다.input ... > < OP amp 741 >< 74HC90 >PROCEDURES< 실험 1 >위와 같이 D/A converter회로를 구성한다. 74HC90은 clock신호에 따라 counting

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| 리포트 | 8페이지 | 2,000원 | 등록일 2013.09.25

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[아주대] 논리회로실험 10장 결과(DA & AD converter(DAC & ADC))

한 전압PROCEDURES & RESULTS위 사진에서 볼 수 있듯이 기본적인 회로에 공급한 공급전류원은 5V DC 전압을 사용했다. 하지만 OP amp에 공급한 전압은 15V DC ... 전압을 사용했다.< 실험 1 : DAC >< 실험 1 > 회로도● 실험1 : DAC- Single pulse clock으로 single pulse를 가하여 D/A c ... 기를 이용하여 계단 파형(1KHz)이 나오는지 관찰하고 파형을 그려라.< 실험1 > 실험 결과 사진구성한 회로 사진Rf=1.5k OMEGA Rf=2.7k OMEGA실험1은 위

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| 리포트 | 7페이지 | 2,000원 | 등록일 2013.09.25

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아주대_논리회로실험_예비7_복호기와 부호기

다.(4) 2단 2진 카운터의 출력을 다음 코드로 인코딩할 수 있는 회로를 그려라.Normal Count StateEncoded output001000010100100010110001< 그림 4. 2단 2진 카운터의 waveform과 Encoding >

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| 리포트 | 3페이지 | 1,000원 | 등록일 2010.04.04

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아주대 논리회로실험 예비4-멀티플렉서와 디멀티플렉서

하고, G'로 표시되는 enable pin은 D핀에 대치되어 같은 기능을 수행한다.(3) Active High 와 Active low논리회로에서 사용하는 신호에는 active high ... 와 active low로 구분하기도 한다. 이것은 어떠한 논리 회로가 어떤 신호에서 특정 기능을 수행하는지에 따라 나누는데, active high라 함은 그 기능이 signal ... )의 원리를 이해하고 실험을 통해 동작을 확인한다.2. 이론(1) 멀티플렉서(Multiplexer)복수개의 입력선으로부터 필요한 데이터를 선택하여 하나의 출력선으로 내보내는 회로이다. 예

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| 리포트 | 5페이지 | 1,000원 | 등록일 2010.04.04

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아주대 논리회로실험 결과5-래치와 플립플롭

.98V)1(4.97V)? 실험 결과 Truth table※ 동작 원리R-S latch회로에서는 SR = 00일 때, 회로의 출력은 변하지 않고 Q(t-1)값을 갖으며 SR = 01 ... )1111(4.97V)1(4.97V)※ 동작 원리이는 R-S latch회로에 쿨럭 입력 C가 추가 된 회로로 C = 1일 때에만 입력에 응답하도록 동작하고 C = 0일 때에는 입력 ... 이 아무리 변해도 출력의 변화가 일어나지 않는다. 이를 바로 동기식 플립플롭이라 한다. C = 1일 때에는 위 R-S latch의 회로의 출력과 같음을 알 수 있다.(3) 예비과제

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| 리포트 | 4페이지 | 1,000원 | 등록일 2010.04.04

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[보고서+소스코드]아주대 논리회로실험 기말프로젝트 VHDL 신호등 설계(Traffic Lights) 보고서

1. 프로젝트의 목적 HBE-COMBO II 보드에 장착되어 있는 Traffic Lights Module을 이용하여 실제 실생활에 쓰이는 신호등의 컨트롤러를 구현한다. 기본적인 신호등의 기능을 직접 VHDL을 이용하여 코딩하고 시뮬레이션 해본 후 HBE-COMBO II..

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| 리포트 | 30페이지 | 3,800원 | 등록일 2014.10.04 | 수정일 2017.08.03

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아주대논리회로실험 9장 RAM 결과(문답+빵판+고찰)

이 정해지는데 이것을 읽어 들이는 메모리 동작을 확인하는 실험이다. 우선 회로에서 74HC03 게이트는 오픈 드레인이기 때문에 풀업 저항을 달지 않으면 두 입력이 High일때 결과

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| 리포트 | 5페이지 | 2,000원 | 등록일 2011.12.21

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아주대 논리회로실험 결과7-복호기와 부호기

으로 Excess-3 Code는 출력 값에 십진수 3을 더해주는 코드이다. 즉 3의 이진수 0011을 더해줌으로써 출력을 얻을 수 있었다. 하지만 회로의 오류가 있어서 처음엔 정확 ... 한 출력 값을 얻을 수 없었지만 회로를 차근차근 오류의 원인을 파악함으로써 오류를 찾아 정확한 회로로 실험하니 Excess-3 Code에 정확한 값을 얻을 수 있었다.5) 7 s ... egment 표시기를 갖는 BCD 카운터< 그림 8. 7-segement 표시기를 갖는 BCD 카운터 >※ 토의 사항이번 실험은 교재의 실험 회로의 오류로 정확한 실험 결과를 얻을 수 없

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| 리포트 | 5페이지 | 1,000원 | 등록일 2010.04.04

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아주대 논리회로실험 예비6-시프트 레지스트와 카운터

에 D 플립플롭으로 구성된 4비트 링 카운터 회로도를 나타내었다. 회로도로부터 알 수 있듯이 링 카운터의 각 D 플립플롭은 자신의 왼쪽에 있는 플립플롭의 출력을 입력으로 받아들이도 ... 값은 Q0으로, Q0 값은 Q3으로 순환된다. 따라서 만일, 회로의 초기 상태 값이 Q3Q2Q1Q0=1000 이었다면 클럭 펄스가 하나씩 인가될 때마다 1000, 0100 ... , 0010, 0001, 1000, 0100, ... 와 같은 순서로 상태 값이 변화될 것이다. 그런데 만일, 회로의 초기 상태 값이 Q3Q2Q1Q0=0000 이거나 Q3Q2Q1Q0

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| 리포트 | 6페이지 | 1,000원 | 등록일 2010.04.04

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아주대논리회로실험 1장.basic gates 결과(문답+빵판+고찰)

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반:조 :학 번:성 명 ... 를 사용하여 직접 확인해 볼 수 있었고 같은 IC회로라도 하더라도 배열 및 연결순서를 바꾸면 완전히 다른 논리적인 연산을 할 수 있다는 것을 알았다. 논리회로 처음 실험인데도 많은 어려움을 느껴 다음부터는 예비보고서를 쓸 때 철저하게 예습을 하고 실험에 임해야겠다고 느꼈다. ... 과 회로 구성 사진(A =0, B=1, C=1, L1 = 0)( A=1, B=1, C=1, L2=1)바로 아래에서 왼쪽 그림을 실제 구현한 것이 위에 사진들이다. 실제 설계에서는 소자

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| 리포트 | 11페이지 | 1,500원 | 등록일 2011.12.21

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아주대_논리회로실험_결과9_D/A & A/D Converter

실험 9. D/A & A/D Converter(DAC & ADC)1. 목 적D/A와 A/D 변환기(converters) 회로의 구성과 동작 원리에 대해 이해한다.2. 결과보고서 ... (1) D/A converter1) 그림 4의 회로를 구성한다.< 회로 1. D/A converter - Decade DCD >2) Single pulse clock으로 single ... 은 경우를 비교하라.< 68KΩ 병렬 전 > < 68KΩ 병렬 후 >※ 토의 사항이번 실험은 D/A converter의 회로의 구성과 동작 원리에 대해 알아보는 실험이다. D/A

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| 리포트 | 5페이지 | 1,000원 | 등록일 2010.04.04

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아주대논리회로실험 7장 시프트레지 결과(무답+빵판+고찰)

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반:조 :학 번:성 명 ... :1실험9. 예비 16조 허성인실험7장 결과 16조1) 시프트 레지스터(1) 그림 1의 회로를 구성하라. 스위치 중 PR 스위치는 +5V에 연결하고 Serial Data 스위치 ... 씩 이동하는 기억소자이다. 쌍안정 소자에서의 출력값 Q와 Q’이 다음 쌍안정의 J, K 입력에 연결된다면 다음 단의 쌍안정 회로는 이동 명령에 의해 이전 단의 쌍안정 회로가 가지고 있

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| 리포트 | 5페이지 | 1,500원 | 등록일 2011.12.21

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아주대논리회로실험 8장.카운터 예비(기본구성+빵판+예상결과)

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반:조 :학 번:성 명 ... 계수 회로는 모든 계수회로의 기본으로서 입력펄스는 LSB부터 차례로 채워지고 원하는 진수에 이르렀을 때는 회로 내의 모든 F/F의 출력이 0으로 환원된다. 만일 카운터가 n s ... 중간 상태가 존재할 수 있어 논리상의 에러를 유발할 수 있게 된다.이러한 전송지연을 없애기 위해서 모든 F/F들은 같은clock 펄스에 의해 동시에 트리거시킬 필요가 있으며 이러

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| 리포트 | 6페이지 | 1,500원 | 등록일 2011.12.21

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아주대 논리회로실험 예비9-D/A & A/D Converter

실험 9. D/A & A/D Converter(DAC & ADC)1. 목 적D/A와 A/D 변환기(converters) 회로의 구성과 동작 원리에 대해 이해한다.2. 예비 보고서 ... 3. n비트 D/A 변환기의 간단한 회로 >위 회로는 2진수로 가중된 저항형 사다리 회로망을 이용한 n비트 D/A변환기 회로이다. 이 회로는 기준 전압 VR과 n개의 2진수 ... 로 흐르도록 제어한다. 따라서 이 연상 증폭기의 가상 접지로 흘러들어가는 총 전류 io는==이 되므로, 따라서 출력 전압가 된다.< 그림 4. R-2R 사다리 회로망을 이용한 D/A

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| 리포트 | 7페이지 | 1,000원 | 등록일 2010.04.04

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아주대논리회로실험 9장 예비보고서(기본구성+빵판+예상결과)

following this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반 ... 를 선택하는 데 필요한 번지용 논리회로로 구성되어 있다. 그림 1에는 한 비트의 정보를 저장하는 2진 소자의 논리 회로가 나타나 있는데 이 2진 소자는 메모리 장치를 구성하는 기본 ... 단위가 된다. 이 그림에서 2진 소자는 1개의 플립플롭과 몇 개의 게이트로 나타나 있지만 실제로는 입력이 여러 개인 2개의 트랜지스터로 구성되어 있다.(a) 논리도 (b) 블록

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| 리포트 | 7페이지 | 1,500원 | 등록일 2011.12.21

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아주대논리회로실험 10장 예비보고서(기본구성+빵판+예상결과)

하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2011년 9월 27일과목명: 논리회로실험교수명:학 번:성 명 ... :실험 10. D/A & A/D Converter(DAC & ADC)1. 실 험 목 적D/A와 A/D 변환기(converters) 회로의 구성과 동작 원리에 대해 이해한다.?DAC ... resistor와 그림 3과 같은 ladder type resistor가 있다. 그림 2의 회로를 사용하는 경우에 전압식은 아래와 같다 (VR은 reference voltage

Non-Ai HUMAN
| 리포트 | 6페이지 | 1,500원 | 등록일 2011.12.21

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아주대논리회로실험 5장.디코더인코더 예비(기본구성+빵판+예상결과)

로하지는 않는다.< 그림 1. 2단 2진 카운터의 waveform과 decoding >그림 1에서 2진 카운터를 구성하는 논리소자는 flip-flop이며 본 실험에서는 J-K flip ... -flop을 이용해서 카운터를 구성한다.(2) 인코딩인코딩은 디코딩의 반대를 의미하며 10진수를 2진수로 변환하는 것이다. 인코딩할 때는 출력코드의 각 비트에 대해 논리 연산 OR ... (1개)(5) Common anode type 7-segment LED(1개)(6) 저항 : 330Ω (7개)4. 예측되는 결과1) 2단 2진 카운터회로그림A는 JK 플립플롭의 입력

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| 리포트 | 10페이지 | 1,500원 | 등록일 2011.12.21

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아주대논리회로실험 9장 가산기감산기 결과(문답+빵판비교+고찰)

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반:조 :학 번:성 명 ... 를 뺄 수 없으면 B에서 하나 빌려와 B는 1이 되고 그 빌린수로 Y와의 차를 D에 적어주면 되었다. 이번 실험은 가산기와 감산기를 논리회로로 구성하여 그 결과를 측정하는 것이 ... :1실험9. 예비 16조 허성인실험7장 결과 16조실험 3. 가산기와 감산기(1) 예비보고서에서 구상한 반가산기를 구성하고 그 결과를 확인하라.그림 3-1. 반가산기 회로왼쪽

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| 리포트 | 7페이지 | 2,000원 | 등록일 2011.12.21

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