• AI글쓰기 2.1 업데이트
  • 통합검색(384)
  • 리포트(312)
  • 자기소개서(71)
  • 시험자료(1)
  • 기간
  • 연관순
  • 영역
  • 페이지 수
  • 확장자
  • 할인자료 보기

연관검색어

FPGA 사칙연산 fpga 프로젝트 전전설2 FPGA FPGA 게임 vivado 7segment 회로 개수
판매자 표지는 다운로드시 포함되지 않습니다.

"논리회로 FPGA" 검색결과 201-220 / 384건

  • 자료 표지
    결과보고서 #8
    과 목 : 논리회로설계실험과 제 명 : #8 순차회로 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A반 ... 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 4. 29논리회로설계 실험 결과보고서 #8실험 8.순차회로 설계1. 실험 ... 목표순차회로에 대한 기본개념을 이해하고 조합회로와의 차이점을 이해할 수 있다. 또한 순차회로 중레지스터에 대해 이해하고 많은 기능들이 있는 범용 레지스터를 VHDL을 이용해 설계
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
    다운로드 장바구니
  • 자료 표지
    경희대학교 논리회로 레포트
    ) 디지털.3) 논리회로.4) HDL의 정의, 종류.5) CAD Tools.6) IP.7) FPGA.8) SoC.9) 시뮬레이션.-------------------------------- ... 논리회로(정 연 모 교수님) / 제출일 : 2012. 09. 13.Homework #0 /=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-= ... 다는 특징이 있다.3) 논리회로 : 논리곱(AND), 논리합(OR), 부정(NOT)의 기본적 논리소자를 연결하여 수치를 나타내는 신호를 처리하는 회로이다. 전자계산기의 연산장치 등
    Non-Ai HUMAN
    | 리포트 | 3페이지 | 2,000원 | 등록일 2016.04.17
    다운로드 장바구니
  • 자료 표지
    결과보고서 #10 - 순차회로 설계 (FSM)
    과 목 : 논리회로설계실험과 제 명 : #10 순차회로 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A ... 반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 5. 13논리회로설계 실험 결과보고서 #10실험 10.순차회로 설계 ... (FSM)1. 실험 목표순차회로의 일종인 FSM의 일종인 밀리머신과 무어머신의 개념을 이해하고 이를 이용해 실생활에서 쓰이는 자판기를 VHDL 코드를 이용하여 설계해볼 수 있다.2
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
    다운로드 장바구니
  • 자료 표지
    결과보고서 #2- 반가산기, 전가산기 설계
    과 목 : 논리회로설계실험과 제 명 : #1 기본게이트 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A ... 반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 3. 25논리회로설계 실험 결과보고서 #2실험 2. 반가산기, 전가산기 ... 설계1. 실험 목표반가산기와 전가산기의 기본 원리에 대해 이해하고, 이를 통하여 논리회로의 구성 능력을 키운다. Xilinx ISE 를 통해 4가지 방법(동작적, 자료흐름, 구조
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
    다운로드 장바구니
  • 자료 표지
    결과보고서 #11 - RoV Lab3000 실습
    과 목 : 논리회로설계실험과 제 명 : #11 RoV_Lab3000 실습(결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 ... & 조 : A반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 5. 20논리회로설계 실험 결과보고서 #11실험 11. RoV
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
    다운로드 장바구니
  • 자료 표지
    결과보고서 #4 - 디코더, 엔코더 설계
    과 목 : 논리회로설계실험과 제 명 : #4 디코더, 엔코더 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 ... : A반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 04. 08논리회로설계 실험 결과보고서 #4실험 1. 디코더, 엔
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
    다운로드 장바구니
  • 자료 표지
    결과보고서 #9 - 순차회로 설계
    과 목 : 논리회로설계실험과 제 명 : #9 순차회로 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A반 ... 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 5. 6논리회로설계 실험 결과보고서 #9실험 9.순차회로 설계1. 실험 ... 목표순차회로인 카운터에 대해 동작 방식과 구조를 이해하고, 카운터의 종류와 특징에 대해 이해한다. 주어진 회로가 어떤 회로인지 찾아낼 수 있고, XilinX ISE를 통해 직접 설계
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
    다운로드 장바구니
  • 자료 표지
    결과보고서 #1 - 기본 게이트 설계
    과 목 : 논리회로설계실험과 제 명 : #1 기본게이트 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A ... 반 4조학 번 : 2011311307, 2011이 름 : 김영관, 김윤섭제 출 일 : 2015. 3. 18논리회로설계 실험 결과보고서 #1실험 1. 기본 게이트 설계1. 실험 목표 ... 로 주어진 Mission 설계를 해보면서 우리가 예전에 논리회로 시간에 배웠던 카노맵이 얼마나 다양하게 쓰일 수 있는지 알게 되었고 어떠한 진리표가 나오건 VHDL을 이용해 하드웨어
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
    다운로드 장바구니
  • 자료 표지
    기본 게이트 설계 예비보고서
    과 목 : 논리회로설계실험과 제 명 : 기본 게이트 설계담당교수 :담당조교 :학 과 : 전자전기공학과학 년 : 3학 번 :이 름 :제 출 일 : 2014. 3. 20논리회로설계 ... Logic)와 FPGA의 복합성과 구조적 특징을 지닌 논리 소자이다.CPLD는 내부 여러 개의 LAB(Logic Array Block)와 LAB의 연결선인 PIA(Programmable ... 유지되므로 추가되는 프로그램용 메모리가 필요없다.CPLD의 구조는 빠른 성능이나 정확한 타이밍 예측이 요구되는 어드레스 디코더나 시퀀스 회로 등에 적합하다.[그림 2] FPGA2
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,000원 | 등록일 2014.07.25
    다운로드 장바구니
  • 자료 표지
    01 논리회로설계실험 예비보고서(And,or gate)
    논리회로설계 실험 예비보고서 #1실험 1. 기본게이트 설계1. 실험 목표VHDL을 이용하여 AND gate와 OR gate를 설계한다.각 게이트를 설계 할 때, 동작적 모델링 ... logic device, 제조 후 사용자가 내부 논리 회로의 구조를 변경할 수 있는 집적 회로)와 같은 기능을 갖는 논리 블록들과 그것을 서로 연결하여주는 스위치, 행렬 등이 칩 내부 ... 에 내장된 소자- FPGA(field programmable gate array)산업 현장에서 엔지니어가 직접 디바이스를 프로그래밍하여 설계한 회로를 반도체 칩 상에 구현할 수 있
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15
    다운로드 장바구니
  • 자료 표지
    서울시립대 전자전기컴퓨터설계실험2 제06주 Lab05 Pre
    . 17학번이름Professor조교실험 소개실험 목적Decoder, Encoder, Mux의 Verilog 설계를 통해 Programming 능력을 향상하고 조합 논리 회로를 이해 ... Table of Full SubtractorMuxN개의 Input Data를 입력 받아, 그 중 하나를 선택하여 Output으로 출력하는 논리 회로.Logic Diagram of ... , Arithmetic Logic and Comparator, 서울시립대학교.Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소.
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04
    다운로드 장바구니
  • 자료 표지
    논리설계및실험텀프로젝트 전자시계 제안서
    , 추진 일정과 방법 등을 설명해둔 문서이다.목표FPGA BOARD와 FLOWRIAN을 이용한 논리 회로(디지털 시스템) 설계FLIP-FLOP과 REGISTER등을 이용하여 전자시계 ... 002분반(화요일)논리회로 설계 및 실험23조 Term Project 제안서 (전자시계)Dept. of Computer Science & Engineering/Pusan ... 시계버튼이 입력될 때 마다 위의 동기식 카운터 회로를 응용하여 최대 3개의 다른 나라의 시간이 표시 되도록 한다.세계 시간은 현재 시간에서 특정 나라의 시차만큼을 더하고 뺀 값
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 2,000원 | 등록일 2016.11.28
    다운로드 장바구니
  • 자료 표지
    HBE-ComboⅡ-SE 보드, Xilinx 스파르탄3 FPGA 칩, ISE 디지털 디자인 툴
    )Introduction (실험에 대한 소개)Purpose of this Lab : Xilinx ISE를 이용하여 Schematic 설계를 한다. 이는 기본적인 논리 회로를 설계해보고 이 ... 디바이스에 있는 데이터로 FPGA 동작AND Gate- 출력은 논리 입력의 곱과 같음.- Truth Table- 두 입력에 임의의 파형을 넣었을 때의 결과Materials ... Pre-Lab Report- Title: Lab#02_HBE-ComboⅡ-SE 보드, Xilinx 스파르탄3 FPGA 칩, ISE 디지털 디자인 툴-담당 교수담당 조교실 험 일학
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 1,000원 | 등록일 2016.04.06
    다운로드 장바구니
  • 자료 표지
    Lab#03 Verilog HDL
    this labVerilog HDL 문법에 대해 익히고, 이를 이용하여 논리게이트를 설계한다.나. Essential Backgrounds1) Verilog HDL ... introduction가) HDL기반 설계의 장점(1) 설계오류 수정시간 및 회로변경 시간 단축에 따른 설계시간의 단축(2) 최적화, 상위수준 설계를 통한 설계의 질 향상(3) 특정 설계기술이나 공정 ... 으며, 논리게이트나 모듈사이의 물리적인 연결을 나타내기 위해 사용된다. 구동자가 연결되지 않으면 high-impedance가 되며, 연속할당문이나, 게이트프리미티브 같은 구동자에의해 연속
    Non-Ai HUMAN
    | 리포트 | 20페이지 | 1,500원 | 등록일 2016.09.11
    다운로드 장바구니
  • 판매자 표지 자료 표지
    전자전기컴퓨터설계실험2(전전설2)3주차예비
    을 시뮬레이션 가능하게 한 프로그램이다.나. HBE-ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습을 위한 장치로 회로에서 많이 사용 ... 를 구현하고 이를 FPGA를 이용하여 구현한다. 또한 gate primitive modeling 과 behavioral modeling의 차이를 이해하고 설계한다.2. 배경 지식 ... , 전자회로적인 특성을 기술하는 언어이다. 원하는 동작을 구현할 수도 있고 구조 또한 기술 가능하다. C 등등의 다른 언어와도 비슷하나 특정 시간이나 동시성을 표현할 수 있다는 점
    Non-Ai HUMAN
    | 리포트 | 18페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
    다운로드 장바구니
  • 자료 표지
    Combinational Logic Design Ⅱ Decoder, Encoder and Mux
    )Introduction (실험에 대한 소개)Purpose of this Lab : 조합논리회로에 대해서 알아보고 디코더 및 MUX회로를 ISE 프로그램을 이용하여 설계해본다. 이를 이용 ... 하여 다른 회로도 응용할 수 있도록 한다.Essential Backgrounds (Required theory) for this Lab조합 논리 회로논리 곱(AND), 논리 합 ... (OR), 논리 부정(NOT)의 세가지 기본 회로를 조합하여 구성한 논리 회로출력이 입력에 의해 결정됨.논리 게이트로만 구성되며, 플립플롭 같은 기억소자는 포함되지 않
    Non-Ai HUMAN
    | 리포트 | 16페이지 | 1,000원 | 등록일 2016.04.06
    다운로드 장바구니
  • 자료 표지
    논리회로실험 - 제 10장 KIT의 출력방식 중 하나인 7-segment를 통하여 디지털 시계를 설계 결과보고서
    1. IntroductionVHDL의 순차 논리 회로 설계에서 KIT의 출력방식 중 하나인 7-segment를 통하여 디지털 시계를 설계해보고 이를 Training Kit에 검증 ... 은 VHDL의 순차 논리 회로 설계에서 KIT의 출력방식 중 하나인 7-segment를 통하여 디지털 시계를 설계해보고 이를 Training Kit에 검증해보는 실험이었다. 7-s
    Non-Ai HUMAN
    | 리포트 | 32페이지 | 1,000원 | 등록일 2014.08.15
    다운로드 장바구니
  • 자료 표지
    전지전자기초실험 연산 회로 설계 실험 결과레포트
    전기전자 기초실험 결과보고서제9장 연산 회로 설계 실험학과학년학번분반실험조성명전기전자공학26. 실험과정 및 결과측정::: 4비트 덧셈기/뺄셈기>>WAVEFORM(1) SEL이 0 ... (논리연산)(3) Cin이 0, M이 0일 때 (산술연산)>>Timing Analyze>> 표 9-5 4비트 ALU의 결과 (M=1)동작 제어 신호A = 0001B = 0010A ... . 결과보고서① 자리 올림 예견법(carry look ahead)의 장단점을 조사하고 위의 회로와 비교하시오.위 그림의 입력 A, B를 x, y라 놓으면 2진
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,000원 | 등록일 2017.12.01
    다운로드 장바구니
  • 자료 표지
    전자전기컴퓨터설계실험2(전전설2) (8) 7-Segment and PIEZO Control
    으로 구현하고, 설계한 논리를 시뮬레이션하기 위한 테스트 벤치를 작성하고 장비로 동작을 확인한다.2. 실험 이론2.1. 7-Segment7-세그먼트 표시 장치(seven-segment ... display)는 표시 장치의 일종으로, 7개의 획으로 숫자나 문자를 나타낼 수 있다. 비슷한 역할을 하는 점 행렬에 비해 단순하기 때문에 전자 회로의 내부적인 수치를 보여 주 ... ChainFPGA에 프로그래밍할 파일을 선택한다..bit 파일을 선택한다.PROM에 프로그래밍할 파일을 선택한다.PROM File을 생성하지 않았고 FPGA에만 다운로딩 하기 때문에 파일
    Non-Ai HUMAN
    | 리포트 | 22페이지 | 2,000원 | 등록일 2019.10.12 | 수정일 2021.04.29
    다운로드 장바구니
  • 자료 표지
    아주대학교 논리회로 실험 설계 예비보고서
    논리회로 실험설계설계주제:스톱워치목차1. 설계 목표2. 동작 조건3. 동작 설명 및 알고리즘4. 1차 설계 및 분석(1) Clock dividing part(2) 7-s ... ) 총 설계 회로5. 예상 결과 & 미작동 시 대처1. 설계 목표- FPGA를 사용하여 자유 주제로서 스톱워치를 설계한다.(기본의 심화 과제인 start/stop의 기능과 up ... 이 멈춘다.3. 동작 설명 및 알고리즘FPGA를 이용하여 stopwatch를 설계한다. Clock은 50Mhz를 사용한다. 이 clock signal을 divde하여 스톱워치에 사용할 수
    Non-Ai HUMAN
    | 리포트 | 10페이지 | 2,000원 | 등록일 2016.06.14
    다운로드 장바구니
  • 전문가요청 배너
해캠 AI 챗봇과 대화하기
챗봇으로 간편하게 상담해보세요.
2025년 11월 27일 목요일
AI 챗봇
안녕하세요. 해피캠퍼스 AI 챗봇입니다. 무엇이 궁금하신가요?
7:34 오후
문서 초안을 생성해주는 EasyAI
안녕하세요 해피캠퍼스의 20년의 운영 노하우를 이용하여 당신만의 초안을 만들어주는 EasyAI 입니다.
저는 아래와 같이 작업을 도와드립니다.
- 주제만 입력하면 AI가 방대한 정보를 재가공하여, 최적의 목차와 내용을 자동으로 만들어 드립니다.
- 장문의 콘텐츠를 쉽고 빠르게 작성해 드립니다.
- 스토어에서 무료 이용권를 계정별로 1회 발급 받을 수 있습니다. 지금 바로 체험해 보세요!
이런 주제들을 입력해 보세요.
- 유아에게 적합한 문학작품의 기준과 특성
- 한국인의 가치관 중에서 정신적 가치관을 이루는 것들을 문화적 문법으로 정리하고, 현대한국사회에서 일어나는 사건과 사고를 비교하여 자신의 의견으로 기술하세요
- 작별인사 독후감
“EasyAI 가 작성한 문서 초안은 완벽하지 않을 수 있습니다"
EasyAI 이동하기