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임베디드 Empos2 보드를 이용한 심리 테스트 프로그램 구현

사람들은 끊임없는 호기심과 자신의 내면에 대해 알고자 하는 욕구가 누구든지 무의식 중에 잠재되어 있다. 정확하지 않은 것에 대한 믿음이나 기대감을 느끼는 것은 사람의 많은 심리 중 하나이다. 그런 기대가치를 이용해 사람들이 틈틈이 시간이 날 때마다 재미있게 즐길 수 있는 심리테스트 시스템을 구현하고자 한다.Touch screen – 초기 화면에서 메인화면 으로 들어갈때 메인화면에서 심리테스트 선택(4중 택1) Button – 각 심리테스트 항목 중 자신에게 맞는 지문을 선택LED – 초기화면과 메인화면에서 선택하기전 좌우로 LED 점등7Segment – 일부 심리 테스트 중 점수를 이용한 결과를 보여주는 심리테스트의 마지막 화면에 점수 표시<중 략>결론 및 느낀 점모든 기능은 계획대로 마무리 되었으나, 시간이 촉박해서 좀더 사용자가 호기심을 가질 심리테스트 자료를 수집하지 못한 것 같아 아쉬움이 남음.Empos-2 Setting 부분에서 ping 이 재대로 전송 될 때도 있고 되지 않을 때도 있어, 많은 setting시간 투자Touch기능 구현 중 Virtual Table error를 수정하는데 많은 시간 소요Button 기능 구현 중 time 함수 사용 방법을 몰라 사용방법을 익히는데 많은 시간소요리눅스의 기능과 장비에 대해 많이 알아 갈 수 있었던 뜻 깊은 시간

공학/기술| 2012.12.10| 8페이지| 3,000원| 조회(190)

임베디드, empos2, 임베디드 심리 테스트

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컴퓨터 그래픽스 Open GL을 이용한 3D 별자리 구현 평가A+최고예요

주제 Open GL을 이용한 3D 별자리 별자리를 둥근 원 구에 형상화시켜 마우스 또는 키보드로 회전시키며 별자리의 위치를 찾아 볼 수 있도록 하며 각 별자리는 전체를 볼 수도 있고 계절별로 볼 수 있도록 선택 가능하다.별자리의 색상을 변경 가능하다.사용자 매뉴얼-page up , page down key 로 별자리 구를 확대 또는 축소 가능-방향키로 상,하,좌,우 로 별자리 구를 자유롭게 회전가능-마우스 좌클릭으로 자동회전, 마우스 우클릭으로 정지 가능<중 략>void MyReshape(int w, int h){ glViewport(0, 0, w, h);glMatrixMode(GL_PROJECTION);glLoadIdentity( );gluPerspective(40., (GLfloat)w/(GLfloat)h,1., 10.);glMatrixMode(GL_MODELVIEW);glLoadIdentity ( );gluLookAt(0., 0., 5., 0., 0., 0., 0., 1., 0.);glTranslatef(0., 0., -1.);}void reshape (int w, int h){glViewport (0, 0, (GLsizei) w, (GLsizei) h); glMatrixMode (GL_PROJECTION);glLoadIdentity ();gluPerspective(zoom1, (GLfloat) w/(GLfloat) h, 5.0, 50.0);glMatrixMode(GL_MODELVIEW);glLoadIdentity();gluLookAt (0.0, 0.0, eye1, 0.0, 0.0, 0.0, 0.0, 0.1, 0.0);}

공학/기술| 2012.12.10| 5페이지| 3,000원| 조회(1,040)

컴퓨터 그래픽스, open GL, 3D 별자리, 별자리 프로젝트

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데이터 시트 해석 평가C아쉬워요

디지털 논리회로설계 및 실습실험 6. 데이터 시트 해석1. 실험 목표□ TTL과 CMOS 논리에 대한 정적인 전기적 사양 측정.□ 전압 및 전류 요구 사양과 한계를 포함하는 제조업체의 데이터 시트 해석.□ TTL 인버터에 대한 전달 곡선(transfer curve) 측정.2. 이론 요약TTL 논리는 출력이 LOW일 때 외부에서 게이트의 출력 단자 쪽으로 흐르는 일반적인 전류(+에서 -로)를 가지도록 설계된다. 이러한 전류를 유입 전류(sink current)라고 하는데, 이 전류는 외부에서 게이트 쪽으로 흐르는 전류를 의미하는 양(positive)의 전류로 데이터 시트에 표시된다. 일반적으로 출력이 HIGH인 경우에 전류는 게이트로부터 외부로 흘러 나간다. 이 전류는 음(negative)의 전류로 데이터 시트에 표시되어 있으며 이러한 전류를 유출 전류(source current)라고 한다. TTL 논리에서는 유출 전류보다 유입 전류가 훨씬 크다.TTL이 양극성 트랜지스터(bipolar transistor)를 사용하는 반면, CMOS 논리는 전계 효과 트랜지스터(field-effect transistor)를 사용한다. 이러한 차이점으로 인해 TTL과 CMOS는 매우 다른 특성을 나타낸다. 결과적으로 전압 레벨 및 전류를 유출하고 유입하는 능력이 다르기 때문에 두 논리를 각자의 사양을 적절히 고려하지 않은 채 직접 서로 연결할 수 없다. 다양한 논리 형태 사이의 인터페이스는 이들 사양에 의해 결정된다. 또한 모든 MOS 논리군은 정전기에 매우 민감하기 때문에, MOS 소자들을 다룰 때에는 정전기로 인한 손상을 방지하기 위하여 특별히 주의해야 한다.논리군에 대한 중요한 사양 중 하나가 잡음 여유(noise margin)이다. 잡음 여유는 보장되는 논리 레벨이 유지되면서 한 게이트 출력과 다음 게이트 입력 사이에 존재하는 전압 차이를 말한다. TTL에서 이 차이는 다음과 같다.3. 데이터 및 관찰 내용Table 6-1. TTL 7404추천 동작 조건기호변수DM 5404DM 7404단위측정값MinNomMaxMinNomMaxVCC공급 전압4.555.54.7555.25VVIHHIGH 레벨 입력 전압22Va. 5.0VILLOW 레벨입력 전압0.80.8Vb. 0.24자유 대기 온도에서의 추천 동작에 대한 전기적 특성기호변수조건MinNomMax단위측정값IIHHIGH 레벨입력 전류VCC = Max, VI = 2.4V40㎂g. 31004. 평가 및 복습 문제1. 실험 순서 4에서 부하 저항 없이 VOL을 관찰 하였다. 실험 순서 5에서는 부하 저항을 연결하고 VOL을 측정하였다. 부하 저항이 VOL에 대해 어떤 영향을 미치는가?2. TTL 논리 게이트가 +2.4V의 HIGH 출력 전압 논리를 가진다고 가정하자. 표 6-1에 제공된 최대 IOH를 사용하여 출력과 접지 사이에 연결할 수 있는 최소 출력 저항을 결정하여라.3. 어떤 가상의 논리군이 VIL = +0.5V, VIH = +3.0V, VIL = +0.2V, VOH = +3.5V와 같은 특성을 가진다고 하자. 이 논리군의 LOW와 HIGH에 대한 각각의 잡음 여유(noise margin)를 계산하여라.VNL(LOW) = VNL(HIGH) =

공학/기술| 2011.01.05| 4페이지| 1,000원| 조회(1,102)

TTL, CMOS, 디지털 논리회로, 데이터 시트 해석

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수 체계 실험 결과 보고서 (7 segment)

디지털 논리회로설계 및 실습실험 3. 수 체계 실험 결과 보고서1.실험 목표□ 2진수 또는 BCD(binary coded decimal) 수를 10진수를 변환.□ BCD 수를 디코딩하고 7-세그먼트로 표시해 주는 디지털 시스템 구성.□모의실험용으로 결함을 만들어 놓은 회로의 고장 진단.2.이론 요약수 체계에서 기호의 개수를 기수라고 부른다. 10진수 체계에서는 양을 표현하기 위해 0부터 10개의 숫자 기호를 사용한다. 따라서 이는 10기수 체계가 된다. 이 체계에서는 각 위치의 숫자에 대해 가중치를 주어 9보다 큰 양을 나타낸다. 디지털 시스템은 양을 표현하기 위해서 두 가지의 상태를 사용하기 때문에 사실상 2진법이 된다. 이러한 수들을 단순화하기 위해서 간단한 방법으로 2진수와 연관된 다른 체계가 종종 사용됩니다. 이러한 숫자 체계로서 8진수, 16진수 BCD 가 있다.BCD 체계는 각각의 10진 숫자를 표현하기 위해서 4개의 2진 비트를 사용한다. 이 체계는 10기수로부터 기계가 이해할 수 있는 코드로 즉시 변환이 가능하기 때문에 매우 편리한 코드이긴 하지만, 비트가 낭비되는 단점이 있다. 4비트 2진수는 0부터 15까지의 수를 표현할 수 있으나 BCD에서는 단지 0부터 9까지 만을 사용하여 표현한다. 10부터 15까지의 2진수 표현은 BCD 에서는 사용되지 않는다.BCD를 읽을 수 있는 형태로 변환하는 것은 디지털 시스템에서 일반적인 문제가 된다. 보통 사용되는 디스플레이로서 7-세그먼트가 있는데, 이는 시계와 같은 많은 디지털 응용에서 사용된다. 이번 실험에서 기본적인 7-세그먼트 디스플레이에 결선하는 방법을 설명한다.이번 실험에서는 단순화된 디스플레이 장치를 구성해 볼 것이다.7-세그먼트 결선데이터 및 관찰 내용 :표 3-17447디코더의c부터 시작해서 차례대로 세그먼트의 A-c B-d C-e D-f E-g F-a G-b 순으로 연결되어 있다.입력출력2진수BCD 수7-세그먼트디스플레이00***************************************0008100191010무효(A)1011무효(B)1100무효(C)1101무효(D)1110무효(E)1111무효(F)표 3-2고장번호고장 내용관찰 내용1C 입력용 LED 개방C 항상 LOW값 입력2A 입력선 개방A 항상 HIGH값 입력(DIP 스위치값 +1)3Lamp test 입력선 접지로 단락모든 세그먼트가 점등 된다47447A 15번 핀에 연결되는 저항 개방세그먼트 F가 점등되지 않는다실험순서 6. 맨 앞자리의 0을 표시하지 않기 위한 방법먼저 이실험을 하기위해서는 7447 디코더의 정확한 기능에 대해서 알아야 합니다.7447은 밑의 그림에서 보면 4번핀 BI/RBO 와 RBI 기능 그리고 LT포트의 기능 등 각 핀과 포트의 정확한 기능을 알아야 가능한 실험입니다.각 모델의 핀의 기능에 대해서 알아보기 쉬운방법은 실험책 뒷부분 부록을 참고 하는 방법도 있고 데이터 시트 사이트(www.alldatasheet.com)를 참고 하는 방법이 있습니다.저희 조는 데이터 시트 사이트에서 7447의 기능에 대해 상세히 알아보았습니다.7447의 RBI(Ripple-Blanking Input)(5번핀)은 만약 2자리 수 이상의 숫자를 표현하기 위해 7세그먼트를 2개 이상 연결할 경우, 1자리 숫자가 나오면 10자리 숫자를 표시하는 7세그먼트에는 0이 표시되지 않고 아예 점등이 되지 않게 하기위한 기능입니다. 즉, 0을 표시하지 않기 위해서는 RBI를 GND 에 접지하여 점등 되지 않게 하고, 1의 자리를 표시하는 7세그먼트는 점등되어야 하므로 RBO(4번핀)을 1의 자리를 표시하는 다른 7447의 RBI와 연결합니다. 그 결과 두 개의 7-세그먼트 중 10의 자리수를 표현하는 7-세그먼트는 점등되지 않으며 1의 자리를 표시하는 7-세그먼트만 점등되어 각 숫자를 디스플레이 합니다.7447 기능 참고 사이트 - http://pdf1.alldatasheet.com/datasheet-pdf/view/80216/NSC/7447.html

공학/기술| 2011.01.05| 4페이지| 1,500원| 조회(637)

BCD, 7 segment, 수 체계, 디지털 논리회로

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논리 게이트 결과 보고서 & 추가 논리 게이트

디지털 논리회로설계 및 실습담당교수 : 신옥근 교수님제 출 일 : 2009. 10. 06 (화)제 출 자 : 20061496 최상훈20061486 조민정20061453 신봉섭실험 4. 논리 게이트1. 실험 목표□ 실험적으로 NAND, NOR, 인버터 게이트의 진리표를 작성.□ NAND, NOR 게이트를 이용한 달느 기본 논리 게이트 구성.□ ANSI/IEEE 표준 91-1984 논리 기호 사용.2. 이론 요약논리에서는 논리 ‘1’ 또는 ‘0’의 두 가지 정상 조건만을 다룬다. 이들 조건은 질문에 대한 ‘예’나 ‘아니오’의 답변과 같다. 또는 스위치가 닫혀 있거나(1) 열려있는 것(0), 어떤 사건이 발생했거나(1) 발생하지 않은 경우(0) 등등과 같다고 할 수 있다. 부울 논리에서 1과 0은 조건을 나타낸다. 양(positive)의 논리에서 HIGH는 1로, LOW는 0으로 표현되며, 높은 전압이 1이 되고 낮은 전압이 0이 된다. 떤 시스템에서는 이와 같은 정의가 반대로 된다. 음(negative)의 논리에서는 높은 전압이 0이되고 낮은 전압이 1이 된다.AND, OR, 반전 함수 이외에 추가적으로 두 개의 다른 기본 게이트가 논리 설계자에게 매우 중요하다. 이들은 NAND와 NOR 게이트로서 각각 AND와 OR 게이트의 출력을 반전시킨다. 이 두 게이트는 광범위하게 사용되는 특성 때문에 중요한데, AND, OR, 반전 함수를 포함하여 다른 부울 논리 함수를 합성하는데 사용될 수 있다.이번 실험에서 NAND와 NOR 게이트와 이들 게이트의 몇 가지 조합에 대한 진리표를 테스트해 볼 것이다. 두 개의 진리표가 동일하다면 그 진리표에 대한 논리 회로도 등가라는 것에 유의하기 바란다.# 참고* OR, XOR, INVERTER를 이용하여 NAND 게이트 구성3. 데이터 및 관찰 내용입력출력측정 출력전압ABX0014.70100.181000.181100.16입력출력측정 출력전압ABX0014.50114.41014.51100.13Table 4-2. NAND 게이트 Table 4-3. NOR 게이트Table 4-4. Table 4-5.입력출력측정 출력전압AX014.4100.13입력출력측정 출력전압AX014.6100.18입력출력측정 출력전압ABX0000.1480100.1621000.161114.41Table 4-6. Table 4-7.입력출력측정 출력전압AX000.133114.4Table 4-8. Table 4-9.입력출력측정 출력전압ABX0000.1380100.1381000.1411114.4입력출력측정 출력전압ABX0000.1480114.411014.401114.414. 평가 및 복습 문제1. 실험 보고서의 진리표를 살펴보고 다음에 답하여라.a. 어떤 회로가 인버터와 등가 회로인가?b. 어떤 회로가 2-입력 AND 게이트와 등가인가?c. 어떤 회로가 2-입력 OR 게이트와 등가인가?2. 어떤 일괄 처리 작업에서는 온도나 압력이 매우 높다는 것을 알려주는 경보 회로가 필요하다. 만약 두 조건 중 하나가 참이면 마이크로 스위치는 그림 4-11에서와 같이 접지로 단락된다. 경보 조건이 참일 때 LED에 요구되는 출력은 LOW 신호이다. A 학생은 OR 게이트가 필요하다고 하고, B 학생은 AND 게이트가 필요하다고 한다. 누구의 말이 옳으며, 그 이유는 무엇인가?3. 자동차 도난 경보기는 보통 문이 닫혀 있을 때 4개의 각 문에 LOW 스위치가 달려 있다. 만약 어떤 문이라도 열리게 되면 도난 경보가 울린다. 경보는 액티브-HIGH 출력을 필요로 한다. 이 논리를 제공하기 위해서는 어떤 유형의 기본 게이트가 필요한가?4. 회로에 2-입력 NOR 게이트가 필요하지만 지금 가지고 있는 것은 7400(4조 2-입력 NAND 게이트)만 가지고 있다고 가정하여라. NAND 게이트를 사용하여 필요한 NOR 함수를 얻을 수 있는 방법을 설명하여라.5. 데이터 송신/수신을 위해 컴퓨터 시스템에서 사용되느 S제어 신호는 DT/R로 표시한다. 이 신호가 HIGH와 LOW일 때 어떤 동작이 일어날 것으로 보는가?6. 4-입력 NAND 게이트 하나를 포함하고 있는 회로를 고장 진단하던 중 NAND 게이트의 출력이 항상 HIGH인 것을 발견하였다고 가정하자. 이는 게이트에 문제가 있다는 것을 의미하는가? 설명해 보아라.실험 5. 추가 논리 게이트1. 실험 목표□ 실험을 통하여 OR와 XOR의 진리표 결정.□ 펄스 파형을 이용하여 OR와 XOR 논리 게이트 테스트□ OR와 XOR 게이트를 사용하여 4비트 2진수의 1의 보수 또는 2의 보수를 실행하는 회로 구성.□ 모의실험용 결함에 대한 보수(complement) 회로의 고장 진단.2. 이론 요약이번 실험에서는 OR와 XOR 게이트를 테스트해 보는데, 먼저 이 게이트들에 대해 자세히 알아보고 응용에서 이들을 사용해 보겠다.2-입력 OR 게이트 진리표입력출력ABX*************-입력 XOR 게이트 진리표입력출력ABX000011101110* OR 게이트에서는,입력 중 어느 하나가 HIGH이면 출력은 HIGH이고, 그렇지 않으면 LOW이다.* XOR 게이트에서는,한 개의 입력만이 HIGH이면 출력은 HIGH이고, 그렇지 않으면 LOW이다.XOR 게이트는 파형의 선택적 반전(inversion)을 가능하게 하는 기능을 가지고 있다.-> 스위치를 열어 놓으면 Inverter 역할# 참고3. 데이터 및 관찰 내용Table 5-2. OR게이트 Table 5-3. XOR게이트입력출력측정 출력전압ABX00000115.011015.011115.01입력출력측정 출력전압ABX00000115.011015.011100Figure 5-2.Table 5-4.입력출력D3 D2 D1 D0Q3 Q2 Q1 Q00 0 0 00 0 0 00 0 0 11 1 1 10 0 1 01 1 1 00 0 1 11 1 0 10 1 0 01 1 0 00 1 0 11 0 1 10 1 1 01 0 1 00 1 1 11 0 0 11 0 0 01 0 0 01 0 0 10 1 1 11 0 1 00 1 1 01 0 1 10 1 0 11 1 0 00 1 0 01 1 0 10 0 1 11 1 1 00 0 1 01 1 1 10 0 0 14. 평가 및 복습 문제1. 실험 순서 3에서 XOR 게이트의 선택적 반전 기능을 언급하였다. 주어진 신호를 발전할지 안할지를 선택하는 방법에 대해 설명하여라.2. 그림 5-2의 회로는 4비트 입력으로 제한되어 있다. 두 개 이상의 IC를 추가하여 8비트 입력 회로로 어떻게 확장할지를 설명하여라.3. 그림 5-4의 비교기는 SA, SB, SC, SD 스위치와 A, B, C, D 입력에 의존하는 출력을 발생시킨다. 비교기가 어떻게 동작하는지를 설명하여라. 출력이 언제 HIGH이고 LOW인가?4. ANSI/IEEE 표준 91-1984의 논리 기호들을 이용하여 그림 5-4를 다시 그려라.5. 2개의 입력 A, B와 이들의 보수 A, B를 사용할 수 있다고 가정하자. 2-입력 NAND 게이트를 사용하여 어떻게 XOR 기능을 실행할 수 있는지를 설명하여라.

공학/기술| 2011.01.05| 9페이지| 2,000원| 조회(515)

디지털 논리 회로, 디논, 논리 게이트

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