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  • VHDL코드를 이용한 4비트 감가산기 구현
    VHDL코드를 이용한 4비트 감가산기 구현
    디지털 시스템 Term project 포트 폴리오설계 과제명Digicom V3.32와 quartusII를 이용한 4비트 감가산기 구현과목명디지털 시스템담당교수ooo 교수님기간-설계 배경디지털 시스템 수업시간에 익힌 내용을 토대로 quartus로써 vhdl code를 작성하여 Digcom v3.2로써 3단스위치와 세그먼트를 이용한 4비트 감가산기를 구현하기로 하였다.설계 내용① Digicom V3.2 에 있는 슬라이드스위치 8개를 4개씩 2부분으로 나누어서 왼쪽부터2 ^{3} ,`2 ^{2} ,`2 ^{1} ,2 ^{0} 순으로 지정하여 스위치를 온 시키는 해당 위치의 값에 ‘1’을 대입하여 0000(2)에서 1111(2)까지 값을 입력②왼쪽의 4비트를 a, 오른쪽의 4비트를 b 로 지정하여 sw라는 3단 스위치가 1단일 때는 a에서 b를 감산, 그렇지 않을 때는 가산③계산의 결과가 16진수로 출력이 되고 음수일 경우에는 (-)부호도 출력④LED D3~D6에 결과값을 2진수로 표현해 출력⑤overflow가 발생시 LED D7에 불이 들어오고, underflow 시 D8에 불이 들어온다.결과VHDL CODE를 이용하여 소스를 구성하고 이를 Digcom v3.2에 구현을 하여 정상 작동하는지 확인 해보았다.비고이oo4비트 감가산기 설계1. 설계 목적- 디지털 시스템 수업시간에 익힌 내용을 이용하여 감가산기의 원리를 이해하고 VHDL code를 작성하여 설계한다. quartus 8.1를 이용하여 Digcom v3.2에 다운로드 후, 정상작동을 확인한다.2. 작동원리① 8번 3단 스위치를 1단에 위치시킴으로써 감산, 다른 곳에 위치시킴으로써 가산을 선택한다.② 1번 스위치인 슬라이드스위치의 SW24~27를2 ^{3}~2 ^{0}으로서 a변수로 주고, SW28~31을2 ^{3}~2 ^{0} b변수로 주어, 각각의 변수의 값을 입력한다.③ 3단 스위치가 1단일 때, 즉, 감산일 때는 a에서 b를 뺀 값을 res라는 변수에 저장을 하고, 가산일 때는 a와 b를 합한 값을 res에 저장한다.④ 가산의 과정- res값이 15보다 크면 overflowr가 발생하는데 이 때, over라는 변수에 ‘1’값을 넣고 그것을 이용해 “overflow LED”로 지정한 LED D7에 불이 들어오고 양수 값이므로 부호는 생략한다.⑤ 감산의 과정- res값이 0보다 작으면 underflow가 발생하는데 이 때, under라는 변수에 ‘1’값을 넣고 그걸 이용해 “underflow LED”로 지정한 LED D8에 불이 들어오고 seg4에 (-)부호가 출력된다.- (-)res값을 16으로 나눈 몫을 seg5 그 나머지를 seg6 LED에 출력하도록 한다.⑥ res값이 0보다 작은 경우를 제외하고는 res값이 양수이므로 res값을 16으로 나눈 몫을 seg5 그 나머지를 seg6 LED에 출력하도록 한다.⑦ over값과 under값이 둘다 0일 경우 res 값을 sum에 입력하여 그 sum을 LED3~LED6에 2진수의 꼴로 표현된다.3. VHDL code--4bit subadder--library ieee;use ieee.std_logic_1164.all;package mydata issubtype adder_range is integer range 0 to 15; -- adder_range 의 범위 0 ~ 15subtype result_range is integer range -15 to 30; -- result_range 의 범위 -15 ~ 30end mydata;library ieee;use ieee.std_logic_1164.all;use ieee.std_logic_arith.all;use ieee.std_logic_unsigned.all;use work.mydata.all;entity addsub isport( a, b : in adder_range;sw : in std_logic;seg1, seg2 : out std_logic_vector(6 downto 0);sign : out std_logic;sum : out result_range;underflow, overflow : out std_logic);end addsub;architecture design of addsub issignal over, under : std_logic;signal seg1Reg, seg2Reg : integer range 0 to 15;beginprocess(sw, a, b, over, under)variable res : result_range;beginif (sw = '0') then res := a + b;else res := a - b;end if;if (res < 0) then under
    공학/기술| 2020.05.19| 8페이지| 1,000원| 조회(334)
    태그 디지털, VHDL, 텀프로젝트, 디지털회로, 쿼터스, 디지털시스템, 디지컴, Digi..
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  • 수학의산책 인터넷강의 1차 과제
    수학의산책 인터넷강의 1차 과제
    <썸네일을 참고해주세요>
    자연과학| 2016.05.30| 7페이지| 1,000원| 조회(62)
    태그 레포트, 보고서, 1차, 과제, 수학의산책
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  • 9장결과- BJT 에미터 바이어스, 콜렉터궤환 바이어스
    9장결과- BJT 에미터 바이어스, 콜렉터궤환 바이어스
    실험.9 BJT 에미터 바이어스, 콜렉터궤환 바이어스[결과]1. 실험결과1)beta 의 결정①2N3904 트랜지스터를 사용하여 회로를 구성하라.②(측정치)전압V _{B}= 5.158V,V _{R _{C}}= 4.559V③I _{B}={V _{CC} -V _{B}} over {R _{B}}=14.84mu AI _{C}={V _{R _{C}}} over {R _{C}}=2.072mA④beta ={I _{C}} over {I _{B}}=151.822)에미터 바이어스회로①단계1.에서 결정된 β값을 이용하여, 측정된 저항치와 공급전압V _{CC}를 이용해서I _{B}와I _{C}값을 계산하라I _{B}=4.20mu A,I _{C}=2.308mA②그리고 베터리와 저항은 그대로 유지하고, 2N3094 트랜지스터를 2N4401 트랜지스터로 바꾼 후, 위의 과정을 반복하여V _{B} ,V _{C} ,V _{E} ,V _{BE} ,V _{CE}을 측정하여 아래의 표에 기록하라.계산치트랜지스터 형V _{B}(V)V _{C}(V)V _{E}(V)V _{BE}(V)V _{CE}(V)I _{B}(mu A)I _{C}(mA)2N39045.7914.935.110.6859.8214.202.3082N44015.4415.34.760.6489.8814.212.17축정치측정치로 부터트랜지스터 형V _{B}(V)V _{C}(V)V _{E}(V)V _{BE}(V)V _{CE}(V)I _{B}(mu A)I _{C}(mA)β2N39045.15815.584.610.68810.9515.822.111133.442N44017.3013.276.8070.6366.3813.563.115229.72③2N3904 트랜지스터를 2N4401 트랜지스터로 바꾸고,V _{R}와V _{R _{C}}를 측정하고, 측정된 저항을 이용하여I _{B}와I _{C}의 값을 계산하라. 그리고 트랜지스터의beta 값을 결정하여I _{B} ,I _{C} ,beta 를 기록하라.④다음 식을 이용하여beta ,I _{C} ,V _{CE} ,I _{B}의 백분율 변화를 계산하여 기록하라.%TRIANGLE beta ={LEFT | beta _{(4401)} - beta _{(3904)} RIGHT |} over {LEFT | beta _{(3904)} RIGHT |} TIMES 100%, %TRIANGLE I _{C}={LEFT | I _{C _{(4401)}} -I _{C _{(3904)}} RIGHT |} over {LEFT | I _{C _{(3904)}} RIGHT |} TIMES 100%, %TRIANGLE V _{CE}={LEFT | V _{CE _{(4401)}} -V _{CE _{(3904)}} RIGHT |} over {LEFT | V _{CE _{(3904)}} RIGHT |} TIMES 100%, %TRIANGLE I _{B}={LEFT | I _{B _{(4401)}} -I _{B _{(3904)}} RIGHT |} over {LEFT | I _{B _{(3904)}} RIGHT |} TIMES 100%%TRIANGLE beta %TRIANGLE I _{C}%TRIANGLE V _{CE}%TRIANGLE I _{B}77.88%52.26%71.63%14.4%[beta ,I _{C} ,V _{CE} ,I _{B}의 백분율 변환]3)컬렉터 궤환회로①2N3904 트랜지스터를 사용해 구성하여라.②단계1)에서 결정된beta 를 이용하여I _{C} ,I _{B} ,V _{C} ,V _{B} ,V _{CE}를 계산하여 기록하고,V _{C} ,V _{B} ,V _{CE} 를 측정한 후,I _{C}CONG {V _{R _{C}}} over {R _{C}}의 식을 이용하여 전류I _{B}와I _{C}를 계산하라.③또한 2N3904 트랜지스터를 2N4401 트랜지스터로 바꾸고 순서②를 반복한다.④beta ,I _{C} ,V _{CE} ,I _{B}의 백분율 변화를 계산하라.이론적인 계산치트랜지스터 형V _{B}(V)V _{C}(V)V _{CE}(V)I _{B}(mu A)I _{C}(mA)beta2N39045.7914.935.110.6859.8214.202N44015.4415.34.760.6489.8814.21측정치측정치로부터 계산치트랜지스터 형V _{B}(V)V _{C}(V)V _{CE}(V)I _{B}(mu A)I _{C}(mA)beta2N39045.15815.584.610.68810.9515.822N44017.3013.276.8070.6366.3813.56%TRIANGLE beta %TRIANGLE I _{C}%TRIANGLE V _{CE}%TRIANGLE I _{B}77.88%52.26%71.63%14.4%[beta ,I _{C} ,V _{CE} ,I _{B}의 백분율 변환]2. 검토 및 토의이 실험은 에미터 바이어스 회로와 컬렉터 궤환 바이어스 회로에 대한 실험이다. 에미터 바이어스는 고정바이어스에서 에미터 부분에 저항R _{E}를 추가함으로써 안정도를 높여주는 방식이다. 그리고 컬렉터 궤환 바이어스 회로란 바이어스 저항기를 컬렉터로 이동시키는 것에 의해 감소할지도 모른다고 생각하고 접근한다. 만약 이미터 전류가 증가하면R _{C} 에서의 전압강하는 증가,V _{C} 는 감소하고, 베이스로의 궤환I _{B} 는 감소한다. 이것이 반복되면, 이미터 전류는 감소하고, 처음의 증가를 바로잡는다. 이와 같은이유로beta 의 값이 변하여도I _{C}의 값의 변화를 최소화 시켜 회로의 안정도를 높여주는 시스템이다. 위의 실험결과를 통해서 알 수 있는데, 먼저 에미터 바이어스 회로를 보자. 계산치와 측정치의V _{B} ,V _{C} ,V _{E} ,V _{BE} ,V _{CE}의 값이 모두 차이가 있는데, 그 이유는 이론적으로 사용한 저항은 실질적으로 회로에서의 저항은 오차가 있기 때문이다. 그리고 2N3904 트랜지스터에서 2N4401 트랜지스터로 교체한 후,beta 의 값이 감소하였는데,I _{C}의 변화율은 증가하였음을 볼 수 있다. 고정바이어스 회로라면beta 의 변화와 동일하게I _{C}가 변하겠지만, 에미터 바이어스 회로는 저항R _{E}로 인해 안정도를 높여 주었다. 그리고 두 번째로 콜렉터 궤환 바이어스 회로를 보자. 트랜지스터를 2N3904에서 2N4401로 교체하면,beta 의 값은 152.45에 168.43로 증가하게 되는데, 이 때I _{C}의 변화율은 증가하였다. 이는 에미터 바이어스 회로보다도 더욱 낮은 변화율을 가지게 되는데, 이는 안정도가 더 높다고 할 수 있다. 결국 트랜지스터 동작점 영역의 폭이 넓은지, 좁은지에 따라서 좋고 나쁨을 가려낸다. 영역의 폭이 넓으려면 회로내부에서
    공학/기술| 2016.05.30| 2페이지| 1,000원| 조회(79)
    태그 전자실험, 결과, 9장, BJT 에미터 바이어스, 콜렉터궤환 바이어스
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  • 7장결과- 키르히호프 전압법칙(KVL)
    7장결과- 키르히호프 전압법칙(KVL)
    실험.7 키르히호프 전압법칙(KVL) [결과]1.결과 값7-1 저항기의 측정 저항값R_1R_2R_3R_4R_5R_6R_7R_8정격 값(Ω)3*************2*************0측정 값(Ω)339476*************73325046957-2 전압원과 저항이 직렬로 연결되어 있는 회로표시값예상값측정값R2000Ω1994ΩV_15V5.01VV_25V5.01VI5.10mA5.10mA7-3 두 개의 전압원과 저항의 직렬 연결된 회로표시값예상값측정값R6900Ω6846ΩV_14.77V4.20VV_210.12V8.93VI2.17mA2.03mA7-4 키르히호프의 전압법칙 입증V_PSV_1V_2V_3V_4V_5V_S계산값(그림7-6)15V1.89V2.69V4.70V5.73V15.01V측정값(그림7-6)14.88V1.98V2.74V4.85V5.77V15.3V계산값(그림7-7)15V0.73V0.64V2.14V1.34V12.06V15.91V측정값(그림7-7)14.87V0.84V0.78V2.28V1.46V10.09V15.45V2. 실험 결과 고찰1) 실험 A의 결과를 KVL을 써서 회로를 해석하시오.인가전압 10V에 대해서 1kΩ의 저항 두 개가 직렬로 연결되어 있다. 두개가 같은 저항값을 가지기 때문에 두 저항에 걸리는 전압의 비율은 1:1 즉 5V씩 걸리게 된다. 인가된 전압 10V를 음의 값으로 잡고 전압강하가 일어나는 저항 두 개는 양의 값으로 잡는다. 그런다음 이 저항들의 총합은-10V+5V(R _{1} )+5V(R _{2} ) image 0 이다. 다시말해 모든 전압의 합 은 약간의 오차가 있지만 0이라고 할 수 있다. 다르게 말하면 인가전압의 합=전압강하의 합 이라고도 할 수 있다.2) 실험 B의 결과를 KVL을 써서 회로를 해석하시오.인가전압 10V와 3V의 합 13V에 대해 저항 두 개에 걸리는 전압의 비율은 약 2:1이고 계산해 본다면R _{1}에는 4.14VR _{2}에는 8.85V가 걸리게 된다. 이 값들 을 KVL에 적용해 보면 인가된 전앖 10V와 3V를 음으로 잡고 전압강 하가 일어나는 저항 두 개에 걸리는 값은 양으로 잡는다. 이것을 식으로 나 타내면-10V-3V+4.14V+8.85V image 0이다. 다시말해 인가된전압과 저 항에 걸리는 저항의 합은 약간의 오차가 있지만 0이라고 할 수 있다. 다 르게 말하면 위와 같이 인가전압의합=전압강하의 합 이라고도 할 수 있다.3) 실험 B에서는 실험 A보다 독립전압원이 하나 더 추가되었다. 어떻게 변하였는가? 설명하시오.크게 변화된 점은 없다. 두 개의 독립전원을 하나로 합해서 생각하면 된다.7. 토의1) 실험 B와 같은 전압원이 두 개가 연결이 될 때에는 접지를 어떻게 해야하는가?V1의 -전압을 V2의 +전압으로 연결하고 V2의 -전압 부분을 그라운드로 접지하면 된다.따라서 R2의 양단 중에 V2와 맞닿은 점 또한 그라운들 접지된다.2) 실제 회로에서는 KVL이 사용되면 오차가 생긴다. 원인이 무엇이라고 생각하는가?오차가 생기는 이유는 실험측정값의 오차때문인데 그 원인으로는 첫 번째 실험에 사용된 저항들이 표기된 값을 정확하 게 나타내지않고 오차가 존재하는데 그것은 저항내부의 내부저항 때문이다. 두 번째로는 실험에 사용된 실험 기기들의 내부저항 때문에 측정값들의 오차가 존재한다. 세 번째로는 실험 회로구성에서 저항을 접촉되는 점에서 발생되는 저항 때문에 발생하는 오차값이 있다. 즉 이상적인 회로와 이상적인 실험기기가 아니고 실제 적용되는 경우기 때문에 이론 상의 이상적인 경우처럼 오차가 발생하지 않을 수 없다.
    공학/기술| 2016.05.30| 2페이지| 1,000원| 조회(78)
    태그 결과, 7장, 키르히호프 전압법칙(KVL)
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  • 수학의산책 인터넷강의 2차 과제
    수학의산책 인터넷강의 2차 과제
    2014년도 1학기 수학의 산책 : 2차 과제대학: - 학과: - 학번: - 이름: -1. 다음 문제는 합동식 계산에 대한 연습입니다.(1) a == 11(mod26) 이고 b==19(mod 26)일 때 a+b(mod26), -2a+3b(mod26)과 a ^{10} (mod26)의 값을 계산하시오.a+b(mod26)=11+19(mod26)=30(mod26) == 4(mod26)-2a+3b(mod26)=-2 BULLET 11+3 BULLET 19(mod26)=-22+57(mod26)=35(mod26) == 9(mod26)a ^{10} (mod26)=11 ^{10} (mod26)=25937424601(mod26)=26 BULLET 997593253(mod26) == 23(mod26),,또는a ^{10} (mod26)=11 ^{10} (mod26) == (11 ^{5} ) ^{2} == 7 ^{2} == 49 == 23(mod26)(2) e==19(mod 26)일 때 e CDOT d == 1`(mod26)을 만족하는 1
    학교| 2016.05.30| 8페이지| 1,500원| 조회(131)
    태그 레포트, 보고서, 과제, 2차, 수학의산책
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