"논리회로설계및실험"의 검색결과 입니다.

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전전설2 성결대 논리회로 실험12 멀티플렉서 4bitfulladder 두더지 잡기 plc제어

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"논리회로설계및실험" 검색결과 1,201-1,220 / 1,755건

7-segment를 이용한 게임만들기 계획서

을 사용할 수 있다)논리회로실험 시간에 배운 IC를 사용한다.가능한 한 최소화해서 일부 IC를 사용한다.수업시간에 배운 내용을 반영해야 한다.3 - 11 ... 한인석20721779 허유현팀 구성원의 역할이완상 : 물품 구매 및 회로 구현한인석 : 회로설계 및 구현허유현 : 발표자료(PPT) 및 Report 작성, 회로설계7 - 11설계 ... / 목표디지털 논리장치의 기초적인 처리를 이해한다.2 - 117-segment와 74LS47을 이용하여 디지털 논리회로를 구현한다.디지털 논리회로를 이용하여 간단한 게임을 구현

리포트 | 13페이지 | 1,000원 | 등록일 2010.10.29

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[디지털시스템실험(Verilog)] Verilog 기본 실습 예비보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목Verilog실험목표 ... 이 끝나면, 기본적으로 Nets를 통해 회로를 직접적으로 코딩해야 한다. Nets란 하드웨어 요소 사이의 논리적 연결을 나타내며, 그 종류로는 wire, wand, wor, tri 등 ... 의 설계아래에는 32-bit adder의 설계를 대비하여 Verilog의 기본 Syntax들을 미리 정리하고, 실험 목적에 맞게 직접 코딩해보았다. 그러나 프로그램의 코딩은 사용자

리포트 | 2페이지 | 1,000원 | 등록일 2011.10.05

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기본논리회로 및 부울대수, 회로의 간소화 및 Exclusive OR회로

명제가 참인지 거짓인지를 논하기 때문에 논리대수라고 한다. 전화교환기 등의 통신분야 및 컴퓨터의 논리 회로에 응용되고 있으며, 불 대수를 이용하여 논리 회로를 설계할 경우 복잡 ... 1.Title기본논리회로 및 부울 대수회로의 간소화 및 Exclusive OR회로2.Name3.Abstract1) 기본적인 논리 요소인 Gate(AND / OR / NOT ... / XOR 등)에 대하여 이해한다.2) 기본논리회로 제작을 통해 부울대수 공리 및 정리를 이해한다.3) K-map을 이용한 부울함수 유도 및 회로 최적화에 대하여 이해한다.4

리포트 | 75페이지 | 3,000원 | 등록일 2010.06.09

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Encoder, Decoder, Mux 예비레포트

할 수 있게 된다.실험 3. 8 by 3 Encoder 를 gate를 이용하여 설계하고, 모의실험을 통해 검증하라.위의 회로도는 8 by 3 Encoder를 gate를 이용하여 설계 ... 까지의 신호를 3비트의 2진수로 코드화 시키는 것 이었다.실험 4. 3 by 8 Decoder를 gate를 이용하여 설계하고, 모의실험을 통해 검증하라.위 회로는 3 by 8 Decoder ... 를 gate를 이용하여 설계한 회로이다. 위 회로의 시뮬레이션은 다음과 같다.Decoder는 2진화 되어있는 n개의 입력을 ,개의 출력으로 나타내는 것으로써 실험 4는 3비트

리포트 | 14페이지 | 1,000원 | 등록일 2010.10.16

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2진계수기 실험보고서

기의 동작과 특성을 실험한다.3. 필요부품 및 기기- 디지털 회로 실험기, DCT - 201 1대- 직류 전압계, VOM 1대- 7476 dual JK Flip - Flop op ... 실험보고서,목 차1. 목적 ……………………………………… 3P2. 서론 ……………………………………… 3P3. 부품 및 기기 …………………………… 3P4. 실험순서 ... ……………………………… 3P5. 2진 계수기(Binary Counter)란? ,4 4P6. 실험과정 ………………………………… 5P8. 소감 및 고찰 ……………………… 6~7P1. 목적- 2진 계수

리포트 | 7페이지 | 2,000원 | 등록일 2011.11.21

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디지털 텀프 정환 디지털오르간

Term project - 디지털오르간과 목디지털논리회로실험학 과전자공학과요 일화요일조1조조 원담당교수담당조교Ι. 제목DIGITAL ORGAN (Using Counter with ... )시간을 10초씩 증가 시켜주기 위하여 0~5까지 작동하는 6-module counter가 필요하다. jk f/f을 이용하여 모듈을 설계하고 디바운싱 회로를 스위치의 인풋에 drive ... down 카운터를 설계하였다. 시계의 초가 0에서 9로 바뀌는 timing에 down counter를 사용하여 1씩 다운시켜주었다③ 회로 stop 제어on_off switch에 의해

리포트 | 13페이지 | 1,000원 | 등록일 2013.01.24

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기초전기전자실험 보고서(PLC 제어 실험)

기초 전기전자 실험 보고서실험 20 PLC 제어학 과 : 기계공학부제출일 : 2012년 10월 15일□ 실험 목적CNC(Computer Numerical Control)와 PLC ... 을 순차 제어하는 기능으로서, NCK가 담당하는 서보제어 부분을 제외한 각종 기계동작을 위한 보조적인제어 기능을 담당□ 실험 순서1. RS-232 케이블을 컴퓨터와 PLC에 연결한다.2 ... 가 열린다(후진). (클램핑실린더는 열리는게 후진이기 때문에 반전코일을 이용하여 아웃풋으로 설정해야 하지만 실험당시 제대로 작동하지 않아 그림과 같이 설정했다. 원인은 모르

리포트 | 9페이지 | 2,000원 | 등록일 2014.04.28

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[전자회로실험] MOSFET의 특성 예비보고서

전기회로 설계 및 실험 KEEE205_05 전기전자전파 공학부전자회로 설계 및 실험 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목MOSFET의 특성실험목적 ... 공정이 비교적 간단하다. MOSFET만을 이용하여 디지털 논리 기능과 메모리 기능을 실현할 수도 있다.☞ 현재 대부분의 VLSI 회로는 MOS 기술로 만들어지고 있다.② 전류 전도 ... 속박 음전하들은 그들을 중화시키던 정공들이 기판 아래쪽으로 밀려났기 때문에 “노출되어” 있을 것이다.또한, 양의 게이트 전압은 전자들을 n+소스 및 드레인 영역으로부터 채널 영역

리포트 | 5페이지 | 1,500원 | 등록일 2011.10.05

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4. 디코더,인코더 및 다중화기 역다중화기 7세그먼트 디코더

년도?학기2011년 1학기과목명디지탈논리회로실험LAB번호실험 제목4디코더/인코더 및 다중화기 역자중화기, 7세그먼트 디코더실험 일자제출자 이름제출자 학번팀원 이름팀원 학번 ... Chapter 1. 관련 이론(Theoretical Background)1. 디코더(Decoder)디코더(decoder)는 N bit 2진 입력 코드를 2N개의 출력으로 변환하는 논리회로 ... ~9까지 10개이며 출력은 BCD코드에 대응하여 4개이다.3.다중화기(MUX, multiplexer)여러 개의 입력을 받아 그 중 하나의 입력만을 선택하여 출력하는 논리회로를 다중

리포트 | 9페이지 | 1,000원 | 등록일 2011.06.08

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판매자 표지

대입자기소개서

를 다녀올 계획입니다. 그리고 복학 후 전자산업분야의 전문 지식인으로 성장하기위해 심도 있는 공부를 진행하고 싶습니다. 전자공학과 관련된 교과인 공학설계, 회로 및 시스템, 전자회로Ⅱ ... 등 전공학습에 열심을 내겠습니다. 3학년 때는 전공심화과정인 공학설계, 전자회로실험Ⅱ, 등 전자공학 중에서 전자회로 관련한 이론과 실전 능력을 쌓겠습니다. 전공자가 전문적인 기초 ... 지식 완성하고자 합니다. 4학년 때는 초고주파 공학실험, 집적회로I, 전자공학 종합설계Ⅱ, 집적회로II 와 같은 전자회로 관련 담당교수님의 도움을 받아 저만의 특별한 논문을 작성

자기소개서 | 5페이지 | 4,900원 (30%↓) 3430원 | 등록일 2013.06.12 | 수정일 2020.09.23

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5주차 결과보고서(UART와 AD컨버터)

실험(4) 결과보고서마이크로컨트롤러 기능? UART? A/D converter실험(4) 4주차 예비보고서(타이머와 PWM)A886042 유동현실험(4) 결과보고서(UART와 A ... 다. 이렇게 높은 주파수의 신호가 필요한 것은 수신부 때문이다.UART의 수신부는 수신 신호의 상태가 논리 ‘1’에서 논리 ‘0’으로 변하는 하강 에지, 즉 시작비트를 기다린다. 하강 ... -232 상태▶ 빌드시킨 후 UART로 PC와 데이터를 주고받는 모습이다.실험(4) 4주차 예비보고서(타이머와 PWM)A886042 유동현실험(4) 결과보고서(UART와 A/D c

리포트 | 12페이지 | 2,000원 | 등록일 2014.07.08 | 수정일 2023.09.07

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[디지털시스템실험(Verilog)] Multiplexer & Logical Unit 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목Multiplexer ... & Logical Unit실험목표① 128 to 4 Multiplexer를 hierarchy하게 설계한다.② Processor의 Logical Unit들을 설계한다.실험결과실험 ① 128 to ... 이 결과 'dout'에 정확히 도출되었음을 확인할 수 있다.실험 ② Logical Unit들의 설계32bits AND, OR, XOR, NOT게이트의 설계는 테스트벤치 파일을 제작

리포트 | 3페이지 | 2,000원 | 등록일 2011.10.05

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디지털실험 3 - 2비트 전가산기 결과레포트

실험은 반가산기, 전가산기의 원리 및 구조를 해석하는 능력을 키우고, 다양한 가산기를 사용하여 논리회로를 구성하는 능력 또한 키울 수 있는 실험이었다.실험 5개 중에 2,4,5번 ... 의 회로는 전감산기를 나타내고,논리회로 식은 아래와 같다.D=( AB )Bn-1B=A'B+(AB)'Bn-1이 실험 또한 이론치와 같게 나왔다.○ 실험 5의 결과를 기입하라.A0=0 ... 의 성질을 띄고 있다고 봐도 될 것 같다.다음 4번 실험은, 전감산기를 나타내는데 이것은 가산기의 응용된 형태라 볼 수 있다. 결과값이 더해지는 것이 아닌 빼지는 전감산기의 논리회로 식

리포트 | 11페이지 | 1,000원 | 등록일 2012.03.09

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[Lab#2]논리게이트 회로 실습

/ 디지털공학 및 설계_2011_기계공학과Digital Engineering and LabDept. of Mechanical Engineering('11.3.31 목)(오후)반 ... , 성명: 신호영 학번: 200810211 제출마감: '10.4.11(월) 20:00[Lab.2]논리 게이트 IC회로 실습[1]학습목표a)AND, NAND, OR, NOR, XOR ... 한다.d)주어진 회로도를 이용하여 breadboard에 회로 구성과 부품을 연결하는 능력을 배양한다.[2]부품 및 실습기기 (각 IC의 data sheet 준비)품명사양수량품명사양

리포트 | 16페이지 | 1,000원 | 등록일 2011.06.01

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4자리 가감산기 / 8421가산기 최종보고서

의 가감산회로를 설계하는 방법을 이해한다.③ BCD 가산기의 가산원리를 이해하고 논리게이트를 써서 설계한다.최종보고서 < 4자리 가감산기 / BCD 가산기 설계 > 2 조Ⅱ. 합성1 ... . 설계순서① 74H87과 74LS83을 써서 진, 보, 영, 일기의 논리회로 설계② 4자리 가감산기 설계③ BCD 가산기 설계2. 성능2-1. 진-보-0-1 기하나의 논리회로 ... 도최종보고서 < 4자리 가감산기 / 8421가산기 설계 > 2 조Ⅲ. 분석1. 회로도 및 시뮬레이션 파형1-1. 진-보-0-1 기회로도파형1-2. 74H87회로도파형1-3. 74

리포트 | 19페이지 | 2,000원 | 등록일 2010.09.19 | 수정일 2020.12.14

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아주대논리회로실험 7장시프트레지 예비보고서(기본구성+빵판+예상결과)

하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반:조 :학 번:성 명:1실험9. 예비 16조 허성인실험7. 예비보고서 16조1. 실험 목적시프트 ... 하며, 설계 절차는 sequential circuit의 설계와 같다.② Up-Down Binary Counter : up 카운트와 down 카운트를 할 수 있는 카운터.3. 실험 기기(1 ... +55+50+50+50060+50+50+52) 집적회로 시프트 레지스터이 실험은 7496 5비트 shift-right 레지스터를 사용한다. 이 IC는 5개의 master-slave Rm이다.

리포트 | 8페이지 | 1,500원 | 등록일 2011.12.21

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[12주차] Calulator

과 목 : 논리회로설계실험과 제 명 : 계산기 설계담당교수 : 정일섭 교수님학 과 : 전자전기공학과학 년 :이 름 :제 출 일 :논리회로설계실험 - 계산기 설계 과제7조 ( 유광 ... 위 / 박석호 )0. Purpose지난시간에 배운 LCD를 활용하여 감가산기의 설계를 해본다. 감가산기는 앞에서 실습했던 4bit full_adder를 사용하고 이에 대한 입력 ... 은 딥스위치와 버튼스위치를 사용하여 설계를 한다.1. Back Ground. 4bit full_adder_subtracter위의 block diagram을 모두 기억하고 있을 것이

리포트 | 20페이지 | 2,000원 | 등록일 2012.06.30

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드 모르간의 법칙(예비)

실험 9 드 모르간의 법칙1. 실험 목적▣ 드 모르간 법칙을 소자를 이용하여 실험적으로 증명한다.▣ 드 모르간 법칙을 이용하여 부울대수 변환 및 논리회로를 간소화하는 능력 ... 을 익힌다.▣ 논리소자의 동작을 이해한다.※ 실험 부품 및 장비구 분명 칭비 고실험 및 계측장비논리회로실험장치(logic lab unit)오실로스코프20[MHz]이상, 2채널용멀티메타 ... 게이트 실험그림 3-7과 같이 NOT, NAND 및 NOR 게이트를 이용하여 회로를 구성하고, 실험 결과는 표 3-5와 그림 3-8의 타이밍도에 기록한다.논리회로 실험장치 또는

리포트 | 6페이지 | 1,000원 | 등록일 2010.07.14

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TTL-Logic 예비보고서

Logic 실험 -- 조 -소속 :학번 :이름 :담당조교 :◎ 기본 논리게이트(Logic Gate)에 대하여 설명하시오.→ 논리 게이트는 일반적으로 1개 이상의 입력 단자와 하나의 출력 ... 단자로 구성되는 기본적인 논리회로를 일컫는다.→ 논리 회로를 구성할 때는 불 대수와 진리표, 카르노 도표 등의 방법을 이용하여 논리식을 최소화 하고, 이렇게 최소화된 식을 기본 ... 논리 게이트들로 구성하여 만들게 된다.※ 컴퓨터 회로를 구성하는데 필요한 기본적인 논리 게이트에는 논리곱(AND),논리합(OR), 논리부정(NOT) 등이 있다.○ 논리곱 (AND

리포트 | 11페이지 | 1,000원 | 등록일 2011.03.10

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[토끼] Synchronous MOD 12 Counter, 10 Counter, N Counter 설계 및 구현, 검증

이 수 있었다.세 번째 회로도는 3비트 카운터-감소 회로도 인데 실험 내용에는 나와 있지 않지만 연관이 있는 것 같아서 올렸다. 일반적으로 출력은 Q 만쓰고 Q' 는 사용하지 않 ... 의 확인을 용이하게 하였다.실험3) 74LS161을 사용하여 synchronous MOD N Counter 를 설계하고 제작하여 동작을 확인하라< ORCAD Schematic ... 으로 가서 시작 >< 0~11까지 세그먼트 표시 참고 >< 쿼터스 컴파일 및 핀 할당 화면 >B. Discussion실험 결과를 보면 피스파이스 시뮬레이션과 납땜의 동작, 그리고

리포트 | 36페이지 | 5,000원 | 등록일 2011.04.11 | 수정일 2014.06.08

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