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기초디지털실험 기초디지털실험2 디지털논리회로 전전설2 FPGA PLD 종류 장단점 논리회로
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"logic circuit" 검색결과 521-540 / 690건

  • 자료 표지
    BJT 기본 특성 실험
    영역은 증폭기로 사용되고, Saturation 영역은 Switching 하므로 Logic Gate 등에 많이 이용한다.BJT 의 기본 동작 및 전류 특성에 대해 자세히 알아보 ... 므로 Logic Gate등에 많이 이용된다.●결과 분석 및 토의사항1. 측정한 값을 바탕으로 Ic-VCE 특성곡선을 그래프로 그리시오.2. VBE=3V 일 때, 활성 영역에서의 Ic 곡선 ... 은 Microelectronic CIRCUIT 책의 p.400 의 그림이다.실제의 Ic-Ice 특성곡선을 그려보면, saturation region 일 때, 일정한 값으로 유지
    리포트 | 7페이지 | 1,000원 | 등록일 2009.12.15 | 수정일 2015.09.08
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  • 자료 표지
    [논리회로실험] CMOS회로의 전기적 특성(예비)
    output of a logic circuit takes to change from one state to another(논리회로에서 하나의 상태에서 다른 상태로 천이할 때 걸리 ... 1. 실험목표1) High-speed CMOS logic family인 74HC시리즈의 전기적 특성을 이해하고 실험을 통해 동작을 확인한다.2) CMOS IC의 데이터시트 ... 상승엣지이므로 해당 핀이 L에서 H로 변하는 순간 작동하게 됩니다.4. 실험방법1) Logic Levels & DC Noise Margins(1) DC 전원공급기는 VIN
    리포트 | 12페이지 | 1,500원 | 등록일 2009.03.20
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  • 자료 표지
    Speaking Lesson Plan
    computer, but how to design computer architecture or digital logic circuit. But many people would
    리포트 | 6페이지 | 2,000원 | 등록일 2010.02.06
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  • 자료 표지
    [컴퓨터 구조] VHDL을 이용한 4bit ALU 설계
    -bit arithmetic circuit2) 4-bit logic circuit3) 4 to 1 MUX(2) 4-bit ALU의 기능1) 4-bit arithmetic ... circuit의 기능2) 4-bit logic circuit의 기능3) 4 to 1 MUX의 기능(4) 4-bit ALU의 진리표2) VHDL을 이용한 4-bit ALU설계3) 시뮬레이션후 ... 출력값 확인3. 결론1. 서론-. 4-bit ALU : 산술 연산기(Arithmetic circuit)와 논리 연산기(Logic circuit), 그리고 멀티플렉서(MUX
    리포트 | 10페이지 | 1,000원 | 등록일 2005.06.01
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  • 자료 표지
    아주대학교 논리회로실험 예비8소스
    있다. 이번 실험에서 사용하는 memory들은 positive logic일 때는 데이터가 memory에 기록되고 negative logic일 때는 밖으로 읽혀진다. RAM은 크 ... 에 주로 사용된다.(4) IC 메모리(integrated circuit memory) :=> RAM은 하나의 기본단위인 2진소자마다 R-S 플립플롭을 사용하여 구성되어진다. 이것
    리포트 | 3페이지 | 1,500원 | 등록일 2008.11.27
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  • 자료 표지
    FPGA 구조와 응용
    FPGA 구조와 응용FPGA를 알기 전에FPGA를 알기 전에 그보다 큰 범주인 PLD와 ASIC이란 단어에 대해 알아보면,PLD(Programmable Logic Design ... ) 란 사용자가 필요로 하는 논리 기능을 직접 만들어 쓸 수 있는 IC로서, 현재 ASIC(Application Specific Integrated Circuit )등의 내부에 사용 ... 되고 있는 PLA(Programmable Logic Array)와 같이 급속히 발전하고 있다. 그래서 대표적인 MMI사(현재는 AMD사)의 PAL (Programmable Array
    리포트 | 20페이지 | 2,000원 | 등록일 2007.03.23
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  • 자료 표지
    IEEE802
    (bandwidth)을 하나하나 각각의 장치에 할당한다. LLC(Logical Link Control)계층은 전통적인 데이터 연결 계층을 확장한 것으로 단일 매체와 좀더 논리적 연관 관계를 갖 ... 는 802.3 프레임 안에 LLC(Logical Link Control) 헤더의 포함여부에 있다. Ethernet은 자신의 헤더에 상위 계층으로의 연결을 위한 요소(Type field ... )를 Gbit/s (125 and 1,250 MB/s) over HYPERLINK "http://en.wikipedia.org/wiki/Printed_circuit_board" \o
    리포트 | 29페이지 | 3,500원 | 등록일 2008.05.13
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  • 자료 표지
    [디지털실험] 기본 논리게이트의 특성이해
    1. 실험 목적- 각정 기본 논리게이트의 특성이해Kinds of basic logic gateX-ORX-NOR 1X-NOR 2NAND X-ORGray Code2. 관련 이론☞ X ... -OR gate circuit - 입력 조건 중 둘 다 HIGH이거나 둘 다 LOW이면 출력에서는 LOW을 나타내고 둘 중 하나만 HIGH이면 HIGH의 값을 출력한다.X-NOR ... gate circuit - X-OR 게이트의 반대 값을 나타내는 게이트로써, 입력 값이 둘 다 HIGH이거나 LOW이면 출력값에는 HIGH인 반면에 둘 중 하나의 값만 HIGH이
    리포트 | 15페이지 | 2,000원 | 등록일 2008.03.13
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  • 자료 표지
    디지털 회로 실험 제 6장 입니다.
    ● 실험 내용 : 1. ALU를 이용한 진리표 완성하기*준비물 : LOGIC LAB UNIT, 74LS181 4비트 ALU, 전선*내용 :1. 먼저 74LS181 칩을 적당한 곳 ... Carry inOperationType (M)F3F2F1F0Carry out0111XHHHHXALogic0111XX0011LHLHXNOT (B)Logic1100X11000111 ... BArithmetic1101L(1)10100001HHHHHA MINUS 1Arithmetic1001L(1)2. 두개의 NAND 게이트로 이루어진 RS latch설계하고 써킷
    리포트 | 2페이지 | 1,000원 | 등록일 2006.10.06
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  • 자료 표지
    (전자공학) 능동필터 실험 및 시뮬레이션
    n1MHz이하에서 사용하고 동조하기 쉽다. n차수 n=C의 수능동/수동의 차이기본적으로 FET/BJT/Diode 류의 비선형소자를 포함한 회로를 능동회로(Active circuit ... )이라 부르고, 그렇지 않은 회로를 수동회로(Passive circuit)이라고 부른다. 이 분류법은 일반 전자회로와 완전히 동일하다.비선형소자가 포함된 경우에는 제3의 사용 ... 하면 됩니다. TR, FET, OPAMP, LOGIC...따라서 R,L,C로만 구성된 필터라면 수동필터라고 할수 있고, 여기에 OPAMP나 TR들을 사용했다면 능동필터가 된다.구성
    리포트 | 5페이지 | 1,500원 | 등록일 2008.12.14
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  • 자료 표지
    [경영전략]세계의 반도체 산업의 경영전략 사례 보고서
    를 만드는 방법을 발견하였고 1959년 Texas Instruments와 Fairchild 반도체회사가 각각 독자적으로 접 적회로(IC: Integrated Circuit)에 대한 ... /analog)집적회로(IC)디지털방식(Digital)DRAM SRAM EPROM 기타메모리(Memory)로직(Logic)먼저 트랜지스터와 같이 성숙화된 제품인 Discrete ... 다. 디지털IC란 ON과 OFF의 스위치로 작동하는 것으로 메모리(memory)와 로직(logic) 두 가지 종류가 있다. 메모리란 정보를 저장하는 수단으로서 우리가 가장 잘 아
    리포트 | 4페이지 | 2,000원 | 등록일 2008.01.23
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  • 자료 표지
    Closing The Circle - Speed, Timing, and Effectiveness
    COMMERCIALIZATION○ 스마트카드IC(integrated circuit : 집적회로) 기억소자를 장착하여대용량의 정보를 담을 수 있는 전자식 신용카드로ISO의 규격은 IC가 1개 이상 ... 내장되어 있는 모든 카드○ 1974년에 Roland Moreno에 의해서 발명- 아이디어 초기 당시, 카드사이즈 크기와 직접회로(integrated circuit) 사용 등 설계 ... Each Stage for Its Own Logic○ 기술사업화 과정의 각 스테이지에서 기회의 창을 만나는 가장 좋은 방법은 각자의 로직으로 각 스테이지를 관리하는 것임
    리포트 | 19페이지 | 3,000원 | 등록일 2010.05.10
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  • 자료 표지
    [디지털논리회로]Digital clock design
    ounter and mod-60 counter② Draw the logic diagram by Quartus-II③ Simulate the designed circuit- VHDL ... 결과 검증 및 비교4. 결론1. 서론- 설계 목적① binary counter의 역할을 이해한다.② synchrnous type digital circuit의 설계과정을 이해 ... ounter and mod-60 counterBCD countermod-12 countermod-60 counter② Draw the logic diagram by Quartus
    리포트 | 10페이지 | 1,500원 | 등록일 2006.06.21
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  • 자료 표지
    자동 개폐식 블라인드
    하게 쓰일 수 있는 실용적인 아이디어로 판단.비용성 : 5만원이라는 제한된 비용으로도 제작가능하다고 판단.(4) 아이디어의 실행가. Gantt chart(간트도표)와 Logic ... 문헌Introduction to Logic Design, Alan B. Marcovitz, McGraw Hill, 2nd edition, 2004.Fundamentals OF ... Electric Circuit Fourth Edition [Alexander &Sadiku] Macgraw Hill팀 미팅 활동 보고서 ( 1차)교과목명 : 전기회로실험 및 설계수강
    리포트 | 15페이지 | 2,000원 | 등록일 2010.11.11 | 수정일 2015.10.19
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  • 자료 표지
    Excess 3 to BCD code converter ( Excess-3-to-BCD code converter )
    제목 : Design of a Excess-3-to-BCD code converter (combinational circuit)개요본 실습에서는 Excess-3 code를 BCD ... 될 기계의 디바이스 이름 (Cyclone 2)Device : 설정된 기계의 스펙들 (EP2C35F672C6)Total Logic elements : 전체 33,216개의 로직 게이트
    리포트 | 16페이지 | 3,500원 | 등록일 2011.04.22
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  • 자료 표지
    디지털 회로 실험 제 3장
    ● 실험 내용 : 1. 2*4 디코더 회로를 설계하라.2. 2*4 디코더와 74ls139회로로 3*8 디코더를 설계하라.*준비물 : LOGIC LAB UNIT, TTL게이트 ... 하여 인 74ls139회로와 결합해3*8 디코더를 설계한다.*결과 : 2*4 디코더 브레드 보드 연결표+-+- 3*8 디코더 브레드 보드 연결표+-+-2*4 디코더 회로도3*8 디코더 회로도● A full adder circuit
    리포트 | 4페이지 | 1,000원 | 등록일 2006.10.06
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  • 자료 표지
    vhdl 수업지도안
    ▶ Hardware Description Language2) VHDL▶ Very High Speed Integrated Circuit HardwareDescription Language ... 있다.5. singal1) 정의- 외부 입출력 신호선2) 모든 signal은 자료형을 가져야 한다.6. 자료형1) std_logic- signal의 개수가 1개일때(1bit)2 ... ) std_logic_vector(0 to n) orstd_logic_vector(n downto 0)- signal의 개수가 n개일때(nbit)3) to와 downto의 차이점
    리포트 | 4페이지 | 1,000원 | 등록일 2008.05.09
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  • 자료 표지
    실험 8. R A M
    있다.실험에서 사용되는 memory는 positive logic일 때는 데이터가 memory에 기록되고 negative logic일 때는 밖으로 읽혀진다. 이런 양립성은 s ... 이 공급되는 한 저장된 상태로 남아있다.◆IC 메모리(integrated circuit memory)1970년경부터 종래의 코어메모리, 와이어메모리와 대체되어 사용되기 시작
    리포트 | 5페이지 | 2,000원 | 등록일 2009.03.10
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  • 자료 표지
    8051 micro-controller(마이크로 컨트롤러) 특징, 기능 및 구조
    Oscillator Output : 내부 클럭발생 회로의 출력 신호VccVss4020Supply Voltage : 회로의 +5V 전원.Circuit Ground : 회로의 전원 접지.4 ... (Arithmatic Logic Unit)8 Bit 변수에 대하여 산술논리연산을 하는 곳으로 ALU에서 수행할 수 있는 기능은 다음과 같다.• 캐리없는 덧셈, 캐리있는 덧셈/뺄셈 • 8비트/16비트
    리포트 | 5페이지 | 1,000원 | 등록일 2011.08.09
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  • 자료 표지
    2-port OR gate
    으로 나타낼 때 노드(node)와 노드 사이에 어떤 IC(Integrated Circuit) 소자(component)들이 들어가 있는지 표현하는 방식과 일치한다. ◎Mixed ... 을 실행하여 project명을 정해주고 파일을 실행한다. 실행 후 logic 설정은 프린트물처럼 설정해주고, VHDL Module로 소스를 생성한다. 실험이 2port Or
    리포트 | 17페이지 | 1,000원 | 등록일 2010.06.24
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2025년 07월 11일 금요일
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