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"아주대 논리회로" 검색결과 361-380 / 484건

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    실험2 결과보고서
    실험 2. CMOS 회로의 전기적 특성(결과보고서)실험 1. Logic Levels & DC Noise Margins① 전원공급기의 CH1 노브를 조절하여 4.5V로부터 약 0
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,000원 | 등록일 2013.01.01
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    논리회로실험 실험3 Adder & Subtracter 결과보고서
    4주차 결과보고서실험 3 Adder & Subtracter▶실험과정 및 결과◈ 실험 1 : 반가산기(Half adder)구성 사진 :- 결손도를 참고하여 회로를 구성하였다. ... 이 2 개뿐이기 때문에 비교적 회로가 간단하다.◈ 실험 2 : 전가산기(Full adder)회로구성 사진 :- 결손도를 참고하여 회로를 구성하였다.- led를 이용하여 결과를 쉽 ... 게 측정할 수 있다.- 반가산기 두개와 OR게이트도 사용하기 때문에 반가산기의 회로구성에 비해서 확연히 회로가 복잡하다.- 아래 led가 S이며 위의 led는 Co이다.실험 결과
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08
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    논리회로실험 실험5 Decoder & Encoder 결과보고서
    Decoder IC 74HC42를 사용하여 결손도를 바탕으로 브레드보드에 회로를 구성하였다.- 출력이 Active Low로 출력이 되므로 LED의 +극을 5V에 연결하고 극을 IC ... 에 연결하였다.- 도선을 서로 구분하기 쉽도록 양쪽 수직노드에 5V와 접지를 모두 연결하여 회로가독성을 향상시켰다.- LED의 수가 많아서 소자배치와 정리정돈에 힘써 구별하기 쉽 ... - Decimal to Excess-3 Encoder를 74HC11과 74HC20를 사용하여 결손도를 바탕으로 브레드보드에 회로를 구성하였다.- 10진수를 입력받아 EXCESS-3코드
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08
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    예비 Basic Gates
    gate(논리 게이트)란? >: 디지털 회로를 만드는 데 가장 기본적인 요소로서 대부분은 두 개의 입력과 한 개의 출력을 가진다. 특정 순간에 모든 단자는 두 개의 조건 중 하나 ... - 이들 변수 간의 상관관계를 논리곱(AND), 논리합(OR), 부정(NOT) 등의 연산자로 논리적으로 나타낼 수 있다불 대수의 이 2가지 측면은 디지털 계산에 사용되는 전자 회로 ... , 논리합, 부정 연산간의 관계를 기술하여 정리한 것으로 전기, 전자 공학적으로는 논리 회로에서 응용되며 AND 연산과 OR 연산을 이용한다.제 1 정리: 변수들의 곱
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    | 리포트 | 5페이지 | 1,500원 | 등록일 2013.12.26
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    결과 Basic Gates
    실험1. 3-input 논리 게이트SETTING: 전압 공급기를 사용하여 소자에 5V의 공급전압 Vcc를 인가하였다.BCCBAAInputInputGNDGND3-input AND ... , OR gate 구성회로3-input NAND, NOR gate 구성회로: 74HC08, 74HC32 하나의 칩에는 AND와 OR게이트가 4개가 들어있기 때문에 같은 gate를 2 ... 에 해당하는 74HC08, 74HC00 2개의 소자를 사용하였고 NOR 회로를 만들 때도 마찬가지로 74HC32, 74HC02 소자 2개를 사용하여 회로를 구성하였다. 또한 위 사진
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    | 리포트 | 8페이지 | 2,000원 | 등록일 2013.12.26
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    결과 DAC & ADC
    의 입력을 위하여 진폭이 5V, 주파수가 1kHz 인 사각 펄스파를 사용했다.4) 다음과 같은 회로 구성Measurement주파수가 1kHz인 펄스를 인가하고 opamp의 출력단
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    | 리포트 | 4페이지 | 2,000원 | 등록일 2013.12.26
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  • 자료 표지
    결과 Decoder & Encoder
    는 해독기의 역할을 하는 논리회로이다. 실험에서는 2 TIMES 4 디코더를 구성하여 실험을 진행 해보았다.첫 번째 실험에서 입력 단자 2개, 출력 단자 4개를 가지는 디코더를 구현 ... table ]: 교재에 있는 회로도대로 2 TIMES 4 디코더를 구성하여 실험을 진행 해보았다. 입력 단자 2개, 출력 단자 4개를 가지는 구조이다. 입력이 2개이므로 각 비트 ... 상태로써 나오게 된다. 디코더 소자의 특성상 다른 다이오드가 동시에 켜진다면 회로 연결이나 IC소자에 문제가 있는 것이지만 이번실험을 진행하면서 그런 현상은 나타나지 않았다. 때문
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    | 리포트 | 6페이지 | 2,000원 | 등록일 2013.12.26
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    예비 Decoder & Encoder
    : Encoder 혹은 Encoding과 반대의 개념으로 n비트의 2진 코드를 2n개의 서로 다른 정보로 바꾸어 주는 조합 논리회로. 입력 n개, 출력 m개인 디코더를 nXm 디코더라고 하 ... 나 BCD와 같은 코드로 변환 해주는 조합 논리회로. 2n개의 입력과 n개의 출력을 갖고 있으며, 출력은 입력 값에 대응하는 2진 코드를 생성함. 여러 개의 입력 단자와 여러 개 ... 이며(4번pin) 0번 단자가(10번pin) 우선순위가 제일 낮다.GS는 데이터 입력중 하나가 0이고 EI가 0일 때만 0이 된다.EI와 EO는 74HC148 소자를 여러개 연결할 때 사용.5. 회로 결선도
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2013.12.26
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  • 자료 표지
    실험6 예비보고서
    로 되는 것을 배제하기 위하여 수정한 회로이다. 전송펄스가 Low일 때 모든 NAND 게이트의 출력은 High가 되고 SD 혹은 CD 입력에 영향을 미치지 않는다. 따라서 4개의 플립 ... 로 만들어진 링카운터의 구조와 동작원리에 대해 조사하라.위 회로도는 시프트레지스터를 JK 플립플롭으로 구현한 예이다. 초기조건을 가정하고 트리거 신호가 가해졌을때의 각 플립플롭의 동작 ... 방향의 다음 플립플롭으로 저장하고 있는 값이 이동(shift)할 것이다.우리가 구현한 위 회로의 JK 플립플롭의 경우 비정상적인 입력상태가 없기 때문에 링 카운터에 사용하기 적합
    Non-Ai HUMAN
    | 리포트 | 15페이지 | 1,000원 | 등록일 2013.01.01
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  • 자료 표지
    예비 DAC & ADC
    1. 실험목적: D/A와 A/D 변환기(converters) 회로의 구성과 동작 원리에 대해 이해한다.2. 이 론DAC(Digital Analog Converter
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    | 리포트 | 5페이지 | 1,500원 | 등록일 2013.12.26
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    논리회로실험 설계 보고서
    1 논리회로실험설계과제·REPORT전자공학도의 윤리 강령 (IEEE Code of Ethics)`(출처: http://www.ieee.org)나는 전자공학도로서, 전자공학이 전 ... 윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2012. 12. 17과목명: 논리회로실험 설계 ... 구조를 사용할 수 있다.4. 동시성, 타이밍 및 클럭킹은 모두 모델화될 수 있다. VHDL은 동기식뿐 아니라 비 동기식 순차 회로 구조도 처리한다.5. 한 설계에 대한 논리 연산
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    | 리포트 | 24페이지 | 4,000원 | 등록일 2013.11.25 | 수정일 2013.11.28
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    논리회로 프로젝트 보고서
    1 논리회로설계과제·REPORT전자공학도의 윤리 강령 (IEEE Code of Ethics)`(출처: http://www.ieee.org)나는 전자공학도로서, 전자공학이 전 세계 ... 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2012. 11. 30과목명: 논리회로 설계과제교수 ... & 결과에 대한 설명)7. 고찰논리회로 설계과제(4bit*4bit multiplier)1. 문제 설명 (설계 과제) : 4bit의 2's complement binary 입력 2개
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    | 리포트 | 14페이지 | 3,000원 | 등록일 2012.12.23 | 수정일 2013.11.25
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    실험2예비[1].CMOS회로의.전기적특성나중
    )구간으로 논리값이 정의되지 않음.Schmitt-Trigger Inverters일반 Inverter에 비해 noise를 줄여주는 기능.입력, 출력 전압이 각각 하나씩인 반면 두 개 ... 과 CMBIC 2. 출력 파형VILmin = 900.092㎷, VIHmin = 3.15 VSchmitt-Trigger Inverters회로 SEQ 회로 \* ARABIC 2 ... .99460.9Resistive Load회로 SEQ 회로 \* ARABIC 3. Rn 측정을 위한 회로회로 SEQ 회로 \* ARABIC 4. Rp 측정을 위한 회로= 193.462
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    | 리포트 | 10페이지 | 1,000원 | 등록일 2011.06.27
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    가천대 소프트웨어학과 전공사
    로 소프트웨어 설계∙경영학과를, 2011년 성균관대가 소프트웨어학과를, 2012년 아주대가 소프트웨어융합학과, 한양대가 소프트웨어 전공을 만들고 신입생을 선발했다. 소프트웨어학과 ... 의 사칙연산과 논리합, 논리곱 등의 논리연산을 연속적으로 처리할 수 있는데, 계산이 가능하도록 고안된 장치 자체를 ‘하드웨어(hardware), 이 장치에 특정 값과 특정 연산 ... 다. ‘반도체 집적회로의 용량은 18개월마다 2배로 늘어난다’는 무어의 법칙(Moore’s Law)이 꾸준히 지켜졌고, 컴퓨터의 연산처리장치(CPU) 클럭 수는 1993년 60
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2019.06.26
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    실험4 예비보고서
    측에 어떤 신호가 있는가를 탐지해서 표시해 주는 집적 회로 또는 논리소자로 구성된 회로를 통틀어 복호기라고 할 수 있다. N개의 입력에 대하여 출력은 2N개까지 있을 수 있 ... 기에서 작성된 데이터를 하나의 통신회선을 이용, 전송할 수 있게 해주는 회로장비인 것이다.예를 들어 주컴퓨터에서는 연결된 단말기 수만큼의 연결단자에서 전송선로가 나와 먹스에 연결 ... -ZHLHLLLTri-state buffer는 소자와는 달리 세 가지 출력 상태를 갖는 논리 소자의 하나로. 세가지 출력은 H, L, High-Z로 나타나게 된다. High-Z는 high
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    | 리포트 | 10페이지 | 1,000원 | 등록일 2013.01.01
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    실험8결과[1].RAM
    \* ARABIC 1. 2-Bit RAM- 이 실험은 R-S Latch와 Gate들을 조합하여 2bit Ram을 구성해 Ram의 동작에 대해 논리회로 적으로 분석하여 세부적인 동작을 확인
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2011.06.27
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    실험8예비[1].RAM
    Address 회로로 구성된다. Address decoder에 의해 Memory Cell을 접근하게 되고, Write 또는 Read 작업을 수행하는 것이다. 각 Memory Cell ... 으로 Latch 회로를 사용하면 SRAM이라 부르고, 정보를 Capacitor에 저장하는 경우 DRAM이라 부른다.그림 SEQ 그림 \* ARABIC 1. RAM Block ... DiagramSRAM Cell – RS Latch회로에 각 Bit 정보를 저장하는 방식으로 Select핀과 B(쓰기), B_N(읽기)의 값에 따라 데이터를 기록하거나 지우는 과정을 거친다. 예
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2011.06.27
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    실험4결과[1].MUX&DEMUX
    1. 실험 결과실험1. 멀티플렉서Enable 입력을 갖는 4x1 멀티플렉서를 74HC20과 74HC04를 이용하여 다음 회로와 같이 구성한다. 여기서, E가 enable 입력이고 ... S0, S1은 선택입력, 그리고 D0~D3이 4개의 데이터 입력이다.회로 SEQ 회로 \* ARABIC 1. Multiplexer다음 표와 같이 입력을 가한 뒤에 출력 Y를 측정 ... 이렇게 3가지로 나뉜다. Enable 입력은 회로를 활성화 시키는 역할을 하며 입력 값이 1일 경우에는 출력값이 다른 입력에 관계없이 0이 나오고, 입력 값이 0일 경우에는 다른
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2011.06.27
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    실험3결과[1].가산기와감산기
    URLJohn F.Wakerly, Digital Design Principles and Practices 4E, PEARSON컴퓨터의 논리회로 –http://nengjung.kit.ac ... 1. 실험 결과예비보고서에서 구상한 반가산기를 구성하고 그 결과를 확인하라.회로 SEQ 회로 \* ARABIC 1. 반가산기그림 SEQ 그림 \* ARABIC 1. 반가산기 출력 ... 을 출력하는 회로를 만들고 확인해보는 실험이었다. 그 결과, Sum은 A,B가 서로 다를 때에만 1을 출력하고 Carry는 A,B가 둘 다 1일 때에만 1을 출력한다는 것을 알 수
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2011.06.27
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    예비 Multiplexer & Demultiplexer
    (Multiplexer): 여러 개의 입력선 중에서 하나를 선택하여 출력선에 연결하는 조합 논리회로이다. 선택선의 값에 따라 한 개의 입력선을 선택한다. 일반적으로 입력선2 ^{n}개와 선택선 n개 ... 하여, 받은 정보를 전송하는 회로이다. 선택선(selection line) n개의 값에 따라서 출력선 한 개를 선택한다. 멀티플렉서와는 반대되는 기능을 구현하며 디멀티플렉서는 간단히 ... 했던 회로와 결과가 같은지 비교한다.실험1) Multiplexer: 2가지 방법으로 구현한 멀티플렉서 모두 정상적으로 작동한다면 주어진 표와 같은 결과가 나올 것이다.실험2
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2013.12.26
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2025년 12월 06일 토요일
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