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전기회로설계실습 실험12 멀티플렉서 중앙대 아날실 전기회로 fpga 프로젝트 논리회로 6장 생능 rlc 직렬공진 회로 LPF와 HPF 설계 결과 전자회로실험 디지털회로실험
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"디지털회로실험" 검색결과 341-360 / 8,927건

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    서강대 고급전자회로 실험 - 실험 8. Digital Filter Design - 결과 보고서
    고급전자회로 실험 결과 보고서실험 8. Digital filter design분반학번이름조학번이름시작종료실험시작/종료시간 기재(통계 목적임)실험 11.1 다음의 filter ... 하여 합성된 곡을 들어본 결과 원곡과 거의 유사하게 들린다는 것을 확인할 수 있었다.실험 2Lab 7의 두 번째 실험에서 제작한 작은별 곡(2,3,4차 하모닉 성분 포함)으로부터, 기
    Non-Ai HUMAN
    | 리포트 | 15페이지 | 2,000원 | 등록일 2015.06.18 | 수정일 2015.06.22
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    디지털회로실험 18장. D/A, A/D 변환기(Converter)
    를 이해하고 D/A, A/D 변환기 회로를 구성한다.실험이론1. A/D 변환기A/D 변환기는 아날로그 신호를 디지털 신호로 변환시키는 것이고, D/A 변환기는 그 역변환을 하는 것이 ... 를 디지털 신호에 따라 가산하는 원리로 실현된다. 12비트의 이상의 정밀도를 얻기 위하여 집적 회로를 제작한 후에 레이저 광선 등으로 저항과 용량치를 미세 조정하는 트리밍 수법(手法 ... )이 사용되고 있다.2. D/A 변환기디지털 신호를 연속한 아날로그 신호로 변환하기 위하여 사용되는 기계적, 전기적 장치. 아날로그-디지털 변환기(analog to digital c
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,000원 | 등록일 2014.04.07
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    디지털회로실험 05장. X-OR와 X-NOR게이트
    에도 NAND게이트와 NOR게이트를 이용하여 X-NAND게이트와 X-NOR게이트를 만들 수 있는것을 보고 디지털회로를 얼마나 더 발전시킬 수 있는지 기대하게 만드는 실험이었다. ... -NOR의 논리회로는 아래와 같다.실험 방법1. 인버터, ANDM OR게이트를 사용하여 X-OR 논리회로를 구성 한 뒤 A, B의 값에 따른 출력 Y의 값을 실험에 의해 구하여 표 5 ... -2에 기입하라.2. 74LS02와 74LS08을 사용하여 X-NOR 논리회로를 구성한 뒤 A, B의 각 입력에 따른 출력 Y의 값을 실험에 의해 구하여 표 5-3에 기입하라.3
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,000원 | 등록일 2014.04.07
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    디지털회로실험 2장 예비보고서 - MUX
    3. 실험 예비 보고3.1 32대 1 MUX에서는 최소 몇 개의 선택선이 필요한가?- 32는이므로 5개의 선택선이 필요하다.3.2 4대 1 MUX에서의 두 선택 선을 A와 B라 ... .3.4 앞 실험 3.3번을 기초하여 74153으로 전가산기를 구현하는 pin 연결도와 반가산기를 구현하는 pin 연결도를 그려라.
    Non-Ai HUMAN
    | 리포트 | 2페이지 | 1,000원 | 등록일 2012.12.17
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    [예비보고서]디지털회로실험1
    1. 실험 제목- 논리게이트2. 실험 목적- 게이트의 종류와 특징에 대해 이해한다.- 게이트의 기능을 확인한다.3. 이론???논리 게이트(logic gate)란, 0 또는 1 ... 로 구성된 ?2 진 정보를 취급하는 논리 회로(logic circuit)로서, 일반적으로 2 개 이상의 입력 단자와 하나의 출력 단자로 구성된다.???컴퓨터 회로를 구성하는 데 필요 ... 나 또는 두 개의 입력 모두가 "참"이라면 출력은 "거짓"이 된다. 이러한 회로를 관찰하는 다른 방법으로는, 두 개의 입력들이 서로 다르면 출력은 1이 되고, 두 개의 입력이 서로
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2010.07.04
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    [디지털회로실험] [쿼터스 / 베릴로그 언어(Verilog HDL) / DE2] (실험13) 시프트 레지스터와 카운터의 설계
    《 실험13 예비 보고서 》조제출일학과/학년학번이름2) , , 그리고 에서 코드가 빠진 부분을 채워라.① 시프트 레지스터(Shift register)? 코드? 시뮬레이션5② Up ... ) 카운터를 리셋 시키기 위한 Verilog HDL 구문을 들고 설명하라.? 코드? 시뮬레이션5《 실험13 결과 보고서 》조제출일학과/학년학번이름실험 (1)? 이론 (1 ... 후 동작clk 1번 동작실험 (2)? 이론 (2)에서 설명한 up-down 카운터의 입력으로 reset 신호를 추가하고, 이 신호가 1이되면 카운터가 초기화되는 동기식 reset
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 2,000원 | 등록일 2014.10.21 | 수정일 2016.06.13
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    전자공학과 디지털 회로 실험 및 설계 텀프로젝트 간이전압계 ppt자료입니다.
    디지털회로 실험 및 설계 Term Project프로젝트 주제 제작 동기 사용부품 및 공구 동작원리 실험결과 결론 2프로젝트 주제 작품명 : 간이 전압계 3제작 동기 4 디지털회로 ... LM7805 라는 레귤레이터를 사용하여 9V 를 5V 로 바꾸어 디지털 소자로 전원을 공급11실험결과 12실험결과 13실험결과 1415{nameOfApplication=Show} ... 실험 및 설계 강의를 들으면서 우리가 배웠던 논리게이트 , 여러 가지 플립플롭 , 멀티플렉서 , 디멀티플렉서 , FND, 카운터 등을 사용하여 만들 수 있는 작품을 찾다가 실제
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    | 리포트 | 15페이지 | 2,000원 | 등록일 2016.04.06
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    디지털 공학 실험[순차회로(검출기)설계]
    설계과목과 목 명디지털공학실험분 반담당교수담당조교설계수행자소 속전자 공학부학 번성 명연 락 처설계과제제목순차회로(검출기)의 설계주 별 설계진행일정설계 1주차: 설계과제 이해 및 ... 과제 제안서 작성설계 2주차: 순차회로의 이론 및 특징 조사설계3주차: 설계 과제에 대한 이론적 출력 확인 및 상태도 상패그래프 천이표 작성설계4주차: MAX PLUS II ... 의 Toll과 문법을 사용 하여 순차회로를 설계공 학 이 론순차회로의 상태 그래프, 상태도, 천이표, 밀리 머신의 특징VHDL에 사용되는 Toll, MAX PLUS II의 문법과 사용법
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2011.06.07
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    [디지털회로실험] [쿼터스 / 베릴로그 언어(Verilog HDL) / DE2] (실험17) 주파수 카운터 설계
    가 빠진 부분을 채워라.? 《 실험17 결과 보고서 》조제출일학과/학년학번이름실험 (1) 실험에서 제시한 회로를 다음 지시에 따라 수정 설계하라.1. 레지스터 reset를 1비트 신호 ... 《 실험17 예비 보고서 》조제출일학과/학년학번이름2) , , , , , , 그리고을 설명하고 시뮬레이션 결과를 제시하라.? ? ? ? ? ? ? ? 시뮬레이션3) 에서 코드
    Non-Ai HUMAN
    | 리포트 | 10페이지 | 2,000원 | 등록일 2014.10.21 | 수정일 2016.06.13
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    실험예비42 디지털집접회로
    실험 42 . 디지털 집적회로 : AND,OR 게이트Ⅰ. 기초이론ⅰ. AND , OR 게이트 특성AND 게이트의 동작은 입력의 수와는 무관하다. 즉, 높은 출력을 얻기 위해서 ... 장비디지털 멀티미터IC7408, 7432 각 1개기타논리브레드보드, 3SPDT 스위치Ⅳ. 실험 순서ⅰ. AND 게이트? 그림 42-7과 같이 연결한다. (14번 핀에 +5V, 7번 ... 입력과 같이 스위치를 연결하고, 출력상태를 0과 1로 기록한다.? 모든 입력이 높은 값일 때만 높은 출력값을 얻을 수 있는 3입력 논리회로를 게이트의조합으로 설계한다. 회로를 그린다.? 실험에 의해 회로를 검토한다. 진리표에 결과를 기록하고 이 회로의 부울식 표현을
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2010.06.14
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    디지털실험 4 - 엔코더와 디코더 회로 결과레포트
    ◈ 4장. 엔코더와 디코더 회로-결과 레포트-2조 2008065321권태영1. 실험 결과 및 정리○ 실험 1의 결과를 기입하라.ABD0D1D2D30 ... *************01001100011번 실험은 2선-4선 디코더 회로인데다음 이론에 의해 진리값을 구할 수 있었다.디코더(Decoder)는 코드화된 입력을 출력으로 변환하는 다중-입력, 다중-출력 논리 ... 000001000100001011100001000110001000101001000000101000001100위 회로는 인코더 로써, 진리값을 다음의 이론에 의해 구할 수 있었다. 실험 3은 6선-4선 인코더 였고, NAND
    Non-Ai HUMAN
    | 리포트 | 3페이지 | 1,000원 | 등록일 2012.03.09
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    디지털 회로실험 두더지 게임 프로젝트
    . Main Project ½Process설계에 필요한 지식카운터 회로도카운터 상태도7-Segment 구동회로회로 구성에 필요한 기본 재료Ⅲ. Main Project 2/2
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    | 리포트 | 35페이지 | 9,900원 | 등록일 2009.03.08
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    디지털로직실험 13장 디멀티플렉서를 이용한 조합논리 회로
    실험13디멀티플렉서를 이용한 조합 논리● 실험 목표□ 디멀티플렉서를 이용한 다중 출력 조합 논리 회로의 설계.□ 오실로스코프를 아용하여 카운터-디코더 회로의 타이밍 다이어그램 ... , 녹색 2개저항: 330 Ω 6개, 1.0㏀ 2개● 실험 순서교통 신호 디코더이번 실험에서의 회로는 ‘이론 요약’에서 설명한 바와 같이 교통 신호 제어 시스템의 네가지 상태(s ... 이 켜진다.1. 실험 보고서의 그림 13-6에 미완성의 회로도가 있다. 74LS139A는 상태 디코더이고반전 입력 NOR 게이트로 그려진 AND 게이트는 출력 논리를 만든다. 진리표
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    | 리포트 | 7페이지 | 6,000원 | 등록일 2013.06.22 | 수정일 2025.09.06
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    [디지털]디지털논리회로 실험
    1-21]과 같은 NOT Gate 회로를 구성하고 입력 A의 변화에 따른 출력 Y의 상태를 [표 1-7]에 기록하라.3. 사용 기자재 및 부품? 논리 실험기? 오실로스코프 ... 2입력 Inverter)? 저항: 680Ω, 220Ω? 콘덴서: 0.01μF제 2장 UNIVERSAL 게이트 (NAND, NOR)1. 실험 목적논리 회로에서 가장 많이 사용 ... 되는 유니버셜 게이트인 NAND, NOR Gate의 기본 논리 동작 및 특성을 실험을 통하여 이해한다.2. 실험 과정, 회로도 및 타이밍 다이어그램(1) NAND Gate① 2입력
    Non-Ai HUMAN
    | 리포트 | 18페이지 | 1,500원 | 등록일 2006.03.22
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    디지털회로실험 결과보고서 모음
    , 디지털 멀티미터, 함수 발생기 브레드 보드, 전원공급기, 7400논리 게이트3.실험의 이론적 결과1) 예비보고 1번 항목을 참고하여 2번과 3번에서 준비한 회로를 따라 결선을 하 ... 하여 AND, OR, NOT 게이트의 기능을 수행하고 그에 따른 입력전압과 출력전압의 파형을 측정할 수 있었다. 처음 하는 논리게이트 실험이라 처음에는 회로를 구성하는 방법이라든가 장비 ... 2.실험 목표- NAND 게이트의 기능과 핀 구성도, 문턱전압을 알아본다.- NAND 게이트로 AND게이트의 기능과 OR게이트의 기능을 수행 해 본다.3.실험 재료-오실로스코프
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    | 리포트 | 5페이지 | 3,000원 | 등록일 2009.12.23
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    디지털회로실험 예비보고서 모음
    그림 OR3에서 설계에 필요한 라이브러리 작성 툴 팔레트 기능은 다음과 같다. Selection: 전자도면의 일부분이나 부품을 선택하며, 도면을 편집하는 기능이다. Part: 부품 라이브러리에서 부품을 선택하여 각 부품을 불러오는 기능이다. Wire: 부품과 부품..
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    | 리포트 | 5페이지 | 2,500원 | 등록일 2009.12.23
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    [디지털회로실험] [쿼터스 / 베릴로그 언어(Verilog HDL) / DE2] (실험15) 상태도(State Diagram) 구현
    《 실험15 예비 보고서 》조제출일학과/학년학번이름3) 에서 코드가 빠진 부분을 채워라.? 코드? 시뮬레이션《 실험15 결과 보고서 》조제출일학과/학년학번이름실험 (1) p201 ... 에 주어진 상태도를 Verilog HDL로 구현하라.? 코드? State Diagram실험 (2) 카운트 방향을 제어하는 입력신호가 up_dn인 3비트 up-down 카운터의 상태도를 완성하고, Verilog HDL로 구현하라.? 코드? State Diagram
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    | 리포트 | 4페이지 | 2,000원 | 등록일 2014.10.21 | 수정일 2016.06.13
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    [디지털회로실험] [쿼터스 / 베릴로그 언어(Verilog HDL) / DE2] (실험14) 주파수 분주기 설계
    《 실험14 예비 보고서 》조제출일학과/학년학번이름2) 과 의 동작을 설명하고 시뮬레이션 결과를 나타내라.① 1/2 ^{4} 분주기? 코드? 테스트벤치 시뮬레이션5② 기타 비율 ... 주파수 분주기? 코드? 테스트벤치 시뮬레이션《 실험14 결과 보고서 》조제출일학과/학년학번이름실험 (1) 27MHz -> 1Hz로 주파수를 분주하는 코드 및 DE2 보드 구현? 코드(선언부)? 코드(1/27 분주)5? 코드(1/10 ^{6} 분주)
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    | 리포트 | 4페이지 | 2,000원 | 등록일 2014.10.21 | 수정일 2016.06.13
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    [디지털회로실험] [쿼터스 / 베릴로그 언어(Verilog HDL) / DE2] Half Adder / Full Adder
    《 결과 보고서 》조제출일학과/학년학번이름실험1? 코드? 시뮬레이션 결과? Pin 입력? DE2 보드 사진스위치 00 입력스위치 01 입력스위치 10 입력스위치 11 입력실험2
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    | 리포트 | 3페이지 | 2,000원 | 등록일 2014.10.21 | 수정일 2016.06.13
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    디지털전자실험 - 연산회로
    디지털회로 실험 결과 보고서실험 9-1 반가산기(Half-Adder)A ＋ BAB입력회로(a)반가산기BAS(Sum : 합)C(Carry : 자리올림)*************101 ... 반가산기 실험 방법 및 주의사항① 위의 회로를 보고 브레드 보드에 연결한다.② 직류 전력 공급기에 A, B 연결하여 회로 구성을 완료한다.( XOR 게이트 - 7486 와 AND ... + B)Ci(A + B)Ci(A + B) + Ci실험 9-2 전가산기(Full-Adder)입력회로 (b) 전가산기Ci (입력Carry)BASC0 (출력 Carry
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,500원 | 등록일 2009.01.30
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2025년 10월 21일 화요일
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