"논리회로실험"의 검색결과 입니다.

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verilog 논리회로 텀프로젝트 전전설2 논리회로 설계 vhdl 실험12 멀티플렉서 논리회로실험 and or not 게이트

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"논리회로실험" 검색결과 2,601-2,620 / 4,736건

순서논리회로 2 시프트 레지스터 예비보고서

■실험의 목적- 이번 실험은 '순서논리회로 2: 시프트 레지스터' 라는 실험이며, 순서논리회로의 기본적인 응용회로가 되는 시프트 레지스터, 링 카운터, 존슨 카운터, 의사 불규칙 ... 이진수열 발생기 등을 구성하고 각각의 동작 특성을 확인해 보며 전반적인 이해를 도모 하도록 하는 실험입니다.■실험의 세부적인 이론 및 방향(1)시프트 레지스터-시프트 레지스터 ... 들어오면 플립플롭의 4개 출력은 각각 0 0 0 1 으로 되고, 클럭 펄스 의 수만큼 1이 오른쪽으로 이동하게 됩니다.-별도의 복호기가 필요하지 않다는 장점이 있습니다.(a)회로

리포트 | 2페이지 | 1,500원 | 등록일 2014.11.28

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Decoder, encoder와 multuplexer, demultiplexer 예비 report

, 3mmΦ 적색 투명 LED(4개)4. 실험에 필요한 기본 지식(1) 디코더(Decoder)디코더란 2진 부호와 같은 BCD 코드를 부호가 없는 형태로 바꾸는 변환회로를 말 ... 0100000000001001000000100100000010001100001000100000100001010010000011001000000111100000000XXX00000000b) 블록표시도그림 10.8 1X8 디멀티플렉서5. 실험절차 및 예상1. 다음 그림 11.1의 회로를 구성하고 표 11.1의 진리표를 실험 ... 의 회로를 구성하고 표 11.4의 진리표를 실험에 의해 완성하라.- 74151 소자를 그림 11.4의 모습처럼 BreadBoard 위에 구성하고, 전원을 이용하여 5V를 가한 후

리포트 | 13페이지 | 2,000원 | 등록일 2015.11.01

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물리실험(2) RC 및 RL 회로

/ 실 / 험 / 보 / 고 / 서 /제목 : RC 및 RL 회로(Oscilloscope)1. 목적RC와 RL 직렬 회로에 대한 실험적인 시간상수tau _{e}를 결정하여 이론 ... 적인 시간 상수 RC와 L/R의 이론값을 비교한다.2. 이론RC 회로많은 전자 회로의 동작은 직렬 또는 병렬로 연결된 축전기와 저항의 성질에 의존한다. 이번 실험에서는 매우 간단 ... {R}로 표기된다.그림 8은RL 회로에서의V(t)에 대한 정형적인 결과이다.실험적으로tau _{e}를 가장 정확히 결정하는 방법은 시간t에 대한log``V(t)의 그래프를 이용

리포트 | 6페이지 | 1,000원 | 등록일 2015.12.20

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디지털실험및설계 예비(시프트 레지스터)

디지털 논리실험 및 설계#3 시프트 레지스터 (예비)담당교수님 : 교수님제출일자 : 2015. 03. 30조 :학번 :이름 :1. 실험 이론순서논리회로의 기본적인 응용회로가 되 ... 출력을 내는 것에 비하면 비효율적이다.하지만 링 카운터는 별도의 복호기가 필요하지 않다는 장점이 있다. 그림2)는 링 카운터 회로도 이다. 그림2.1)는 진리표이다.그림2) 링 ... 카운터 회로도CLKQ_{ 3}Q_{ 2}Q_{ 1}Q_{ 0}1000120010301004100050001그림2.1) 진리표(3) PRBS (의사 불규칙 이진수열 발생기)의사 불

리포트 | 8페이지 | 1,500원 | 등록일 2015.12.05

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실험 4. 멀티플렉서와 디멀티플렉서

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: '08. 10. 6과목명: 논리회로실험 결과보고 ... & Demultiplexer)1. 실 험 결 과실험 1. 멀티플렉서(1) Enable 입력을 갖는 4x1 멀티플렉서를 74HC20과 74HC04를 이용하여 구성한 회로◆ PSPICE ... 0001110000000011001110100010010101010110010010010110111001110001이번 실험은 4×1 MUX 를 74HC153 집적회로를 이용해서 구성하는 실험이

리포트 | 10페이지 | 2,000원 | 등록일 2009.03.10

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서울시립대학교-전자전기컴퓨터설계실험2-제07주-Lab06_Pre

, Register and SIPO, 서울시립대학교.Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소.Flip-flop, Wikipedia. ... Pre-lab Report전자전기컴퓨터설계실험Ⅱ7주차. Sequential Logic Design, Flip-Flop, Register and SIPO실험 날짜2016. 10 ... Design Tool (Version - 14.7)HBE-ComboⅡ-SE Board (included - Xilinx Spartan3 FPGA Chip)Pre-Lab실험 방법[실험 1

리포트 | 6페이지 | 1,500원 | 등록일 2017.09.04

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서울시립대학교-전자전기컴퓨터설계실험2-제08주-Lab07-Pre

Counter, 서울시립대학교.Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소.State Machine, Wikipedia. ... Pre-lab Report전자전기컴퓨터설계실험Ⅱ8주차. Sequential Logic Design, FSM and Clocked Counter실험 날짜2016. 10.31학번이름 ... Board (included - Xilinx Spartan3 FPGA Chip)Pre-Lab실험 방법[실험 1] Moore MachineAdd SourceSource CodeReset

리포트 | 7페이지 | 1,500원 | 등록일 2017.09.04

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10주차 가산기 & 감산기

실험 목적– 반가산기와 전가산기의 논리와 회로의 이해– 반감산기와 전감산기의 논리와 회로의 이해실험과정1. 반가산기의 회로를 구현하기 위해 Quatrus ll를 이용하여 두 결과 ... 값 s와 c의 결과 값이 서로 일치하는지를 Modelsim을 이용하여 증명하자1) 회로도반가산기의 회로를 나타낸 회로도의 사진이다. XOR, AND 두 개의 게이트로 이루어진 것 ... 한 기능은 아래 파형을 보며 분석해보도록 한다.2) 파형Modelsim을 활용하여 위의 회로의 파형을 얻어보았다. 위에서부터 차례로 a, b, co, s 이다. 10진수의 덧셈

리포트 | 8페이지 | 1,000원 | 등록일 2014.10.12

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디지털실험및설계 예비(논리게이트)

디지털 논리실험 및 설계#1 기본 논리 게이트 (예비)담당교수님 : 교수님제출일자 : 2015. 03. 16조 :학번 :이름 :1. 실험 이론기본논리게이트란 디지털 회로를 만드 ... 는 데 가장 기본적인 요소이다. 입력에 따른 출력을 나타내는데 서로 다른 전압으로 표현하면 전압이 높음(1), 낮은(0)으로 나타낸다. 기본논리게이트의 종류에는 NOT, AND ... , OR, NAND, NOR, XOR 등이 있다.1) NOT 게이트NOT게이트는 출력이 입력과 반대되는 값을 가지는 논리 소자이다.흔히 인버터(Inverter)라고 부르기도 한다. 또

리포트 | 10페이지 | 1,500원 | 등록일 2015.12.05

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순서논리회로 1 플립플롭 결과보고서

■이번 실험에서는 지난 실험시간에 숙지하였던 기본적인 6가지의 논리게이트 (NOT gate, AND gate, OR gate, NAND gate, NOR gate, XOR ... gate)에 를 자유롭게 이용하여 일명 '플립플롭' 이라는 게이트를 제작해 봅니다.플립플롭이란 두 개의 안정상태 중 어느 쪽이든지 한쪽을 보존하는 논리회로의 일종이며, 두 개의 상태 ... 하는 결과 를 이끌어 내었습니다.이번 실험은 이론상으로만 알고있던 플립플롭 회로가 실제로 왜 필요해야 하는지 등의 이유를 알게 되었습니다.또한 이번 회로를 설계하며 느낀 점은, 각

리포트 | 2페이지 | 1,500원 | 등록일 2014.11.28

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논리결과-9-RAM

실험 9. RAM1. 실험목적반도체 memory의 기본적인 동작 원리를 알아보고 64-bit 기억 소자의 동작을 실험을 통해 확인한다.2. 실험결과실험 1. 2-bit ... RAMReadWriteABOE 0OE 1In 0In 1WR 1WR 0Out putOut put10*************00101010001011001실험 1은 2-bit RAM의 특성 ... 을 알아보는 실험이다. 처음에 모든 스위치는 접지로 초기화시킨다. Memory를 동작시키기 위해서 처음에 memory의 각 기억소자에 정보를 기억시킨다. 그런 후에 정보를 읽어낼 수

리포트 | 3페이지 | 1,000원 | 등록일 2012.12.23

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[대충] 결과 Digital logic

전자회로실험(결과보고서)실험 : Digital logic1. 결과보고 사항ViVo04.88V57.2mV?Inverter?NOR gateV1V2Vo004.94V056.8mV507 ... =0V가 됩니다.?NOR gate의 표를 가지고 진리표를 작성하시오.NOR gateInputOutputABF001010100110?검토사항1-2, 2-1학기 때 논리회로 시간에 배운 ... NOT gate와 NOR gate는 이론 책의 기호로 표기되어 있었으며, 디지털공학실험에서 칩으로 간단히 되어있었기에 원리를 모르고 사용해 왔었습니다. 그런데 이번 전자회로 수업

리포트 | 2페이지 | 1,000원 | 등록일 2015.01.17

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디지털회로실험 전자주사위 텀프로젝트 (회로도 및 설명, 사진 첨부)

10조 디지털회로실험 및 설계 Team project 보고서제목LED를 이용한 전자주사위 (10조)학과전자공학과학번2000000성명홍길동제출일1. 프로젝트 개요이번 실험 프로젝트 ... 로 구현하기로 한다. 기본적인 주사위는 LED 7개를 이용하여 표현이 가능하다.2. 작품 설계 동기 및 목표LED로 표현된 주사위는 현재 디지털공학 수업 시간과 기초전자 회로실험 시간 ... 에 다루고 있는 논리 회로에 대한 내용으로 적합하게 구성되어 있다. 디지털 회로를 구성하는 기본 소자 IC소자, 그리고 LED등을 이용하여 회로가 구성되어 있을 뿐 아니라, IC칩

리포트 | 8페이지 | 2,000원 | 등록일 2015.01.27

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논리회로의 간소화 예비레포트

실험8. 논리회로의 간소화● 실험의 목적- 무효 BCD-코드 감지기에 대한 진리표 작성- Karnaugh 맵을 이용한 표현식의 간소화- 간소화된 표현식을 구현하는 회로의 구성 및 ... / DM7400 Quad 2-Input NAND Gates ● 실험 회로에 대한 진리표표 8-2 무효 BCD-코드 감지기에 대한 진리표입 력출 력D C B AX00 ... -5회로(실험순서 5: 무효 BCD-코드 감지기 회로)● 실험 회로에 대한 고찰그림 8-5의 회로는 무효 BCD-코드 감지기 회로입니다. 이미 예비 레포트를 작성하면서 조사한대로

리포트 | 5페이지 | 1,000원 | 등록일 2014.11.01

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전자전기컴퓨터설계실험2(전전설2)5주차결과

개의 OR gate , inverter를 이용하여 회로를 구현할 수 있다.다. 멀티플렉서여러 개의 데이터를 입력 받을 때 그 중 하나를 선택하여 출력하는 논리 회로로 선택은 지정 ... 신호 처리기 등등을 시뮬레이션 가능하게 한 프로그램이다.나. HBE-ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습을 위한 장치 ... 한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정에서 사용하는 클럭의 입력은 1MHz

리포트 | 20페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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서울시립대학교 전자전기컴퓨터설계실험2 제11주 Lab10 Pre

watch가 잘 작동함을 확인할 수 있다.ReferenceDatasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소. ... Pre-lab Report전자전기컴퓨터설계실험Ⅱ11주차. Project, Digital Watch Counter.실험 날짜2016. 11.21학번이름Professor조교 ... 3 FPGA Chip)Pre-Lab실험 방법Digital Watch Up CounterAdd SourceSource Code는 크게 네 부분으로 구성되어 있다.Source Code

리포트 | 9페이지 | 1,500원 | 등록일 2017.09.04

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인하대학교 전자공학과 디지털논리회로 sequence detector

010 sequence detector`timescale 1ns / 1ps//////////////////////////////////////////////////////////////////////////////////// Company: // Engineer: //..

리포트 | 3페이지 | 1,000원 | 등록일 2017.10.15

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FPGA를 이용한 디지털 시스템 설계(인하대) MUX, Decoder, Comparator 보고서

이번 실험의 세번째 주제는 4bit Comparator를 설계하는 것이다.Comparator는 비교기로 두 수의 크고 작음을 비교하는 논리 회로로 두 입력값 중 한 값이 다른 값 ... 하는 것이다.MUX는 Multiplexer의 줄임말로 선택 입력신호에 의해 여러 개의 입력 중에서 하나를 선택하여 출력하는 논리회로이다. 다중 입력 데이터를 단일 출력하므로 데이터 ... MUX는 4개의 입력신호 중 하나를 택하는 회로를 말한다.우리는 이번 실험에서 4개의 신호 중 하나의 신호를 출력하는 4-to-1 MUX를 설계하여 본다.4-to-1 MUX의 기본

리포트 | 18페이지 | 2,000원 | 등록일 2014.11.26 | 수정일 2015.09.30

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디지털실험 8 결과 실험 8. CMOS-TLL interface

다. 실험 5의 회로에 뒷부분만 추가하면 만들어 진다.결과로 (1)번과 (4)번을 비교하기 위한 사진. 1이 NOR되서 0이되고 그 0이 다기 NOT되서 1이 되는 것을 보면 논리동작 ... 디지털 실험 결과보고서실험 8. CMOS-TLL interface실험 결과실험 1의 회로이다. CMOS NOR소자이다. 소자의 동작 범위를 보기 위한 실험이다.소자가 제대로 동작 ... .2V4.2V0의 회로를 구성하고, V _{DD}(핀 14번)를 +10[V]로 연결하고, 입력값에 따른 출력을 살펴보고, 또한 +5[V]로 연결하여 살펴보아라.실험 2의 회로이

리포트 | 9페이지 | 1,000원 | 등록일 2014.09.30

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기본 게이트 설계 예비보고서

과 목 : 논리회로설계실험과 제 명 : 기본 게이트 설계담당교수 :담당조교 :학 과 : 전자전기공학과학 년 : 3학 번 :이 름 :제 출 일 : 2014. 3. 20논리회로설계 ... 실험 예비보고서 #1실험 1. 기본 게이트 설계1. 실험 목표AND, NOT, NAND, OR, XOR, NOR 게이트의 기호와 기본적인 동작 특성을 이해고, 실험을 통해 동작 ... )[그림 1] CPLD 1) CPLDComplex Programmable Logic Device(복합 프로그래머블 논리 소자)의 약자로 PAL(Programmable Array

리포트 | 7페이지 | 1,000원 | 등록일 2014.07.25

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