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"디지털시스템실험" 검색결과 101-120 / 6,850건

디지털 시스템실험, Verilog 코딩, Sequential Circuit (신호등) 구현, FPGA보드에서 신호등 사진 결과

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서실험제목Sequential Circuit 설계 및 구현실험목표① 동기식 UP ... /DOWN 카운터를 설계한다.(기본)② 카운터를 이용한 Sequential Circuit을 설계한다.(신호등을 설계하였다)실험결과이번 실험은 각종 Flip-flop을 구현하고 최종 ... . FPGA보드에 연결하자 Clock에 변화에 맞춰서 신호등이 바뀌는 것을 확인하였다.토의이번 실험은 저번 주에 실험했었던 비동기식, 즉 Clock pulse가 모두 동시에 들어가

리포트 | 3페이지 | 2,000원 | 등록일 2015.12.05 | 수정일 2018.05.16

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디지털시스템 실험(동기식 up/down counter)+응용한 신호등 설계

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2014 전기전자공학부이름 : 전기전자전파공학부 ... 고찬규(7조)학번 : 2011171059실험제목Sequential Circuit 설계 및 구현실험목표① 동기식 UP/DOWN 카운터를 설계한다.(기본)② 카운터를 이용 ... 한 Sequential Circuit을 설계한다.(신호등을 설계하였다)실험결과이번 실험은 각종 Flip-flop을 구현하고 최종적으로 이를 이용하여 BCD Ripple Counter

리포트 | 3페이지 | 1,500원 | 등록일 2014.11.03 | 수정일 2016.11.10

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디지털 시스템 및 실험-디지털 클럭 발진기

과 목 : 디지털 시스템 및 실험-Experiment 8 Report디지털 클럭 발진기(Digital - Clock Oscillator)목적? 적절한 디지털 클럭으로 사용하기 ... 위해 크리스탈 발진기를 구성한다.결과실험1 R1 = 330R2 = 330실험2 R2 = 330R1 = 680실험3 크리스탈을 인덕터& 커패시터로 대체했을 경우Discussion이번 ... 실험은 수정발진기인 크리스털과 LC발진기를 비교해보는 실험이었다.LC발진기의 이론 공진주파수 값은= 1071977.781= 1.07M가 계산되며 실험결과 1.08M정도로 이론값

리포트 | 2페이지 | 1,000원 | 등록일 2009.06.29

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디지털 시스템실험, Verilog 코딩, 16X4 RAM(Random Access memory) 설계, FPGA보드 결과 포함

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서실험제목RAM(Random Access Memory)실험목표16×4RAM ... (Random Access Memory)를 설계한다.실험결과이번 실험에서는 플립플롭을 이용한 memory, 즉 RAM(Random Access Memory)를 coding하였다.code ... 다른 주소에 다른 값을 Write, Read해보았다.토의이번 실험은 저번 주에 실험했었던 Register와도 연관이 있다. Register는 하나의 값을 저장하는 반면 이번

리포트 | 3페이지 | 2,000원 | 등록일 2015.12.05

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디지털 시스템 실험, Verilog 코딩, Adder/Subtractor/Multiplier/Divider, Binary to BCD 설계, FPGA보드 결과 포함

디지털 시스템 설계 및 실험 결과보고서실험제목Add/Subtractor/Multiplier/Divider 설계실험목표Half Adder과 Full adder를 이용하여4bit ... Add/Subtractor를 설계하고, Multiplier / Divider를 설계한다.실험결과1. Half Adder 코드를 작성하였다.2. Half Adder코드를 이용 ... 에 FPGA보드에 해당하는 Pin을 입력하여FPGA보드에 연결하여 올바르게 작동하는지 확인하였다.토의이번 실험은 Half Adder, Full Adder, 4bit Adder

리포트 | 5페이지 | 2,500원 | 등록일 2015.12.05 | 수정일 2018.05.23

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디지털시스템 실험(SR Latch, JK, D FF, Register, Shift Register, Register를 이용한 가산기)

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2014 전기전자공학부이름 : 전기전자전파공학부 ... Latch와 Flip-flop을 설계하고 이를 이용하여 크게 2가지를 실험 해보았다.BCD Ripple counter와 One digit Add Sub calculator이 ... 고찬규(7조)학번 : 2011171059실험제목Latch & Flip-Flop실험목표1. SR Latch 를 설계한다.2. SR Latch 를 이용하여 D-Type Positive

리포트 | 5페이지 | 1,500원 | 등록일 2014.11.03

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[디지털시스템실험(Verilog)] TTL 기본 실습 예비보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목TTL 기본 실습실험목표 ... full adder를 설계해본다.실험준비물Oscilloscope 및 사용 설명서, DC Power supply, function generator, digital multi ... 형), 저전력 쇼트키형(LS형)의 총 다섯 종류로 분류되며 쇼트키형은 advanced 쇼트키형(AS형), 저전력 advanced 쇼트키형(ALS형)으로 다시 분류된다.논리회로 실험

리포트 | 2페이지 | 1,000원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] TTL 기본 실습 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서학부 : 학번/이름 :실험조 : 실험일 :실험제목TTL 기본 실습실험목표 ... full adder를 설계해본다.실험결과실험 ①NOT게이트 구성Yellow Pulse : InputBlue Pulse : OutputInput과 Output값의 파형이 완벽하게 대칭 ... 되지는 않았으나, 그 값이 대체적으로 반대 방향의 파형으로 보이는NOT게이트의 일반적인 결과값이 도출되었다.실험 ②1-bit full adder 설계왼쪽 사진과 같이 7408 칩 1

리포트 | 3페이지 | 1,500원 | 등록일 2011.10.05

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디지털 시스템 및 실험-Experiment 6

과 목 : 디지털 시스템 및 실험-Experiment 6목적? 조합 논리회로의 예로서 멀티플렉서와 디멀티플렉서의 동작 원리 및 특성을 확인한다.결과(1) 4-to-1 멀티플렉서 ... 은 4.38V가 나왔으며 0은 0.12V가 나왔습니다.Discussion이번 실험은 멀티플렉서와 디멀티플렉서를 이용한 동작에 대한 실험이었다.우선 강의시간 ... 에 배운대로개의 변수를 컨트롤하기 위해서는 n개 만큼의 스위치가필요하다는 것을 확인해 볼 수 있었다. 위의 실험 4-to-1실험도 4개의 변수 즉,개의 변수를 가지므로 스위치는 n

리포트 | 3페이지 | 1,000원 | 등록일 2009.06.29

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디지털 시스템 및 실험-Experiment 4

과 목 : 디지털 시스템 및 실험Experiment 4 Report목적조합 논리회로의 기본적인 예가 되는 복호기와 부호기의 동작원리 및 특성을 확인하고 Seven-segment ... LED array의 특성을 실험적으로 검증한다. BCD-to-seven-segment decoder driver를, seven-segment array와 바르게 연결한다.결과입력 ... 000000001100102001130100401015011060111710008100191010X1011X1100X1101X1110X1111X표 5Discussion이번 실험은 회로도를 보고 기판위

리포트 | 2페이지 | 1,000원 | 등록일 2009.06.29

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[디지털시스템실험(Verilog)] Verilog 기본 실습 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서디지털 시스템 설계 및 실험 KEEE209-09 전기전자전파 공학부학부 : 학번 ... / 이름 :실험조 : 실험일 :실험제목Verilog실험목표① Verilog 언어의 개념을 이해하고 코딩을 위한 기본 문법을 익힌다.② 코딩한 Verilog의 시뮬레이션을 위해 HDL ... 시뮬레이터인 ModelSim의 사용 방법을 익힌다.③ Full adder를 Verilog로 구현하고 모듈화하여, 32-bit adder를 시뮬레이션해본다.실험결과실험 ① 1-bit

리포트 | 3페이지 | 2,000원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] Instruction - Assembly 예비보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목Instruction실험목표① 지금 ... 까지 작성한 TOP 모듈의 동작을 확인한다.② Instruction을 직접 작성해보고 프로세서의 동작을 이해한다.실험준비물ModelSim(HDL Simulator)기본지식

리포트 | 2페이지 | 1,000원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] Execution Combination Top 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목PICO Processor ... - Execution Combination Top실험목표① PICO Processor의 Execution Combination Top을 구현한다.실험결과① Execution ... 하였던 모든 모듈의 코드를 점검하였으나, 별다른 문제점을 발견할 수 없었다.현재까지 실험을 하며 다루었던 Verilog 내용으로는 input값의 오류로 인해 모듈이 정상적으로 실행

리포트 | 4페이지 | 2,000원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] Verilog 기본 실습 예비보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목Verilog실험목표 ... adder를 Verilog로 구현하고 모듈화하여, 32-bit adder를 시뮬레이션해본다.실험준비물ModelSim(HDL Simulator)기본지식① Verilog HDL ... 의 설계아래에는 32-bit adder의 설계를 대비하여 Verilog의 기본 Syntax들을 미리 정리하고, 실험 목적에 맞게 직접 코딩해보았다. 그러나 프로그램의 코딩은 사용자

리포트 | 2페이지 | 1,000원 | 등록일 2011.10.05

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디지털 시스템 설계실험 Verilog, Simple computer 구현(Control Unit, Datapath, Data memory 등) FPGA보드 결과 사진

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 프로젝트 보고서프로젝트 제목Simple Computer 구현(Multiplier 동작 ... 확인)실험결과Simple Computer 설계도먼저 Simple Computer는 크게 ControlUnit과 Datapath로 구성되어있고 데이터를 저장하는 곳으로 Data ... 하여 시뮬레이션을 실행하였다. 올바른 값이 출력되었다(input 2,3 - output 6)토의이번 실험은 앞서 구현한 Datapath와 ControlUnit등을 이용하여 최종

리포트 | 4페이지 | 2,500원 | 등록일 2015.12.05 | 수정일 2018.05.16

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[디지털시스템실험(Verilog)] Multiplexer & Logical Unit 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목Multiplexer ... & Logical Unit실험목표① 128 to 4 Multiplexer를 hierarchy하게 설계한다.② Processor의 Logical Unit들을 설계한다.실험결과실험 ① 128 to ... 이 결과 'dout'에 정확히 도출되었음을 확인할 수 있다.실험 ② Logical Unit들의 설계32bits AND, OR, XOR, NOT게이트의 설계는 테스트벤치 파일을 제작

리포트 | 3페이지 | 2,000원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] Arithmetic Logical Unit(ALU) 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목ALU - Arithmetic ... Logical Unit실험목표① Arithmetic Logical Unit을 구현한다.실험결과① Arithmetic Logical Unit의 시뮬레이션 결과실험 당시 제공된 테스트벤치 ... 파일을 이용한 시뮬레이션 결과는 위와 같다.실험 당일에는 코딩 종료 후 주어진 wlf파일의 wave form과 위의 시뮬레이션 결과를 대조하여 일치 여부를 검사하였고, 일치

리포트 | 6페이지 | 2,000원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] PICO Processor - Decoder 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목PICO Processor ... - Decoder실험목표① PICO Processor의 Decoder를 구현한다.실험결과① Decoder의 시뮬레이션 결과Decoder의 시뮬레이션 결과는 다음과 같다.Wave form ... 5bit control(이 모듈에서는 'alu_op')로 출력하는 방법으로 모듈을 구현하였다.실험시 주어진 ISA(Instruction Set Architecture)파일은 모듈

리포트 | 4페이지 | 2,000원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] 32×32 Binary Multiplier 예비보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목32×32 Binary ... Multiplier실험목표① 32×32 Unsigned Binary Multiplier를 gate level로 구현한다.② Unsigned Binary Multlplier를 확장 ... 하여 Signed Multiplier를 구현한다.실험준비물ModelSim(HDL Simulator)기본지식① Multiplier피승수와 승수의 곱셈 연산을 수행하는 곱셈기이

리포트 | 2페이지 | 1,500원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] 32×32 Binary Multiplier 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목32×32 Binary ... Multiplier실험목표① 32×32 Unsigned Binary Multiplier를 gate level로 구현한다.② Unsigned Binary Multlplier를 확장 ... 하여 Signed Multiplier를 구현한다.실험결과① 32×32 Unsigned Binary Multiplier의 시뮬레이션 결과63×77 = 4851 이다.설계된 unsigned

리포트 | 3페이지 | 2,000원 | 등록일 2011.10.05

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