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"디지털시스템실험" 검색결과 81-100 / 7,198건

A+ 디지털 시스템 실험 Random Access Memory (RAM) <9주차 예비보고서>

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목Random ... Access Memory (RAM)실험목표① 16×4RAM(Random Access Memory)를 설계한다.② 자율적으로 메모리를 활용한 새로운 모듈을 설계한다.기본지식1 ... ,Parameter 형을 모두 사용할 수 있으며 산술.논리.조건 연산식을 사용할 수 있습니다.실험방법1. 16×4 RAM 메모리를 설계한다.

리포트 | 4페이지 | 1,000원 | 등록일 2017.07.05

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A+ 디지털 시스템 실험 Simple Computer – Data Path <10주차 결과보고서>

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목 ... Simple Computer ? Data Path실험목표① 컴퓨터 시스템의 기본적인 구조를 이해한다.② DATAPATH를 설계 및 구현하고 검증한다.실험결과1. Register File ... ) | 출력 :Reg0(4bit),Reg1(4bit),Reg2(4bit),Reg3(4bit)토의이번 실험은 Simple Computer의 Microoperation을 수행하기 위한

리포트 | 9페이지 | 1,500원 | 등록일 2017.07.05

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디지털 시스템 실험 Simple Computer 2 - Control Unit 예비보고서

디지털 시스템 설계 및 실험 예비 보고서작성자:학번:실험조:실험일:실험제목Simple Computer - Control Unit실험목표1. Simple Computer의 구조 ... 다. Datapath는 Function unit과 Register file로 이루어져 있다.2. Instruction Set Architecture(ISA)프로그래밍 가능한 시스템

리포트 | 7페이지 | 1,000원 | 등록일 2016.04.08

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디지털 시스템 실험 Simple Computer 1 - Data Path 결과보고서

디지털 시스템 설계 및 실험 결과 보고서작성자:학번:실험조:실험일:실험제목Simple Computer - Data Path실험목표1. 컴퓨터 시스템의 기본적인 구조를 이해한다.2 ... 한다. 다음으로는 reg3에 저장된 값에서 reg1에 저장된 값을 빼서 reg2에 저장하는 연산을 수행한다.디지털 시스템 설계 및 실험 ... . DATAPATH를 설계 및 구현하고 검증한다.실험결과토의DATAPATH는 Register File, Input Logic, Arithmetic Circuit, Logic

리포트 | 5페이지 | 1,500원 | 등록일 2016.04.08

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디지털 시스템 실험 Simple Computer 1 - Data Path 예비보고서

디지털 시스템 설계 및 실험 예비 보고서작성자:학번:실험조:실험일:실험제목Simple Computer - Data Path실험목표1. 컴퓨터 시스템의 기본적인 구조를 이해한다.2 ... . DATAPATH를 설계 및 구현하고 검증한다.배경지식1. Computer System폰 노이만 구조 (Von Neumann Architecture)폰 노이만 구조는 다음과 같

리포트 | 10페이지 | 1,000원 | 등록일 2016.04.08

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A+ 디지털 시스템 실험 Sequential Circuit 설계 및 구현 <7주차 예비보고서>

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목Sequential ... Circuit 설계 및 구현실험목표① 동기식 UP/DOWN 카운터를 설계한다.② 카운터를 이용한 Sequential Circuit을 설계한다.기본지식1. 카운터? 일반 ... 에서 0~9의 숫자가 반복되면 10진 카운터라고 부른다. 이 카운터는 시스템을 설계하는데 중요하다. 시스템에 필요한 주파수를 생성하는 부분에서도 이 카운터가 사용되고, 데이터의 흐름

리포트 | 4페이지 | 1,000원 | 등록일 2017.07.05

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A+ 디지털 시스템 실험 Latch & Flip-Flop <6주차 예비보고서>

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목Latch ... & Flip-Flop실험목표① SR Latch를 설계한다.② SR Latch를 이용하여 D-Type Positive-Edge-Triggered Flip-Flop을 설계한다.③ D Flip ... 는 16분주되어 출력되고 있다.실험방법1. SR Latch를 설계SRQQ'1001Set1101(after S=1, R=0)0110Reset1110(after S=0, R=1)0011

리포트 | 3페이지 | 1,000원 | 등록일 2017.07.05

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A+ 디지털 시스템 실험 기본적인Combinational Circuit <3주차 결과보고서>

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목기본적인 ... Combinational Circuit① Decoder 설계② Binary-to-BCD Convertor 설계실험목표① 2-to-4, 3-to-8 라인 디코더를 설계 ... 한다.② Binary-to-BCD Convertor 설계한다.실험결과2-to-4 라인 디코더이다. 00일 때부터 11일 때의 D0~D4 출력 값 을 보여주고 있다.3-to-8 라인 디코더이

리포트 | 4페이지 | 1,500원 | 등록일 2017.01.25 | 수정일 2017.07.06

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A+ 디지털 시스템 실험 Sequential Circuit 설계 및 구현 <7주차 결과보고서>

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목 ... Sequential Circuit 설계 및 구현실험목표① 동기식 UP/DOWN 카운터를 설계한다.② 카운터를 이용한 Sequential Circuit을 설계한다.실험결과1. 동기식 UP ... FPGA 결과토의이번 실험은 6주차 실험 결과를 이용해 Up/Down 카운터를 설계하고 이를 응용하는 회로를 설계해 보는 실험이었다. Up/Down 카운터는 JK 플립플롭 4개를 이용

리포트 | 8페이지 | 1,500원 | 등록일 2017.07.05

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A+ 디지털 시스템 실험 Latch & Flip-Flop <6주차 결과보고서>

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목 ... Latch & Flip-Flop실험목표① SR Latch를 설계한다.② SR Latch를 이용하여 D-Type Positive-Edge-Triggered Flip-Flop을 설계 ... 을 이용하여 BCD Ripple Counter를 설계한다.실험결과1. SR Latch 설계[그림 1] SR Latch 시뮬레이션 결과 (입력 : S,R,CLR | 출력 : Q,Q_n

리포트 | 11페이지 | 1,500원 | 등록일 2017.07.05

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A+ 디지털 시스템 실험 기본적인Combinational Circuit <3주차 예비보고서>

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험디지털 시스템 설계 및 실험 2016 전기전자공학부이름학번실험제목기본적인 ... Combinational Circuit① Decoder 설계② Binary-to-BCD Convertor 설계실험목표① 2-to-4, 3-to-8 라인 디코더를 설계한다.② Binary-to-BCD ... Convertor 설계한다.기본지식① Decoder디지털 컴퓨터에서 정보의 이산 적인 양은 2진 코드들로 나타내어진다. n비트 2진 코드는 코드정보의 별개 요소들로 표현되는 2

리포트 | 5페이지 | 1,000원 | 등록일 2017.01.03

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[디지털시스템실험(Verilog)] Multiplexer 예비보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목Multiplexer실험목표 ... ① 128-to-4 Multiplexer를 hierarchy하게 설계한다.② Processor의 Logical Unit들을 설계한다.실험준비물ModelSim(HDL Simulator)기본 ... input이 2개로, input이 4개로 증가하였다. 그러나 output인 Y는 여전히 한 개다.여기서 오늘 실험에서 다룰 MUX들의 공통적 구조를 살펴보면, ‘n to 1 MUX

리포트 | 2페이지 | 1,000원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] Register 예비보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목PICO Processor ... asynchronous reset D Flip-Flop이다.디지털시스템 교과서에서는 D Flip-Flop을 D Latch 하나와 SR Latch 하나로 구현하였다.Master가 D Latch이고 ... - Register실험목표① NAND게이트를 사용하여 SR Latch를 설계한다.② SR Latch를 사용하여 D Flip-Flop을 설계한다.③ D Flip-Flop을 사용하여 2

리포트 | 3페이지 | 1,500원 | 등록일 2011.10.05

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[디지털시스템실험(Verilog)] Decoder 예비보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목PICO Processor ... - Decoder실험목표① PICO Processor의 Decoder를 구현한다.실험준비물ModelSim(HDL Simulator)기본지식① Instruction ... DecoderDecoder(이하 디코더)는 Fetch로부터 명령어(instruction)을 받아서 해석하는 모듈이다.실험에서 구현할 디코더는, 8bit의 Opcode를 받아 Execution이 동작

리포트 | 3페이지 | 1,000원 | 등록일 2011.10.05

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디지털 시스템 실험 FPGA 및 Verilog의 이해, Verilog를 통한 FPGA 프로그래밍 방법 이해 결과보고서

디지털 시스템 설계 및 실험 결과 보고서작성자:실험조:실험일:실험제목: FPGA 및 Verilog의 이해, Verilog를 통한 FPGA 프로그래밍 방법 이해실험목표: FPGA

리포트 | 3페이지 | 1,000원 | 등록일 2016.04.08

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디지털 시스템 및 실험-Multivibrator

과 목 : 디지털 시스템 및 실험-Experiment 12Multivibrator목적? 비안정 멀티바이브레이터의 동작 특성을 배운다.? 비안정 모드에서 사용된 555타이머의 동작 ... 데이터 중 1bit를 기억시키는 방법은 플립플롭(flip-flop)이 있다. 이 플립플롭 회로가 바로 멀티 바이브레이터 회로로 이루어져 있다. 이 멀티 바이브레이터는 디지털 시스템 ... 특성을 실험적으로 확인한다.? 단안정 멀티바이브레이터의 동작 특성을 배운다.? 상업적으로 사용하는 IC 단안정 멀티바이브레이터의 동작 특성을 실험적으로 확인한다.결과LM555

리포트 | 3페이지 | 1,000원 | 등록일 2009.06.29

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디지털 시스템 및 실험Experiment 5

과 목 : 디지털 시스템 및 실험Experiment 5 Report목적? 조합 논리회로의 반가산기와 전가산기의 동작원리 및 특성을 확인한다.? 반가산기의 동작을 확인한다.? 반 ... 00.24V04.11V14.11V14.11V14.11V14.11V14.11V1표 2 전가산기 진리표Discussion이번실험은 전가산기와 반가산기 회로를 설계하여 보고 입력변수 ... 를 달리해가며 출력되는 합과 캐리의 값을 확인해보는 실험이었다. 솔직히 실험 당시에는 이론을 배우지 않은 상태라서 독학 후 실험에 임해서 그런지 회로와 전가산기 반가산기가 잘 이해

리포트 | 2페이지 | 1,000원 | 등록일 2009.06.29

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[디지털시스템실험(Verilog)] Memory Controller 결과보고서

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 결과 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목PICO Processor ... - Memory Controller실험목표① PICO Processor의 Memory Controller를 구현한다.실험결과① Memory Controller의 시뮬레이션 결과Memory

리포트 | 3페이지 | 2,000원 | 등록일 2011.10.05

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디지털 시스템 실험 레포트

Disscussion 이번 실험의 목적은 XOR gate 동작회로를 구성하고 회로의 동작 상태를 이해하며 다른 logic gate(① AND, OR NOT gate ② NAND ... gate ③ NOR gate)를 이용하여 XOR gate를 대체하는 방법을 실험을 통하여 실험하는 것이었다. 또한 Parity 에 대하여 이해 및 실험, XOR gate 및 다른 ... gate를 이용하여 비교회로를 구성 및 동작 상태를 확인 하는 것이다. 첫 실험은 기본 논리 게이트를 이용한 XOR gate의 구현으로 실험 1-1는 AND, OR NOT

리포트 | 8페이지 | 1,000원 | 등록일 2006.09.15

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디지털 시스템실험, Verilog 코딩, Sequential Circuit (신호등) 구현, FPGA보드에서 신호등 사진 결과

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서실험제목Sequential Circuit 설계 및 구현실험목표① 동기식 UP ... /DOWN 카운터를 설계한다.(기본)② 카운터를 이용한 Sequential Circuit을 설계한다.(신호등을 설계하였다)실험결과이번 실험은 각종 Flip-flop을 구현하고 최종 ... . FPGA보드에 연결하자 Clock에 변화에 맞춰서 신호등이 바뀌는 것을 확인하였다.토의이번 실험은 저번 주에 실험했었던 비동기식, 즉 Clock pulse가 모두 동시에 들어가

리포트 | 3페이지 | 2,000원 | 등록일 2015.12.05 | 수정일 2018.05.16

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