"베릴로그코드"의 검색결과 입니다.

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verilog 엘리베이터 베릴로그 fpga 프로젝트 디지털시스템실험 전전설2 project single cycle 8bit counter segment 하이닉스 설계

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"베릴로그코드" 검색결과 81-90 / 90건

[Flowrian] 4x4 매트릭스 키패드 인터페이스 회로의 Verilog 설계 및 시뮬레이션 검증

키패드 인터페이스 회로를 설계하고 보다 실제적인 상황에서의 테스트를 위하여 키패드의 스위치를 누르는 동작을 Verilog 코드로 모델링하여 이 두 모듈이 서로 연동되도록 테스트

리포트 | 21페이지 | 3,000원 | 등록일 2011.12.13

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[Flowrian] 미사일 발사 제어 회로의 Verilog 설계 및 시뮬레이션 검증

들의 조합으로 구조수준에서 설계되었다아군 미사일을 회전시키는 유한상태머신아군 미사일 전체 동작을 제어하는 유한상태머신적군 미사일의 방향을 알려주는 테스트벤치미사일 제어 회로 존슨코드를 활용하는 예제 회로로서 Verilog 언어를 설계를 배우려는 분에게 도움이 된다.

리포트 | 31페이지 | 1,500원 | 등록일 2011.10.01 | 수정일 2014.08.19

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[Flowrian] Hamming 코드 기반 Error Detection/Correction 회로의 Verilog 설계 및 시뮬레이션 검증

) 인터페이스 회로이다. 프로세서가 메모리로 데이터를 전송하는 경우는 16 비트 데이터에 6 비트의 해밍 코드를 추가하여 22 비트의 데이터를 메모리로 전송한다. 반대로 메모리

리포트 | 10페이지 | 2,500원 | 등록일 2011.10.29

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FPGA를 이용한 DC-DC 부스트 컨버터 PID 제어 설계 및 실험(verilog 코드 포함)

- FPGA를 이용하여 전력전자 공학에서 배우는 DC - DC 부스트 컨버터 설계 및 PID 제어 실험- 전체적인 회로도 및 QUARTUS II 를 이용한 PID 제어 사용법 포함(PDF 및 동영상)FPGA.zip 자료 내용- FPGA.zip

리포트 | 3,000원 | 등록일 2014.11.30 | 수정일 2020.03.15

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[Verilog 언어] 기본시계 소스코드입니다.

1. 소 스module timer(Mili_Low, Mili_High,Sec_Low, Sec_High, Min_Low, Min_High, Hour_Low, Hour_High, CLK); output [3:0] Mili_Low, Mili_High, Sec_Low, Se..

리포트 | 2페이지 | 2,500원 | 등록일 2009.01.14

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MIPS Processor multi cycle(verilog)

하는 결과를 얻을 때 까지 코드를 수정한다. 로직 합성(Synthesis), 배치 및 배선(Place&Routing) 과정을 수행한 후 타이밍 시뮬레이션 (Timing s ... 추가2. Verilog 소스코드(※ ori, bne를 추가한 코드)/*-------------------------------------------------------------

리포트 | 23페이지 | 1,500원 | 등록일 2009.07.31

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16bit CLA (carry lookahead adder)

4비트 block의 16비트 CLA검증 완료된 코드이며, 베릴로그로 기술되었음.

리포트 | 무료 | 등록일 2005.07.23 | 수정일 2017.03.08

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32비트 ALU Verilog설계

ALU결과 보고서1.실습목표CPU에서 산술 연산 논리장치인 ALU(Arithmetic Logic Unit)을 설계하고 검증한다.2.이론ALU(산술 논리장치)는 두 숫자의 산술연산(덧셈 뺄셈 등등)과 논리연산 (AND OR XOR)등을 계산하는 디지털 회로이다.opcod..

리포트 | 34페이지 | 1,500원 | 등록일 2010.12.21

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[공학]16비트 컴퓨터 설계 보고서

system1>> Resister coding(AR, PC, DR, AC, IR, TR, OUTR, INPR)Register는 위의 AC와 같은 구조의 code를 갖는다. 단지 ... resisterHolds input characterOUTR8Output resisterHolds output characterSymbol : 위의 coding을 통해 다음과 같이 8개 ... 씩 증가한다.2>> Memory unit coding4096X16의 메모리 RAM을 설계한다. 이번 설계 과정 중 첫 번째로 부딪힌 난관이다. 이번 설계 과정 중 사용하는 coding

리포트 | 23페이지 | 5,000원 | 등록일 2007.06.21

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[vhdl] fifo

FIFO⊙ sourcelibrary ieee;use ieee.std_logic_1164.all;use ieee.std_logic_unsigned.all;entity fifo isport ( clk: in std_logic;wr, rd : in std_logic;wrin..

리포트 | 12페이지 | 1,500원 | 등록일 2004.06.03

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