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16 bit CLA register file 기초아날로그실험 ripple carry adder 표 4bit sipo register 8array 7segment
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"Parallel Simulation" 검색결과 61-80 / 95건

  • 자료 표지
    dc 6, 7
    parallel elements?→ 병렬 성분들에 대하여 양 끝의 전위는 항상 각각 같기 때문에 두 점의 전위차가 병렬 성분에 공통으로 걸리는 전압 값이 된다.Simulation c ... 6. Parallel ResistancePart 1. Two Parallel Resistors(a)TABLE 6.1770.03Ω770Ω0.004%770.03Ω12.9mA770 ... that the total resistance of a parallel network will always be less than the smallest resistor. Has
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    | 리포트 | 14페이지 | 2,500원 | 등록일 2010.10.06
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  • 자료 표지
    실험3예비[1].가산기와감산기
    진리표와 동일)3. 실 험 - Simulation예비보고서에서 구상한 반가산기를 구성하고 그 결과를 확인하라.그림 SEQ 그림 \* ARABIC 1. 반가산기 출력 파형반가산기 ... 를 이용하여 전가산기를 구성하고 그 결과를 확인하라.그림 SEQ 그림 \* ARABIC 2. 전가산기 출력 파형2-bit serial adder와 2-bit parallel adder ... 가 주기를 가지고 입력되기 때문에 모든 경우의 수 측정 및 결과를 보는데 어려움이 있어, 일부만 Simulation 하였다. 처음에 B에 ‘01’을 입력하고, A는 ‘00’을 입력
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2011.06.27
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  • 자료 표지
    4Bit Ripple Carry Adder의 이론과 레이아웃
    이 다음단의 CARRY IN 으로 연결시킴■ 4BIT ADDER LOGIC DIAGRAM■ 4BIT ADDER SIMULATION & RESULTo 입력이 0101,0010인 경우o ... LAYOUT & LOGIC BLOCK DIAGRAM■ 4BIT ADDER LAYOUT & LOGIC BLOCK DIAGRAM■ 4BIT RIPPLE CARRY PARALLEL
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 2,000원 | 등록일 2011.07.17
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  • 자료 표지
    실험3결과[1].가산기와감산기
    -bit parallel adder를 구성한 뒤 각각의 입력에 대한 출력을 측정하고 결과 값을 확인하라.회로 SEQ 회로 \* ARABIC 3. 2-bit sirial adder그림 ... 할 수 있기 때문에 Serial Full adder로 동작하는데는 문제가 없어보였다.- Simulation에서 알 수 있다 싶이 하나의 연산을 마무리 하기 위해서는 많은 클럭 ... 아서 그 결과를 내보내는데 bit의 제약이 없이 사용할 수 있다는 장점을 갖고 있다.회로 SEQ 회로 \* ARABIC 4. 2-bit Parallel Adder그림 SEQ 그림
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2011.06.27
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  • 자료 표지
    Chapter 3(pre)
    measures initial pulse and period automatically..?R-C, R-L serial/parallel circuit③ Observe output ... erial circuitfig 3-6. R-C serial circuitfig 3-7. R-L parallel circuitfig 3-8. R-C parallel?R-C-L s ... erial/parallel circuit⑥ State the definition of resonance, and explain why it's important in serial
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2011.04.04
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  • 자료 표지
    Basic Circuit Background 1(결과)
    , 20K, 40K, 60K, 100K)0501001K5.96V5K9.94V10K10.85V20K40K60K100KB. Series, Parallel circuit(DC 12V ... parallel. Each of current is equal to V / R. In resistance meter experiment, first, we denote ... /parallel connection of resistors.In series connection,,,,Real values are.In parallel connection,,,Real
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2011.07.09
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  • 자료 표지
    3D Graphics Game 을 이용한 OS 및 Hardware Performance test_Final Report
    들의 output을 분석한다.4. Simulation on RSIMSingle-issue processor들을 이용한 multiprocessor들의 Parallel SpeedupNon ... Subject)Multiprocessor Simulator를 이용한 program의 test result를 비교분석한다.사용할 Multiprocessor Simulator는 RSIM, WWT ... imulation)WWT2FFT(Fast Fourier Transform)LU(A Blocked LU Decomposition)Radix(Radix sort)각 Simulator에 해당
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2009.03.16
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  • 자료 표지
    Verilog 및 Quartus II를 이용한 논리회로 설계 실습 5-예비,결과 보고서
    과 같은 신호를 주어 Simulation한 Waveform이다.위 결과를 토대로 S-R Latch의 동작특성을 살펴보면 S(set) = 1, R(reset) = 0 Q = 0 이라면 ... 을 설계했다. 위 Schematic을 Simulation한 waveform은 다음과 같다.60ns를 한주기로 같는 50% Duty rate로 Clock을 주었으며, 임의로 clear ... 입력이었으며 이 부분을 XOR를 이용해 위와 같이 수정하면 T F/F을 설계할 수 있다.Schematic을 Simulation한 waveform을 확인하여 T F/F이 재대로 동작
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    | 리포트 | 13페이지 | 1,000원 | 등록일 2009.01.25
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  • 자료 표지
    영어과 인터넷활용교육(인터넷활용수업)의 장점과 효과, 영어과 인터넷활용교육(인터넷활용수업)의 교수학습활동유형과 듣기말하기학습, 영어과 인터넷활용교육(인터넷활용수업)의 학습방법과 개선과제 분석
    다1) 정보검색 활동(Information Searches)2) 연속 창작 활동(Sequential Creation)3) 동시적 문제해결 활동(Parallel Problem ... Solving)4) 가상 모임 활동(Virtual Gatherings)5) 시뮬레이션 활동(Simulations)4. 프로젝트 학습의 특징은 학생들이 그룹별로 스스로 목표와 단계 및 ... 연을 제시하면 학생들은 다음 연부터 협동하여 시를 완성해 나간다.3) 동시적 문제해결 활동(Parallel Problem Solving)인터넷상의 여러 사이트에 속해 있는 학생
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2011.08.03
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  • 자료 표지
    [논리회로] State machine을 이용한 Serial adder 설계
    , Multiplexer, Serial AdderMealy Machine, Parallel In, Output, FSM1. 과제 목표 주어진 제한요소(경제성, 경고성, 확장성, 적시성)를 고려 ... 적으론 제한요소를 모두 갖춘 회로를 구성하였다.4. 결과 분석 BDF로 회로를 Design하고 Simulation을 해본 결과 오류비트가 먼저 들어감에도 정상적으로 작동하는 것을 볼 수
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    | 리포트 | 6페이지 | 3,000원 | 등록일 2009.07.18
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  • 자료 표지
    다이오드 반파정파(피스파이스)
    되었다. Peak Value의 경우 Simulation에서는 7.38V 정도 측정 되었다. 측정 된 값으로만 본다면 실험했던 Diode는 마치 Ge Diode처럼 작동한다.【반파정류 2 ... 대가 된다고 하더라도 저항이 병렬로 달려 있기 때문에 실제로는 아무리 저항이 커도 parallel 연결된 저항의 크기를 초과할 수는 없다. 그렇기 때문에 Peak 값의 절반을 넘 ... 사항우선 파형의 경우는 에 비교된 사항을 참고하면 된다. 그러한 파형을 참고하면 Simulation의 결과와 동일하다. 그러나 Threshold 부분에 있어서 조금 차이를 보인다
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2010.09.18
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  • 자료 표지
    [컴퓨터공학]BIM Handbook Chapter5[5.1~5.3] 요약
    Preliminary Analyses 5.3.2 Building System Design and Analysis/Simulation5.0 Executive Summary ... indeed in parallel with it5.3.1 Concept Design and Preliminary Analyses 3D Sketching Tools It s ... omplex to be used for sketching and form generation5.3.2 Building System Design and Analysis/Simulation
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    | 리포트 | 19페이지 | 3,000원 | 등록일 2010.05.06
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  • 자료 표지
    전압 및 전류분배법칙, 키르히호프의 법칙_예비
    onnection)과 병렬(parallel connection)을 node를 사용해 설명하면직렬 : 2개 혹은 그 이상의 branch(element)가 배타적으로 하나의 node ... 의 법칙을 적용하면이므로 따라서 회로의 전류 I는5. Simulation실험 16V 직렬회로R1의 전압 값은 435.85mVR2의 전압값은 927.357mVR3의 전압 값은 4 ... 에 비례하는데 저항이 크면 더 많은 전압이 인가 된다.또 전압 분배가 일어나더라도 총 전위차는 일정하게 유지 되는 특성을 보인다.Simulation 에서도 이런점을 중점적으로 확인해 보
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    | 리포트 | 17페이지 | 1,000원 | 등록일 2011.11.04
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  • 자료 표지
    Shift Register & Division Circuit
    는 직렬입력-직렬출력(Serial-In Serial-Out), 직렬입력-병렬출력(Serial-In Parallel-Out), 병렬입력-직렬출력(Parallel-In Serial ... 의 종류레지스터를 구성하는 모든 플립플롭들이 동시에 트리거 되어 데이터를 받아들이는 병력 입출력 레지스터를 병렬(Parallel) 레지스터라 한다. 그 외에 데이터가 한 번에 한 ... 병렬입력 직렬출력 레지스터 >④ 병렬입력 - 병렬출력 레지스터 (Parallel-In Parallel-Out)4비트 병렬 입출력 레지스터는 일반적으로 출력단자가 3상태로써 연결
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    | 리포트 | 29페이지 | 3,000원 | 등록일 2010.10.16
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  • 자료 표지
    VHDL-Post lab - FF and S-P conversion
    discuss the result10. Design an 8-bit serial-to-parallel registers-Do a waveform simulation-download the ... 가 발드에서 input 값에 충돌이 발생하여 Simulation 상에서 오류가 났음을 알게 되었고, Din 이라는 것을 함부로 사용 하면 안된다는 것을 한번더 일깨워 주는 계기가 되 ... 하다가, 한마디로 괜히 VHDL 코드를 간단화 시키려고 하다가 예상치 못한 결과 Simulation을 얻게 되었다. 분명 Synthesize 합성에서도 이상이 없었는데 Simulation
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    | 리포트 | 11페이지 | 2,000원 | 등록일 2009.06.29
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  • 자료 표지
    dc 14, 15
    적으로 실험에서 회로를 완성하고 충분한 시간이 지나지 않은 상태에서 전압을 측정했을 가능성도 크다.Simulation & AnalysisPSpice0V0V10.07V10.07 ... 한다.Simulation & Analysis→ 피스파이스에 위 회로를 돌리면 각 초마다의 정확한의 값을 알 수는 없지만 대략적으로 실험 결과로 첨부한 엑셀 그래프와 일치한다는 것을 알 ... 수 있다. 따라서 우리가 구한 테브난의 등가회로가 타당하다는 결론을 내릴 수 있다.Simulation & Analysis→ 실험에서 측정된 값들에 따라 구한 테브난 등가회로를 피스
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    | 리포트 | 14페이지 | 2,500원 | 등록일 2010.10.06
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  • 자료 표지
    실험6예비[1].Shift.Register&Counter
    /Parallel Out(위 회로에서 PRE 설정을 모두 ‘H’로 하고 U1A의 J는 Serial Data 입력,K는 Serial Data 반전값을 입력)그림 SEQ 그림 ... \* ARABIC 6. 출력 파형집적회로 Shift Register(7496 소자 라이브러리 문제로 J-K F/F을 이용한 Simulation 수행)기본 동작그림 SEQ 그림 ... 파형카운터(카운터에 해당하는 Simulation은 아래 문제에 포함되어 있음)4. 문 제시프트레지스터로 만들어진 링카운터의 구조와 동작원리에 대해 조사하라.지난 주에 배웠던 실험
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    | 리포트 | 11페이지 | 1,000원 | 등록일 2011.06.27
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  • 자료 표지
    [VerilogHDL] CLA(Carry Look ahead Adder)를 이용한 16bit 고속 가산기 설계
    하는 방식으로구조는 간단한 반면 bit의 개수가 많아질수록 속도가 느려지는 단점이 있다.그림1. 4bit Binary Parallel Adder■ CLA(Carry Look ... Adder Test bench 코드 및 Timing Simulation 결과`timescale 1ns / 1nsmodule tb_CLA16;parameter step = 100;reg
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    | 리포트 | 6페이지 | 2,500원 | 등록일 2013.05.25
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  • 자료 표지
    basic circuit background 2(결과)
    circuit.(corrected schematic)Simulation ResultExperiment Result1001.6129V16.129mA1.612V16.01mA3003 ... with parallel. The resistances are not influenced of the voltage at node a. Because potential
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2011.07.09
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  • 자료 표지
    직렬 병렬 회로
    Experiment 1. Series & Series-Parallel Circuits1. Objectives⑴ 저항이 직렬로 연결된 회로에서 전체저항 RT를 실험을 통하여 확인 ... -Parallel Network① Table 1-4와 같이 저항을 측정하고 계산값과 비교한다.② 그림 5와 같이 회로를 구성하고 Table 1-5를 따라 전압을 측정한다.그림 4그림 3 ... Part D : Design a four-resistor series-parallel circuit for IT 5㎃① 측정된 저항을 사용해서 전류가 5㎃가 흐르도록 그림 3과 같
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    | 리포트 | 11페이지 | 1,000원 | 등록일 2009.03.25
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2026년 04월 29일 수요일
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