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"디지털회로" 검색결과 401-420 / 15,744건

  • 아날로그및디지털회로설계실습 예비보고서11 카운터설계
    아날로그 및 디지털 회로설계 실습예비보고서(설계실습 11. 카운터 설계)11-1. 실습목적JK Flip Flop을 이용한 동기식, 비동기식 카운터를 설계해 보고 리셋 기능을 이용 ... 하여 임의의 진수의 카운터를 제작할 수 있는 능력을 배양한다. 또한 chattering 방지 회로에 대하여 학습한다.11-3. 설계실습 계획서11-3-1 4진 비동기 카운터이론부 ... / 보라색 – Q1 / 갈색- Q211-3-2 8진 비동기 카운터 설계8진 비동기 카운터의 회로도를 그린다. 단, CLK 입력에 클럭 입력 대신 버튼 스위치를 연결하여 버튼을 누를 때
    리포트 | 5페이지 | 1,500원 | 등록일 2020.10.17 | 수정일 2020.11.27
  • 전기및디지털회로실험 실험 2. 기본 논리게이트 예비보고서
    전기및디지털회로실험 예비레포트 담당교수 : 학과 : 학번 : 이름 : 목차 실험 명 실험 개요 이론 조사 - 기본 논리게이트 - 논리게이트 IC 4. 실험 기기 예비보고서 문제 ... 를 이해하도록 한다. (2) 실제 사용되는 기본적인 논리게이트 IC에 대하여 익히도록 한다. (3) 기본 논리소자를 사용한 간단한 회로의 구성과 측정법을 익히도록 한다. (4 ... 한 논리변수들의 입력과 출력간의 관계를 모든 가능한 조합에 대해 표의 형태로 나타낸 것을 진리표라고 한다. 논리 게이트는 주로 전자 회로의 스위치로 작동하는 다이오드 또는 트랜지스터
    리포트 | 10페이지 | 1,000원 | 등록일 2023.06.30 | 수정일 2025.02.19
  • 판매자 표지 자료 표지
    아날로그 및 디지털회로 설계 실습 실습7_논리함수와 게이트_결과보고서
    요약AND, OR, NOT 게이트를 사용하여 NAND, NOR, XOR 게이트 등가회로를 구성하여보고, 반대로 NAND 게이트만을 이용하여 AND, OR, NOT, 3-Input ... NAND 게이트 등가회로를 구성하였다. AND 게이트와 OR 게이트의 딜레이 시간을 직접 측정하였다. NAND 게이트를 이용하여 논리게이트가 동작하는 최소 Vcc 전압을 구하 ... 였다. 마지막으로 2x4 디코더를 직접 구현하고 올바르게 동작하는지 확인하였다.사용계측기 : Digital Multimeter(KEYSIGHTE 34450A)Function
    리포트 | 9페이지 | 1,000원 | 등록일 2024.08.27
  • 판매자 표지 자료 표지
    아날로그 및 디지털회로 설계 실습 실습8_래치와 플립플롭_결과보고서
    디지털 회로에서 매우 중요한 역할을 담당하고 있 고 다양한 곳에서 사용되므로 그 동작 원리를 이해하고 회로를 구성할 수 있는 능력을 키우는 것이 중요하다고 할 수 있다3.실험 ... 1.요약이번 실습에서는 논리 gate(nand, inverter)를 사용해 래치와 플립플롭의 회로를 설계하였다. 입 력의 변화에 민감한 래치의 특성과 클록과 함께 들어온 입력 ... 에 영향을 미치게 된다. 입력의 변화에 민감한 래치는 주로 메모리 회로의 데이터 저장에 사용되고 클록의 변화에 영향을 받는 플립플롭의 경우 cpu에 사용한다. 이렇듯 래치와 플립플롭
    리포트 | 6페이지 | 1,000원 | 등록일 2024.08.27
  • 판매자 표지 자료 표지
    아날로그및디지털회로설계실습 (예비)설계실습 11. 카운터설계 A+
    이론부의 그림 14-2의 비동기식 4진 카운터에 1MHz의 구형파 (square wave)를 인가할 때, Q1 신호의 주파수와 Q2 신호의 주파수를 구한다. 또한, 입력 신호, Q1 신호, Q2 신호의 파형 을 함께 그린다.초기 상태가 Q1=Q2=0(low) 이었을 때..
    리포트 | 3페이지 | 1,000원 | 등록일 2024.12.23
  • 판매자 표지 자료 표지
    디지털 논리회로 4장 연습문제 풀이 (생능출판, 김종현)
    + + yz'4.5풀이: 그림 4-30의 회로로부터 출력 F에 대한 부울함수를 유도해보면F = [{(A+B)'B}'C]' + B = [{A'B'B}'C]' + B= [{0}'·C ... ]' + B = [1·C]' + B = C' + B답: B + C'4.6풀이 및 답: 그림 4-31의 회로를 부울 대수를 이용하여 표현하면F A(B + C) + BC 이렇게 나온다 ... 000000000110000101000011101110000001011101110110111111114.7풀이 및 답: 그림 4-32의 회로에서 각 게이트의 출력에 주어진 임시 변수들(a, b, c) 및 두 출력 변수들(F와 G)에 대한 부울 함수를 각각
    리포트 | 12페이지 | 3,000원 | 등록일 2021.03.18 | 수정일 2021.04.20
  • 판매자 표지 자료 표지
    디지털 논리회로 3장 연습문제 풀이 (생능출판, 김종현)
    이 발생한 경우에는 0이 된다고 가정하였다. 집안 어느 곳에서든 침입이 발생하면 경고음이 울리도록 회로를 설정하면 다음과 같다.F(경고음발생장치)현관문창문 A창문 B창문 C창문 D3.9 ... 풀이 및 답: 전조등을 켜고 자동차를 운행한 후에 엔진을 끄면 전조등도 자동적으로 꺼지게 하는 회로를 구성한다. 엔진점화 스위치가 off가 되었을 때 전조등 스위치가 on인 경우 ... 에는 전조등을 off시키기 위한 구동 신호(+5V)를 발생하는 게이트 회로를 구성하면 다음과 같다.(엔진점화 스위치를 끄면 1이 발생하도록 해야하므로 인버터를 이용하여 출력한다.)F
    리포트 | 9페이지 | 3,000원 | 등록일 2021.03.17 | 수정일 2021.03.22
  • 판매자 표지 자료 표지
    아날로그 및 디지털회로 설계 실습 실습4_신호발생기_예비보고서
    설계 실습4. 신호발생기4-1. 목적Wien bridge RC 발진기를 이용하여 신호 발생기를 설계, 제작, 측정하며 그 동작을 확인한다.4-2. 준비물 및 유의사항부품Op amp. (UC741CN) : 1개다이오드 1N4001 : 2개가변저항 10k Ω : 6개커패시..
    리포트 | 5페이지 | 1,000원 | 등록일 2024.08.27
  • 서강대학교 디지털논리회로실험 7주차 결과보고서
    cycle을 반복적으로 수행하는 순차 논리회로이다. Counter의 modulus는 cycle내의 상태 수에 의해 결정되는데, 여기서 modulus란 다시 초기상태로 돌아오
    리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02
  • 서강대학교 디지털논리회로실험 9주차 결과보고서
    1. 실험목적1) 메모리 소자들의 동작 원리와 활용 방법을 이해한다.Read Only Memory(ROM)Random Access Memory(RAM)2) Address decoding의 개념과 구현 방법을 이해한다.3) ROM을 이용해서 임의의 기능을 수행하는 com..
    리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02
  • 서강대학교 디지털논리회로실험 4주차 결과보고서
    의 동작원리와 활용방법을 이해한다.2. 배경이론 및 실험방법Multiplexer는 n개의 입력신호로부터 1개를 선택해서 출력에 연결해주는 Digital Switch이다.일반적으로 n개 ... circuit는 FPGA로 회로를 구현해 알아보는데, MUX와 DeMUX 를 연결해 데이터가 어떻게 전달될 수 있는지 관찰한다.
    리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02
  • 판매자 표지 자료 표지
    디지털공학_7장 다단게이트 회로, NAND, NOR 게이트 연습문제풀이
    리포트 | 3페이지 | 2,000원 | 등록일 2023.08.06
  • 디지털 논리회로 실험 1주차 기본 논리 게이트 예비보고서
    디지털 논리회로 설계 및 실험예비보고서주제 : 기본 논리 게이트 (AND, OR, NOT Gate)소속: 공과대학 전자전기공학부수업: 수2,3 XXX 교수님 XXX 조교님제출 ... 1과 0(high와 low)를 가지고 논리연산(AND, OR, NOT 등)을 수행하는 회로를 말한다. High와 Low로 이루어진 Digital signal을 Input으로 넣 ... 었을 때 이것들을 조합하여 우리가 원하는 Output Digital signal을 만들 수 있는 회로이다. 이러한 논리 회로 중 기본이 되는 간단한 것을 논리게이트 또는 단순히 게이트
    리포트 | 8페이지 | 1,500원 | 등록일 2020.09.19 | 수정일 2020.09.24
  • 디집적, 디지털집적회로설계 실습과제 2주차 인하대
    하는 것이기 때문에 아직은 생소하게 느껴지지만 많은 연습을 수반한다면 금방 익숙해 질 수 있을 것 같다.디지털집적회로설계 실습 2주차 과제
    리포트 | 7페이지 | 1,500원 | 등록일 2021.08.31
  • 판매자 표지 자료 표지
    디지털 논리회로 2장 연습문제 풀이 (생능출판, 김종현)
    2.1(1) 36과정:2) 362) 18 나머지 수 = 0 → b02) 9 나머지 수 = 0 → b12) 4 나머지 수 = 1 → b22) 2 나머지 수 = 0 → b32) 1 나머지 수 = 0 → b40 나머지 수 = 1 → b5=> 36(10) = 100100(2)..
    리포트 | 17페이지 | 3,000원 | 등록일 2021.01.18
  • 디집적, 디지털집적회로설계 실습과제 4주차 인하대
    키나 각 부분에서 어떤 명령어를 입력하고 어떤 painting을 해야 하는지도 확실히 더 익숙해졌고 좀 더 복잡한 회로들을 layout 하다 보면 실력이 더 향상 될 것으로 기대된다.디지털집적회로설계 실습 4주차 과제 ... 이 아닌 2:2로 되어있다. 우선 CMOS 회로에서 load capacitor가 충전되고 방전되는 시간이 같아야 하므로 NMOS와 PMOS의 저항이 동일해야 한다. 이를 식으로 표현
    리포트 | 6페이지 | 1,500원 | 등록일 2021.08.31
  • 디집적, 디지털집적회로설계 실습과제 11주차 인하대
    로 구성되어 있다. 트랜지스터 레벨 회로를 살펴보면, 과제의 조건대로 mobility의 비율 를 만족하도록 transistor의 size를 구했을 때 에서 을 만족한다() 따라서 ... 했던 signal을 그대로 사용했다.M1000 부터 M1011까지 총 12개의 트랜지스터가 정상적으로 사용되었고 inverter에선 width 비율이 2:1을 만족하고 XOR 회로 ... 는 부분이 있고 poly contact와 Metal1 사이에도 겹치는 부분이 존재하기 때문에 실제의 회로에선 capacitor가 생성될 수밖에 없다. Capacitor를 줄이기 위해서
    리포트 | 10페이지 | 1,500원 | 등록일 2021.08.31
  • 판매자 표지 자료 표지
    아날로그및디지털회로설계실습_4bit-Adder_결과보고서
    9-4. 설계실습 내용 및 분석9-4-3 설계한 전가산기 회로의 구현 (2-비트 전가산기 회로)설계실습계획서에서 그린 2-Bit 전가산기 회로를 스위치와 LED를 추가하여 설계 ... 및 구현한다. 4가지 다른 입력 값에 대해 구현된 회로의 입력 단자와 출력 단자의 동작을 LED로 확인한다.
    리포트 | 12페이지 | 1,000원 | 등록일 2023.04.01
  • 디집적, 디지털집적회로설계 실습과제 9주차 인하대
    하는 element들이 없기 때문에 전력은 음수가 나오거나 매우 작은 값이 출력된다.고찰이번과제는 HSPICE로 단순 회로 구동만을 검증하는 것이 아닌 propagation delay와 power
    리포트 | 9페이지 | 1,500원 | 등록일 2021.08.31
  • A+ 중앙대 아날로그및디지털회로설계실습(결과)10. 7-segment Decoder 회로 설계
    설계실습을 통하여 무엇을 배웠는가?디지털 회로의 명확한 결과가 나오는 것이 매력적이라고 생각한다. 이번 실습을 통해 7-segment와 Decoder의 구조를 학습하고 역할 ... 에 대해 배울 수 있었다. 회로를 설계하여 입력에 대한 출력을 확인해보고 올바른 회로를 설계하였다는 것을 알 수 있었다.실습을 진행해주신 조교님께 감사인사드린다.1. 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, 75-86 ... 실습 10. 7-segment / Decoder 회로 설계(학생이름, 학번, 학수번호, 실험조의 번호, 실험조원의 이름, 실험날짜, 제출날짜)요약 :7-segment
    리포트 | 3페이지 | 1,000원 | 등록일 2022.09.10
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2025년 09월 08일 월요일
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