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아날로그 stopwatch 설계 래치와 플립플롭 smps 3.스텝모터 예비 신호발생기
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"아날로그 및 디지털회로설계실습" 검색결과 181-200 / 724건

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    A+ 중앙대 아날로그및디지털회로설계실습(결과)10. 7-segment Decoder 회로 설계
    에 대해 배울 수 있었다. 회로를 설계하여 입력에 대한 출력을 확인해보고 올바른 회로를 설계하였다는 것을 알 수 있었다.실습을 진행해주신 조교님께 감사인사드린다.1. 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, 75-86 ... 설계실습을 통하여 무엇을 배웠는가?디지털 회로의 명확한 결과가 나오는 것이 매력적이라고 생각한다. 이번 실습을 통해 7-segment와 Decoder의 구조를 학습하고 역할 ... 실습 10. 7-segment / Decoder 회로 설계(학생이름, 학번, 학수번호, 실험조의 번호, 실험조원의 이름, 실험날짜, 제출날짜)요약 :7-segment
    리포트 | 3페이지 | 1,000원 | 등록일 2022.09.10
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    아날로그 및 디지털회로설계실습 실습5(전압제어 발진기) 예비보고서
    예비보고서(설계실습 5. 전압제어 발진기)아날로그 및 디지털 회로 설계실습설계실습 5. 전압제어 발진기5-1. 목적 : 전압제어 발진기 (VCO : Voltage ... Controlled Oscillator)를 설계하고 전압을 이용한 발진 주파수의 제어를 실험으로 확인한다.5-2. 실습 준비물부품저항 100Ω, 1/2W, 5%3개저항 5.1㏀, 1/2W, 5 ... amp1개사용장비오실로스코프 (Oscilloscope)1대브레드보드 (Bread Board)1개파워서플라이 (Power Supply)1대점퍼선다수5-3. 설계실습 계획서5-3-1
    리포트 | 14페이지 | 1,000원 | 등록일 2020.09.24
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    아날로그및디지털회로설계실습 실습6(위상 제어 루프(PLL))예비보고서
    예비보고서(설계실습 6. 전압제어 발진기)아날로그 및 디지털 회로 설계실습설계실습 6. 위상 제어 루프(PLL)6-1. 실습목적 : 위상 제어 루프 회로의 이론을 학습하고 간단 ... 한 위상 제어 루프 회로를 구성하여 주파수 동기화(Phase Locking) 원리를 이해한다.6-2. 실습 준비물부품저항 100Ω, 1/2W, 5%3개저항 1㏀, 1/2W, 5%2개 ... 다수6-3. 설계실습 계획서6-3-1 위상제어루프의 용도이론부의 위상 제어 루프를 이해하여 요약, 설명하고 실제 사용되는 분야에 대해서 서술한다.VCO의 출력 위상을 입력 신호
    리포트 | 11페이지 | 1,000원 | 등록일 2020.09.24
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    [A+] 중앙대학교 아날로그 및 디지털 회로 설계실습 예비보고서 12. Stopwatch 설계
    (A) 12-4-1 기본적인 클럭 생성 회로 및 카운터 회로 테스트Function generator를 이용하여 실습서와 동일하게 Frequency는 1 [Hz
    리포트 | 5페이지 | 1,000원 | 등록일 2023.02.06 | 수정일 2023.02.09
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    [A+] 중앙대학교 아날로그 및 디지털 회로 설계실습 예비보고서 11. 카운터 설계
    를 구한다. 또한, 입력 신호, Q1 신호, Q2 신호의 파형을 함께 그린다.[그림 1]에 이론부의 [그림 14-2]의 비동기식 4진 카운터 회로를 나타내었다. High 신호는 5 ... [V]로 표현하였다. 이 회로에 1 [MHz]의 구형파 즉, 1 [us]를 주기로 갖는 구형파를 인가하였다. JK Flip Flop은 CLR이 High일 때 우리가 알고 있는 동작
    리포트 | 5페이지 | 1,000원 | 등록일 2023.02.06
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    아날로그 및 디지털회로설계실습 실습6(위상 제어 루프(PLL))결과보고서
    촬영한 사진들이다.2. 설계실습 내용 및 분석6-4-1 위상제어루프의 설계그림 6-2의 위상 제어 루프를 구성한다.(Op amp의 동작전원은 ±5V이고, Logic gate ... 한다.위상 제어 루프를 브레드보드에 설계한 사진→ 설계실습 책 그림 6-2를 참고하여 브레드보드에 위상 제어 루프를 설계하였다. 회로를 설계하는데 사용한 재료는 UA741, 74 ... 설계실습 6. 위상 제어 루프(PLL)요약이동 통신 등의 채널 설정에 주로 쓰이는 위상 제어 루프에 대해 실험을 하였다. 위상 제어 루프는 VCO의 직류 입력에 변조 신호를 인가
    리포트 | 7페이지 | 1,000원 | 등록일 2020.09.24
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    [A+]중앙대 아날로그및디지털회로설계실습 예비보고서11 카운터 설계
    아날로그및디지털회로설계실습 05분반 13주차 예비보고서설계실습 11. 카운터 설계11-3-1- 4진 비동기 카운터 회로도- 파형Q1신호의 주파수 = 1/T1 = 1/2us = 0 ... .5MHz , Q2신호의 주파수 = 1/T2 = 1/4us = 0.25MHz11-3-2- 8진 비동기 카운터 회로도: CLK 입력을 switch로 설정하였고 변화하는 파형을 관찰 ... 가 바뀌도록 하였다.11-3-3- 10진 비동기 카운터 회로도: CLK 입력을 switch로 설정하였고 변화하는 파형을 관찰하기 위해 임의의 시간을 설정하였다. 출력부분에는 LED
    리포트 | 4페이지 | 1,000원 | 등록일 2021.10.09
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  • 판매자 표지 자료 표지
    A+ 아날로그및디지털회로설계 실습 예보 접촉식 초전형 적외선 센서
    리포트 | 1페이지 | 1,000원 | 등록일 2022.03.27
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  • 자료 표지
    [A+] 중앙대 아날로그 및 디지털회로 설계실습11 카운터 설계 예비보고서
    아날로그 및 디지털 회로 설계 실습-실습 11 예비보고서-카운터 설계학 과 : 전자전기공학부담당 교수님 : XXX 교수님제출일 : 2020.12.XX(X)조 : X요일 X조학번 ... / 이름 : XXXXXXXX / XXX11-1. 실습 목적JK Flip Flop를 이용한 동기식, 비동기식 카운터를 설계해 보고 리셋 기능을 이용하여 임의의 진수의 카운터를 제작 ... 할 수 있는 능력을 배양한다. 또한 chattering 방지 회로에 대하여 학습한다.11-2. 실습 준비물부품JK Flip Flop 74HC73: 4개NAND gate 74HC00
    리포트 | 4페이지 | 1,000원 | 등록일 2021.09.06
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  • 자료 표지
    [A+]중앙대학교 아날로그및디지털회로설계실습 Stopwatch 설계 예비보고서
    를 통하여 카운터, 분주회로, 클럭 회로, 디코더 등 다양한 디지털 회로 구성요소에 대한 이해를 높이고 Datasheet를 읽고 분석하는 능력과 원하는 회로를 설계할 수 있는 능력을 배양한다. ... 크게 BCD to 7 Segment decoder 와 BCD 카운터, Binary 카운터 두 가지만 정리하겠다.BCD to 7 Segment decoder디지털 회로의 출력은 대 ... 를 선택하며 74HC192/193 칩은 up 카운트용 클럭 핀과 down 카운트용 클럭핀이 별도로 있어서 목적에 맞는 클럭 핀에 클럭을 인가하면 된다. 실습목적Stopwatch 설계
    리포트 | 5페이지 | 1,000원 | 등록일 2021.09.02
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    아날로그 및 디지털회로설계실습 6주차 위상 제어 루프(PLL) 예비 리포트
    설계실습 6. 위상 제어 루프(PLL)요약: 이번 보고서를 통해 위상 제어 루프를 학습했다. 위상제어루프의 구조나 역할등을 확인하고 XOR을 이용한 위상검출기의 동작 ... 상 과 이 같을 때(High, Low 둘 경우 모두) 이 Low이고 다를 때 High이다.교재의 그림 6-2의 회로를 Simulation tool (PSPICE)로 설계한다. 이 ... 을 PSPICE를 통해 확인했으며 그 후 위상제어루프를 설계하고 파형을 확인했다. 그 후 대비 VCO의 주파수의 변화를 알아보았으며 Loop Filter의 1/2RC값을 바꿔 필터효과를 바꿔보
    리포트 | 13페이지 | 1,000원 | 등록일 2021.09.02
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    [A+]중앙대 아날로그및디지털회로설계실습 예비보고서12 Stopwatch 설계
    아날로그및디지털회로설계실습 05분반 14주차 예비보고서설계실습 12. Stopwatch 설계12-3
    리포트 | 1페이지 | 1,000원 | 등록일 2021.10.09
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  • 자료 표지
    [A+]중앙대 아날로그및디지털회로설계 실습 예비보고서12 stopwatch 설계
    -segment를 활용한 실습을 진행시 먼저 type을 확인해야 한다.- BCD to 7-Segment decoder디지털 회로의 출력은 대게 2
    리포트 | 11페이지 | 1,000원 | 등록일 2022.09.08 | 수정일 2022.09.16
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  • 자료 표지
    중앙대 아날로그 및 디지털 회로 설계 실습 3학년 2학기 stopwatch설계 예비
    아날로그 및 디지털회로 설계 실습14주차 예비: Stopwatch 설계전자전기공학부20160000 하대동고릴라설계실습 방법에 나온 Stopwatch 제작 과정 중, 12-4-1 ... 이 표시될 것으로 예상된다. 실습11. 카운터 설계의 10진 비동기 카운터 설계 부분에서도 10이 아주 짧게 나왔기 때문이다.실습 11에서 10진 비동기 회로의 출력 아래 그래프 ... 를 이용해야 한다.1. 기본적인 클럭 생성 회로 및 카운터 회로 테스트(A). Function generator를 이용하여 사용하고자 하는 1Hz의 Clock 신호를 만들어 낸다
    리포트 | 12페이지 | 2,000원 | 등록일 2020.12.23
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    [A+]중앙대학교 아날로그및디지털회로설계실습 카운터 설계 예비보고서
    카운터 등의 디지털 회로를 제작하다 보면 전원 및 작동을 위하여 다양한 종류의 스위치를 사용하게 된다. 대개 전원용으로는 토글 스위치를 사용하며, 동작용으로는 버튼 스위치를 많이 ... 상태가 될 수도 있다. 스위치를 끌 때도 마찬가지다. 이러한 현상을 chattering 현상이라고 하는데, 경우에 따라서는 회로 오동작의 원인이 되기도 한다.실습목적JK Flip ... Flop을 이용한 동기식, 비동기식 카운터를 설계해 보고 리셋 기능을 이용하여 임의의 진수의 카운터를 제작할 수 있는 능력을 배양한다. 또한 chattering 방지 회로에 대하
    리포트 | 7페이지 | 1,000원 | 등록일 2021.09.02
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    [결과보고서]중앙대학교 아날로그및디지털회로설계실습 신호 발생기
    실습 내용 및 분석4-4-1 설계한 Wien bridge oscillator 구현(A) 계획서의 4-3-1에서 설계한 대로, 그림 4-1에 주어진 Wien bridge 발진기를 제작하시오.이 때 Op-amp는 ±  전압을 공급하시오. ... 는   , 발진주파수가 1.613 kHz가 나왔다. 첫 번째, 두 번째 실험의 출력파형을 비교해보고, 설계된 회로로 이득을 변화시켜가며 왜곡된 파형과 출력 파형의 최대치 ... 을 목적으로 한다.Op amp에 인가되는 저항의 크기로 원하는 주파수와 gain을 설정하고, 다이오드를 연결하여 왜곡이 덜 발생하는 회로를 구성하였다.2. 실험결과4-4. 설계
    리포트 | 7페이지 | 1,000원 | 등록일 2023.06.23
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    [예비보고서]중앙대학교 아날로그및디지털회로설계실습 논리함수와 게이트
    : 다수7-3. 설계실습 계획서7-3-1 XNOR 게이트 설계 및 특성 분석(A) AND, OR, NOT 게이트를 사용하여 NAND, NOR, XOR 게이트의 기능을 갖는 회로도 ... 를 그리고, XNOR (Excllulsive NOR)의 진리표를 사용하여 AND, OR, NOT 게이트로 XNOR의 회로도를 설계한다.Ans.1. NAND 게이트첫 번째로 NAND ... 게이트를 먼저 설계하였으며 AND, NOT 게이트를 활용하여 NAND 게이트를 구성하였다.다음페이지에서 회로와 Simulation 결과를 확인할 수 있다.그림에서 빨간색과 초록색
    리포트 | 8페이지 | 1,000원 | 등록일 2023.06.23
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    12. Stopwatch 설계 결과보고서 [2021년도 아날로그 및 디지털 회로 설계 실습 A+ 자료]
    아날로그 및 디지털 회로 설계 실습-실습 12 결과보고서-Stopwatch 설계학과 :담당 교수님 :제출일 :조 :학번 / 이름 :12-4. 설계실습 방법이번 stopwatch ... 처음에 진행하도록 하고 나머지 과정들의 순서는 약간 변경해도 무방하다.12-4-1 기본적인 클럭 생성 회로 및 카운터 회로 테스트(A) Function generator를 이용 ... 의 기본적인 연결은 표시할 필요 없이 주요 부품과 주요 결선 부분만 표시) 또한 예비 설계보고서에서 예상했던 대로 회로가 동작하지 않았을 경우, 그 이유를 설명하고 어떻게 문제
    리포트 | 6페이지 | 1,000원 | 등록일 2022.10.24
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  • 자료 표지
    아날로그 및 디지털회로설계실습 2주차 Switching Mode Power Supply(SMPS)과제
    리포트 | 3페이지 | 1,000원 | 등록일 2021.09.02
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    A+ 중앙대 아날로그및디지털회로설계실습(결과)7. 논리함수와 게이트
    된 부분에 이 번호를붙인다.)1. 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, pp 55-60 ... 다.2. 실험결과7-4. 설계실습 내용 및 분석7-4-1 설계한 논리게이트 구현 및 동작(A) Low(0) 값, High(1) 값, Vcc를 각각 0V, 5V, 5V로 설정 ... (예)의 형식으로 작성하되, 다음 사항을 검토하여 작성하라.- 본 설계실습에서 무엇을 하였으며 그 결과는 어떤가? 수치를 포함하여 요약한다. 설계실습계획서에서 설계한 회로와 실제
    리포트 | 5페이지 | 1,000원 | 등록일 2022.09.10
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2025년 08월 16일 토요일
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