"논리회로실험 2"의 검색결과 입니다.

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"논리회로실험 2" 검색결과 1,701-1,720 / 4,025건

디지털회로실험 전자주사위 텀프로젝트 (회로도 및 설명, 사진 첨부)

로 구현하기로 한다. 기본적인 주사위는 LED 7개를 이용하여 표현이 가능하다.2. 작품 설계 동기 및 목표LED로 표현된 주사위는 현재 디지털공학 수업 시간과 기초전자 회로실험 시간 ... 10조 디지털회로실험 및 설계 Team project 보고서제목LED를 이용한 전자주사위 (10조)학과전자공학과학번2000000성명홍길동제출일1. 프로젝트 개요이번 실험 프로젝트 ... 에 다루고 있는 논리 회로에 대한 내용으로 적합하게 구성되어 있다. 디지털 회로를 구성하는 기본 소자 IC소자, 그리고 LED등을 이용하여 회로가 구성되어 있을 뿐 아니라, IC칩

리포트 | 8페이지 | 2,000원 | 등록일 2015.01.27

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서울시립대학교-전자전기컴퓨터설계실험2-제09주-Lab08-Post

Design @ 7-segment and Piezo Control, 서울시립대학교.Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소. ... Post-lab Report전자전기컴퓨터설계실험Ⅱ9주차. Application Design 7-segment and Piezo Control실험 날짜2016. 11.07학번이름 ... buzzer에서 나오는 것을 확인하였다.pressed button switch 2Button switch 2를 누른 경우, LED 2에 불이 들어옴을 확인할 수 있다. ‘레’ 음이

리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04

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[대충] 결과 Digital logic

전자회로실험(결과보고서)실험 : Digital logic1. 결과보고 사항ViVo04.88V57.2mV?Inverter?NOR gateV1V2Vo004.94V056.8mV507 ... =0V가 됩니다.?NOR gate의 표를 가지고 진리표를 작성하시오.NOR gateInputOutputABF001010100110?검토사항1-2, 2-1학기 때 논리회로 시간에 배운 ... .8mV554.7mV2. 검토사항 및 논의?Inverter 및 NOR gate를 구성하기 위한 동작 특성을 설명 하시오.실험이론에 나와있듯이 Inverter는 입력 전압 Vi=0V

리포트 | 2페이지 | 1,000원 | 등록일 2015.01.17

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순서논리회로 1 플립플롭 결과보고서

■이번 실험에서는 지난 실험시간에 숙지하였던 기본적인 6가지의 논리게이트 (NOT gate, AND gate, OR gate, NAND gate, NOR gate, XOR ... gate)에 를 자유롭게 이용하여 일명 '플립플롭' 이라는 게이트를 제작해 봅니다.플립플롭이란 두 개의 안정상태 중 어느 쪽이든지 한쪽을 보존하는 논리회로의 일종이며, 두 개의 상태 ... 하는 결과 를 이끌어 내었습니다.이번 실험은 이론상으로만 알고있던 플립플롭 회로가 실제로 왜 필요해야 하는지 등의 이유를 알게 되었습니다.또한 이번 회로를 설계하며 느낀 점은, 각

리포트 | 2페이지 | 1,500원 | 등록일 2014.11.28

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VLSI 설계 및 프로젝트 실습 (인하대학교 전자공학과) CMOS AND,OR Layout Simulation 결과 보고서

를 비교하는 것이다.2. 실험과정이번 실험은 크게 아래와 같은 단계로 진행되었다.① 회로 설계 (NETLIST 직접 작성)② HSPICE로 시뮬레이션③ Magic tool을 이용 ... 의 입력으로 넣어주면 구현할 수 있고, 마찬가지로 OR는 NOR의 출력을 인버터의 입력으로 넣어주어 구현할 수 있다.이번 실험에서는 위와 같은 방법으로 쉽게 2-input AND ... 실험과 마찬가지로 B의 주기를 A의 주기의 2배로 하여 A와 B의 조합이 (0,0) , (0,1) , (1,0) , (1,1)의 결과를 모두 확인할 수 있었다.우선 네가지 시뮬레이션

리포트 | 11페이지 | 2,000원 | 등록일 2015.09.30

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전자전기컴퓨터설계실험2(전전설2)4주차결과

신호 처리기 등등을 시뮬레이션 가능하게 한 프로그램이다.나. HBE-ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습을 위한 장치 ... 한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정에서 사용하는 클럭의 입력은 1MHz ... 위의 결과값을 통해 논리 회로를 만들어보면 1bit 감산기는 다음과 같다.나. module instance 설계 시 주의할 점앞서 4bit 비교기에서 있어서 맨 왼쪽 bit

리포트 | 19페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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DSP실험 lab2

적으로 처리하는 논리회로를 말 한다.2. 신호처리에 특화되어있다1.부동 소수점(Floating-point) 연산을 통합 해서 직접 데이터 형태로 처리한다. 높은 수준의 병렬 처리 ... < DSP 실험 - LAB02 >1. fixed point number는 2진법 표시의 데이터로, 가정 소수점의 위치를 고정하여 수치를 표시한 데이터이다. 반면에 floating ... point number는 수의 소수점의 위치를 움직일 수 있게 함으로써 한정된 비트의 수로 정밀도를 보다 높게 표시할 수 있다.2.고정 소수점 프로세서부동 소수점 프로세서1

리포트 | 3페이지 | 1,000원 | 등록일 2016.09.20

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논리회로의 간소화 예비레포트

실험8. 논리회로의 간소화● 실험의 목적- 무효 BCD-코드 감지기에 대한 진리표 작성- Karnaugh 맵을 이용한 표현식의 간소화- 간소화된 표현식을 구현하는 회로의 구성 및 ... / DM7400 Quad 2-Input NAND Gates ● 실험 회로에 대한 진리표표 8-2 무효 BCD-코드 감지기에 대한 진리표입 력출 력D C B AX00 ... 한칸의사각형에 나타냄.카르노 맵의 각 칸에서 수평 또는 수직 방향으로 인접한 칸(adjacent term)은 한변수의 논리상태만 서로 다르다.카르노 맵에서 인접 항을 2, 4

리포트 | 5페이지 | 1,000원 | 등록일 2014.11.01

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FPGA를 이용한 디지털 시스템 설계(인하대) MUX, Decoder, Comparator 보고서

코드는 2n개의 다른 정보들을 표현할 수 있다.따라서 일반적으로 n-bit 입력코드를 m-bit 출력 코드로 변환하는 조합 논리회로를 n-to-m decoder라 하고 입력과 출력 ... 이번 실험의 세번째 주제는 4bit Comparator를 설계하는 것이다.Comparator는 비교기로 두 수의 크고 작음을 비교하는 논리 회로로 두 입력값 중 한 값이 다른 값 ... FPGA를 이용한 디지털시스템 설계 REPORTMUX , Decoder , Comparator 설계1. 실험목표이번 실험의 목표는 4-to-1 MUX , 2-to-4 Binary

리포트 | 18페이지 | 2,000원 | 등록일 2014.11.26 | 수정일 2015.09.30

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[컴퓨터공학기초설계및실험1 예비레포트] 보수를 이용한 감산과 병렬 가감산기

가감산기)목적보수에 대해 이해하고, 보수를 이용한 감산을 안다. 이를 이용한 2진 병렬 가감산기와 BCD 병렬 가산기의 회로를 설계하여 실험한다. 실험한 회로의 동작이 올바른지 ... 컴퓨터 공학 기초 설계 및 실험1예비보고서실험제목:보수를 이용한 감산과 병렬 가감산기 (예비)실험일자:제출일자:예비보고서제목 및 목적제목보수를 이용한 감산과 병렬 가감산기(2진 ... 확인하는 데 목적을 둔다.원리(배경지식)컴퓨터 시스템의 논리회로 기능을 살펴보면 대수적인 뺄셈이 불가능하므로 보수를 이용한 덧셈 방법에 의하여 뺼셈을 수행하는 방법이 사용되고 있

리포트 | 3페이지 | 1,000원 | 등록일 2015.03.16

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SK하이닉스 합격 자기소개서

. 1지망. 공정통합 / 2지망. 설계 (근무지:이천)공정통합: 제조공정, R&D공정, TEST기술설계: 회로설계,SSD회로설계, 배치설계, CAE, System IC설계Q. 자발 ... 을 시도하기 위해 날카로운 자로 살짝 표시를 한 후에 기계에 케이블을 투입하였고, 정상품과 불량품을 비교해 보니 쉽게 구분할 수 있었습니다. 비록 2가지 방안을 모두 실험해야 하기 ... 학년 때는 기초적인 회로이론 및 논리회로, 반도체 이론 등을 수강해왔습니다. 그리고 관련 과목들의 프로젝트나 과제를 수행하면서 모르는 것이 생기면 포기하지 않고, 시간이 날 때

자기소개서 | 6페이지 | 3,000원 | 등록일 2018.08.18

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디지털로직실험/최신 디지털 공학 실험8 논리 회로 간소화

실험 8논리 회로 간소화실험목표▣ BCD 무효 코드 검출기에 대한 진리표 작성.▣ 카르노 맵(Karnaugh mpa)을 이용한 표현식의 간소화.▣ 간소화된 표현식을 구현하는 회로 ... 다. 이들 회로의 논리 표시기를 분석하고, 가장 가능성 있는 원인을 찾아 실험 보고서에 기술하여라실험 8 보고서이름 : 날짜 : 조 :실험 목표:BCD 무효 코드 검출기에 대한 ... 검출기에 대한 진리표 작성과 카르노 맵을 이용해 표현식을 간소화하고 간소화 된 표현식으로 회로를 구성하고 테스트해볼 수 있었다.A원B원표 8-2에는 실험 순서에 적힌대로 10개

리포트 | 24페이지 | 1,000원 | 등록일 2014.06.30

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서울시립대학교 전자전기컴퓨터설계실험2 제04주 Lab03 Pre

, Output -> LED 1에 할당되어 있으므로, Button Switch 1과 Button Switch 2를 동시에 눌렀을 때에만 LED 1에 불이 들어올 것임을 예상할 수 있다.[실험 ... .Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소. ... Pre-lab Report전자전기컴퓨터설계실험Ⅱ4주차. Verilog HDL실험 날짜2016. 9. 26학번이름Professor조교실험 소개실험 목적HDL(Hardware

리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04

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디지털실험 8 결과 실험 8. CMOS-TLL interface

.2V4.2V0의 회로를 구성하고, V _{DD}(핀 14번)를 +10[V]로 연결하고, 입력값에 따른 출력을 살펴보고, 또한 +5[V]로 연결하여 살펴보아라.실험 2의 회로이 ... 배로 올랐을 때 인식하는 값도 두 배로 오른 것을 볼 수 있다.2. 의 회로를 구성하고 실험 1과 같이 전압을 인가하여 각각의 진리표를 작성하라.실험 3의 회로이다. 저항을 바꿔 ... 시킨 후 전압 V _{out}을 측정하라.( R=1k OMEGA ,``2.2k OMEGA ,`4.7k OMEGA ,`10k OMEGA ,`470k OMEGA )실험 4의 회로이

리포트 | 9페이지 | 1,000원 | 등록일 2014.09.30

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02 논리회로설계실험 결과보고서(전,반가산기)

논리회로설계 실험 결과보고서 #2실험 2. 반가산기와 전가산기 설계1. 실험 목표VHDL을 이용하여 반가산기와 전가산기를 설계한다.각 게이트를 설계 할 때, 동작적 모델링과 자료 ... ) Schematic Design1) Design2) Wave Form3) 결과 분석Schematic Design으로 설계하는 방법은 모델링 방식과는 다르게 논리회로를 그려 설계한다. 방법은 다르 ... 흐름 모델링을 이용한다.또한 반가산기 설계 시, Schematic Design을 이용하여 설계해본다.2. 실험 결과실험 1. 반가산기(1) 동작적 모델링 / 자료흐름적 모델링1

리포트 | 9페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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[대충] 예비 순차논리회로 설계 및 구현(1)

디지털공학실험(예비보고서)실험 : 순차논리회로 설계 및 구현(1)1. 실험 목적가. 4상태를 가진 상태도(state diagram)를 회로로 구현하고 동작을 확인한다.나. T ... -플립플롭을 이용한 4비트 리플 카운터를 설계하고 구현한다.다. 최대 동작 주파수와 전달 지연(propagation delay)을 측정한다.2. 실험 이론가. 4상태를 가진 상태도 ... 전 비트가 ‘H’에서 ‘L’로 변화할 때만 반전한다. 이것은 정상적인 2진 계수의 순서와 동일하다.(따라서 별도의 외부 조합회로가 필요하지 않게 된다.) 특정비트가 ‘H’에서 ‘L

리포트 | 3페이지 | 1,000원 | 등록일 2015.01.17

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전자전기컴퓨터설계실험2(전전설2)6주차예비

Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 순차회로를 이해하고 순차회로 중 플립플롭 회로에 대해 이해한다.2. 배경 지식(Essential ... 논리회로 설계 실습을 위한 장치로 회로에서 많이 사용되는 Switch, LED와 같은 주변 장치를 위주로 구성하여 장비의 크기를 간단하게 만든 모델이다. 가장 큰 특징 ... 으로는 Breadboard를 가지고 있어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정

리포트 | 12페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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기본 게이트 설계 예비보고서

과 목 : 논리회로설계실험과 제 명 : 기본 게이트 설계담당교수 :담당조교 :학 과 : 전자전기공학과학 년 : 3학 번 :이 름 :제 출 일 : 2014. 3. 20논리회로설계 ... 유지되므로 추가되는 프로그램용 메모리가 필요없다.CPLD의 구조는 빠른 성능이나 정확한 타이밍 예측이 요구되는 어드레스 디코더나 시퀀스 회로 등에 적합하다.[그림 2] FPGA2 ... 실험 예비보고서 #1실험 1. 기본 게이트 설계1. 실험 목표AND, NOT, NAND, OR, XOR, NOR 게이트의 기호와 기본적인 동작 특성을 이해고, 실험을 통해 동작

리포트 | 7페이지 | 1,000원 | 등록일 2014.07.25

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Verilog HDL

& Basis of the assumption2. Materials & Methods (실험 장비 및 재료와 실험 방법)가. 실험을 통해 구하고자 하는 데이터와 이를 획득하기 위한 ... Pre-Lab Report- Title: Lab#03_Verilog HDL -담당 교수담당 조교실 험 일학 번이 름목 차1. Introduction (실험에 대한 소개 ... 실험 순서나. Materials (Equipment’s, Devices) of this Lab다. Matters that require attentions3. Supposed

리포트 | 57페이지 | 1,000원 | 등록일 2016.04.06

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논리회로실험- RAM (램) 결과보고서

하고 WE를 접지시킨다.d. 출력단 DO4-DO1에서 입력 데이터를 읽는다.e. ME와 WE를 +5V에 연결시킨다.이와 같은 실험과정에서 +2.5V보다 높으면 논리 “1”이고 +0 ... 실험 8. RAM 결과보고서1. 2-bit RAMWrite(bit0) Read (bit1)OUTPUTSENSE0SENSE1SENSE0SENSE1AB10011X01XX0X10101 ... X10XX1X0101X1XX01X00110X1XX10X1-실험 사진-실험에 대한 고찰첫 번째 실험은 두개의 RS래치를 이용한 2bit RAM을 구성하는 실험이었다.실험에서 우리

리포트 | 9페이지 | 1,000원 | 등록일 2008.02.25

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