"논리회로설계및실험"의 검색결과 입니다.

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전전설2 성결대 논리회로 실험12 멀티플렉서 4bitfulladder 두더지 잡기 plc제어

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"논리회로설계및실험" 검색결과 1,381-1,400 / 1,755건

[컴퓨터 공학 실험] 논리 및 연산회로{가산기(Adder),감산기(Subtractor),부호 변환기(Code converter)}

논리 및 연산회로 Xxx( 이름 ) xxx목 차 가산기 (Adder) 반가산기 (Half Adder) 전가산기 (Full Adder) 병렬 가산기 (Parallel Adder ... 로 나타내는 논리 회로 . S= A ⊕ B ⊕ Ci C0=AB+ACin+BCin가 -3) 병렬 가산기 (Parallel Adder) 와 직렬 가산기 (Serial Adder ... (Full Subtractor) 정의 세 개의 입력 단자와 두 개의 출력 단자를 갖고 , 입력 신호의 차와 빌림수를 출력 신호로 나타내는 논리 회로 . Bo=AB+BBin+BBin다

리포트 | 24페이지 | 1,000원 | 등록일 2009.03.25

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멀티플렉서(MUX)와 비교기(Comparator)설계

7주차 과제멀티플렉서(MUX)와 비교기(Comparator)설계1. 설계 배경 및 목표이번 7주차 실습은 멀티플렉서(Multiplexer)와 비교기(Comparator)를 설계 ... 하여 출력단과 연결하는 역할을 한다.S0S1F00I001I110I211I3S1I0I1I2I3FS04X1 MUX4X1 MUX 회로도4X1 MUX 구성4X1 MUX 진리표2. 관련 기술 및 ... 비교기 구성1-bit 비교기 진리표4-bit 비교기의 진리표3. 설계 내용 및 방법entity 선언 (입력이 I1, I2, s, 출력이 Iout)Behavioral 방식

리포트 | 13페이지 | 1,500원 | 등록일 2010.06.24

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디코더와 인코더

면 이와 같다그림 8x3 디코더 회로3. 실험방법가. 기기 및 부품- 74LS04, 74LS08, 74LS32, 74LS85, 74LS86, 74LS138, 74LS147, LED ... 9장 디코더와 인코더1. 실험목적가. 디코더와 인코더의 원리 및 구성방법을 익힌다.2. 관련이론가. 디코더와 인코더1) 디코더(Decoder)BCD 코드를 원래의 10진수로 변환 ... 도 하고 기호나 숫자를 코드화하는 것을 인코딩이라 한다. 예를들면 8x3 인코더를 설계하면 이 인코더는 입력이 8개이고 출력은 3개의 출력이 필요하다. 이 회로의 진리표를 작성하면 이

리포트 | 7페이지 | 1,000원 | 등록일 2009.05.31

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BCD TO 7 SEGMENT

한 Diagram 및 Simulation 결과 5. 실험을 위한 회로도 6. 실험결과 7. 시연사진 및 동영상(CD) 첨부1. 7-Segment 란?Display장치 디지털시계, 전자계산기 등 ... 회로도와 같이 동작을 하는 가에 대한 실험적 내용을 기술함. DC(동영상) 및 PPT 에 실험결과를 첨부.5. 실험을 위한 회로도6. 실험결과9876543210 ... . Max+plus II 10.2 를 이용한 Diagram (계속)Waveform Edit를 이용한 Simulation앞장과 같은 논리회로를 가진 집적회로는 BCD Code를 효과

리포트 | 22페이지 | 10,000원 | 등록일 2009.04.10 | 수정일 2017.07.16

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디지털논리회로실험 - 제 5장 기본연산회로

디지털회로실험예비 보고서(제 5장 기본 연산회로)학과학번성명1조컴퓨터공학과20040244김선습안현태안정민김성훈제 5장 기본 연산회로1. 실험 목적 및 기본 개념실험 목적: 연산 ... 회로의 기초가 되는 반가산기, 전가산기, 반감산기, 전감산기의 구성 및동작 특성을 실험을 통하여 이해하며 학습한다.2. 실험 과정, 회로도 및 타이밍 다이어그램그리고 예비실험 및 ... 000000000111110101111011010110010101010000110000011111113. 사용 기자재 및 부품? 논리 실험기? 오실로스코프 또는 디지털 멀티메터? 7408 (4조 2입력 AND Gate)? 7432 (4조 2입력 OR Gate

리포트 | 12페이지 | 1,500원 | 등록일 2008.11.28

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Verilog 및 Quartus II를 이용한 논리회로 설계 실습 3-예비,결과 보고서

view를 이용해 얻은 것이다.실험3 결과보고서?설계된 회로의 동작 및 설계 방법에 대하여 검토하고 토의 사항을 기술하시오.input (BCD 9의 보수)output (7-segment ... 해서 설계한 논리도를 바탕으로 7조의 회로도를 참고해서 작성했다.이 회로 설계에는 7404, 7408, 7411, 7427, 7432 총 11개의 IC를 사용했다. 실험중 ... 실험3 예비보고서① BCD 입력에 대한 9의 보수 생성기의 진리표를 작성하시오. 이 회로의 입출력 및 동작은 다음과 같다.A. 입력: 4 자리 BCD codeB. 출력:i. 입력

리포트 | 8페이지 | 1,000원 | 등록일 2009.01.25

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논리실험 (연산논리장치)

◈제목-연산 논리 장치◈목적1. 상용 연산논리장치의 기능을 이해한다.2. 상용화된 4비트 연산논리장치를 이용하여 두 수의 덧셈, 뺄셈 및 크기 비교를 실험함으로써 연산논리장치 ... 하는 부분을 별도로 설계하거나, 또 산술 오퍼레이션과 논리 오퍼레이션을 겸하여 수행할 수 있도록 설계한다.2. 산술 논리 장치 설계그림 9-23은 한 단계만으로 된 산술 연산 회로 ... 을 선택하고,=1이면 논리 회로의 출력이 선택된다. 이런 방식으로 결합하는 것이 ALU를 설계하는 최선의 방법은 아니다. 일반적으로 산술연산회로(Arithmetic circuit

리포트 | 3페이지 | 1,000원 | 등록일 2008.09.19

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7부울의 법칙 및 드모르간의 정리-예비보고서

7부울의 법칙 및드모르간의 정리■ 실험 목표이 실험에서는 다음 사항들에 대한 능력을 습득한다.● 실험을 통한 부울 대수의 규칙 증명● 부울 규칙 10과 11을 증명하는 회로 설계 ... 함을 기억하라.이번 실험에서 구성하는 회로에서는 CMOS 논리를 사용한다. IC에 정전기로 인한 손상이 발생하지 않도록 참고문헌(Floyd, Digital Fundamental, 8판 ... ● 실험을 통해 3-입력 변수의 회로들에 대한 진리표를 작성하고 드모르간의 정리를 이용하여 이들이 대수적으로 등가인가를 증명하기■ 사용 부품7071 quad 2-입력 OR 게이트

리포트 | 3페이지 | 1,000원 | 등록일 2008.11.16

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기본논리게이트 결과보고서

? 실험 제목 : 기본논리게이트? 목적 : 기본논리게이트인 NOT, AND, OR, NAND, NOR, XOR 게이트의 동작 특성 및 응용에 대하여 살펴본다.? 관련이론? AND ... ? 실험순서① 디지털 실험기관 위에 7408 AND 게이트를 이용하여 논리게이트 실험회로 (a)를 구성하고 데이터 스위치 SW₁과 SW₂를 각각 A, B에 연결하고, SW₁과 SW₂ ... , 7400 NAND 게이트, 7402 NOR 게이트, 7486 XOR 게이트를 이용하여 논리게이트 실험회로 (b), (c), (d), (e)를 구성하고 절차 (l)을 반복하여 표

리포트 | 12페이지 | 1,000원 | 등록일 2009.09.21

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Verilog 및 Quartus II를 이용한 논리회로 설계 실습 5-예비,결과 보고서

듯이 simulation결과에는 아무 이상이 없었음을 알 수 있다.이전까지의 실험, 즉 실험4까지는 조합논리회로를 설계하는 실험이었다. 하지만 이번 실험5부터는 순서논리회로를 설계하는 실험이었다. ... 실험5 예비보고서1) NAND gate를 이용하여 S-R latch를 구현하고, 이를 이용하여 D latch 및 master-slave D F/F을 구현하시오.SRQQ ... 조건과 부합하는 회로임을 알 수 있다.4) D F/F을 이용하여 synchronous parallel load 기능이 있는 4-bit shift register를 설계하시오.이 s

리포트 | 13페이지 | 1,000원 | 등록일 2009.01.25

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2010하반기 하이닉스 이공계(서류합격 자소서)

에 대해 이해하였으며, 이를 바탕으로 팀프로젝트를 진행하며, 반도체 설계에 대해 한층 더 깊이있는 이해를 하였습니다.그리고, 논리회로실험과, 전자회로실험을 통하여, 반도체의 원리가 되 ... 는 이론에 대해 실험을 통하여 확인하며, 이해의 깊이를 강화하였습니다.[통신 및 네트워크]통신과 네트워크 관련 수업을 수강하며, Matlab을 이용하여 노이즈 제거하고, 수신기 ... 를 설계하였으며, 뿐만 아니라 TCP/IP정보를 인식하는 프로그램을 설계 제작하였습니다. 이러한 프로젝트를 통해 통신 및 네트워크에 대해 깊이있게 이해할 수 있었습니다.이러한 다양

자기소개서 | 2페이지 | 3,000원 | 등록일 2010.12.17 | 수정일 2022.02.20

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디지털전자실험 - counter 회로

ounter)논리상태 확인용 : LED, FND실험 3-1 4-bit 비동기식 업 카운터 회로회로도설치방법위의 그림과 같이 4개의 J-K 플립플롭(2개의 7476)을 이용하여 4 ... 은 꼭서 Q0~Q3의 논리 상태를 측정하여 결과를 기입한다.위 실험 3-1와 거의 비슷한 회로를 구성하며 한 가지 틀린 점은 CLR 쪽에 Q1 과 Q3 를 NAND 하여 CLR 쪽 ... 디지털회로 실험 결과 보고서목적Flip-Flop 을 이용한 동기식(synchronous)카운터와 비동기식(asynchronous)카운터[=리플(ripple)카운터] 회로를 구성

리포트 | 12페이지 | 2,000원 | 등록일 2009.01.30

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산술연산논리회로

예비보고서실 험 주 제 :실험5. 산술연산 논리회로과 목 :디지털회로실험학 번 :분 반 :이 름 :1.실험 제목산술논리연산회로(ALU)2.관련이론산술논리연산장치(ALU ... 부분에 대한 설계가 먼저 이루어져야 하며, 그 다음에 논리연산 부분에 대한 설계가 이루어지고 마지막으로 산술연산 부분이 산술 및 논리 연산을 모두 수행할 수 있도록 수정 ... 되어야 한다.ALU는 앞서 설명한 산술연산회로와 논리연산회로를 조합하여 서로 간섭이 발생하지 않도록 제어회로를 설계하는 것이 중요한다. FA를 사용한 2-bit ALU를 병렬로 연결

리포트 | 5페이지 | 1,000원 | 등록일 2008.09.20

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44장 예비레포트 2진 가산과 전가산기

(Exclusice-OR) 게이트의 특성을 이해한다.3. IC 논리블록을 사용하여 전가산기를 구성한다.[실험 장비 및 재료]? 전원 공급 : 가변 직류 저전압? 장비 : 디지털멀티미터? 저항 ... 개[기초이론](1)2진 가산기산술회로는 2진수나 2진 코드화된 10진수로 더하기, 빼기, 곱하기, 나누기 같은 산술기능을 수행하는 조합회로이다. 우리는 계층적 설계를 통해 산술회로 ... 기라고 하며, 세 비트의 합을 수행하는 회로를 전가산기라고 한다. 반가산기 2개로 전가산기의 기능을 수행할 수 있다. 반가산기와 전가산기는 다른 산술회로를 설계하는 데 기본이 되

리포트 | 8페이지 | 1,000원 | 등록일 2009.11.29

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디지털 시스템 및 실험-Experiment 6

과 목 : 디지털 시스템 및 실험-Experiment 6목적? 조합 논리회로의 예로서 멀티플렉서와 디멀티플렉서의 동작 원리 및 특성을 확인한다.결과(1) 4-to-1 멀티플렉서 ... (예: 선풍기의 바람 세기를 멀티플렉서를 활용하여 강, 중, 약 3단계로 조절하는 회로를 설계해보는 실험등) 에 대한 실험도 해 볼수 있는 기회가 있었으면 한다. ... . 첫 실험이 멀티플렉서를 확인해보는 실험이었고 두 번째 실험이 디멀티플렉서를 확인해보는 실험이었다. 마지막 실험이 멀티플렉서와 디멀티플렉서를 중첩 이용한 회로로서, 회로구성에 약간

리포트 | 3페이지 | 1,000원 | 등록일 2009.06.29

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예비02_CMOS 회로의 전기적 특성

한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 10.09.13 (월)과목명: 논리회로실험조교명: 유창승분 반: 월F학 ... 의 전기적 특성을 이해하고 실험을 통해 동작을 확인한다.II. 이론 및 유의사항(a) CMOS inverter◆ CMOS inverter와 BJT inverter의 차이점CMOS ... inverter는 PMOS와 NMOS 각각 한 개씩으로 구성되어 있으며, 실제 설계 및 simulation 시 High & Low의 출력 특성이 명확하게 나타난다. 즉, 출력 값

리포트 | 5페이지 | 2,500원 | 등록일 2010.10.19

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주파수응답 및 필터의 이해

주파수응답 및 필터의 이해1. 실험 목적1) 주파수 응답 및 필터에 대한 이론을 학습한다.2) PSIM(소프트웨어)의 사용법을 익힌다.3) 고주파 통과 필터(HPF : High ... (PULL) : TTL/CMOS 논리회로의 입력파형으로 고정논리레벨을 갖는 파형을 인가할 때 사용하는 조절 스위치. 푸쉬/풀에 따라TTL/CMOS 모드 선택된다. ? TTL/CMOS ... 필터실험① 저항과 캐패시터를 이용하여 고역통과 필터를 구성하고, 주파수 응답을 측정한다. 필터는 입력 신호의 주파수에 따라 그 응답이 달라지므로 여러 주파수를 회로에 인가하여 크기

리포트 | 12페이지 | 1,000원 | 등록일 2010.12.22

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[논리회로실험] 가산기와 감산기 (예비)

의 특징과 논리회로 설계 방식을 설명하시오. 또한 이 두 방법을 이용하여 4-bit serial adder와 4-bit parallel adder를 각각 구성하시오.(1) 병렬가산기 ... 1. 실험목표1) Logic gates를 이용하여 가산기와 감산기를 구성하여 동작을 확인한다.2) 위를 바탕으로 디지털 시스템의 기본 요소인 가산기와 감산기의 기본 구조 및 동작 ... 원리를 이해한다.2. 실험 장비 및 부품1) 5V DC 전압원2) IC : 74HC00, 74HC04, 74HC08, 74HC74, 74HC86, 74HC164, 74HC1943

리포트 | 11페이지 | 1,500원 | 등록일 2009.03.20

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18 단안정 및 비안정 멀티바이브레이터예비결과보고서 디지털공학실험

트리거 논리●비안정 멀티바이브레이터로 구성된 555 타이머의 듀티-사이클 및 주파수 측정●555 타이머를 이용한 비안정 멀티바이브레이터 설계 및 시험■사용부품74121 단안정 멀티 ... 와 전류 제한용으로 저항 330Ω을 사용하라.펄스폭이 설계 내용과 대략 같은지를 검사하라. 보고서에 회로를 그려 넣고 실험 결과를 기술하라.이번 실험 결과 예상표18-1 74121 단 ... 18 단안정 및 비 안정 멀티바이브레이터■ 실험목표이 실험에서는 다음 사항들에 대한 능력을 습득한다.●특정 펄스와 트리거 모드 발생을 위한 74121 one-shot 구성 및

리포트 | 12페이지 | 1,000원 | 등록일 2008.11.16

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디지털논리회로실습 - 제 7장 디코더 인코더

, 회로도 및 타이밍 다이어그램그리고 예비실험 및 조사2.1 디코더(Decoder) ( n X 2ⁿ)디코더는 2진 코드(n Bit) 형태의 입력을 받아들여 우리가 일상적으로 사용 ... 8단자, 출력 3단자 인코더가 있다. 여기서 주의할 사항은 여러 개의 입력 중에서 2개 이상의 입력이 동시에 인가될 수 없다는 것이다. 인코더 설계는 조합논리회로 설계과정과 동일 ... 으로 표현함.A = D2 + D3B = D1 + D3위에서 구한 출력변수에 대한 논리식을 근거로 [그림 A]와 같은 논리회로도 설계.[그림 A] 4X2 인코더A B C DA (MSB

리포트 | 23페이지 | 2,000원 | 등록일 2008.12.08

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