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verilog 논리회로 설계 vhdl FPGA 게임 실험12 멀티플렉서 stopwatch 설계
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"논리회로설계" 검색결과 1,381-1,400 / 4,392건

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    실험6-산술논리연산회로-예비레포트
    (뺄셈)110모두 1F = A-1111모두 1F=A(산술연산회로의 기능)논리연산회로 설계s1s0출력기능00OR 연산01XOR 연산10AND 연산11NOT 연산(1bit 논리연산 ... 회로) (논리연산회로의 기능)산술논리연산회로아래는 2bit ALU 회로이고 이를 병렬로 연결하면 임의의 bit에 대한 ALU를 설계할 수 있다. 모드 및 기능 선택 입력에 따른 ... 실험 6. 산술논리연산회로목차 TOC \o "1-3" \h \z \u Hyperlink \l "_Toc401081084" 1실험 목적 PAGEREF _Toc401081084 \h
    리포트 | 14페이지 | 1,000원 | 등록일 2017.03.07
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    논리 회로 실험 과제 (4장)
    논리 회로 실험 과제 (01-class)실험 4 : 가산기와 감산기?담 당 교 수 :?과 목 명 : 논리회로 및 실험?학 과 :?학번 / 이름 :?제 출 일 :1. 실험목적 ... 과 다르게 확실히 어려워 진 것을 느꼈다. 일부 실험은 머리가 아플 정도로 복잡하게 회로가 설계되어졌다. 특히 마지막 실험이었던 병렬가감산기 회로의 경우 다 만들고 출력 값을 보는데 ... 하는 방법으로 실험을 진행하였다. 비교적 복잡한 회로를 구성해야 했기에 동시에 회로를 구성하면 오히려 혼돈될 수 있다는 판단이었다. 그렇게 한명은 회로를 설계하고 다른 한명은 결과를 미리
    리포트 | 6페이지 | 5,000원 | 등록일 2016.04.09
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    JK,D,T 플립플롭
    하도록 하는 회로(slave)로 주인과 종의 관계이다. 다음 그림은 입력단의 플립플롭은 클럭의 상승 엣지에서 동작하고 슬레이브는 하강 엣지에서 동작하도록 구성된 그림이다.[2] D ... 플립플롭플립플롭은 저장장치로서 1비트 논리의 처리 및 저장이 가능하므로 입력신호는 2단자를 갖지 않아도 된다.RS 플립플롭이나 JK 플립플롭은 2개의 입력단자이므로 이를 하나의 입력 ... 된 입력 신호에 따라 출력 신호가 반전되는 플립플롭을 말한다.④ JK 플립플롭을 이용한 T 플립플롭3. 실험[기초실험(1)] 다음 회로에서 실험을 통하여 진리표를 완성하고 타이밍도
    리포트 | 8페이지 | 1,000원 | 등록일 2019.06.21
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    논리 회로 실험 과제 (‘7-세그먼트’를 이용한 실험)
    논리 회로 실험 과제 (01-class)‘7-세그먼트’를 이용한 실험담 당 교 수 :과 목 명 : 논리회로 및 실험학 과 :학번 / 이름 :제 출 일 :실험목적- 7-세그먼트 ... ), 그리고 7-세그먼트를 이용하여 입력 값을 변화하여 ‘LOGIC’문자를 찍는 회로를 설계한다. 단, 주의할점은 7-세그먼트는 1이 아닌 0의 값을 ON으로 출력하기 하기 때문에 0
    리포트 | 3페이지 | 5,000원 | 등록일 2016.05.25
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    실험 2. CMOS 회로의 전기적 특성 예비보고서
    하는데 최선을 다할 것을 서약합니다. 학 과: 전자공학과제출일: 2017년 10월 16일과목명: 논리 회로 실험교수명: 이해영 교수님학 번: 201320767 201520735성 명 ... . 윤리의식과 문화적 소양을 갖춘 정보통신인전자공학 프로그램 교육목표1. 공학 기초지식과 전문지식을 활용하여 전자공학의 시스템, 부품, 공정, 방법을 분석하고 설계하는 능력을 기른다.2 ... : 김경수 김지승실험 2. CMOS 회로의 전기적 특성1. 실험목적멀티플렉서(Multiplexer)와 디멀티플렉서(Demultiplexer)의 원리를 이해하고 실험을 통해 동작
    리포트 | 12페이지 | 1,000원 | 등록일 2017.12.07
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    논리 회로 실험 과제 (1~2장)
    논리 회로 실험 과제 (01-class)1. 기본 논리게이트2. 불 대수와 드모르간의 정리?담 당 교 수 :?과 목 명 : 논리회로 및 실험?학 과 :?학번 / 이름 :?제 출 ... 고 레벨(High, Low, 하이 임피던스) 중 하나를 갖는 논리소자이다. 제어단자 E(또는 )는 입력단자 D와 출력단자 O 사이의 회로를 개폐하는 역할을 한다. 위 예제에서는 이 ... 었다.회로를 설계하고 실험하기에 앞서, 조원과 미리 계산을 해서 각자의 결과를 비교해 보고, 서로의 결과가 일치하면 실험 후 실제 결과와 비교하며 다음 실험을 진행하였다. 대부분
    리포트 | 9페이지 | 5,000원 | 등록일 2016.04.09 | 수정일 2016.04.14
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    결과보고서 #2- 반가산기, 전가산기 설계
    과 목 : 논리회로설계실험과 제 명 : #1 기본게이트 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A ... 반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 3. 25논리회로설계 실험 결과보고서 #2실험 2. 반가산기, 전가산기 ... 설계1. 실험 목표반가산기와 전가산기의 기본 원리에 대해 이해하고, 이를 통하여 논리회로의 구성 능력을 키운다. Xilinx ISE 를 통해 4가지 방법(동작적, 자료흐름, 구조
    리포트 | 6페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    결과보고서 #9 - 순차회로 설계
    과 목 : 논리회로설계실험과 제 명 : #9 순차회로 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A반 ... 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 5. 6논리회로설계 실험 결과보고서 #9실험 9.순차회로 설계1. 실험 ... 목표순차회로인 카운터에 대해 동작 방식과 구조를 이해하고, 카운터의 종류와 특징에 대해 이해한다. 주어진 회로가 어떤 회로인지 찾아낼 수 있고, XilinX ISE를 통해 직접 설계
    리포트 | 6페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    결과보고서 #10 - 순차회로 설계 (FSM)
    과 목 : 논리회로설계실험과 제 명 : #10 순차회로 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A ... 반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 5. 13논리회로설계 실험 결과보고서 #10실험 10.순차회로 설계 ... (FSM)1. 실험 목표순차회로의 일종인 FSM의 일종인 밀리머신과 무어머신의 개념을 이해하고 이를 이용해 실생활에서 쓰이는 자판기를 VHDL 코드를 이용하여 설계해볼 수 있다.2
    리포트 | 6페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    결과보고서 #1 - 기본 게이트 설계
    과 목 : 논리회로설계실험과 제 명 : #1 기본게이트 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A ... 반 4조학 번 : 2011311307, 2011이 름 : 김영관, 김윤섭제 출 일 : 2015. 3. 18논리회로설계 실험 결과보고서 #1실험 1. 기본 게이트 설계1. 실험 목표 ... 로 주어진 Mission 설계를 해보면서 우리가 예전에 논리회로 시간에 배웠던 카노맵이 얼마나 다양하게 쓰일 수 있는지 알게 되었고 어떠한 진리표가 나오건 VHDL을 이용해 하드웨어
    리포트 | 9페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    결과보고서 #8
    과 목 : 논리회로설계실험과 제 명 : #8 순차회로 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A반 ... 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 4. 29논리회로설계 실험 결과보고서 #8실험 8.순차회로 설계1. 실험 ... 목표순차회로에 대한 기본개념을 이해하고 조합회로와의 차이점을 이해할 수 있다. 또한 순차회로 중레지스터에 대해 이해하고 많은 기능들이 있는 범용 레지스터를 VHDL을 이용해 설계
    리포트 | 5페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    결과보고서 #3
    과 목 : 논리회로설계실험과 제 명 : #3 병렬가산기 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A ... 반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 4. 1논리회로설계 실험 결과보고서 #3실험 3. 병렬 가산기 설계1 ... . 실험 목표기존에 배웠던 전가산기를 이용하여 4bit, 8bit의 병렬가산기를 Xilinx ISE를 이용해 여러 가지 방식(동작적,자료흐름,스키마틱)으로 설계하고 이를 이용해 원
    리포트 | 9페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    결과보고서 #11 - RoV Lab3000 실습
    과 목 : 논리회로설계실험과 제 명 : #11 RoV_Lab3000 실습(결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 ... & 조 : A반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 5. 20논리회로설계 실험 결과보고서 #11실험 11. RoV
    리포트 | 8페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    결과보고서 #12 - RoV Lab3000 실습
    과 목 : 논리회로설계실험과 제 명 : #12 RoV_Lab3000 실습(결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 ... & 조 : A반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 5. 27논리회로설계 실험 결과보고서 #12실험 12. RoV
    리포트 | 7페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    결과보고서 #4 - 디코더, 엔코더 설계
    과 목 : 논리회로설계실험과 제 명 : #4 디코더, 엔코더 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 ... : A반 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 04. 08논리회로설계 실험 결과보고서 #4실험 1. 디코더, 엔 ... 코더 설계1. 실험 목표디코더와 인코더를 응용하여 오류정정 코드중에 하나인 해밍코드 인코더와 디코더를 설계하고 시뮬레이션을 통해 확인한다.2. 실험 결과실험 1. 해밍코드 인코더1
    리포트 | 6페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    논리회로(7-Segment) Term
    7-Segment 설계1. 서론 ( 설계 개요 )이 설계의 목적은 7-segment의 구조 및 동작 개념을 이해하고 segment의 구동 및 사용법을 확인 후 논리회로에 대한 ... 까지 배워 온 논리회로 지식과 실험 지식을 통해 Term Project를 무사히 마무리 지을 수 있었다. 납땜하는 과정에서 여러 실수가 있었다. 첫 번째로 소켓에 칩을 끼워 놓은 상태 ... 의 피복을 너무 적게 벗겨내자 자주 떨어져 나가버린 것이다. 만약 핀들이 서로 멀리 떨어져 있었다면 단번에 회로를 설계했으리라 생각된다.
    리포트 | 6페이지 | 1,500원 | 등록일 2012.02.09
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    결과보고서 #5
    과 목 : 논리회로설계실험과 제 명 : #5 조합회로 설계 (결과)담당교수 : 국태용 교수님담당조교 : 김태경 이희준 조교님학 과 : 전자전기공학과학 년 : 3반 & 조 : A반 ... 4조학 번 : 2011311307, 2011314184이 름 : 김영관, 김윤섭제 출 일 : 2015. 4. 15논리회로설계 실험 결과보고서 #5실험 5.조합회로 설계1. 실험 ... 목표멀티플렉서와 산술 논리 연산 장치의 기본개념에 대해 이해한다. 이것들을 VHDL의 Subprogram 문법인 function과 procedure를 이용해 설계할 수 있
    리포트 | 7페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28
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    FPGA 트레이닝키트 사용 (결과보고서)
    으로는 논리 블록이라고도 함)에 간단한 플립플롭이나 더 완벽한 메모리 블록으로 된 메모리 요소를 포함하고 있다.프로그램이 가능한 내부선 계층구조는 FPGA의 논리블록을 시스템 설계자 ... 가 요구하는 대로 단일 칩 프로그래밍가능 빵판처럼 내부연결을 할 수 있다. 이 논리블록과 내부선은 제조공정 이후에 소비자/설계자가 프로그램할 수 있으므로 요구되는 어떠한 논리기능 ... 있다. 이런 설계개발은 일반적인 FPGA에서 만들었고 좀 더 ASIC와 비슷한 고정된 버전으로 변경되었다. 복합 프로그래머블 논리 소자 (CPLD)는 비슷한 역할을 할 수 있
    리포트 | 8페이지 | 1,000원 | 등록일 2015.08.25
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    [졸업, 취업]포트폴리오 템플릿 - 글자만 바꾸면됨 A+ !
    동작해야 할 것인가에 대한 논리를 구성하였습니다 . 작품 난이도 프로그램 기구제작 전기회로 결론 및 후기 처음으로 동아리 프로젝트를 진행하면서 , 팀원 간의 의사소통이 중요한 걸 ... 설계 , 그리고 전기 / 전력전자에 대한 지식을 두루 습득해야만 합니다 . 저는 전공동아리에서 팀프로젝트 활동을 하면서 위 세가지 파트 ( 프로그램 , 기구설계 , 전기 / 전력전자 ... ) 중에 전기 / 전력전자 파트를 중점적으로 맡아서 하였습니다 . 특히 , 여러가지 센서들의 회로를 구성해주고 출력되는 전압값들의 변화를 측정하여 작품이 정상적으로 동작 할 수
    ppt테마 | 23페이지 | 3,000원 | 등록일 2018.11.13 | 수정일 2022.07.04
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    디지털시계 Term Project
    디지털논리회로실험 Term Project디지털 시계전자공학과금요일 5조- 목 차-1.개 요2.Block diagram3.회로 및 Simulation 결과4.제작 결과 및 검토사항 ... 5.후 기6.참고문헌(1) 개요2005년 디지털 논리회로실험 Term Project의 주제를 디지털 시계로 정했다. 이 디지털 시계를 구현하기 위해 이번학기 실험에 사용한 한백전자 ... 를 위한 FPGA를 설계하는데 있어서 1)CLOCK을 통해 시간을 재는 Counter(74161 symbol 활용)부분과 2)이 Counter의 신호를 받아 7 segment 신호
    리포트 | 4페이지 | 1,000원 | 등록일 2013.01.02 | 수정일 2019.05.01
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