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디지털논리회로 인하대 verilog 텀프로젝트 회로 디지털집적회로 and or not 게이트 디지털공학개론

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방송통신대 - 2025 방송통신대 리포트 및 과제물 업데이트, 중간고사/기말고사자료
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"디지털논리회로" 검색결과 101-120 / 4,233건

  • 자료 표지
    [디지털논리회로] 2장 연습문제 풀이 (생능출판, 김종현)
    리포트 | 8페이지 | 1,000원 | 등록일 2023.06.27
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  • 자료 표지
    [디지털논리회로] 4장 연습문제 풀이 (생능출판, 김종현)
    리포트 | 7페이지 | 1,000원 | 등록일 2023.06.27
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  • 자료 표지
    디지털 논리회로 Xilinx와 key, dot matrix를 활용한 패턴 저장, 표출
    디지털 논리회로 실험 학기말 프로젝트1. 설계 목적학기 중에 다룬 기본기술(combinational circuits, sequential circuits, shift ... 위한 회로를 설계한다.Step4 설계 : Dot matrix 를 이용하여 임의의 pattern 을 편집/표시할 수 있는 기능을 구현. Key matrix 에 상/하/좌/우/선택/취소 ... dot matrix 이다.회로를 구성하기 앞서서 먼저 4x4 key matrix 에 대한 이해가 필수적이다.Figure . SEQ Figure \* ARABIC 1Key matrix
    리포트 | 17페이지 | 2,000원 | 등록일 2020.12.03
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  • 판매자 표지 자료 표지
    디지털 논리회로 - 이론 및 실험 (생능출판), 6장 연습문제
    시험자료 | 14페이지 | 2,500원 | 등록일 2025.01.09 | 수정일 2025.01.11
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    아날로그 및 디지털회로설계실습 9 부울대수 및 조합논리회로 과제
    4-bit Adder 회로 설계 과제1. 다음의 진리표를 보고 입력 x, y, z와 출력 f를 Karnaugh맵을 이용하여 간소화하여 부울 대수식으로 표현하시오.입력출력xyzF ... HC86 XOR gate의 Vcc와 GND가 몇 번 pin인지 쓰시오.Vcc는 14번 pin이고 GND는 7번 pin 이다.3. XOR gate를 이용한 Full Adder 회로를 Pspice를 사용하여 직접 설계하시오.
    리포트 | 2페이지 | 1,000원 | 등록일 2021.09.02
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  • 자료 표지
    서강대학교 디지털논리회로실험 3주차 - Decoders and Encoders
    는 Cmod S6에 내장된 버튼을 PlanAhead에서 FPGA의 핀에 할당할 때 Pull Type을 잘못 설정한 채 알아차리지 못하고 있었기 때문이다. 이 간단 하지만 큰 실수를 통해 회로 실험에서는 하나하나 꼼꼼히 실험 환경을 준비해야 한다는 것 을 알 수 있었다.
    리포트 | 16페이지 | 1,500원 | 등록일 2024.08.17
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  • 판매자 표지 자료 표지
    홍익대_디지털논리회로실험_3주차 예비보고서_A+
    디지털 논리실험 및 설계 3주차 예비보고서실험 준비1.1 기본 실험 (1)의 회로가 2-bit 복호기인 이유를 설명하시오.기본 실험 (1)의 회로는 입력 A,B를 받아 Y0, Y ... 으로 들어오는 데이터를 받아 그것을 숫자로 보고 2의 n제곱 개의 출력 회선 중 그 숫자에 해당되는 번호에만 1을 내보내고 나머지는 모두 0을 내보내는 논리 회로. 위 회로는 복호기 ... 1, Y2, Y3 4개의 결과값을 출력하는 회로이다.Y0, Y1, Y2, Y3를 출력으로 하는 AND 게이트의 입력값은 순서대로 (), (A,이다. 이 회로의 진리표는 다음과 같
    리포트 | 6페이지 | 1,500원 | 등록일 2024.05.15
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  • 판매자 표지 자료 표지
    홍익대_디지털논리회로실험_9주차 예비보고서_A+
    디지털 논리실험 및 설계 9주차 예비보고서실험 준비1.1 8-bit Serial-in Parallel-out Shift Register 74164의 datasheet를 확인 ... 으로 출력이 바뀐다.1.3 응용실험 (2)에서 초기화 하는 과정을 자세히 서술하시오.응용실험 (2)의 회로는 D Flip-flop 4개를 이용하여 만든 링 카운터이다. 초기조건이 Q ... 다. 이전의 Q0는 Q1에 출력된다. Q1, Q2는 각각 Q2, Q3에 출력된다.2.2 기본실험 (2)기본실험(1)에서 만든 회로의 원리대로 8개의 D Flip-flop을 이어
    리포트 | 6페이지 | 1,500원 | 등록일 2024.05.15
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    홍익대_디지털논리회로실험_7주차 예비보고서_A+
    디지털 논리실험 및 설계 7주차 예비보고서실험 준비1.1 S-R Latch와 - Latch의 동작에 대해 설명하시오.Latch란 1비트의 정보를 저장할 수 있는 회로이다. S ... 이 여러 번 된 것으로 간주되어 결과가 나타난다.실험 결과2.1 기본실험 (1)모두 0일 때 둘 다 1이 출력되지만 이것은 위 회로에선 invaild하다고 할 수 있다.= (0
    리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15
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    홍익대_디지털논리회로실험_6주차 예비보고서_A+
    디지털 논리실험 및 설계 6주차 예비보고서실험 준비1.1 ALU 74181의 datasheet을 읽고 네 자리 이진수의 덧셈을 74181을 이용하여 어떻게 구현할 수 있는지 설명
    리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15
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  • 판매자 표지 자료 표지
    홍익대_디지털논리회로실험_4주차 예비보고서_A+
    디지털 논리실험 및 설계 4주차 예비보고서실험 준비1.1 멀티플렉서와 부호기(encoder)의 차이를 설명하시오.멀티플렉서는 여러가지의 입력 가운데 하나를 골라 그대로 출력하지 ... 되는 것이다. 이를 표로 정리하면 다음과 같다.1.6 응용 실험 (2)가 4-to-1 멀티플렉서로 동작하는 원리를 자세히 서술하시오.응용 실험(2) 회로에는 3-INPUT AND ... 1일 때 D3 값이 출력되는 것을 볼 수 있다.이 회로의 진리표는 다음과 같다.기본 실험(1)과 같은 것을 볼 수 있다.
    리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15
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  • 판매자 표지 자료 표지
    홍익대_디지털논리회로실험_2주차 예비보고서_A+
    디지털 논리실험 및 설계 2주차 예비보고서실험 준비1.1 NAND 7400 게이트, NOR 7402 게이트, XOR 7486 게이트의 datasheet를 확인하시오.7402 ... NOR 게이트는 지금까지의 게이트와는 다르게 1번 pin이 output이기 때문에 유의할 필요가 있다.1.2 기본 실험 (4)의 회로를 구현하시오.1.3 응용 실험 (1), (2 ... ), (3)의 회로를 구현하시오.응용 실험(1)응용 실험(2)응용 실험(3)1.4 응용 실험 (3)의 결과를 예상하고 이유를 서술하시오.= (A+B)(A+C) [∵드모르간 법칙]= AA
    리포트 | 6페이지 | 1,500원 | 등록일 2024.05.15
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    홍익대_디지털논리회로실험_8주차 예비보고서_A+
    디지털 논리실험 및 설계 8주차 예비보고서실험 준비1.1 Gated D Latch의 동작에 대해 설명하시오.Gated S-R Latch와 매우 유사하다. S와 R에 1이 동시 ... 에 CLK의 값이 0에서 1로 변하는 순간에만 Q의 출력이 변할 수 있다.1.5 응용실험 (1)과 응용실험 (2)의 회로를 비교하시오.응용실험 (1)의 회로는 D Flip-flop ... 에 연결된 스위치가 올라갈 때에만 출력 값이 변할 수 있다.응용실험 (2)의 회로를 보면 D의 입력이 이다. 는 Q가 토글된 값이다. 즉 Q가 1이면 =0이고 Q가 0이면 =1이
    리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15
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    홍익대_디지털논리회로실험_5주차 예비보고서_A+
    디지털 논리실험 및 설계 5주차 예비보고서실험 준비1.1 4.1 기본 실험 (2)의 전가산기 [그림 2]는 반가산기 [그림 1] 두 개와 하나의 OR 게이트로 이루어져 있 ... 다. [그림 2]의 회로가 전가산기로 동작하는 원리를 설명하시오.전가산기는 입력 3개를 받아 2개의 결과를 출력한다. 이때 입력에는 자리올림수가 포함되어있다고 생각할 수 있다. 전가산기 ... 를 ∑ = (A⊕B으로 구현했다.1.2 응용 실험 (1), (2)의 회로를 구현하시오.응용실험(1)전가산기를 두개 이용하여 두 자리 이진수 덧셈기를 구현했다. 이때 두번째 전가산기
    리포트 | 5페이지 | 1,500원 | 등록일 2024.05.15
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  • 자료 표지
    디지털 논리회로의 응용 D/A, A/D Converter/반도체 기억장치
    Exp#9. 디지털 논리회로의 응용 – D/A, A/D Converter/반도체 기억장치메인 레포트실험 목표디지털-아날로그 변환기와 아날로그-디지털 변환기에 대해 이해할 수 있 ... 다.디지털 논리 소자를 이용하여 간단한 반도체 기억장치를 구성하여 그 원리를 이해할 수 있다.실험 이론디지털 아날로그 변환기 (D/A converter)디지털 아날로그 변환기 ... 2-(d)0010과 0001의 경우는 각각 그림 2-(c), (d)와 같게된다. 이 경우도 각각의 회로를 테브냉 등가를 이용해서 계산하면 출력값이 나오게 된다.아날로그 디지털
    리포트 | 11페이지 | 1,000원 | 등록일 2022.03.03
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  • 자료 표지
    디지털 논리회로 실험 2주차 기본 논리 게이트 (NAND, NOR, XOR Gate) 결과보고서
    디지털 논리회로 설계 및 실험결과보고서주제 : NAND, NOR, XOR GATE 및 응용소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자 ... 실험ABX001011101110(1) [그림 1]과 같이 회로를 결선한 후 NAND 게이트의 진리표를 그려보시오.[그림 1]이번 실험은 NAND 게이트의 특성을 알아보는 실험이 ... 다. 회로의 VCC와 GND를 연결하고 스위치 1번과 핀 1번을 점퍼선으로 연결한다. (입력값 A) 스위치 2번과 핀 2번을 역시 점퍼선으로 연결한다. (입력값 B) 핀 3번과 LED
    리포트 | 11페이지 | 2,000원 | 등록일 2022.04.21
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  • 자료 표지
    서강대학교 디지털논리회로실험 5주차 결과보고서
    다. Subtractor(감산회로)는 어떤 수의 2’s complement를 더함으로 구현하거나 subtractor의 구현을 통해 수행할 수 있다.ALUs(연산회로)는 여러 연산 및 논리 ... 1. 실험목적1) Exclusive-OR회로를 이용한 비교회로의 구현 및 동작원리 이해2) 기본 gate를 이용한 half-adder 및 full-adder의 구현 및 동작원리 ... 이해-ISE를 이용한 symbol library 생성 및 활용3) 연산회로의 동작 및 signed/unsigned numbers에 대한 이해2. 배경이론 및 실험방법비교회로
    리포트 | 13페이지 | 1,000원 | 등록일 2021.10.02
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    서강대학교 디지털논리회로실험 10주차 결과보고서
    1. 실험목적1) Digital-to-analog 변환(DAC)- Digital 신호를 analog 신호로 반환하는 회로의 동작 원리를 이해한다.- DAC IC(DAC0808 ... )의 구동 방법을 배운다.2) Analog-to-digital 변환(ADC)- Analog 신호를 digital 신호로 변환하는 회로의 동작원리를 이해한다.- ADC IC(ADC ... 를 나타낼 수 있는데, 회로는 다음과 같다.이 회로는 R과 2R의 크기를 갖는 저항들을 사다리형태로 배열하고 입력되는 4-bit 디지털 데이터는 해당 bit의 스위치를 연결하거나 여
    리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02
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    서강대학교 디지털논리회로실험 3주차 결과보고서
    을 최대한 묶어서 표현하여 최소화 나타낸다. Decoder는 하나의 code체계를 다른 code 체계로 변환하는 논리회로이다. 일반적으로 입력이 출력보다 적고, enable신호 ... 한다.4) 표시장치(display devices)의 동작원리를 이해한다.2. 배경이론 및 실험방법회로를 수식으로 나타낼 때 직접적으로 최소화하는 것은 비효율적이다. 더 효율적인 방법 ... 를 할당해 놓는다.실험은 주어진 회로를 브래드보드에 나타낸 후 스위치에 따라 LED의 변화를 살펴본 후, 이를 통해 Binary decoder의 기능에 대해 알아본다. 그 후 Combinational 회로 설계 단계에서 Karnaugh map을 통해 출력 F를 구한다.
    리포트 | 8페이지 | 1,000원 | 등록일 2021.10.02
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  • 자료 표지
    서강대학교 디지털논리회로실험 8주차 결과보고서
    .② Serial-in, parallel-out저장되는 모든 bits에 대해 개별적인 출력이 존재하며, 직렬데이터를 병렬데이터로 변경 시켜주는 역할을 하는 회로이다.③ Parallel ... 되어 load와 shift의 선택에 따라 데이터를 선택 하게 되며, 병렬데이터를 직렬데이터로 변환하는 기능을 하는 회로이다.④ Parallel-in, parallel-out병렬로 입력 ... 되어 저장되는 모든 입력 데이터를 보여줄 수 있는 출력 신호를 갖는 회로이다. 두 개의 모듈을 통해 송수신 하는 구조는 다음과 같다.두 모듈 사이를 직렬bus를 이용해 연결
    리포트 | 14페이지 | 1,000원 | 등록일 2021.10.02
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2025년 06월 25일 수요일
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