"전자전기컴퓨터설계"의 검색결과 입니다.

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"전자전기컴퓨터설계" 검색결과 81-100 / 5,177건

서울시립대 전자전기컴퓨터설계실험1 전전설1 9주차 결과레포트 결레 RC RL RLC A+

전자전기컴퓨터설계실험1결과 보고서 post-lab report초록 abstract본 보고서는 RC, RL, RLC 회로의 출력 전압의 관찰과 time response를 주제 ... 로 한다. RC, RL회로에서 저항을 각각 세 가지로 달리하고 RLC 회로에서 축전기의 전기용량을 바꾸어 가며 시정수의 변화를 관찰하였다. 구형파를 인가하여 입력 및 출력파형의 변화

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| 리포트 | 18페이지 | 2,000원 | 등록일 2021.04.13

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서울시립대 전자전기컴퓨터설계실험1 전전설1 9주차 예비레포트 예레 RC RL RLC A+

가. 실험의 목적 RC, RL, RLC 회로의 time response를 실험으로 구하고 이론과 비교한다. 나. 실험 이론a. RC time response RC 회로에서 최초에 capacitor에 전압이 없다고 하자. 직류 전압원을 연결한 t>0에는 캐패..

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| 리포트 | 17페이지 | 2,000원 | 등록일 2021.04.13

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[서울시립대] 전전설3 전자전기컴퓨터설계실험3 5주차 OP-AMP3 (결과레포트+LTspice 파일)

"[서울시립대] 전전설3 전자전기컴퓨터설계실험3 5주차 OP-AMP3 (결과레포트+LTspice 파일)"에 대한 내용입니다.

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| 리포트 | 8페이지 | 2,500원 | 등록일 2021.10.03 | 수정일 2021.10.13

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[서울시립대] 전전설3 전자전기컴퓨터설계실험3 4주차 OP-AMP2 (결과레포트+LTspice 파일)

"[서울시립대] 전전설3 전자전기컴퓨터설계실험3 4주차 OP-AMP2 (결과레포트+LTspice 파일)"에 대한 내용입니다.

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| 리포트 | 2,500원 | 등록일 2021.10.03 | 수정일 2021.10.15

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[서울시립대] 전전설3 전자전기컴퓨터설계실험3 3주차 OP-AMP1 (결과레포트+LTspice 파일)

"[서울시립대] 전전설3 전자전기컴퓨터설계실험3 3주차 OP-AMP1 (결과레포트+LTspice 파일)"에 대한 내용입니다.

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| 리포트 | 2,500원 | 등록일 2021.10.03 | 수정일 2021.10.15

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 3주차 예비+결과(코드포함) Verilog HDL

가.실험목표-Verilog HDL 문법을 익혀 이를 활용한다.-Primitive Modeling, Behavioral Modeling 방법으로 회로를 설계하고 Testbench

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| 리포트 | 7페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.06.18

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 1주차 예비+결과(코드포함) TTL_gates_Lab_on_Breadboard

가. 실험목표1) OR, XOR 게이트의 동작을 이해하고, 직접 회로를 구성하여 동작 결과를 확인한다.2) 논리 게이트를 적절히 활용하여 반가산기를 구현하여, 반가산기의 진리표와 실제동작을 비교 및 이해한다.나. 이론적배경1) OR Gate: 입력 중 하나라도 1이 되..

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| 리포트 | 7페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.06.18

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 9주차 예비+결과(코드포함) Application_Design_II Text-LCD Control.

I.INTRODUCTION본 실험은 Text LCD에 대한 이해를 바탕으로 Text LCD를 직접 설계 및 구현하여 원하는 텍스트를 LCD에 띄우는 것을 목표로 한다. 본 결과 ... 보고서에서는 설계 및 구현한 Text LCD의 코드에 대한 설명과 시뮬레이션 결과에 대한 보고 및 검증을 진행할 예정이다.II.Text LCD 설계 결과 보고A.Codea)Text ... 한 부분이다. 두 번째 부분은 Fig. 2와 같이 clk을 1/10으로 분주해주는 분주기를 설계한 부분이다. clk로 1kHz를 사용하는데 이 분주기를 구현함으로써 LCD에 필요

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| 리포트 | 3페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.06.18

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 2주차 예비+결과(코드포함) HBE-Combo2-SE board

가. 실험목표1)Xilinx를 활용하여 간단한 논리 게이트를 설계하고, 이들을 이용하여 Instance Symbol 기능을 활용하여 복잡한 회로를 설계한다.2)Isim을 활용 ... 하여 설계한 게이트 및 회로의 동작을 Simulation하고 이론과 비교 및 확인한다.나.이론적배경1)OR gate는 두 입력이 모두 0일 때만 출력이 0이고, 나머지 경우엔 출력

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| 리포트 | 8페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.06.18

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 4주차 예비+결과(코드포함) Combinational_Logic_Design_1 Arithmetic_Logic and Comparator

가. 실험목표-HDL 문법을 활용하여 Verilog 설계 및 시뮬레이션을 할 수 있다.-감산기와 비교기의 구조 및 동작을 이해 및 확인한다.나. 실험결과1.Full ... Subtractor아래 그림은 예비보고서에서 설계했던 전감산기(FS)의 시뮬레이션 결과이다. testbench를 통해 모든 경우의 수를 넣어주었기 때문에 정상 작동 여부를 완벽히 확인할 수 있 ... 다.2.4-bits Subtractor아래 그림은 예비보고서에서 설계했던 4비트 전감산기의 시뮬레이션 결과이다. 입력이 각각 4비트 이기 때문에 모든 경우의 수를 확인할 수 없

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| 리포트 | 7페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.12.14

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 5주차 예비+결과(코드포함) Combinational_Logic_Design_II Decoder, Encoder and MUX

가. 실험목표-HDL 문법을 활용하여 Verilog 설계 및 시뮬레이션을 할 수 있다.-Decoder, Encoder, MUX의 구성과 작동 방식을 이해 및 설계한다.나.실험결과 ... 된다. 결과의 정확성 검증은 결론에서 다룰 예정이다.2.4:1 MUX 예비보고서에서는 2-bits 4:1 MUX를 설계했으나, 1-bit 4:1 MUX로 시뮬레이션을 다시 수행하였다.코드 ... 을 수행할 수 있다.2.4:1 MUX마찬가지로 TABLE III는 설계한 4:1 MUX의 시뮬레이션 결과와 예상 결과를 비교하여 실험의 정확성을 판단한 표이다. TALBE IV

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| 리포트 | 7페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.06.18

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[전자전기컴퓨터설계실험2] (코드txt추가) [이거 하나면 끝 !!] A+ 서울시립대학교 전전설2 파이널 프로젝트 공학용계산기 결과(코드파일 포함)

I.INTRODUCTION본 보고서는 최종 프로젝트 주제인 공학용 계산기의 설계에 대한 방법과 결과에 대한 보고서이다. 총 10가지 기능을 구현한 논리의 방식을 소개한 뒤, 임의

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| 리포트 | 8페이지 | 15,000원 | 등록일 2021.03.26 | 수정일 2024.03.18

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 6주차 예비+결과(코드포함) Sequential_Logic_Design_I Flip-Flop, Register and SIPO

Abstract Flip-Flop을 사용하여 clock divider를 설계한다. 1/2, 1/4, 1/5 divider를 설계하고, Master Slave 1bit JK ... Flip Flop를 설계할 수 있다.Index Terms D Flip-Flop, Clock Divider, Master slave 1bit JK Flip Flop, cascadeI ... -Slave JK Flip Flop의 설계 및 시뮬레이션 검증을 할 예정이다.II.Clock Divider & Master Slave 1bit JK Flip Flop 설계 및 시뮬레이션A

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| 리포트 | 7페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.06.18

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 8주차 예비+결과(코드포함) Application_Design_I 7-segment and Piezo_Control

I.INTRODUCTION본 실험은 7-segment와 dynamic 7-segment, 그리고 PIEZO buzzer를 설계한다. 7-segment에 사용되는 decoder ... 를 설계해보고, 이러한 이해를 바탕으로 3개의 7-segment로 구성된 동적 7-segment를 설계한다. 그리고 마지막으로 PIEZO buzzer를 설계함으로써 verilog 코드 ... 를 통한 응용을 학습한다.II.7-Segment, Piezo buzzer, dynamic 7-segment 설계A.Codea)Piezo buzzer- Piezo를 설계한 code

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| 리포트 | 3페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.06.18

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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 7주차 예비+결과(코드포함) 자판기 Sequential_Logic_Design_II FSM and Clocked_Counter

I.INTRODUCTION본 보고서는 예비보고서에서 조사한 State machine 정보와 여러 예외사항을 반영하여 작성한 State diagram을 기반으로 설계 ... 한 Vending machine의 code 및 시뮬레이션 결과를 확인 및 검증에 관한 보고서이다.II.Vending machine 설계 code 및 Simulation 결과A.CodeA Part

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| 리포트 | 3페이지 | 2,000원 | 등록일 2021.03.26 | 수정일 2021.06.18

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전자전기컴퓨터설계실험2 실험1 예비레포트

1. 실험 소개가. 실험 목적TTL을 이용한 논리 회로 구성을 이해하고 다음과 같은 내용을 포함하여 실험 및 설계 능력을 함양한다.⚫ OR 게이트 논리 회로 실험⚫ XOR 게이트

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| 리포트 | 13페이지 | 1,500원 | 등록일 2020.11.24

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전자전기컴퓨터설계실험 1 1주차 예비 보고서

1주차 예비 보고서2018440166전자전기컴퓨터공학부박민철가. 실험의 목적- 기본 실험 장비 사용방법 숙지▶ DC 전원 공급기(power supply)▶ 디지털 멀티미터

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| 리포트 | 4페이지 | 1,000원 | 등록일 2020.04.06

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전자전기컴퓨터설계2 FinalProject [A+]

[Final_Project] Report- Final Project -담당교수담당조교실험일2016.12.12 ( Monday)학번2013440043이름문범우목차‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 21. Introduction (실험에대한소개)‥‥‥‥‥‥‥‥‥‥‥‥2가. Pu..

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| 리포트 | 82페이지 | 1,000원 | 등록일 2017.10.19

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전자전기컴퓨터설계실험1(전전설1) (11) 디자인 프로젝트

디자인 프로젝트post-lab report디자인 프로젝트post-lab report과목명전자전기컴퓨터설계실험1담당 교수전공 학부전자전기컴퓨터공학부학번성명제출 일자목 차Ⅰ. 서론 ... equation의 설계[사진 24] analog computer for first-order linear differential equation의시뮬레이션 결과이론식과 data ... sheet, PSpice 상의 설계를 바탕으로 PCB board에 1차 선형 미분 방정식에 대한 analog computer를 [사진 25]와 같이 제작하였다. 그리고 오실로스코프

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| 리포트 | 16페이지 | 3,000원 | 등록일 2019.10.04 | 수정일 2021.04.29

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전자전기컴퓨터설계실험2(전전설2) (10) Final Project

Final Project : Digital Watchpost-lab report과목명전자전기컴퓨터설계실험2담당 교수전공 학부전자전기컴퓨터공학부학번성명제출 일자목 차Ⅰ. 서론 ... . Finite State Machine유한 상태 기계(finite-state machine, 이하 FSM)는 컴퓨터 프로그램과 전자 논리 회로를 설계하는 데 쓰이는 수학적 모델이 ... 하게 사용하기 위한 전자 설계 자동화(EDA) 도구를 제공한다. 핵심 제품군은 완전한 EDA 흐름을 제공하는 ISE이다. 베릴로그나 VHDL, 배치와 배선(PAR)을 합성하고, 생성

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| 리포트 | 110페이지 | 10,000원 | 등록일 2019.10.13 | 수정일 2021.04.29

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