"논리회로설계및실험"의 검색결과 입니다.

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전전설2 성결대 논리회로 실험12 멀티플렉서 4bitfulladder 두더지 잡기 센서입력처리

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"논리회로설계및실험" 검색결과 821-840 / 1,755건

논리회로-13주차

REPORT━━━━과 목 명논리회로 및 실험분 반2 분반(COM203-02)실 험 날 짜2013. 05. 28담 당 교 수도재수 교수님소 속컴퓨터멀티미디어 학부학 번성 명제 출 ... 일2013. 05. 31동국대학교Dongguk university. since 1906목 차실험 : 7과 연습문제 16번3초과 코드를 BCD 코드로 변환하는 회로를 설계하여라.1 ... 을 입력하고 0을 입력하여 다른 방법으로 결과 값을 확인할 수 있었다.마지막으로 이번 실험을 통해서는 서로 다른 코드를 변환하는 회로를 설계하는 방법에 대해서 이해하고, 설계할 땐 작은 마더보드에 선을 연결하면서 복잡하긴 했지만 결과가 정상적으로 나왔을 때 뿌듯하였다.

리포트 | 7페이지 | 1,500원 | 등록일 2015.11.12

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논리회로설계실험_라인트레이서_프로젝트_결과보고서

논리회로설계 실험 설계프로젝트라인트레이서1. 실험 목표VHDL을 이용한 여러가지 VHDL표현 방식에 대해서 이해하였으며 그에 따른 여러 조합회로와 순차회로 설계를 수행 ... 하였다. 순차회로에서 수행한 내용들이 linetracer를 구현하는데 많이 사용되었으며 분주기 설정, finite state machine 설계 등이 있었다. 또한 VHDL로 작성된 코드 ... 를 RoV-Lab3000을 사용하여 직접 하드웨어로 구현해 보며 사용법과 주의 사항에 대하여 완벽히 숙지하였다. 그러나 이번 실험에서는 bit 파일이 아닌 mcs 파일을 PROM 설계

리포트 | 9페이지 | 6,000원 | 등록일 2018.01.10

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디지털 2장 예비보고서 Boolean 대수와 논리식 간략화

기초전자회로설계및실험15주차 예비 보고서(Boolean 대수와 논리식 간략화)학번성명1. 실험내용P.144에 있는 그림 2.1은 Boolean대수 기본법칙의 ‘A+AB=A+B ... ) 논리식의 간략화를 수행할 수 있다.3. 실험 기기 및 부품 설명(1) 직류전원 공급 장치직류전원공급장치는 실험회로에 직류전원을 공급하기 위한 장치이다.직류전원공급장치로는 변압기 ... ’ 식을 설명하는 회로도 이다.회로를 구성한 수 진리표를 작성하고 계산값이 측정값과 동일함을 보여라.2. 실험목표(1) 논리식의 Boolean 대수 기본 법칙을 이해할 수 있다.(2

리포트 | 8페이지 | 1,000원 | 등록일 2016.10.07

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디지털로직실험 논리프로브 구성

때는 ‘거짓(0)’을 출력함을 알 수 있다.평가 및 복습 문제2. 실험 순서 5에서 두 개의 인버터를 직렬로 연결하였다. 이러한 구성은 종종 논리 회로에서 사용된다. 두 개의 인버터를 이처럼 직렬로 연결하는 논리적인 이유가 무엇인지 제시해 보아라. ... 다. 모든 디지털 회로는 ON과 OFF 조건을 나타내기 위해 고속의 트랜지스터를 사용하는 스위칭 회로이다. 논리 설계자는 다른 기술을 나타내는 여러 가지 유형의 논리를 사용할 수 있 ... 한 논리 프로브이다. 논리 프로브는 회로에서 HIGH와 LOW논리레벨의 존재를 검출하는 데 유용하다. 이 실험에서의 논리 프로브는 단지 집적회로의 연결과 논리 프로브의 사용 설명을 위

리포트 | 7페이지 | 1,000원 | 등록일 2015.07.20

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서울시립대학교 전자전기컴퓨터설계실험2 제10주 Lab09 Pre

– Verilog HDL 실습 Lab#09 Application Design Ⅱ Text-LCD Control, 서울시립대학교.Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소. ... Pre-lab Report전자전기컴퓨터설계실험Ⅱ10주차. Application Design Ⅱ - Text-LCD Control.실험 날짜2016. 11.14학번이름 ... FPGA Chip)Pre-Lab실험 방법[실험 1] Text LCD에 문자 표시Add Source레포트의 분량 축소 목적으로 소스코드의 이미지를 줄인다.Source Code크게 4개

리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04

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경희대학교 논리회로 레포트

논리회로(정 연 모 교수님) / 제출일 : 2012. 09. 13.Homework #0 /=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-=-= ... ) 디지털.3) 논리회로.4) HDL의 정의, 종류.5) CAD Tools.6) IP.7) FPGA.8) SoC.9) 시뮬레이션.-------------------------------- ... 다는 특징이 있다.3) 논리회로 : 논리곱(AND), 논리합(OR), 부정(NOT)의 기본적 논리소자를 연결하여 수치를 나타내는 신호를 처리하는 회로이다. 전자계산기의 연산장치 등

리포트 | 3페이지 | 2,000원 | 등록일 2016.04.17

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디지털실험및설계 결과1(논리게이트)

디지털 논리실험 및 설계#1 기본 논리 게이트 (결과)담당교수님 : 교수님제출일자 : 2015. 03. 23조 :학번 :이름 :1. 실 험 결 과(1) 2 입력 NOR, XOR ... 게이트입력NOR (d)XOR (e)AB논리논리0*************00회로(d)는 NOR게이트로 실험에서 7402를사용하였다. NOR게이트의 경우 OR의 값에NOT을 붙인 값 ... 을 출력을 한다. 입력값이모두 ‘0’일 때 ‘1’을 나타낸다.회로(e)는 XOR게이트로 실험에서 7489을 사용하였다. 입력 값이 같으면 ‘0’을 출력하고 입력 값이 서로 다르

리포트 | 5페이지 | 1,500원 | 등록일 2015.12.05

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아주대 논리회로 실험 예비3 가산기 감산기 adder subtractor

을 이수하는데 최선을 다할 것을 서약합니다.학 부: 전자공학부제출일: 2015/03/27과목명: 논리회로실험교수명: 이정원분 반: 5조학 번:성 명:실험 3. 가산기 & 감산기실험목적 ... Logic gate 를 이용해서 가산기(adder) 와 감산기 (substractor)를 구성한다.디지털 시스템의 기본 요소인 가산기와 감산기의 기본 구조및 동작원리를 이해한다.실험 ... REPORT(예비보고서)교육목표정보통신대학 교육목표정보통신대학은 수요지향적 교육을 바탕으로 국제 경쟁력과 전문성 및 실용성을 갖춘 고급 정보통신 엔지니어의 양성을 목표로 하고 있

리포트 | 8페이지 | 1,000원 | 등록일 2016.12.24

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서울시립대학교 전자전기컴퓨터설계실험2 제04주 Lab03 Pre

Description Language)를 이용한 AND 및 NAND Gate 설계를 해보고, Verilog HDL 문법을 익힌다.실험에 필요한 배경 지식Verilog HDLHiLo ... .Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소. ... Pre-lab Report전자전기컴퓨터설계실험Ⅱ4주차. Verilog HDL실험 날짜2016. 9. 26학번이름Professor조교실험 소개실험 목적HDL(Hardware

리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04

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전자전기컴퓨터설계실험2(전전설2)2주차결과

로 게이트어레이나 디지털 신호 처리기 등등을 시뮬레이션 가능하게 한 프로그램이다.나. HBE-ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습 ... 고 있어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정에서 사용하는 클럭 ... (Purpose of this Lab)Xilinx 프로그램 중 schematic을 이용하여 최종적으로 ripple carry full adder를 설계하고 주어진 실험값들과 HBE-ComboⅡ

리포트 | 15페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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Lab#03 Verilog HDL

introduction가) HDL기반 설계의 장점(1) 설계오류 수정시간 및 회로변경 시간 단축에 따른 설계시간의 단축(2) 최적화, 상위수준 설계를 통한 설계의 질 향상(3) 특정 설계기술이나 공정 ... this labVerilog HDL 문법에 대해 익히고, 이를 이용하여 논리게이트를 설계한다.나. Essential Backgrounds1) Verilog HDL ... 과 무관한 설계(4) 낮은설계비용 및 효율적인 설계 관리나) Verilog HDL 어휘 규칙(1) Identifier대소문자를 구별하며, 각 객체에 이름을 지정하는 것이다. 문자

리포트 | 20페이지 | 1,500원 | 등록일 2016.09.11

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논리설계 및 실험 전자시계 결과보고서

002분반(화요일)논리회로 설계 및 실험23조 Term Project 결과 보고서(전자 시계)Dept. of Computer Science & Engineering/Pusan ... Project 작동 법 사용한 회로 등을 설명해둔 문서이다.목표FPGA BOARD와 FLOWRIAN을 이용한 논리 회로(디지털 시스템) 설계FLIP-FLOP과 REGISTER등 ... National University정보컴퓨터공학전공 부산대학교2014년 12월 05일(화)요 약Term Project 전자시계 제작에 관한 보고서로 Project의 최종 결과 및

리포트 | 9페이지 | 2,000원 | 등록일 2016.11.28

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[디지털 논리회로 실험] 16장. 동기식 카운터 결과레포트

논리회로실험 A반결과 보고서16장동기식 카운터5조이름학번실험일15.06.02제출일15.06.09측정 전압 ? 4.90V실험에 사용된 기기 및 부품 : 오실로스코프(CRO) 혹은 ... 의 최대값(15 _{10})가 되면 1이 된다.회로가 너무 복잡하여 실험도중 오류를 찾기가 힘들었다. 점프선이 너무 부족하여 회로를 구성하는데 힘들었고 점프선이 너무 복잡해 연결하기 ... 도 힘들었다. 실험을 통하여 동기식 다운 카운터의 회로구성과 동작원리를 알 수 있었으며, 동기식 2진 업, 다운 카운터의 동작원리를 알고, 74163의 동작원리도 알 수 있었다.

리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.09

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반가산기와전가산기 - 예비

기초회로실험- 예비보고서 -- 8조 -정보통신공학부실험목적(1) 반가산기와 전가산기의 원리를 이해한다.(2) 가산기를 이용한 논리회로의 구성능력을 키운다.이론(1) 2진 연산 ... 논리회로이며 반가산기의 논리식과 진리표는 다음과 같다.S = A B + A B = A BABS(sum)C(carry)*************101C = A B(3) 전가산기(Full ... 다.ABCSumCarry0000000110010100110110010101011100111111전가산기 진리표예비과제(1) 이론부분을 이해하고 AND, OR 및 NOT 게이트만을 사용하여 전가산기를 설계하라.ABAB=F

리포트 | 4페이지 | 1,000원 | 등록일 2015.10.18

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논리회로설계실습-비교기-MUX-ALU-결과보고서

논리회로설계 실험 결과보고서 #5실험 5. 조합회로 설계 - 비교기, MUX, ALU1. 실험 목표4비트 크기의 이진수 A, B와 2비트 크기의 선택 신호 S를 입력으로 받아 5 ... 설계한 ALU가 정상적으로 동작하는지 시뮬레이션을 통하여 확인한다.2. 실험 결과 4가지 연산을 수행하는 산술논리연산장치(ALU)를 함수, 프로시저를 이용하여 작성하시오.(1 ... 비트 이진수 Y를 출력하는 산술논리연산장치(ALU)의 동작을 이해하고 설계한다. 소스 코드 작성 시, 함수와 프로시저를 포함한 패키지를 사용하여 작성한다. 테스트 벤치 작성을 통해

리포트 | 8페이지 | 1,500원 | 등록일 2018.01.10

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디지털논리회로 텀프로젝트

과목 : 기초 전자 회로 실험2비교기, 타이머, 카운터, 세븐세그먼트 디코더를 이용한 알람 스톱워치의 설계담당교수학 번 및이 름학 과전자공학과1. 프로젝트의 목적 및 필요성2 ... . 설계 이론3. 회로 구성4. 검토 및 고찰5. 프로젝트 일정6. 역할 분담7. 프로젝트 물품 구매 내역8. 참고 문헌1. 프로젝트의 목적 및 필요성카운터를 이용한 논리회로 구성이 ... 이 끝난 후 카운터에 리셋 스위치를 만들어 회로를 초기화 할 수 있도록 설계할 것이다.2. 설계이론① 1초 주기의 신호 발생 (555 타이머)*NE555 Timer datasheet

리포트 | 7페이지 | 2,000원 | 등록일 2016.08.17

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[대충] 예비 VHDL을 이용한 순차회로 구현

를 VHDL로 설계한다.2. 실험 이론가. 순차논리회로순차회로는 현재의 입력뿐만 아니라 회로 내부에 기억된 이전 상태의 값에 따라 현재의 출력 값이 결정되는 회로이다.①동기식 순차 ... 논리회로동기식 순차논리회로란 회로에 클럭 펄스가 들어오는 시점을 기준으로 회로의 입력 신호로 부터 회로의 동작을 정의할 수 있는 시스템이다.②비동기식 순차논리회로비동기식 순차논리회로 ... 보고 사항 ①, ②, ③ 모두 위의 실험이론 및 앞선 실험들에서 설명을 하였기에 생략하겠습니다.4. 실험가. VHDL을 이용하여 D플립플롭 구현하라.library ieee;use

리포트 | 4페이지 | 1,000원 | 등록일 2015.01.17

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전자공학과 디지털 회로 및 실험설계 텀프로젝트 간이 전압계입니다.

을 측정 할 수 있는 간이 전압계2. 제작 동기디지털회로 실험 및 설계 강의를 들으면서 우리가 배웠던 논리게이트, 여러 가지 플립플롭, 멀티플렉서, 디멀티플렉서, FND, 카운터 등 ... 디지털회로 실험 및 설계Term Project 최종 보고서학 과 : 전자공학과과 목 : 디지털회로 실험 및 설계팀 원 :담당교수 :보고서 제출일 : 2015년 6 월 7 일목차1 ... . 프로젝트 주제2. 제작 동기3. 팀원 구성 및 역할4. 사용 부품 및 공구5. 실험원리5-1 실험 부품 설명5-2 동작 원리6. 실험결과1. 프로젝트 주제10V 이하의 전압

리포트 | 9페이지 | 2,000원 | 등록일 2016.04.06 | 수정일 2017.05.23

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전자전기컴퓨터설계실험2(전전설2)5주차예비

어레이나 디지털 신호 처리기 등등을 시뮬레이션 가능하게 한 프로그램이다.나. HBE-ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습을 위한 ... 어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정에서 사용하는 클럭의 입력 ... 1개와 3개의 OR gate , inverter를 이용하여 회로를 구현할 수 있다.다. 멀티플렉서여러 개의 데이터를 입력 받을 때 그 중 하나를 선택하여 출력하는 논리 회로

리포트 | 13페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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전자전기컴퓨터설계실험2(전전설2)3주차결과

가 있다.나. Verilog HDLVerilog는 HDL 중 하나로 전자 회로 및 시스템에서 쓰이며 회로 설계 및 검증, 구현 등의 용도로 사용된다. Verilog 코딩 시 영어 ... -ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습을 위한 장치로 회로에서 많이 사용되는 Switch, LED와 같은 주변 장치를 위주로 구성 ... 하여 장비의 크기를 간단하게 만든 모델이다. 가장 큰 특징으로는 Breadboard를 가지고 있어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx

리포트 | 19페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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