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"논리회로 및 실험" 검색결과 41-60 / 3,399건

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    회로실험I 결과보고서 - 논리 게이트 및 부울 함수의 구현
    7486 및 SN7404를 이용하여 회로를 구성하고, 각각에 대하여 진리표를 구성하라.고찰논리회로는 전적대에서 부울대수와 카르노프맵을 이용하여 기초적인 부분을 배우고 온 상태라, 기본 ... NAND Gate) ⋄ SN7402(Quad 2-input NOR Gate) ⋄ SN7486(Quad 2-input XOR Gate)실험(1) SN7408로 회로를 결선하고, 1 ... 실험준비물(1) 디지털 멀티미터(HP 34401A) 1개(2) 전원공급기(GW GPC-3020A) 1개(3) 오실로스코프(4) 브레드보드(WISH 206) 1개 ⋄ SN7404
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2019.05.13 | 수정일 2020.05.06
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    회로실험I 예비보고서 - 논리 게이트 및 부울 함수의 구현
    회로실험I 4주차 예비보고서실험 4. 논리 게이트 및 부울 함수의 구현목적?AND, OR, NOT, NAND, NOR, XOR, XNOR의 논리함수 개념과 Gate의 구조 및 ... 기능을 습득한다.? 부울 대수를 사용한 논리회로의 표현방식 및 등가회로를 익힌다.NOT(Inverter)- 하나의 입력과 출력을 가짐- 신호선과 논리기호의 접점에 작은 원을 그림OR ... 함수를 이용한 논리회로의 구현- 부울 함수는 기본 게이트를 사용하여 구현할 수 있음예비과제(1) NOT, AND, OR, NAND, NOR 및 Exclusive-OR 게이트
    Non-Ai HUMAN
    | 리포트 | 4페이지 | 1,500원 | 등록일 2019.05.13 | 수정일 2020.05.06
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    [논리회로 및 실험1 결과보고서] 실험 9. 연필자판기 결과보고서
    및 결론이전까지의 실험은 논리회로에 대한 이론이나 기본적인 사항들을 익힐 수 있는 실험들이었다면 이번 실험부터는 무언가 지금까지 배운 이론들을 활용하여 실용적인 회로를 구성할 수 ... 결과보고서실험 9. 연필자판기과목명담당교수담당조교학과제출일학번/이름1. 실험목표* 주입된 ‘동전’의 양을 기준으로 하여 ‘연필’과 ‘거스름돈’을 지급하는 논리 회로의 설계와 구성 ... .* 실험 회로와 결과에 대한 보고서 작성2. 데이터 및 관찰내용모델-2 연필자판기의 진리표는 다음과 같았다.입력출력N1D1D2QPNCDC1DC200000
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2019.04.26
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    [논리회로 및 실험1 결과보고서] 실험7. 부울 법칙과 드모르간의 정리 결과보고서
    .* 부울 법칙 10과 11을 증명하기 위한 회로 설계* 실험을 통해 3-입력 변수를 가지는 회로에 대한 진리표를 작성하고, 드모르간의 정리를 이용하여 대수적으로 등가인지를 증명.2 ... . 데이터 및 관찰내용* 첫번째 회로에 대한 출력부분의 파형(A + 0 = A)OR 게이트의 첫번째 입력 A 는 함수 발생기로 10KHz 의 파형을 인가한 것으로, 두번째 입력 ... 다. 이 출력 파형은 결국 A + B(A 와 B 를 OR 게이트로 연결했을시)와 동일하다.3. 결과 및 결론회로도타이밍 다이어그램* 회로도에서 A 라고 표시된 부분은 바로 접지와 연결
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    | 리포트 | 7페이지 | 2,000원 | 등록일 2019.04.26 | 수정일 2019.05.27
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    충북대학교 전자공학부 기초회로실험 논리 게이트 및 부울 함수의 구현 예비 보고서
    실험5. 논리 게이트 및 부울 함수의 구현◆ 목적(1) AND, OR, NAND, NOR, XOR, XNOR의 논리 함수 개념과 Gate의 구조 및 기능을 습득한다.(2) 부울 ... 대수를 사용한 논리 회로의 표현 방식 및 등가 회로를 익힌다.◆ 이론(1) NOT(Inverter) : 하나의 입력과 출력을 가지며, 논리적 부정 연산을 행한다.AY0110(2 ... 이 되는 논리 회로.AYC000010100111(4) NAND 및 NOR 게이트 :-NAND : AND 게이트와 NOT 게이트를 결합한 회로. 입력이 A, B가 모두 1일 때
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    | 리포트 | 4페이지 | 2,000원 | 등록일 2020.07.26 | 수정일 2020.09.15
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    충북대학교 전자공학부 기초회로실험 논리 게이트 및 부울 함수의 구현 결과 보고서
    V100.1430V113.7421V◆ 비고 및 고찰☞ 논리 게이트를 이용한 전류의 흐름을 알아보는 실험을 하였다. 인버터는 입력 값의 역수를 주고 AND게이트는 곱셈의 결과, OR ... 다. 그리하여 각각의 회로에 1과 0의 값을 주는 실험을 하였는데 실험시 1에 해당하는 전압은 5V로 측정하였다. 논리 게이트를 사용하는 것은 쉬우나 부울대수가 복잡해지고 길어지 ... ◆실험 결과(1) SN7408로 회로를 결선하고, 1) B=0, 2) B=1, 3) B=Open 상태에 대하여 진리표를 작성하라.ABY000.1145V010.1440V100
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    | 리포트 | 2페이지 | 2,000원 | 등록일 2020.07.26 | 수정일 2020.09.15
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    디지털논리회로실험(Verilog HDL) - 데이터 오류 정정 및 검출, 블랙잭, 계산기
    .데이터 오류 검출 및 정정◦ Parity Bit데이터에 패리티 비트를 붙여서 1의 전체 개수가 짝수 혹은 홀수가 되도록 한다.-> 짝수 패리티 사용◦ 1bit 오류 검출 및
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    | 리포트 | 39페이지 | 3,000원 | 등록일 2019.08.29
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    <논리회로실험>단안정 및 비안정 멀티바이브레이터
    _{1} ,`A _{2} ,`B에 필요한 연결을 결정하여라. 실험 결과에 입력 논리 레벨과 펄스 발생기 연결에 대하여 목록을 작성하고 회로를 구성하여라. 원-숏은 잡음(noise ... },C _{EXT}의 값을 실험 결과의 표 1에 기록하여라.그림 4. 74121을 사용한 단안정 멀티바이브레이터그림 5. 단안정 멀티바이브레이터 회로 구성R _{T}와C _{EXT ... 단안정 및 비안정 멀티바이브레이터**전자공학과Monostable(or One-shot) and Astable Multivibrator**Electronic EngineeringⅠ
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    | 리포트 | 5페이지 | 1,500원 | 등록일 2015.12.15
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    [논리회로 및 실험] 3비트 입력 7-세그먼트 출력 디코더 실험 계획서
    해본다. 또한 2입력 - 1출력인 IC 칩에 맞춰 회로도를 2개짜리로 변경하여 작성해본다.실험에 사용될 예상 기기 및 칩, 기타 부품들Logic Lab Unit Model 9200저항 ... 이거나 1이면 출력은 0이 된다. 불 대수식은 F = X Y 또는 XY' + X'Y 이다.실험 계획:진리표 작성카르노맵 작성 및 논리식 간략화2개 짜리의 입력으로 구성된 회로도 작성 ... 다이오드의 상태 ON)이다.)실험에 쓰일 게이트:NOT 게이트: 입력 1개와 출력 1개가 있는 게이트로써 논리 부정을 나타낸다. 따라서 입력의 반대로 출력된다. 입력이 0인 경우
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2016.07.13
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    논리회로 실험 및 설계
    논리회로 실험 및 설계1. 설계 목적 : 논리회로 이론을 기초로 하여 자판기를 창의적인 방법으로 설계한다.2. 제품 사양 :· 100원 동전, 500원 동전 입력· 200원 커피 ... , 상태회로 구현, 보고서 작성· 김성민 : 우선순위 인코더, 제어기, 물 양 제어기 구현5. 동작 매뉴얼 :· 최대 700원까지 넣을 수 있습니다.· 넣을 돈과 현재 상태의 합 ... 누르지 마세요6. 완성 회로도7. 자체 평가 :반환LED가 들어오는 부분과 초를 맞추기가 힘들어서 생각보다 설계시간이 오래 걸렸다. 좀 더 빨리 했으면 납땜까지 하여 직접 제작을 해
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2009.10.15
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    1장 기본논리회로 실험 결과 및 2장 논리회로의 간략화 예비
    1장 기본논리회로 실험 결과실험 1. 그림 1.6의 회로를 구성하고, 입력 A, B를 변화시키면서 표 1.6의 출력전압 Y를 측정하시오. Voc: 핀14, GND: 핀 7번그림 ... 전압을 측정하시오.그림 1.12표 1.12ABY0000111011102장 논리회로의 간략화 실험 예비AND와 OR, NOT에 대해서 알고 있다면 이해하기가 쉬울 듯 하다어떠한 조건 ... 1.6표 1.6ABY000010100111실험 2. 그림 1.7의 회로를 구성하고, 입력 A를 변화시키면서 표 1.7의 출력전압을 측정하시오. IC 14번 핀은 Voc, 7번 핀
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2012.12.10
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    논리회로실험) 가산기 및 감산기 예비보고서
    예 비 보 고 서10 주 차실험 9 : 가산기 & 감산기1. 실험 목적- 반가산기와 전가산기의 논리와 회로를 이해한다.- 반감산기와 전감산기의 논리와 회로를 이해한다.2. 기본 ... 는 substracter 그대로 뺄셈의 원리를 가지고 있다. 감산기는 가산기와 같은 조합논리 회로이다. 사칙연산을 수행함에 있어서 감산기는 뺄셈의 원리를 가지고 있는데, 저번 실험 ... 실험 이론* 가산기와 감산기란 무엇인가 ?1 ) 가산기( Adder )란 ?- 가산기는 adder 그대로 더해짐의 원리를 가지고 있는 가산회로이다. 가산기는 게이트에 의해 출력
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    | 리포트 | 4페이지 | 2,000원 | 등록일 2014.01.06
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    은행창구회로 -회로해석 및 논리회로실험
    회로해석 및 논리회로실험 2 차 설계 결과보고서 ( 카운터 응용회로 설계 )목차 작품 개요 회로도 제작과정 작품 사진 트러블 슈팅 사용 부품 및 역할 분담 일정작품 개요 작품 ... 는 회로 5. 호출 번호의 창구를 선택할수 있음 작품의 특징 은행에서 이용되는 대기표 발권기 및 부가 기능들에 최대한 근접하면서 추가적인 기능 및 부가기능을 표현하는 작품으로 실용 ... 이 가능하도록 제작 .작품 사진변경 사항 대기 인원수와 방문자 수를 측정할수 있는 회로도에서 은행 대기표 번호 표시와 현재 대기 인원수 호출 번호를 표시하는 회로를 제작 . 직접 은행
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    | 리포트 | 11페이지 | 10,000원 | 등록일 2010.05.31 | 수정일 2023.10.12
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    논리회로실험 기초 ( Or cad사용법 및 논리게이트 기초)
    논리회로실험결과 레포트11. Or cad 사용법 익히기2. 게이트 소자 성질 익히기학 번 20073003이 름 임 수 민실험목표Or cad 기능 가운데 schematic ... Capture를 이용하여 논리 회로를 작성하고 Simulation을 통해 입력신호와 출력신호를 분석해 본다.실험A. 기본 게이트 출력다음의 회로를 OrCAD의 Capture 기능을 이용 ... 된다.? De morgan 응용 출력 결과입 력출 력측정 출력 전압(V)ABC0000011110111111실험2-A. AND 게이트(실험2기본논리회로)? 회로도? Run조건- inA= 0
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    | 리포트 | 12페이지 | 1,000원 | 등록일 2011.11.21
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    논리 회로 설계 및 실험 디지털 시계 기말과제
    논리 회로 설계 및 실험기말 과제[Digital Watch]INDEXSession1. (Introduction)The name of this project (과제 이름)Why ... 들 활용해 나의 기량을 향상 시킬 수 있을 것이라고 생각 하였다.카운터를 이용해 설계할 수 있는 가장 기본이자 대표적인 순차논리회로의 하나이다. 기말과제의 목표에 적당한 것 같 ... ? Digital Watch (과제 선정 이유)Used equipment & components (사용기기 및 부품)Related Theories (관련이론)Session2
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    | 리포트 | 15페이지 | 1,000원 | 등록일 2010.10.19
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    논리회로실험 - 제 2장 가산기 및 감산기 결과 보고서
    과 목 : 논리회로설계과 제 명 : 결과보고서 1담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 4 / 21 ... 한다.VHDL이라는 디지털 회로를 설계하는데 사용되는 하드웨어 기술 언어를 통해 M에 따라서 덧셈과 뺄셈을 달리하는 가/감산기를 설계하고 출력 값을 확인하여 이론값과 비교해 본다 ... .2. Design(1)어떠한 회로를 설계할 것인가1)4bit 가/감산기모드 M의 값에 따라 가산기모드나 감산기모드를 결정한다.M이 0인 경우 가산기 모드이고, M이 1인 경우 감산
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    | 리포트 | 10페이지 | 1,000원 | 등록일 2014.08.15
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    실험 4. 논리게이트의 특성 및 연산회로 결과보고서
    1조2009037600 김동준2009037613 이창엽실험4. 논리게이트의 특성 및 연산회로▣실험목적논리게이트(TTL 74LS04)입출력의 전기적 특성을 실험을 통해서 알아본다 ... .(fan-out, 잡음여유)▣내용4.5.1) 0~5v, 1kHz구형파를 발생시켜 다음 회로의 파형을 관측하라.결과)2V/0.5ms입력()진폭: 5V주기: 1ms출력()진폭: 4.1 ... 이 나타났다. 이를 통해서 여러 개의 TTL 74LS04소자를 연결하게 되면 원하는 출력을 얻지 못할 수도 있겠다는 생각이 들었다.4.5.2) 2) [그림 4.7]의 회로에 입력
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    | 리포트 | 9페이지 | 6,000원 | 등록일 2012.03.18 | 수정일 2017.03.12
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  • 자료 표지
    게이트 및 조합논리회로 dld 디지탈논리회로실험
    1. 실험관련 이론1. 논리회로와 게이트논리 회로는 비연속적(Discrete)인 신호를 다루는 회로인데 특히 두가지의 비연속적인 신호를 다루는 회로를 Binary Digital ... 형태(Y=A×B)의 형태를 띠고 있으며 논리기호및 진리표는 아래와 같다.입력출력1*************1AND 게이트의 논리회로AND 게이트의 진리표나. OR게이트OR게이트는 입력 ... 상태중 하나라도 1이면 출력이 1이되는 회로로서, 논리식은 더하기 형태(Y=A+B)의 형태를 띠고 있으며 논리기호 및 진리표는 아래와 같다.입력출력123000011101111OR
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2008.03.14
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    논리회로실험 부울대수 및 조합논리회로 설계.hwp
    ◆ 제목실험 3. 부울대수 및 조합논리회로 설계◆ 목적(1) 부울대수의 공리 및 정리들을 공부한다.(2) 조합논리회로 설계방법을 공부한다.◆ 이론1. 부울 대수의 기본 정의 ... 라 과거의 입력에 의해서 결정되는 논리 게이트와 기억소자 및 그의 주변 장치들에 의해 구성된다. 또한 조합 논리 회로는 현재의 입력에 의해 부울 대수로 표현된 출력함수를 논리적(진리치 ... 표상)으로 정해진 특별한 기능 그대로 명확하게 처리되도록 회로가 동작하며, 순서 논리 회로는 기억소자와 그의 주변 요소들의 상태 및 입력 함수이며, 기억소자들의 상태는 과거의 입력
    Non-Ai HUMAN
    | 리포트 | 3페이지 | 1,000원 | 등록일 2008.09.19
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    전자공학실험1 실험4장 결과보고서 : 논리게이트의 특성 및 연산회로
    결과보고서전자공학실험논리게이트의 특성 및 연산회로조원 :담당교수 :실험일자 : 2012.4.6제출일자 : 2012.4.13.1.실험목적논리게이트는 디지털 회로를 구성하는 기본 ... 단위이다. 논리게이트(TTL 74LS04) 입출력의 전기적 특성을 실험을 통해 알아본다. 그리고 논리식을 조합논리회로로 구현하고 실험을 통해 진리표를 얻어 본다.2.실험내용2.1 ... 아야 하지만, 측정값의 오차나, 가변저항값의 오차가 커서 이러한 결과가 나왔다.5) 실험 7에서 구성한 회로의 논리식을 각각 구하라. 실험 결과로 얻은 진리표를 통하여 두 논리식이 등
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2013.01.31
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2025년 12월 05일 금요일
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