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전기전자공학실험-공통 소스 트랜지스터 증폭기2025.04.301. 공통 소스 증폭기(Common Source Amplifier) 소스(Source)부분이 접지되어 입력전압과 출력전압의 기준이 되어 공통 소스 증폭기라고 불리며, 입력은 Gate, 출력은 Drain에 연결되어있다. BJT 공통 이미터 증폭기와 유사한데 게이트 방면을 통하여 들여다보는 쪽은 역방향 바이어스가 걸린 접합면이므로 입력 임피던스가 매우 크고 그로 인하여 높은 전류이득과 BJT에 비해 떨어지는 편이지만 전압이득 모두 가질 수 있다. JFET은 입력신호원의 출력 임피던스가 높은 경우에 높은 전류 이득을 얻기 위한 회로에 사...2025.04.30
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울산대학교 전기전자실험 19. 선형 연산 증폭기 회로2025.01.121. 반전 증폭기 반전 증폭기의 경우 R_i값을 변경하며 측정 함으로써 R_i/R_f의 비율로 위상이 반전되어 증폭되는 것을 확인할 수 있었다. 이론값은 전압이득이 -5, 측정값은 -5.2로 조금의 오차가 발생했는데, 이는 오차가 가지고 있는 오차라고 생각할 수 있다. 2. 비반전 증폭기 비반전 증폭기의 경우에는 반전증폭기와 같은 비율로 증폭이 되고 위상도 입력과 동일하게 나오는 것을 확인했다. 이론값은 전압이득이 6, 측정값은 6.3으로 조금의 오차가 발생했는데, 이는 오차가 가지고 있는 오차라고 생각할 수 있다. 3. 가산 증폭...2025.01.12
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공통 게이트 증폭기 실험 예비보고서2025.01.021. 공통 게이트 증폭기 공통 게이트 증폭기 실험을 통해 MOSFET의 동작 특성과 증폭기 회로의 특성을 분석하였습니다. 실험 절차에 따라 입력 전압, 출력 전압, 전류 등을 측정하고 MOSFET이 포화 영역에서 동작하는지 확인하였습니다. 또한 트랜스 컨덕턴스, 출력 저항 등을 구하여 소신호 등가회로를 작성하고 이론적인 전압 이득을 계산하였습니다. 마지막으로 입력 전압과 출력 전압의 크기를 측정하여 전압 이득을 구하고, 입력 및 출력 파형을 확인하였습니다. 1. 공통 게이트 증폭기 공통 게이트 증폭기는 전자 회로 설계에서 중요한 역...2025.01.02
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증폭기의 주파수 특성2025.04.261. 이미터 접지 증폭 회로 이미터 접지 증폭 회로 실험을 통해 주파수 특성에 대해 알게 되었다. 실험 결과, 이론과 달리 실제 증폭기의 이득은 회로를 구성하는 결합 커패시터와 부하 커패시터, 그리고 트랜지스터 내부의 기생 정전용량 성분에 영향을 받는다. 또한 이득은 신호의 주파수에 따라 출력이 달라지며, 그 범위는 저주파, 중간주파, 고주파의 세 영역으로 주파수 범위에 따라 구분할 수 있다. 2. 주파수 특성 실험 이미터 접지 증폭기의 주파수 특성 실험을 통해 주파수 응답에 대해 알게 되었다. 주파수 응답은 진폭이 일정한 다양한 ...2025.04.26
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캐스코드 증폭기 실험 결과 보고서2025.01.021. 캐스코드 증폭기 캐스코드 증폭기는 공통 소스 증폭기에 비해 높은 전압 이득을 얻을 수 있어 많이 사용되고 있습니다. 입력 임피던스가 상대적으로 낮은 공통 게이트 증폭기를 추가로 연결하여 전류 신호를 출력하기에 유용하지만, 출력 전압 스윙이 감소하는 단점이 있어 저전압 회로에서 사용하기 어려울 수 있습니다. 캐스코드 증폭기의 출력 저항은 트랜지스터 자체의 출력 저항에 비해 증가하지만, 실험 과정에서 저항 측정이 이루어지지 않아 정확한 비교는 어렵습니다. PSpice를 통해 구한 전압 이득과 실험 결과 간 차이는 PSpice가 모...2025.01.02
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A+ 전자회로설계실습_피드백 증폭기 (Feedback Amplifier)2025.01.211. Series-Shunt 피드백 증폭기 Series-Shunt 피드백 증폭기는 입력이 전압이고 출력도 전압인 구조입니다. 시뮬레이션을 통해 입력 전압을 0V에서 6V까지 변화시켰을 때 출력 전압의 변화를 관찰할 수 있습니다. 입력 저항과 출력 저항을 각각 1kΩ과 100Ω으로 변경하여 시뮬레이션을 반복하면 출력 전압의 변화 양상이 달라짐을 확인할 수 있습니다. 이를 통해 피드백 증폭기의 특성을 이해할 수 있습니다. 2. Series-Series 피드백 증폭기 Series-Series 피드백 증폭기는 입력이 전압이고 출력이 전류인...2025.01.21
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실험 23_연산 증폭기 응용 회로 1 예비보고서2025.04.281. 비반전 증폭기 비반전 증폭기는 연산 증폭기의 전압 이득이 무한대라고 가정하면 가상 단락의 개념을 이용하여 입력 전압이 출력 전압과 같다는 것을 보여준다. 하지만 실제 연산 증폭기의 전압 이득이 무한대가 아닌 A_0의 값일 경우 전체 전압 이득은 식 (23.2)와 같이 표현할 수 있다. A_0가 크면 클수록 이상적인 값으로부터의 오차가 줄어든다. 2. 반전 증폭기 반전 증폭기는 연산 증폭기의 전압 이득이 A_0의 값일 경우 전체 전압 이득은 식 (23.2)와 같이 표현할 수 있다. 역시 A_0가 크면 클수록 이상적인 값으로부터의...2025.04.28
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능동 부하가 있는 공통 소오스 증폭기2025.01.071. 공통 소오스 증폭기 공통 소오스 증폭기는 전자회로에서 널리 사용되는 증폭기 회로입니다. 이 실험에서는 능동 부하가 있는 공통 소오스 증폭기를 구현하고 분석합니다. 입력 전압 변화에 따른 출력 전압 특성, 전압 이득, 입력 저항 및 출력 저항 등을 측정하고 계산합니다. 또한 10kHz 정현파 입력에 대한 증폭기 성능을 확인합니다. 1. 공통 소오스 증폭기 공통 소오스 증폭기는 전자 회로 설계에서 매우 중요한 역할을 합니다. 이 증폭기는 두 개의 트랜지스터를 공통 소오스 구조로 연결하여 신호를 증폭하는 방식을 사용합니다. 이를 통...2025.01.07
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실험 23_연산 증폭기 응용 회로1 결과보고서2025.04.281. 반전 증폭기 실험회로 1에서 반전 증폭기를 구성하고, R1 = 10kΩ, R2 = 20kΩ으로 설정했다. 입력 크기를 변화시키면서 출력 전압과 전압 이득을 측정했다. 그 결과 전압 이득이 음의 값으로 나왔고 절대값이 1 이상인 것을 확인했다. 이를 통해 반전 증폭기로서 잘 동작했다고 볼 수 있다. 또한 R2를 100kΩ으로 증가시키면 전압 이득도 증가하는 것을 확인했다. 2. 비반전 증폭기 실험회로 2에서 비반전 증폭기를 구성하고, R1 = 10kΩ, R2 = 20kΩ으로 설정했다. 입력 크기를 변화시키면서 출력 전압과 전압 ...2025.04.28
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피드백 증폭기 (Feedback Amplifier) 설계 및 실험2025.05.141. Series-Shunt 피드백 증폭기 설계 Series-Shunt 피드백 증폭기 회로를 PSPICE로 시뮬레이션하여 입출력 특성 곡선을 그렸습니다. 입력저항과 부하저항 값을 변경하여 특성 곡선을 비교 분석하였고, 전원 전압 변화에 따른 출력 전압 변화도 확인하였습니다. 출력 전압이 일정 전압 이상에서 더 이상 변하지 않는 이유를 설명하였습니다. 2. Series-Series 피드백 증폭기 설계 Series-Series 피드백 증폭기 회로를 PSPICE로 시뮬레이션하여 입출력 특성 곡선을 그렸습니다. 입력저항과 피드백 저항 값을...2025.05.14
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