"전전설3 프로젝트"의 검색결과 입니다.

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전전설3 final 동북공정 전전설1 1주차 verilog 시계 pfd 전전설2 3 기업보고서 넥토리얼

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"전전설3 프로젝트" 검색결과 1-20 / 692건

서울시립대 전전설3 final project 예비 보고서

3. 반파 정류회로그림 3은 기본적인 반파 정류회로이다. 하지만 이 회로는 다이오드의 내부 전압 0.7V의 전압 강하로 700 이상에서 forward bias가 인가된다. 하지 ... 만 project에서 설계할 회로는 입력이 10mV로 작은 전압이기에 이러한 0.7V의 전압강하를 무시할 수 없다.그림 4. 그림3 회로의 input output 특성따라서 그림 4 ... model에서의 voltage gain 식을 유도한 모습이다.식 (2)와 (3)은 finite Op amp voltage gain 식을 유도한 모습이다. 이 증폭회로를 앞서 설계

시험자료 | 5페이지 | 3,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 5주차 예비 보고서

A. 예비 보고서1) Finite open-loop gain and bandwidtha) Texas Instruments에서 제공하는 uA741의 datasheet에서 open-loop GB의 typical value를 찾아서 캡쳐하세요.b) R1 = 10 kΩ로 하여..

시험자료 | 12페이지 | 1,500원 | 등록일 2024.07.15

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서울시립대 전전설3 6주차 예비 보고서

하세요.참고 3: LTspice 상에서 diode 설정 및 DC sweep 기능 사용법은 Fig. 8를 참고하세요.참고 4: iD-vD 그래프를 그릴 때 가로축이 vD가 되도록 유념

시험자료 | 11페이지 | 1,500원 | 등록일 2024.07.15

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서울시립대 전전설3 5주차 결과 보고서 Op-amp 2

를 사용하기 때문에, 이를 참고하여 실험을 계획하세요.2) 실험 2 : Slew-rate limitation3) 실험 3 : DC imperfection (Input offset

시험자료 | 7페이지 | 2,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 4주차 결과 보고서 Op amp1

1) 실험 1 : 1차 active low-pass filter (Fig. 5(b)) :a) 부하 저항을 RL = 1kΩ로 두고 예비 보고서에서 계산한 소자값을 이용하여 Fig. 5(b)의 1차 low-pass filter를 구성하세요.(Note : 브레드보드의 op ..

시험자료 | 6페이지 | 1,500원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 4주차 예비 보고서

plot과 2)-b)의 2차 active low-passfilter에 대한 Bode gain plot을 하나의 그래프로 그리세요.3) 1차 low-pass filter 2개

시험자료 | 11페이지 | 1,500원 | 등록일 2024.07.15

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서울시립대 전전설3 final project 결과 보고서

에 따른 output signal 변화Vout(peak) : 1.36VVoltage gain : 3.2Vout(peak) : 2.92VVoltage gain : 5.84Vout ... (peak) : 1.72VVoltage gain : 34.4Vout(peak) : 2.36VVoltage gain : 47.2Vout(peak) : 3.52VVoltage gain ... : 70.4Vout(peak) : 4.96VVoltage gain : 99.2표 3. Input signal이 100mVpp일 때 가변저항 변화에 따른 output signal 변화

시험자료 | 11페이지 | 10,000원 | 등록일 2024.07.15

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서울시립대 전전설3 13주차 결과 보고서 MOSFET 4

을 각각 측정하고, 이를 통해 a) 회로의 voltage gain의 실험값을 도출한 다음, 예비 보고서에서 도출된 이론값, 모의 실험값들과 비교하세요그림 3. 실험 1의 Vin,Vout ... 하여 bode plot을 그려보면 그림 5와 같으며 모의실험에서 구한 bode plot은 그림6과 같다. 두 경우의 cutoff frequency를 비교해보면 아래 표3과 같다.모 ... 의실험값실험값오차율[Hz]16120024%[Hz]340.6k300k12%Bandwidth[Hz]340.4k299.8k12%표 3. 실험값 모의실험값 비교Multi-stage CS-CS

시험자료 | 8페이지 | 3,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 13주차 예비 보고서 MOSFET4

A. 예비 보고서1) Single-stage CS amplifiera) LTspice에서 2N7000의 spice model을 이용하여 Fig. 1의 single-stage CG amplifier 회로를 구성하세요.b) LTspice의 op 함수를 이용하여 a) 회로의..

시험자료 | 13페이지 | 2,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 12주차 결과 보고서 MOSFET3

uF, 1 uFNMOS : 2N7000 x3Experimental Results & Analysis :CG amplifier의 vin과 vsig의 파형을 각각 측정하고, 이를 통해 ... a) 회로의 open-circuit voltage gain과 overall voltage gain의 추정값을 도출한 다음, 예비 보고서에서 도출된 값들과 비교하세요.그림 3 ... . 실험 1의 ,,그림 4. 모의실험에서의 ,,그림 5. 실험에서 사용한 소자의 모의실험에서 ,,실험 1의 Open-circuit voltage gain은 그림3에서 알 수 있듯이 이

시험자료 | 4페이지 | 2,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 12주차 예비 보고서 MOSFET3

A. 예비 보고서1) Source resistor가 없는 CS amplifiera) Fig. 7에 도식화된 CS amplifier 회로에서, 다음의 characteristic parameters의 이론값을 도출하세요.b) 2N7000의 spice model을 이용하여 ..

시험자료 | 11페이지 | 2,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 11주차 결과 보고서 MOSFET 2

Capacitor : 10 μFNMOS : 2N7000그림 3. Source resistor를 포함하는 CS amplifier실험 3의 회로는 그림 3과 같이 구현하였으며, 사용 ... 계산과정은 IV절 analysis에서 확인할 수 있다.4) ID가 80 mA가 될 때까지 VDD를 증가시킨 후, 이 때의 ID = ID3, VGS = VGS3을 기록하세요그림 6 ... 되었다. 계산을 통해 를 구해보면 를 얻을 수 있고 실제 실험을 통해 측정했을 때 약 3.14V가 나옴을 확인할 수 있었다.5) 실험 결과를 이용하여 threshold voltage

시험자료 | 8페이지 | 3,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 10주차 결과 보고서 MOSFET1

시험자료 | 5페이지 | 2,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 10주차 예비 보고서 MOSFET1

A. 예비 보고서1) NMOSa) 2N7000의 datasheet를 이용하여 (a) threshold voltage를 확인하고 (b) NMOS의 transconductance parameter kn 값을 추정하세요.b) Fig. 11의 회로에서 R1 = 10 kΩ라 하..

시험자료 | 8페이지 | 1,500원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 9주차 결과 보고서

시험자료 | 8페이지 | 2,000원 | 등록일 2024.07.15

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서울시립대 전전설3 9주차 예비 보고서 Diode 3

A. 예비 보고서1) pn 접합 diode를 이용한 voltage regulatora) 1N4004의 spice model을 이용하여, LTspice 상에서 Fig. 2(a)의 voltage regulator 회로를 구성하세요.b) a)의 회로에 12 V의 offset..

시험자료 | 16페이지 | 1,500원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 7주차 결과 보고서

시험자료 | 7페이지 | 2,000원 | 등록일 2024.07.15

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서울시립대 전전설3 7주차 예비 보고서

A. 예비 보고서1) Half-wave rectifier and peak detectora) 1N4004 spice model을 이용하여 LTspice 상에서 Fig. 3(a

시험자료 | 13페이지 | 1,500원 | 등록일 2024.07.15

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서울시립대 전전설3 6주차 결과 보고서 Diode 1

vD를 Table 1에 채워넣으세요.2) 실험 2 : Zener diode3) 실험 3 : Schottky diodeC. 결과 보고서1) Analysis :a) 실험 결과

시험자료 | 5페이지 | 2,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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서울시립대 전전설3 3주차 결과 보고서 Passive filter 2

3주차 결과 보고서 : Passive Filter 2000 (0000000000)Introduction :Resistor, Capacitor 및 Inductor로 구성되는 2차 ... : 3.3 mH그림 2. RLC band stop filter실험 2의 RLC band stop filter는 그림 2과 같이 구현하였으며, 사용된 소자의 값은 아래와 같 ... 다.Resistor(R) : 1036 ΩResistor(RL) :Capacitor :Inductor : 3.3 mHFunction generator는 2Vp-p인 sine wave로 세팅

시험자료 | 6페이지 | 2,000원 | 등록일 2024.07.15 | 수정일 2024.07.17

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