"Pspice따라하기"의 검색결과 입니다.

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"Pspice따라하기" 검색결과 981-1,000 / 1,808건

아주대 전자회로실험 결과보고서 3. 적분회로

는 Op-Amp를 이용하여 수학적 미분연산을 수행하는 회로이다. 즉, 시간에 따른 입력의 변화를 출력에서는 미분된 값을 보이는 회로인 것이다. 미분기를 구성하는 방법은 일반적인 ... 에 영향을 받아 발진하기 때문에, 이럴 경우, 위의 그림에 C왼쪽, 즉 입력단과 capacitor 사이에 저항을 추가하여 문제를 해결할 수 있다.(그림3-2) 이 경우,보다 낮 ... 제한된 저주파 이득을 갖는 적분기회로Op-Amp를 이용한 적분기는 Op-Amp를 이용하여 수학적 적분연산을 수행하는 회로이다. 즉, 시간에 따른 입력의 변화를 출력에서는 적분된 값

리포트 | 7페이지 | 1,500원 | 등록일 2015.10.06

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8주차 결과 전자전기컴퓨터설계 실험 3

을 확인하는 Oscilloscope의 출력값이 시간에 따라 계속 변화했기 때문에 실험초반에 정확한 결과 값을 확인하기가 힘들었다. 그렇기 때문에 Input Vin을 Power ... 다.ND gate 회로(pmos 2개 병렬연결, 저항 1개)를 그리고 구성하여 입력 2개와 출력 전압을 측정하라.회로구성Pspice입력: 0 0 출력: 1입력: 0 1 출력: 1입력 ... 회로(pmos 2개 직렬 연결, 저항 1개)를 그리고 구성하여 입력 2개와 출력 전압을 측정하라.회로구성Pspice입력: 0 0 출력: 1입력: 0 1 출력: 0입력: 1 0

리포트 | 19페이지 | 1,500원 | 등록일 2014.07.01 | 수정일 2014.07.03

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아주대 전자회로실험 예비1 부궤환 회로[학점A+]

하며, 오류를 인정하고 수정하며, 타인의 기여를 적절히 인정한다.8. 차별 안하기: 인종, 종교, 성별, 장애, 연령, 출신국 등의 요인에 관계없이 모든 사람을 공평하게 대한다.9 ... 의 방법에 따라서 가산기, 감산기, 적분, 미분 등의 연산 기능을 갖게 할 수 있는 고이득의 직류 증폭기라고 한다.- 오른쪽 그림을 보면 terminal 1은 inverting ... _{out} , 초록색이V _{i n }이다.? PSPICE 시뮬레이션 분석- 저항R _{R} 값을 변화시키면서 나온 출력 전압과 입력 전압의 값들로 전압 이득을 구해봤

리포트 | 6페이지 | 1,000원 | 등록일 2015.12.30

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반파 및 전파 정류회로 (예비)

일 때만 전류가 흐를 수 있도록 하고, 역방향 전압일 때는 전류가 흐르지 못하도록 차단한다. 다이오드에 역방향 전압이 입력되었을 때는 다이오드가 전류의 흐름을 차단하기 때문에, 저항에 걸리는 전압이 위 PSpice결과와 같이 ... 에 교류전원을 연결한 회로이다. 그림의 좌측 그래프와 같은 교류전압를 반파정류 회로에 걸어주면 다이오드의 문턱전압에 따라 출력전압에 변화가 생긴다.값이 문턱전압보다 클 경우엔 다이오드 ... 회로를 연결한다.2. 입력 전압을 바꾸어 가면서 출력 전류 및 전압을 측정하고 파형을 확인한다.PSpice 구현- 반파 정류회로위 PSpice 결과 반파 정류회로의 경우 순방향 전압

리포트 | 3페이지 | 1,000원 | 등록일 2013.05.29

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광센서와 비안정 멀티바이브레이터를 이용한 전자회로프로젝트 레포트

실험(3)PROJECT REPORT1. 실험 목적광센서를 이용해 빛의 유무에 따라 비안정 멀티바이브레이터에 연결된 LED가 켜지고 꺼지는 회로를 설계하고 이를 직접 만들어봄 ... }가 도통, 비도통의 상태를 반복하여 구형파를 발진한다. 반복 주파수는 회로의 시정수를 바꾸어서 임의로 선정할 수 있다. 결합 방법에 따라 이미터 결합형이나 컬렉터 결합형 등으로 분류 ... 는 빛이 밝은 곳에서의 저항은 매우 작으며 어두워짐에 따라 저항값이 증가하는 특징을 가지고 있고 빛의 변화량에는 즉시 응답하지 않고 10~100ms정도의 시간 지연이 있으며 빛

리포트 | 11페이지 | 1,500원 | 등록일 2016.02.14

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아주대 전자회로실험 결과보고서 4. 정궤환회로

다. 커패시터의 작용을 살펴보자. 커패시터는 +V_max의 최종적인 전압쪽으로 저항 R를 통해 충전하기 시작한다. 그러나 커패시터전압이 Vp와 동일한 전압에 도달할 때 비교기는 상태 ... 이 일치한다. 우리조가 실험했을 때 축이 바뀐 채로 그림이 나와 수정방법을 몰라서 그냥 실험을 진행하였다.먼저 실험결과와 PSPICE 시뮬레이션을 통해 구한 V _{TH}와 V _{TL ... }을 비교해보면 두 전압 모두 저항 R에 걸리는 전압이기 때문에 저항 R값에 따라 차이가 났으며 R=3k OMEGA 일 때V _{TH},V _{TL}의 절대값이 R=1k OMEGA

리포트 | 9페이지 | 1,500원 | 등록일 2015.10.06

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MOSFET-01

N7000P-Channel MOSFET FDC6329LPSPICE 상에서 이러한 트랜지스터를 사용하여 회로를 Simulation 하기 위해서는 해당 트랜지스터에 대한 Library가 필요하고 이를 PSPICE 상에서 등록해야 합니다. ... 부분 트랜지스터 역할을 하기 위해 표면이단결정 실리콘으로 도핑 되어 있다.산화막은 실리콘 산화막 형태로 구성 되는데 금속막과 절연을 하는 기능을 한다. 금속막은 MOS 트랜지스터 ... 에 전압을 인가하기 위한 지점으로 사용된다. MOS 트랜지스터는gate, source, drain3개의 터미널로 구성된다. 이것들은 각각 bipolar 트랜지스터의base

리포트 | 12페이지 | 1,000원 | 등록일 2016.04.06

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MOSFET 특성 예비보고서

-channel MOSFET드레인과 소스 사이에 전류가 흐르게 하기 위해서는 일정 전압이상의 게이트 전압을 걸어 주어야한다. 그 과정에서 게이트는 자유전자를 P영역으로 끌어당기 ... RD가 1.78kΩ, 2.0kΩ, 4.0kΩ로 변경하였을 때, 부하선에 따른 동작점을 참조하여 MOSFET의 동작 모드를 예측하고, 실험 2를 통하여 MOSFET의 동작모드 ... 를 판별.Pspice 시뮬레이션과 설명실험1)Vgs 를 0V ~ 5V 까지 Vds 를 0V ~ 10V 로 변화시켰을 때, Ids에 대한 파형이다. 앞서 기술한 드레인 곡선과 파형이 일치

리포트 | 6페이지 | 1,000원 | 등록일 2017.10.08

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9조 pre 8주 p-mos(CMOS Inverter)

해서 Gate Voltage에 따른 ID를 구해낼 수 있을 것이다. 배경이론 MOSFET는 Gate의 전압을 조절함으로써 Drain과 Source사이에 흐르는 전류를 조절하게 되 ... 는 산화막에 의해 채널로부터 절연되어 있기 때문에gate단에는 전류 소모가 없고 채널의 전도성은 gate에 전압 변화에 따라 작동되기 때문이다. 예를 들어 NMOS의 경우 주 반송 ... 자는 자유전자이므로 gate에 (+)를 인가하면 표면에서 채널 쪽으로 좀 더 많은 전자를 잡으려 하기 때문에 채널 영역은 전도성이 커지게 된다. 만일 gate 에 충분한 (+)가 인가

리포트 | 8페이지 | 2,000원 | 등록일 2014.03.06 | 수정일 2025.04.11

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가천대학교 전자공학과 기초회로실험 회로해석방법 예비 결과레포트

하기로 함.다음은 절점 방정식임. 절점 방정식에서는 기준이 되는 절점이 필요한데 이것은 기준이 되는 절점의 위치에 따라 양단에 걸리는 전압이 달라지기 때문임. 즉, 회로에서 접지 ... 음. 통상 폐 회로에 흐르는 전류의 방향은 시계방향으로 통일하기 때문에 시계 방향으로 루프 방정식을 구하는 것을 가정으로 하고 전류가 흐른다고 가정하면 아래와 같은 그림처럼 가정 ... 에 걸리는 전압은V _{R9} =R9*(I _{A} -I _{B} )가 됨. 폐 루프는 에너지 보존 법칙을 만족해야 하므로 다른 인가된 전원이 존재하는지 확인하면 V5가 존재하기 때문

리포트 | 12페이지 | 1,500원 | 등록일 2018.06.24

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다이오드 특성 및 동작원리(피스파이스)

1. diode 배 전압회로에 대한 PSpice simulation(입력전압 Vs 와 출력전압 Vo 의 파형 -2주기)2. zener diode 회로에 대한 PSpice s ... 층을 형성하고 전기장이 형성된다.이후 확산이 진행됨에 따라 결핍층 내의 이온수가 증가하게 되고 전기장이 점점 세지게 되며 어느 순간 캐리어가 이동하려는 힘과 저지하려는 전기장의 크기가 같 ... 하여 홀과 전자가 이동할 수 없는 부도체가 된다. 참고적으로 소수캐리어는 쉽게 이동할 수 있게 되며 이에 따른 약간의 전류( 누설전류, 역방향전류)가 흐른다.?다이오드 전류전압 특성

리포트 | 7페이지 | 1,000원 | 등록일 2014.12.03

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선형 연산 증폭기 회로 예비보고서

가 반전되어 출력되는 증폭기 이다. 음전압은 양 전압으로, 양 전압은 음 전압으로 신호의 모양은 유지하면서 증폭된다.반전 증폭기의 이득을 구하기 위해 회로에서 방정식을 세우 ... 면 : V- = (RfVin + RinVOUT) / Rf + Rin이득(Gain) 방정식 Vout 구하기 위해 V−을 치환하면->여기서 AOL가 매우 크면(이상적 연산 증폭기는 무한대 ... 전압 강하를 줄이는데 목적이 있다. 또 어떤 연산 증폭기의 신호 왜곡을 줄이는데 사용하기도 한다.연산 증폭기의 특징인 입력단자 V+와 V-에 흘러 들어가는 입력 전류는 0이고, V

리포트 | 9페이지 | 1,000원 | 등록일 2016.06.18

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[5주차] 실험 9. 최대 전력전달, 실험 10. 오실로스코프의 사용법, 실험 11. PSpice를 이용한 회로의 Simulation 및 설계과제 결과보고서

.500그림 9-3. 부하에서 최대 전력전달을 얻기 위한 회로.표 9-3. 에서 최대 전력을 구하기 위한 실험 데이터.RL [Ω]RL [Ω] 측정값R + RL [Ω]VL [V]W=VL2 ... 에 따른 의 그래프.그림 9-5. 최대 전력전송을 위한 부하저항 의 결정에 대한 회로.표 9-4. 최대 전력 전송을 위한 의 조건.(측정치)[Ω][Ω][V][V][A](계산 ... 이 RL과 병렬 연결되면 합성저항은 각 저항보다 작아지고 따라서 V에 의한 전압은 더 적게 걸린다. 따라서 측정된 VL값이 이론 값들보다 조금씩 작게 나왔고 이 때문일 수 있다. 실제로

리포트 | 28페이지 | 1,000원 | 등록일 2014.02.17 | 수정일 2014.11.26

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아주대학교 전자회로실험 실험5 결과보고서

실험5. 능동 필터회로1) 예상결과(PSPICE)Pspice 그림결과 값100Hz200Hz500Hz1kHz2kHz5kHz10kHzfV _{IN} (p-p)V _{out} (p-p ... 나오다가 주파수가 올라감에 따라 전압 이득이 0으로 떨어지는 이유이다. 사뮬레이션에서 처음에 주파수가 100Hz일때에 전압 이득은 0.997로 1에 가까운 전압 이득이 나오다가 주파 ... 수가 점점 올라감에 따라 전압 이득이 내려가는데 주파수가 10kHz까지 올라갔을 때의 전압 이득은 0.194 가 나와 전압 이득이 0에 가까운 값이 나오는 것을 확인 할 수 있

리포트 | 9페이지 | 3,000원 | 등록일 2014.11.30 | 수정일 2015.03.24

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전자회로실험 공통이미터회로 AC특성 및 임피던스

DC 해석을 하기 위하여 DC 등가회로를 그린다. 이때 Current Gain B = 100이 되는 Q-POINT와 그 때의 R1, R2, R3값을 찾는다. PSPICE를 통해 ... = 15923.56옴이다. 따라서 C1의 값에 따라 입력 임피던스 Zin이 변화하게 된다.2.2 PSPICE 모의 실험아래의 그림은 X Value = Vcc가 12v일 때 IC가 IB ... 확인한 값은 아래와 같다.C1에서 바라본 임피던스 Zin을 구하기 위해서 위의 회로를 소신호 등가회로로 변경하면위의 회로에서 Rs는 C1이고, R은 R1||R2, Ri=Zin

리포트 | 10페이지 | 1,000원 | 등록일 2012.12.31

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5.클리퍼 회로

되더라도 그 영향을 예측할 수 있고, 완전한 해석도 가능하다.실험회로 및 시뮬레이션 결과위와 같은 회로들을 구성하고 입력전압을 구하고 그에따른 파형을 알아본다.Pspice실험방법 및 ... 은 출력이 다이오드와 별렬로 된 회로이다. 다이오드의 연결 방향에 따라 잘라지는 파형의 위치가 바뀌는데, 특정레벨 이상을 잘라내는 클리퍼 회로에 저항을 직렬로 연결하고 다이오드 ... 유의사항이번 실험은 직렬 및 병렬 클리퍼 회로의 출력 전압을 계산하고 측정하는 실험이다. 다이오드를 이용하기 때문에 극성에 유의하며 연결해야되고 함수발생기를 통해 전원을 입력

리포트 | 2페이지 | 1,000원 | 등록일 2014.11.26

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전전컴설계실험1-8주차예비

Lab다. 그리고 실제로 계산하여 구한 이론값과 simulation 결과를 비교한다.-PreLab 2아래의 회로를 PSpice를 통해 구현하고 simulation 하여 회로에서 Vo ... 는 어떠한가? 를 확인하기 위해서 V를 0V, I를 0mA로 가정하여 계산하여 성립하는지 확인한다.입력 전압 Vs 로 Vpp = 100 mV 를 인가할 때, 출력 V0의 값은 어떻게 되 ... 는가? Op-Amp의 전압이득 계산법을 이용하여 Vpp를 인가하였을 때 Vo값을 계산한다.-PreLab 4아래의 회로에서 +==0이 성립하는가? +==0는 어떠한가?를 확인하기 위

리포트 | 20페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15

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토비스 연구개발 회로 설계 필기 합격자소서 입니다. 합격당시 취업상태로 면접은 참여하지 않았습니다. 서류는 넣은 후 한참 뒤에 합격 연락 왔습니다.

을 했습니다. 출입인원을 관리하며 하기에는 시간이 부족했고 입고 후 1달이 지나서 배치되는 경우가 많았습니다. 새 도서를 기다리는 이들을 위해 근무시간이 아닐 때 자발적으로 1주일 ... 에 따라 경청할 때와 필기 시간을 결정하고자 노력하였습니다.저는 어떤 것이든 노력하면 이룰 수 있다는 생각을 하고 있습니다. 개발자로서 보완할 것이 있거나, 팀의 구성원으로서 부족 ... 하는 오류들을 가급적 빠르고 정확하게 수정하기 위해 간단한 출력까지 기입하였습니다. 3개월 짧지만, 취업 활동과 준비는 멀리하고 오로지 역량 향상에 집중하였습니다. 성적이나 감시가 없

자기소개서 | 3페이지 | 3,000원 | 등록일 2017.03.02 | 수정일 2017.04.03

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전자통신기초실험 12. 공통 콜렉터 증폭기 결과보고서.

중요하고, 무시하기에는 비교적 큰 오차범위를 가지고 있다. 두 번째로는, 저번 실험에서 살펴본것과 같이 신호발생기의 내부저항이 오차의 원인이 될 수 있다. PSPICE에서는 600 ... 차단 주파수를 측정하기 위해서는 V _{p`p`}가 0.26V 가 되는 지점을 찾아야 하지만 Time/division을기계 허용 한계 까지 낮춰도 진폭을 볼 수 없으므로, 측정 할 ... 들은 온도에 영향을 받으니, 온도에 따라 오차가 발생할 수도 있을 것이다. 트랜지스터 뿐만 아니라 모든 기기들도 온도에 영향을 받는다. 그러므로 이 또한 오차의 원인으로 생각해 볼

리포트 | 5페이지 | 1,500원 | 등록일 2015.04.20

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[12주차] 실험22. 직렬공진의 특성, 실험 23. 병렬 공진회로, 실험 24. 미, 적분 회로 및 설계과제 결과보고서

.62712.516fR + 20006.82342.1257.51314.142f에 따른 IL과 IC의 그래프PSpice simulation 결과교점의 주파수 =5.0330[kHz]3. 결과 ... 발생기출력 최소로 고정)표 22-2. 회로의 공진주파수 결정 실험.신호발생기 전압[Vp-p]양단의 전압[Vp-p]신호발생기 주파수[kHz]1.2381944.51PSpice s ... .225PSpice simulation 결과C양단의 전압 VC=94.401[Vp-p]신호발생기 주파수 =50.005[kHz](3) 회로의 Q 가 직렬 공진회로의 주파수 특성에 주는 영향

리포트 | 24페이지 | 1,000원 | 등록일 2014.02.17 | 수정일 2014.11.26

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