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"아주대학교 논리회로실험" 검색결과 61-80 / 447건

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    아주대학교 논리회로실험 실험4 결과보고서
    는 결과가 나왔다. 모든 진리표를 실험했고 올바른 Y값을 출력했다. 결선도를 차근차근 따라가 꼼꼼히 회로를 구성하여야 할 것이다.분석-앞에서 복잡한 회로구성에 익숙해 졌기 때문에 이번 ... 실험의 회로 구성은 빠르게 할 수 있었다. 진리표에 맞는 올바른 결과를 얻었다. 첫 사진의 실험은 E=0, S1=0, S2=0, D3=0, D2=0, D1=0, D0=1 를 입력했고 X=0, Y=1 으로 진리표에 맞는 결과가 나왔다. ... 분석-우선 결선도도 제대로 그리고 갔지만 지금까지 짜왓던 회로들보다 훨씬 복잡하여 회로를 완성했지만 제대로 결과값이 나오지 않았다. 부분 부분 수정해 보았지만 제대로 결과가 나오
    리포트 | 6페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험2 예비보고서
    of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험학 번:성 명:EXPERIMENT 2 ... - CMOS의 회로의 전기적 특성 -1. 실험목적1) CMOS를 이용한 논리소자가 Logic level을 판별하는 방법과 이상적인 논리 소자와 달리 실제 논리 소자가 어떤 특성을 가지 ... 소자vel 판정방식*logic level : 논리 회로에서 2개의 논리값에 대응하는 신호값. 논리 조건(긍정 또는 부정)을 수치로 표시한 것으로 논리 대수에서는 긍정을 1, 부정
    리포트 | 9페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험8 결과보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.과목명: 논리회로실험EXPERIMENT 8- Counter -1 ... . 실험 결과실험 11) 2단 2진 카운터 ? 비동기식 카운터2단 2진 카운터 ? 비동기식 카운터의 회로도결선도실험 결과- 진리표BAA'B' (0)AB' (1)A'B (2)AB (3 ... 하는 순환하는 회로임을 확인 할 수 있었다. 사진과 같이 올바른 실험 결과를 얻었다. 실험에 구성한 회로는 결선도 대로 구성하였고 예상했던 실험결과와 일치하였다.2) 3진 Counter
    리포트 | 6페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험9 예비보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험EXPERIMENT 8 ... 의 입력값에 따라 출력값을 살펴보면 결과는 아래와 같을 것이다.실험 2. 16bit IC RAM위와 같이 회로를 구성한다.데이터를 쓸때는 GWN을 5V에 접속 하고 Memory ... 실험8 예비보고서IEEE Code of Ethics(출처: http://www.ieee.org)We, the members of the IEEE, in recognition of
    리포트 | 5페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험10 결과보고서
    (1) 계단 파형 관찰회로를 구성하고 계단 파형이 출력되는지 관찰하는 실험이다. 실험결과 계단 파형이 각 주기마다 9계단 씩 하강으로 출력이 되었음을 사진을 통해 확인할 수 있 ... 다. 앞으로 실험에서 이 회로를 변화시키며 결과 출력화면의 변화를 관찰할 것이다. 결선도대로 회로를 구성하였고 사진의 결과를 얻었다. 예상결과에서는 위의 사진과 같은 결과가 나올 것 ... 으로 바꾸어 실험을 하였다. 결과는 진폭이 줄어든 파형이 나왔다. 4.5kΩ 일 때는 9개의 계단이 형성되었는데 저항을 2.7kΩ으로 바꾸면 5개에서 6개의 계단이 나타나는데 이는 증폭
    리포트 | 5페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험4 예비보고서
    하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험1. 실험 목적- 멀티플렉서와 디멀티플렉서의 원리를 이해 ... 하고 실험을 통해 동작을 확인한다.2. 실험 이론- 멀티플렉서 : 멀티플렉서는 여러 개의 입력선 중에서 하나를 선택하여 단일의 출력으로 내보내는 조합논리회로이다. 특정 입력선 ... 멀티플렉서는 데이터 분배기라고도 불리며, 멀티플렉서와는 반대되는 연산을 수행하는 조합논리회로이다. 이것은 한 개의 입력선으로부터 정보를 받아 이를2 ^{n}개의 출력선 중의 하나로
    리포트 | 10페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험1 Basic Gates 예비보고서
    in following this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험 ... . 참고 문헌1) 논리회로실험 7쪽, 정영모·조혜경·박영환 공저, 2003, 다산서고2) Digital 논리회로실험 57~58쪽, 고재원·김영채·김재평·문현옥 공저, 2007, 지앤북3) 논리회로실험, 이순흠·최관순 공저, 2007, 상학당결선도는 다음장에 있습니다6 결선도 ... 학 번:성 명:EXPERIMENT 1- Basic Gates -1. 실험목적1) NOT, OR, AND, XOR 등의 게이트의 기본적인 논리 함수와 동작 특성을 이해한다.2) 논리
    리포트 | 5페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험1 Basic Gates 결과보고서
    in following this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험 ... 했던 논리 게이트의 동작을 LED를 이용하여 직접 확인함으로서 보다 정확하게 이해할 수 있었다. 논리회로의 배열에 따라 아주 다양한 논리연산이 가능하다는 것도 또한 알 수 있었다. ... 실험1 Basic Gates 결과보고서IEEE Code of Ethics(출처: http://www.ieee.org)We, the members of the IEEE, in
    리포트 | 7페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험2 CMOS의 회로의 전기적 특성 결과보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험학 번:성 명 ... :EXPERIMENT 2- CMOS의 회로의 전기적 특성 -1. 실험 결과실험 11) Inverter의 입출력 특성 확인logic diagram결선도실험 사진오실로스코프 화면2) 분석결선도 ... 기 위해 세가지 측면에서 접근했다. 실험 1,2 에서는 신호의 입력, 실험 3에서는 신호의 출력, 실험 4에서는 신호의 시간지연에 대해 알아봤다.실험 1에서는 CMOS회로가 입력
    리포트 | 7페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험3 가산김.감산기 결과보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험학 번:성 명 ... 한 연산을 하는 논리회로가 바로 전가산기이다.실험 31) 반감산기logic diagram결선도x=0, y=0x=0, y=1x=0, y=02) 진리표입력출력ABB(내림수)D(차 ... 수)*************1013) 분석이 실험은 반가산기의 회로를 미리 설계하였다. 그리고 그 예상 값을 구해와 실제로 회로를 구성하고 결과를 예상 값과 비교 해보았다. 결과
    리포트 | 6페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로 실험 설계 예비보고서
    논리회로 실험설계설계주제:스톱워치목차1. 설계 목표2. 동작 조건3. 동작 설명 및 알고리즘4. 1차 설계 및 분석(1) Clock dividing part(2) 7-s ... ) 총 설계 회로5. 예상 결과 & 미작동 시 대처1. 설계 목표- FPGA를 사용하여 자유 주제로서 스톱워치를 설계한다.(기본의 심화 과제인 start/stop의 기능과 up ... 할 수 없음을 고려하고, 이를 해결하기 위해 74151 MUX와 7447 Decoder를 이용해 회로를 구성한다. MUX는 필연적으로 control signal이 필요할 수 밖에 없
    리포트 | 10페이지 | 2,000원 | 등록일 2016.06.14
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    아주대학교 논리회로실험 설계 에비보고서
    [설계 Project. Up/Down Counter 설계]? 실험 목적- FPGA를 이용하여 Up ? Down Counter를 설계한다.? 작동 원리 설명1. 기능 설명- 보드 ... 를 받으면 현재 상태에서 99999까지 남은 숫자를 down-counting으로 전환한다.- 동작 중 key0 신호를 받으면 현재 상태에서 정지한다.2. Part별 설계 회로 분석 ... [Switch Part] : Start/Stop 버튼오른쪽의 회로에서 각각의 두 버튼에 JK플립플롭을 사용하였다. JK플립플롭은 SR플립플롭에서 정의되지 않은 S와R이 ‘11’상황
    리포트 | 6페이지 | 1,500원 | 등록일 2016.06.16
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    아주대학교 논리회로실험Basic Gates결과
    논리회로 실험 결과보고서실험1.Basic Gates 결과보고서1.실험의 결과실험1) 3-input AND gate 구성-회로를 구성하고, 출력결과를 토대로 Truth table ... Truth table을 작성하라.truth tableINPUTOUTPUTABXYZ000000111110101111012. 실험에 대한 고찰이번 실험은 논리회로실험에서 쓰이는 가장 기본적인 ... 사용하기도 했다. 이번 실험을 통해 기초적인 논리회로를 구성할 수 있게 됐다. 기본적인 게이트들에 대해서도 이해할 수 있게 됐다.추가 적으로 De Morgan의 법칙과 PULL
    리포트 | 8페이지 | 1,000원 | 등록일 2013.11.29
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    아주대학교 논리회로실험Basic Gates예비
    이해2. 실험 이론1) Logic Gate 의 기본적인 특성논리회로의 Logic Gates는 AND, OR, NOT, XOR등의 논리연산을 수행한다.논리회로의 Logic gates ... 한 것을 논리합 한 것과 같다는 것을 나타낸 정리. 이것을 이용하면 어떠한 논리 회로도 NAND와 NOR를 사용하여 간략하게 나타낼 수 있다.3.실험절차 및 예상결과1) 실험 준비물 ... 실험1. Basic Gates1. 실험 목적1) Logic gates의 이해2) Logic 회로 구성 법칙의 이해-Boolean equation의 이해-De Morgan의 법칙
    리포트 | 6페이지 | 1,000원 | 등록일 2013.11.29
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    아주대학교 논리회로실험 실험4 예비보고서
    IC칩 안에는 앞서 실험에서 구성한 회로가 들어 있을 것이라 예상할 수 있다.ⅱ) Demultiplexer☞ Enable을 갖는 1x4 디멀티플렉서를 74HC11과 74HC04 ... 를 이용하여 다음 회로와 같이 구성한다. 데이터 입력 D는 enable 입력의 역할도 동시에 함을 주목하여 실험한다.☞ 다음 표와 같이 입력을 가한 뒤에 출력 Y3, Y2, Y1, Y0 ... XXXXXX000111000+511010+5010110+5+50111☞ Truth Table을 살펴보면 앞선 실험과 다른 결과가 나온 것으로 보이는 이유는 앞선 실험의 구성 회로
    리포트 | 10페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험 실험6 예비보고서
    1. 실험목적여러 종류의 filp-flop을 구성하고 그 동작 특성을 알아본다.2. 실험이론래치와 플립플롭은 대부분의 순차 회로를 구성하는 기본적인 블록이다. 래치와 플립플롭 ... 에 의해 미리 정의되어 있는 셀들로 구성되어 있다. 표준 IC와 ASIC에 각각의 래치와 플립플롭의 셀을 독자적인 논리 게이트나 귀환 루프를 사용하여 귀환 순서 회로롤 설계 ... 할 수 있는 회로이며 순차 회로의 기본요소이다. 조합논리회로에 비해 플립플롭은 이전상태를 계속 유지하여 저장한다. 디지털 공학에서 입력을 출력에 반영하는 시점을 클럭 신호의 순간
    리포트 | 13페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험 실험8 예비보고서
    )의 코드변환 동작에 관해 실험하고 그 동작원리를 이해2. 실험이론카운터카운터라는 이름은 그림과 같이 상태도가 하나의 사이클을 포함하는모든 클럭드 순차 회로에 일반적으로 사용된다. 카운터 ... 1. 실험목적① 카운터의 동작원리와 특성을 이해② 2진 시스템에서의 숫자표시와 2진 카운터에 대해 이해③ 카운터를 이용해 디코딩(decoding)과 인코딩(encoding ... 하다. 출력은 EN이 유효할 때, 그리고 유효할 때에만 T의 상승 에지에서 토글한다. EN 입력에 연결된 조합 논리가 T의 상승 에지마다 어떤 플립플롭이 토글할지를 결정한다.첫 번째 그림
    리포트 | 9페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험 실험10 예비보고서
    1. 실험목적D/A와 A/D 변환기(converters)회로의 구성과 동작 원리에 대해 이해하고, 응용 능력을 키운다.-DAC : digital 신호를 analog 신호로 변환 ... (=CLKB)과 연결하면 "0000"에서"1001" 까지 Count 합니다.LM741operationalAmplifier4. 실험과정실험1 : DAC① 다음과 같은 회로를 구성 ... 실험 1회로의 출력에 아래와 같은 비교기를 부가한다. ADC는 아니지만 비교기를 통해 analog 신호에 대한 digital 신호 값 유추 가능하다② 1KHz pulse를 s
    리포트 | 10페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험 실험3 예비보고서
    이 된다.)Full Adder (전가산기)논리게이트를 이용하여 2개의 비트 와 자리올림C _{i`n`} 을 더해 SumC _{out}을 표현하는 회로를 구성한다.반가산기 회로 2개 ... 에게 빌려준 1(전단계에서는 1+1에 해당) 고려한 두 비트의 뺄셈을 수행하는 논리회로를 구성한다.빌림수 입력을 취급하기 위해 변수 A,B에 추가로 C의 입력이 한 개 필요하다.반 ... 1) 실험목적1. Logic gate를 이용해서 가산기(adder)와 감산기 (substractor)를 구성한다.2. 디지털 시스템의 기본 요소인 가산기와 감산기의 기본 구조 및
    리포트 | 7페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험 실험5 예비보고서
    화된 출력으로 변환하는 다중 입력, 다중 출력 논리회로이며 입력과 출력코드는 서로 다르다. 입력 코드는 일반적으로 출력 코드보다 작은 비트수를 가지며, 입력 코드 워드(code ... 에서 실험할 디코더는 가장 보편적인 디코더로 회로는 n-to-2 ^{n} 디코더 혹은 이진 디코더(binary decoder)이다. 이러한 디코더는 n비트 2진 입력 코드와 1-out ... 1. 실험목적디코딩(decoding)과 인코딩(encoding)의 코드변환 동작에 관해 실험하고 그 동작원리를 이해한다.2. 실험이론디코더(decoder)는 부호화된 입력을 부호
    리포트 | 10페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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2025년 08월 17일 일요일
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