"VHDL code"의 검색결과 입니다.

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vhdl 7segment display fpga 프로젝트 VHDL 자판기 ALU VHDL 7segment 스톱워치 회로

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"VHDL code" 검색결과 361-380 / 520건

VLSI

Verilog/VHDL ProjectSynopsys Project◈ DescriptionWe changed our design from ‘Traffic Signal

리포트 | 10페이지 | 1,000원 | 등록일 2012.02.14

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FPGA의 이해와 기초

를 하면 FPGA가 어떻게 구성되고 FPGA를 설계하는데 필요한 여러 용어들을 쉽게 이해할 수 있다.다음 그림과 같은 로직을 설계한다고 가정한다. 이에 해당하는 VHDL 코드 ... " 그림 2 VHDL SOURCE PAGEREF _Toc184482418 \h 5 HYPERLINK \l "_Toc184482419" 그림 3 SCHEMATIC MODULE ... VHDL SOURCE그림 SEQ 그림 \* ARABIC 3 SCHEMATIC MODULE그림 SEQ 그림 \* ARABIC 4 Synthesis ReportCPLD 내부에는 실제

리포트 | 16페이지 | 2,000원 | 등록일 2012.03.14 | 수정일 2017.02.24

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VHDL MUX and DEMUX(VHDL Code post lab 입니다)

전자전기컴퓨터설계실험IIIPOSTLAB REPORT[MUX and DEMUX]학 과담당교수조학 번이 름제 출 일목 차 HYPERLINK \l "실험소개" 1. 실 험 소 개 HYPERLINK \l "purpose" 1) Purpose of the Experiment H..

리포트 | 10페이지 | 2,000원 | 등록일 2008.09.28

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VHDL Digital Watch(LCD) VHDL PPT입니다.

차(5.26 ~ 6. 1) LCD Interface source code 분석 Digital Watch VHDL source coding Emulation in BoardWork ... of Members: Basic Requirement Digital Watch 기능 자료 수집 및 Source code 작성 : Additional Functionality - 날짜 ... (년, 월, 일)표시 기능 - 자료수집 및 Source code 작성 : Additional Functionality – 정각 알림 기능(LED로 표시) – 자료수집 및

리포트 | 14페이지 | 2,000원 | 등록일 2008.09.28

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아날로그신호와 디지털신호의 비교

마다 자리값을 가지지 않는 가중치 없는 코드(unweighted code)이다11.아스키코드와 EBCDIC 코드* 아스키(ASCII)코드 (American Standard Code for ... (Extended Binary coded Decimal Interchange Code)- IBM에서 개발한 8비트 코드로 256가지 정보 표현- 2개의 존과 디지트로 구성12.해밍 ... .hamming code의 표현형식과 오류 검출 방법1 2 3 4 5 6 7P1 P2 D1 P3 D2 D3 D4P1 => 1,3,5,6행에 대해서 짝수 패리티 = C1P2 => 2,3

리포트 | 5페이지 | 1,000원 | 등록일 2007.11.07

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디지털시스템설계_Baseline구조의이해&RegisterFile설계

의 값은 0 이된다.이때 유의해야 할 점은 ( pseudo code에 의하면 ) reset과 WR 과정은 CLK에 동기화 되어있지만, Src나 Dest는 CLK 와 상관없이 ... Addr_A, Addr_B가 변하는 즉시 그 값을 가리킬 수 있어야 한다. 이에대한 사항을 만족하는 블록을 VHDL로 설계한 코드는 다음과 같다.library ieee;use ieee ... 파일 블록을 설계하여 VHDL 을 이용해 검증하고, Test Bench를 만들어 simulation 해본다.2. 실험 내용(1) 레지스터 파일의 설계레지스터 파일은 내부

리포트 | 7페이지 | 1,500원 | 등록일 2008.02.19

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VHDL을 이용한 Shift Register구현

개 필요하다. 그 회로는 다음과같이 나타낼 수 있다.▶ Mux source code & Simulationlibrary ieee; use ieee.std_logic_1164.all ... VHDL실습 4주차 레포트Shift Register담당교수 :담당조교 :전자공학과▶Shift Register?매 클록 주기로 모든 비트를 한 자리 옮기게 하는 레지스터(전자회로

리포트 | 7페이지 | 2,000원 | 등록일 2010.12.27

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VHDL 설계과제 LINE TRACER

기 말 프 로 젝 트 보 고 서- VHDL 설계과제 : LINE TRACER -1. 프로젝트 개요1.1 목 표▶ 적외선 센서를 사용하는 라인트레이서를 VHDL을 사용하여 구현 ... 을 이탈한 후 다시 라인을 찾는 동작과 정지 신호를 인식한 후 정지하였다가 다시 주행하는 동작이 라인트레이서의 코드 설계의 주요 문제이다.그리고 라인트레이서가 라인을 정확하게 인식할 수 ... , testbench를 통한 라인트레이서의 시뮬레이션 결과 라인트레이서는 정상 작동 하고 있다는 사실을 알 수 있다.3. 프로젝트 고찰3.1 프로젝트 결과에 대한 고찰▶ VHDL를 통한 라인

리포트 | 6페이지 | 5,000원 | 등록일 2012.03.11

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VHDL를 이용한 농구전광판 구현

Introduction LCD Module 과 7-Segment의 특성을 이해한다. VHDL을 이용하여 Training KIT의 LCD와 7-Segmaent를 이용하여 농구

리포트 | 33페이지 | 5,000원 | 등록일 2010.05.27

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Counters.

Counters1. IntroductionCounter의 동작에 대해 알아보고 VHDL코드로 작성합니다. 여러 종류의 Counter(8-bit up counter with an ... asynchronous reset, 74LS193A counters) 에 대해서 알아보고 VHDL 로 구현해 봅니다.2. MethodsCounter입력에 따라서 미리 정해진 순서

리포트 | 13페이지 | 1,500원 | 등록일 2010.11.02

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C 기반 ALU 설계. 컴퓨터구조 ALU 설계 과제

에 오히려 프로그래밍 하기 쉬운 편리한 언어로 평가되며 , 프로그램을 간결하게 쓰기 위하여 많은 연구를 한 언어이다 . C 언어의 기본 특징은 ASCII 코드 체계로 영문 소문자 ... 미디어 컴퓨터구조 설계 : VHDL 코딩을 중심으로 / 이강현 / 대영사 컴퓨터 구조와 설계 / Pollard, L. Howard/ 대영사 컴퓨터 구조 및 설계 / Heuring , Vincent P / 아이티씨{nameOfApplication=Show}

리포트 | 33페이지 | 3,500원 | 등록일 2013.01.28

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VHDL을 이용한 엘리베이터 설계

펄스동안 유지된다.⑤ Testbench - 설계한 코드를 시뮬레이션하여 동작을 검증하기 위해 테스트 벤치를 작성해야 한다. 테스트 벤치 또한 일반적인 VHDL 코드와 같은 구성 ... [Project 2] VHDL을 이용한 엘리베이터 설계1. 개요- 5개의 층을 가지는 건물의 엘리베이터를 최대한 실제와 비슷하게 설계한다.- 엘리베이터는 모든 층에서 출발, 정지 ... 을 가진다. 필요한 신호를 정의하기 위해 라이브러리를 선언하고, 시뮬레이션하기 위한 코드이므로 entity의 port 선언은 없다. Architecture에서 신호를 정의할 수 있

리포트 | 6페이지 | 4,000원 | 등록일 2011.07.05 | 수정일 2014.10.22

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2-port OR gate

을 마우스 오른쪽 클릭을 한 후, New Source를 클릭하여 VHDL Test Bench를 클릭한다. 새로운 코드를 입력하도록 파일이 생산되는데, Begin과 End process ... 2주차 과제1. 설계 배경 및 목표이론적으로 배운 기본적인 VHDL의 개요를 알고 VHDL 프로그램 (Xilinx ISE, ModelSim XE)의 사용법을 습득한다. 2 ... ; ( 참고 문헌 : ISE를 이용한 VHDL 및 FPGA 실습, 이준성 외 3인 공저, 2008년, 북스힐)3. 설계 내용 및 방법Textfile 생성 Xlinx ISE 9.2i 파일

리포트 | 17페이지 | 1,000원 | 등록일 2010.06.24

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논리회로설계실험 7-Segment 제어기 설계

1.VHDL 코드library IEEE;use IEEE.std_logic_1164.all;use IEEE.std_logic_arith.all

리포트 | 4페이지 | 3,000원 | 등록일 2010.12.22

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VHDL을 이용한 7세그먼트 실험보고서입니다.

TMP_D

리포트 | 12페이지 | 2,000원 | 등록일 2011.06.22

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VHDL을 이용한 엘리베이터(승강기) 설계 프로젝트

도록 하겠습니다. 그래서 서로 미미한 부분은 도와주고 새로운 기능에 대해 토의하는 시간을 갖겠습니다.1. 서론수업시간에 배운 VHDL언어를 사용하여 우리 주변에 쓰이는 단일 엘리 ... 고 차근차근 처음부터 다시 설계하였습니다. 설계하는 부분에서 각자 맡은 기능을 구현하였고 코드를 합치는 부분은 모두 모여서 같이 진행을 하였습니다. 이번 프로젝트로 인해서 수업시간 ... 에 배운 내용들을 좀더 복습할수 있었고 나아가 VHDL이라는 언어에 대해서도 조금더 이해할 수 있었던 좋은 기회였던 것 같습니다. 그리고 우리 생활 속에서도 많은 부분이 이런 언어

리포트 | 19페이지 | 5,000원 | 등록일 2011.12.17

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xilinx를 이용한 FSM설계

VHDL 코드가 나와있어서 4-state를 나타내는 데는 크게 무리가 없었다.5. 토 의현재상태와 차기 상태를 비교하기 위하여 내부 시그널 temp를 설정해주어 임시 저장된 차기 ... 한다. • 3-state Mealy 상태도의 VHDL Modeling Example을 참조하여 그림 과 같은 4-state Mealy 상태도를 VHDL로 설계한다. • 결과 ... 실습을 토대로 코드를 짠다면 좀 더 응용된 결과물을 출력할 수 있을 것이다.{nameOfApplication=Show}

리포트 | 11페이지 | 1,500원 | 등록일 2010.06.24

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논리회로설계실험 메모리 설계

1.VHDL 코드library IEEE;use IEEE.std_logic_1164.all;use IEEE.std_logic_unsigned.all;entity

리포트 | 3페이지 | 3,000원 | 등록일 2010.12.22

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VHDL를 활용한 EE ATM 설계하기

므로서 LCD 화면을 구성한다. 이 역시 VHDL 코드에서 활용 되었는데 먼저 수평으로 CLK를 분주하고 그 CLK을 다시 수직으로 분주하여 하나의 수평 CLK에 모든 수직값이 표시 ... 수정날짜내용1주차(11/12~11/18) - 전체적인 메인함수를 VHDL을 통해 설계2주차(11/19~11/25) - step motor, text lcd, dot matrix

리포트 | 20페이지 | 2,000원 | 등록일 2013.08.11

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논리회로, 디지털공학, 회로 설계

및 구현⑹ 설계 ⑤：인코더와 디코더 설계 및 구현⑺ 설계 ⑥：멀티플렉서와 디멀티플렉서⑻ 설계 ⑦：코드변환기⑼ 설계 ⑧：플립플롭⑽ 설계 ⑨：비동기식 카운터⑾ 설계 ⑩：동기식 카운터 ... 도구이고 1988년 벤 코헨에 의해 설립되었다.제공하는 소자로는 74시리즈, 입출력 및 전원 관련 소자, 아날로그 소자, 디지털 게이트, 조합회로, 스파이스 회로, VHDL 등 ... 0000111111110001111111101010111111011011111110111100111101111101111011111110110111111111101111111⑻ 설계 ⑦：코드변환기

리포트 | 61페이지 | 2,500원 | 등록일 2013.10.16

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