"Pulse회로"의 검색결과 입니다.

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전자회로설계 전자회로설계실습 atmega128 전전설1 pspice 플립플롭의 기능 pulse 구형파그리기 스텝모터 smps adc 회로 pacemaker

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"Pulse회로" 검색결과 361-380 / 1,645건

6주차 인코더를이용한모터상수측정실험

number of pulses counted in a time intervalnumber of pulses generated by the encoder per shaft ... revolutiontotal pulses per revolution of encoderwheel diameter in meter3. DC motorDC 모터는 DC(직류)를 사용하는 모터 ... 모터가 돌아가게 된다. Construction of DC Motor4. Motor velocity constant모터의 속도상수를 구하기 위해 우선 의 회로에 키르히호프의 법칙

리포트 | 8페이지 | 1,000원 | 등록일 2018.11.02

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타이머- 실험예비레포트

이후에 안정 상태로 돌아가는 펄스(pulse) 형태의 출력을 가진다.② totem-pole outputTTL의 출력회로. 출력이 High or Low로 출력되는 것을 말한다. 이때 ... 의 구형파(clock)을 만드는 astable multivibrator 회로가 대표적이다. 같은 multivibrator circuit의 경우에도 단안정 또는 쌍안정(bistable ... 부터 반시계방향으로 번호를 매긴다.⑤ High/Low state논리회로의 참(1), 거짓(0)에 사상하는 전기적 신호 상태. ②로 구현할 수 있다.⑥ bypass capacitor

리포트 | 3페이지 | 1,000원 | 등록일 2020.04.15

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counter 회로

REPORT제목 : counter 회로수강과목 : 기초전자실험21.실험목적-counter 회로의 동작원리에 대해 이해하고 실험을 통해 확인한다.2.실험 배경 이론counter ... 회로-입력되는 펄스의 수를 세는 장치-플립플롭을 연속적으로 연결하여 구성플립플롭의 연결숫자에 의해 count 개수가 결정counter의 종류-비동기식 카운터(asymchromous ... counter)첫 번째 플립플롭의 CP(clock pulse)에만 클록펄스 입력나머지 플립플롭은 직전 플립플롭의 출력을 cp 입력으로 사용-동기식 카운터(synchronous c

리포트 | 10페이지 | 1,000원 | 등록일 2018.11.02

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EMP 효과

EMP 효과[ Electromagnetic Pulse effect, -效果 ]전자기펄스(EMP)로 인하여 나타나는 전자 방출 효과로, 전자기펄스의 영향을 받는 곳에 있는 모든 ... 전자기기는 파괴된다.EMP(Electromagnetic Pulse, 전자기펄스)란 핵폭발에 의하여 생기는 전자기 충격파이다. 핵폭발이 일어나면 전자기파와 중성자가 생성되는데, 이때 ... 는 전자회로로 들어가 전류가 되는데, EMP가 지닌 에너지가 엄청나게 크기 때문에 회로가 버틸 수 없는 정도의 과전류가 흐르게 되고, 이 과전류가 전자회로를 파괴시킴으로써 반도체

리포트 | 11페이지 | 1,000원 | 등록일 2020.07.28

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미래복합재난 시나리오 공모전 발표자료(PPT)

(Electromagnetic Pulse) EMP(Electromagnetic Pulse) 란 ? 순간적인 강력한 전자기 충격파로 인하여 나타나는 전자 방출 효과 EMP 로 인해 영향권 내의 모든 전자기기 ... 및 회로 손상 , 오동작 유발 EMP 테러공격 사례 1990 년 , 걸프전 당시 美 EMP 탄 공격으로 이라크 군 지휘통제시설 무력화 현재 다양한 형태의 소형 EMP 장비가 자체

리포트 | 8페이지 | 3,000원 | 등록일 2020.03.07

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아주대학교 기초전기실험 A+ ac 13, ac 14 예비보고서

filter의 특성을 이해해 본다.2. 이론1) 필터회로펄스 파(pulse wave)란 지속되는 시간이 극히 짧고, 일정한 주기로 반복되는 전압이나 전류의 파형을 말한다. 펄스 ... t Circuits -1. 실험 목적- 병렬로 연결된 공진회로의 기본적인 공식들을 입증해본다.- 회로 내 주파수에 따른 회로의 다양한 전류와 전압을 측정하여 그래프로 그려본다. ... - 공진회로에서 임피던스가 가장 작을 때가 언제인지를 알아보고 증명해본다.- 병렬로 연결된 공진회로의 Q값과 bandwidth와의 관계를 알아본다.2. 이론1) 병렬 공진 회로일반

리포트 | 9페이지 | 1,500원 | 등록일 2019.02.20

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verilog플리플롭

므로 데이터 저장을 위해 메모리 요소에 사용되며,일반적으로 컴퓨터와 같은 전자 장치에 레지스터를 많이 사용합니다.동기식 순서 논리회로클록 펄스(clock pulse)가 감지되어야 입력 ... 에 대한 출력을 내보내기 때문에 매우 안정적입니다. 대표적인 동기식 순서논리회로는 플립플롭(filp-flop)이 있습니다.쉽게 말하면 비트를 저장하게 위해 사용.2. 플립플롭의 중류

리포트 | 2페이지 | 1,000원 | 등록일 2019.06.14

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시분할 다중화 방식 TDM 예비 보고서6

실험 예비 보고서정보통신공학과201530241 강준기● 실험 목적- 펄스 진폭 변조(PAM) 및 복조 회로를 구성하여 아날로그 펄스의 변조 형태를 알아보고 변조파의 최대 진폭 ... 이 적다는 장점을 지니고 있다.[표 8-1] 펄스 변조의 분류펄스 변조연속 레벨 변조PAM(Pulse Amplitude Modulation)PWM(Pulse Width ... Mouleation)PPM(Pulse Phase Modulation)PFM(Pulse Frequency Modulaion)불연속 레벨 변조PNM(Pulse Number Modulation)PCM

리포트 | 8페이지 | 1,000원 | 등록일 2019.07.29

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[Ayeun]컴퓨터구조 계산기 설계 보고서

마다 flip-flop을 연결하여 제어 timing pulse를 발생한다. (one clock) > T1,T2,T4,T6- 회로에서 Flip-flop은 timing pulse를 지연 ... 컴퓨터구조 보고서제목계산기 설계 보고서학과전자공학과학번성명제출일2018. 05. 25소요시간5시간#계산기 회로 완성 및 Timing simulation과 각 부분 동작 설명가감산 ... 기 회로는 제어신호에 따라 덧셈을 수행하거나 뺄셈을 수행하는 회로를 말한다.덧셈 - 회로에서 제어신호 S=0일 경우 Bi十0=Bi이므로 입력 Bi가 그대로 전가산기에 인가되어 덧셈

리포트 | 8페이지 | 3,000원 | 등록일 2018.12.21

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[A+]전전컴실험I Lab04 Pre PSpice를 이용한 전기회로의 시뮬레이션

sourceOrcad Pspice를 통해 Pulse voltage source를 입력하여 회로를 알맞게 설정하면 다음사진과 같다.PSpice에서 구형파를 출력할수 있도록 하는 것 ... 이다.PSpice 회로 구성시 각 항목에 따른 설명은 다음과 같다.V1 = Initial 초기 전압V2 = Pulse Voltage 펄스 전압TD = Delay Time low상태 ... [05주차] PreLab Report- Title: PSpice를 이용한 전기회로의 시뮬레이션 -담당교수담당조교실험일학번이름목차1. Introduction (실험에대한소개

리포트 | 15페이지 | 1,000원 | 등록일 2017.11.24

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실험23_계수기 회로_예비레포트

제목 : 계수기 회로⑴ JK flip-flop에서 입력이 J=K=1 일 때 토글 동작이 되는 이유를 설명하라.JK flip-flop(이하 FF)에 J=K=1의 신호가 입력 ... 할 때에 무조건 toggle이 일어나도록 설계되어 있다.JK FF의 동작은 CLK가 인가될 때 NGT(neagtive edge) 또는 PGT에서 구동된다. 따라서 CLK의 pulse

리포트 | 2페이지 | 1,000원 | 등록일 2020.04.15

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[기초회로실험 보고서]D flip-flop 결과보고서

기초회로실험I결과보고서D flip-flop서론. D flip-flopD flip-flop(D-FF)은 하나의 입력 단자가 있고 Hyperlink "http://terms ... 신호를 clock pulse의 시간 간격만큼 지연시켜 출력으로 내는 데 사용된다. Hyperlink "http://terms.naver.com/entry.nhn?docId ... =1982082&ref=y" \l "_349" 그림 3-15(b)에서 D의 입력이 1 또는 0의 상태에서 C에 Clock pulse가 입력되는 순간, 출력 Q는 반전된다. 그리고

리포트 | 5페이지 | 1,000원 | 등록일 2018.05.18

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플립플롭 실험보고서

한다. 플립플롭은 펄스(pulse)에 의해 주어진 입력과 상태에 따라 현재의 2진 정보를 변경할 수 있다. 이때 회로의 동작을 촉발하는 기동신호를 ‘트리거링’이라고 하며, 플립플롭 ... -Slave J-K 플립플롭에 대해 알아본다.2. 기초이론플립플롭은 1비트를 저장할 수 있는 기억 소자로서 신호의 상태를 일시적으로 유지 또는 기억시켜 두는 장치나 회로를 말 ... 에는 주로 에지 트리거링(edge triggering)이 사용된다. 여러 개의 플립플롭 회로를 병렬로 접속하여 여러 비트의 2진 정보를 기억하는 것을 레지스터(register)라고 한다

리포트 | 12페이지 | 1,000원 | 등록일 2020.04.26

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디지털회로 보고서

디지털 회로 보고서1. 신호등 소개2. 설계 전 분석2.1. 설계 구성요소 분석2.2. 제약 요소 분석3. 전체회로4. 경제성 분석5. 결론6. 참고문헌1. 신호등 소개사거리 ... 동안의 Count-down을 7-segment 2개로 남은시간을 display해준다.2. 설계 전 분석2.1. 설계 구성요소 분석- CLOCK 발생 회로슈미트-트리거 발진기를 이용 ... 화하는 방법으로는 트리거를 사용하는 방법도 있는데 그방법보다는 Q3 CLK에 pulse를 주고 나머지 FlipFlop에 PRE입력을 주어서 초기화하는방법이 더 편하여 이 방법을 사용

리포트 | 5페이지 | 1,500원 | 등록일 2019.09.29

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ECMO 에크모 자료 정리

) Membrane Oxygenator :심폐 bypass 회로 중에서 폐의 가스교환 기능을대행해주는 장치(2) Pump :산소화된 혈액을 환자의 순환계에 되돌려 보내는 장치(심장 ... 역할을 대신해 주는 장치)(3) 회로(circuits) : O2/CO2 조절3. ECMO 연결VA type (심폐 기능 모두 보조)(Venoarterial ECMO)1) 대정맥 ... mH2O 미만으로 유지(너무 높으면 좌심실 감압 어려움, 너무 낮으면 ECMO flow 유지 어려움)- 말초부위 (Pulse, 온도, 색) 확인으로 순환 사정, 소변량 측정(ECMO

리포트 | 4페이지 | 1,000원 | 등록일 2020.02.15

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[기초회로실험 보고서] D flip-flop 예비보고서

Positive Edge Triggered D flip-flop은 Clock pulse의 rising edge에서만 입력 데이터를 받아들여 출력 상태를 바꾸거나 유지하는 순서논리회로이다.

리포트 | 1페이지 | 1,000원 | 등록일 2018.05.18

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판매자 표지

Cardioversion,Defibrillation

회귀회로를 차단하고, 정상적인 전도체계를 회복시킨다.: 심율동 전환이 필요한 부정빈맥 (tachydysrhythmia)- 혈역학 적으로 불안정한 Atrial fibrillation ... atrial flutter, 심근허혈로 인한 부정맥,reentry arrythmia- Ventricular tachycardia with pulse- PSVT with ... 시키므로 Ventiricular fibrillation을 유도한 모든 회귀회로를 차단하고 동방결절의 정상적인 SA node 의 기능을 회복시킨다.- pulseless V-tac- Ventricular

리포트 | 2페이지 | 1,000원 | 등록일 2019.03.22 | 수정일 2022.04.20

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응용전자전기실험 555타이머

2018년도 응용전자전기실험2 결과보고서실험 21장 555 타이머제출일:분 반학 번조성 명■실험 방법-위 회로와 같이 Bread Board에 회로를 구성한 후V _{out ... 이론[그림1]옆에 그림과 같이 case1의 회로에서i)스위치가 open상태 일 때tau =R _{eq} C (R _{eq} =R _{A} +R _{B}) 이므로 아래 그래프와 같이 ... 하여 node2의 전압,{bar{Q}}의 상태,V _{out}의 그래프를 그리면 다음과 같다. (다음 페이지)따라서 위 그림의V _{out} 파형이 pulse파 이므로 [그림 1

리포트 | 6페이지 | 1,000원 | 등록일 2020.05.13

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기초실험 RC회로 연산증폭기 결과보고서

결과보고서학 과학 년학 번조성 명전자공학과3121647083김진두실험 제목연산증폭기응용 25. 실험 결과1 설계예제- 회로 설계 – 10점이번 실험은 2개의 입력과 출력 전압 ... 사이 관계를 구하는 연산증폭기 회로를 설계하였다. 적분기와 반전증폭기를 이용하여 출력값을 구해보았다.먼저 회로도를 구성해보면적분기에 커패시터 부분에 피드백 저항을 물려줌으로써 초기값 ... 저항과 R3에는 2K저항의 소자를 연결시켜 주었다. 또한주어진 입력신호에 의해서 function generator 에서는 사각 pulse 파형을 주었고 주파수는1/2*ms

리포트 | 7페이지 | 1,000원 | 등록일 2019.02.26

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7th monostable , not gate

1. 실험 목적555 timer를 이해하고, monostable, not gate 회로를 제작하고 알아본다.2. 실험 이론555 timer555 timer는 IC로 예부터 많이 ... 다.* Schematic symbol of the 555 timerNo.NamePurpose1GNDGround, low level2TRA short pulse high →low on the ... interrupted by applying a reset pulse to low (0V)5CVControl voltage allows access to the internal

리포트 | 10페이지 | 1,000원 | 등록일 2019.06.10

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