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전전설3 전전설1 반도체 시립대 전전설1 시립대멀티미터 전전설1 예비 plc 전전설3 CMOS
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"전자전기컴퓨터설계" 검색결과 361-380 / 5,118건

  • 자료 표지
    서울시립대 전전설2 Lab-04 결과리포트 (2020 최신)
    전자전기컴퓨터설계실험Ⅱ결과리포트Lab-04 Combinational Logic-1작성일: 20.10.101. 실험목적Verilog HDL을 사용해 비교기 등 ... 의 Combinational logic을 설계하고 테스트벤치 파일을 작성하여 combo box를 통해 동작을 실험한다. 이 때, module instantiation을 이용해 구조적 모델링 설계 능력 ... 을 함양한다. 또한 Combinational logic을 설계할 때 behavioral modeling 방식을 이용해 always 구문을 사용하는 능력을 기른다.2. 배경이론 및
    리포트 | 15페이지 | 1,500원 | 등록일 2021.09.10
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    서울시립대 전전설2 Lab-01 결과리포트 (2020 최신)
    전자전기컴퓨터설계실험Ⅱ결과리포트Lab-01 Design with TTL gates작성일: 20.09.131. 실험목적디지털 설계의 장점과 TTL gate의 특성을 이해하고 OR ... gate, XOR gate, 가산기 등 여러 논리회로를 디자인한 후 실제로 설계하여 실험능력을 함양한다.2. 배경이론 및 사전조사디지털 설계는 다양한 장점이 있다. 1에 대응 ... 화하여 신호를 전달하므로 주변 잡음에 의한 데이터 변형의 가능성도 상당히 적다.디지털 설계의 방식에는 크게 두 가지가 있다. 먼저, Standard logic IC를 이용하는 경우 비교
    리포트 | 15페이지 | 1,500원 | 등록일 2021.09.10
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    (완전 세세한 정리, 끝판왕) 시립대 전전설2 4주차 Lab04 예비 레포트 Combinational Logic 1
    전자전기컴퓨터공학부 설계 및 실험2Pre La-04Combinational Logic 1실 험 날 짜학 번이 름목차1. 실험 목적 ... =7&parentCategoryNo=0&viewDate=¤tPage=1&postListTopCurrentPage=1&from=postView 2의 보수ppt 베릴로그 이론ppt 전자전기설계실험2 교안PAGE \* MERGEFORMAT2 ... 를 사용하여 Combinational Logic을 설계 및 실험한다.2. 배경 이론always 구문과 initial 구문의 차이점-always: 시뮬레이션 하는 동안 계속 동작한다.
    리포트 | 13페이지 | 2,000원 | 등록일 2020.07.27 | 수정일 2020.09.24
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    [서울시립대] A+ 전전설1 [PSpice를 이용한 전기회로 분석] 예비 보고서
    전자전기컴퓨터 설계실험1예비레포트실험4. PSpice를 이용한 전기회로 분석서론실험의 목적회로 분석에 유용하게 사용할 수 있는 PSpice의 사용법을 익힌다.PSpice를 사용 ... 이다.PSpice는 회로의 설계와 편집, 시뮬레이션 그리고 그래픽 출력 등을 볼 수 있는 Capture, Stimulus editor, PSpice A/D, Probe로 구성
    리포트 | 14페이지 | 1,500원 | 등록일 2020.11.26 | 수정일 2020.12.17
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    [PPT] 한눈에 들어오는 깔끔한 대학 / 취업 용 포트폴리오 양식 (프로젝트 관련)
    공학부 이수교과과정 로드 맵 전기회로 및 실험 전자회로 및 실험 자동화 회로 실 무 전력전자회로 실 험 제도 및 CAD 3 차원 CAD 디지털 논리회 로 컴퓨터 프로그래밍 E ... , 기능 등을 직접 설계하고 작동 가능하도록 제작한다 . 교과목 소개 02 창의적 공학설계 창의적 설계 공학기법 (TRIZ) 를 결합시켜 팀으로 설계활동을 이해하고 직접 수행 ... 개요 04 헤드폰의 기본 원리를 배우고 이를 토대로 직접 외관 , 기능 , 재질 등을 결정하여 헤드폰을 만든다 . 인체공학적 설계 : 사람의 귀 모 양 을 본 딴 디자인 재질
    ppt테마 | 10페이지 | 1,500원 | 등록일 2022.01.11 | 수정일 2022.01.16
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    (완전 세세한 정리, 끝판왕) 시립대 전전설2 예비레포트 3주차 Lab03 Introduction to Verilog HDL
    전자전기컴퓨터공학부 설계 및 실험2Pre La-03Introduction to Verilog HDL실 험 날 짜학 번이 름목차1. 실험 목적 ... 개의 차이점은 Verilog는 전자 시스템을 모델링하는 데 사용되는 HDL이며 VHDL은 현장 설계 가능 게이트 어레이 및 집적 회로와 같은 디지털 및 혼합 신호 시스템을 설명하기 ... , Gate Primitive, Behavioral modeling 이 세가지의 Verilog HDL 언어의 기본 사용법을 통해 디지털 논리회를 설계하는 방법을 학습한다.2. 배경
    리포트 | 17페이지 | 2,000원 | 등록일 2020.07.27 | 수정일 2020.09.24
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    (완전 세세한 정리, 끝판왕) 시립대 전전설2, 3주차, Lab03, Introduction to Verilog HDL, 자세한 설명, 결과레포트
    전자전기컴퓨터공학부 설계 및 실험2Post Lab-03Introduction to Verilog HDL실 험 날 짜학 번이 름목차1. 실험 결과 ... 하여 Two-input AND 게이트를 설계하였다. AND게이트는 두 입력 모두 1일때만 1일 출력된다. 시뮬레이션 한 결과 모두 같은 값을 갖는 동일한 그래프의 결과를 확인할 수 있 ... 를 통해 값을 입력한다. 출력은 x이고 그 결과는 LED1에 나타난다. 총 4가지의 경우의 수를 입력하였을 때, 세가지 방법으로 설계한 각각의 실험모두 같은 결과를 도출하였다.(2
    리포트 | 15페이지 | 2,000원 | 등록일 2020.07.27 | 수정일 2020.09.24
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    서울시립대학교 전전설3 8주차 결과레포트(설계 성공적, A+, 코로나로 인한 시뮬레이션 실험, 하지만 이론 주석 깔끔)
    을 볼 수 있다.3. Results of this Lab (실험 결과)- MOSFET Information for Lab.[0-1] 2010년도 1학기 전자전기컴퓨터설계실험 III
    리포트 | 10페이지 | 2,000원 | 등록일 2021.03.20
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  • 자료 표지
    [2024/A+]서울시립대_전전설3_실험3_결과
    ) 실험 결과가 이론적인 예측과 일치함으로써, 해당 회로의 설계가 신뢰성 있게 이루어졌음을 보여준다. 나) 토론１) 실험 결과는 회로 설계의 신뢰성과 안정성을 확인하는 중요한 지표이 ... 다. 파형이 시뮬레이션과 유사하게 나타난 것은 회로가 실제로 원하는 작업을 수행할 수 있음을 의미한다. 이는 설계한 덧셈 및 뺄셈 회로가 예상대로 작동한다는 것을 보여준다.２) 각
    리포트 | 24페이지 | 2,000원 | 등록일 2025.03.10
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    [2024/A+]서울시립대_전전설3_실험4_결과
    실제 측정된 값이 이론 값과 차이가 나는것을 고려할 때, 회로의 안정성과 노이즈에 대한 영향을 고려해야 한다.２) 노이즈와 오프셋 에러를 최소화하기 위해 회로의 설계와 구성을 더
    리포트 | 16페이지 | 2,000원 | 등록일 2025.03.10
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    전전설3 MOSFET 실험 2 Biasing and Common-Source Amplifier
    A. 실험 목적MOSFET을 이용한 증폭기의 biasing 방법, 소신호 모델, 그리고 이를 이용한 증폭기인 Common-Source 증폭기에 대해 학습한다.B. 실험 이론 및 과정 개략 설명MOSFET을 증폭기로 동작시키기 위해서는 적절한 DC 바이어스가 인가..
    리포트 | 4페이지 | 2,000원 | 등록일 2023.11.25
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    전전설2 final project 쉬운 코드 [2020년 최신, A+, 디지털시계, 5가지 기능]
    1. 현재 시간 출력- 입력: Bus SW = 8’b00000000- LCD 상의 화면 (예시 16:00:00)- BUS SW (실제 콤보박스의 BUS SW 좌우와 동일하다고 했을 때)시간조정세계시간스톱워치타이머----* BUS SW = 8’b00000000일 때는 현..
    리포트 | 5페이지 | 4,000원 | 등록일 2021.11.23
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    전전설3 Op-Amp 실험 2 Non-idealities of the Op-Amp
    1. Introduction Ÿ A. 실험 목적이 실험에서는 OP-AMP의 실제 동작 특성에 대해 알아본다.Ÿ B. 실험 이론 및 과정 개략 설명실제 OP-AMP는 이상적인 동작 특성과 달리 유한한 open-loop gain과 bandwidth, slew-rate ..
    리포트 | 8페이지 | 2,000원 | 등록일 2023.11.25
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    전전설3 MOSFET 실험 1 MOSFET CHARACTERISTICS
    A. 실험 목적본 실험에서는 MOSFET의 기본 동작 원리를 살펴본다. 전류-전압 특성 및 동작 영역을 실험을 통해 확인하고 소신호 모델에 대해 학습한다.B. 실험 이론 및 과정 개략 설명NMOS의 동작은 다음과 같이 이루어진다.PMOS의 동작은 다음과 같이 이루어진다..
    리포트 | 5페이지 | 2,000원 | 등록일 2023.11.25
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    전전설3 Diode 실험 2 Diode rectifier
    A. 실험 목적본 실험은 다이오드의 기본 기능인 정류작용에 대해 실험을 통해 이해하는 것을 목표로 한다.B. 실험 이론 및 과정 개략 설명DC 전원 공급 시스템은 교류 입력 전원을 트랜스포 머를 거쳐 원하는 전압으로 조절한 후에 다이오드를 이용한 정류회로를 통과하도록 ..
    리포트 | 11페이지 | 2,000원 | 등록일 2023.11.25
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  • 자료 표지
    중간과제) 단안정 멀티바이브레이터 회로 및 용어정리(과제1)
    Pspie A/D : 오늘날 전기, 전자, 물리, 기계 등 다양한 분야에서 검증을 위해 컴퓨터 시뮬레이션 기술을 도입하여 활용하고 있으며 전기전자회로 분야 역시 여러 종류 ... 의 시뮬레이션 기술이 도입되어 사용되고 있음. Pspice A/D은 전기전자회로의 동작 특성을 시뮬레이션 하는 프로그램으로 회로 해석을 위한 회로 제작 환경 및 4가지 해석 알고리즘과 다양 ... editor : PCB 설계 Tool 은 전자회로 설계 기술과 맥을 같이하여 발전해 오고 있다. 현재의 전자회로 설계는 아날로그와 디지털 영역이 확연히 분리되었고, 특히 디지털 회로 설계
    리포트 | 12페이지 | 3,000원 | 등록일 2025.02.28 | 수정일 2025.03.07
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    전전설3 RLC 실험 1 Passive Filters
    1. IntroductionŸ A. 실험 목적First order RC 및 RL 회로를 이용한 low-pass, high-pass, 그리고 band-pass 필터들의 magnitude와 phase response 및 bode plot에 대한 이해를 높이는 것을 목적으로..
    리포트 | 5페이지 | 2,000원 | 등록일 2023.11.25
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  • 자료 표지
    서울시립대 전전설3 9주차 예비 보고서 Diode 3
    A. 예비 보고서1) pn 접합 diode를 이용한 voltage regulatora) 1N4004의 spice model을 이용하여, LTspice 상에서 Fig. 2(a)의 voltage regulator 회로를 구성하세요.b) a)의 회로에 12 V의 offset..
    시험자료 | 16페이지 | 1,500원 | 등록일 2024.07.15 | 수정일 2024.07.17
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    서울시립대 전전설3 9주차 결과 보고서
    시험자료 | 8페이지 | 2,000원 | 등록일 2024.07.15
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    서울시립대 전전설3 10주차 예비 보고서 MOSFET1
    A. 예비 보고서1) NMOSa) 2N7000의 datasheet를 이용하여 (a) threshold voltage를 확인하고 (b) NMOS의 transconductance parameter kn 값을 추정하세요.b) Fig. 11의 회로에서 R1 = 10 kΩ라 하..
    시험자료 | 8페이지 | 1,500원 | 등록일 2024.07.15 | 수정일 2024.07.17
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2025년 07월 08일 화요일
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