"저항파형"의 검색결과 입니다.

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"저항파형" 검색결과 3,041-3,060 / 10,456건

[기초전자회로실험2] "응용설계 – 발진회로의 설계 및 제작" 결과레포트

=0.01 mu F}}‘ 일떄는 14.937KHz로 이론값 15.912KHZ와 1KHz정도의 오차를 보였다.다음으로는 가변저항을 이용하여 R2의 값을 변화시키며 파형의 변화 ... bridge 발진기(그림 1)의 R2 값에 따른 발진 특성을 분석하라.R2의 값이 낮아질수록 파형이 불안정하다. 반대로 R2의 값이 높아질수록 안정한 정현파의 발진이 나오며R _{2 ... . 고찰Wien bridge 발진 동작을 이해하고 발진회로의 발진조건을 실수부와 허수부로 나누어 학습하였다. 이에 맞는 저항 R과 커패시터 C를 이용하여 Wien bridge 발진

리포트 | 3페이지 | 1,000원 | 등록일 2019.03.27 | 수정일 2019.04.01

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위상천이 발진기 레포트

에 필요한 최소 이득을 이해한다.2. 실험 방법(1) 주어진 회로를 브레드보드에 구성한다.(2) 출력을 오실로 스코프의 CH1에 연결한 후 출력 파형을 그린다.(3) 커패시터를 바꾸 ... ]병렬저항형11036.52.2102.1231202.483.25발진 임계저항 값[K OMEGA ]312290병렬커패시터형11012.796.52.2108.0731208.433.25발진 ... 임계저항 값[K OMEGA ]3202905. 고찰첫 번째 발진기인 위상천이 발진기는 반전회로로 구성되어있어 출력은 입력의 반대가 되기 때문에 반대인 신호를 다시 역으로 맞춰줘야

리포트 | 2페이지 | 1,000원 | 등록일 2020.03.15 | 수정일 2020.03.17

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[결과레포트] 기본 논리게이트(AND, OR, NOT 게이트) 회로실험

을 배양한다.2 관련이론디지털의 값? 0 (Low, 0[V]) 혹은 1 (High, 5[V])Level trigger에 의한 기본펄스파형? High 상태 일 때 제어신호 변함 (by ... positive level trigger)? Low 상태 일 때 제어신호 변함 (by negative level trigger)Edge trigger에 의한 기본펄스파형 ... (�� )로 표시? 입력과 반대의 상태로 출력? 입력이 High 인 경우에는 0으로 출력? 입력이 Low 인 경우에는 1로 출력? 보수연산으로도 불리어짐풀업저항과 풀다운저항풀업저항은 저항

리포트 | 5페이지 | 1,500원 | 등록일 2019.12.10

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기초실험1 파형발생기 결과보고서

결 과 보 고 서실험 제목파형 발생기실험은 왼쪽의 그림과 같이 OP-AMP를 이용하여 적분기회로를 만든 다음 구형파를 입력시켜 삼각파를 발생시키는 과정으로 진행을 하였다. 이론 ... 적인 내용을 잠깐 알아보면 병렬 저항R _{S}로 인해 저주파 이득이 제한을 받게 되므로 앞의 입출력 관계식은 입력 주파수가f _{c} ={1 over {2`pi` R _{S} `C ... 에서부터 점차 삼각파로 바뀌어가며 1kHz에서는 완벽한 삼각의 모양은 아니지만 삼각파와 상당히 유사한 파형이 나오고 있는 것을 관찰할 수 있었다.

리포트 | 2페이지 | 1,000원 | 등록일 2019.11.06 | 수정일 2019.11.28

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MOSFET 다단 증폭기 결과보고서

일 때 그림 5 일 때그림 6 일 때1.3회로4에 대한 측정 결과 :그림 8 회로4의 입출력 파형그림 9 100k으로 바꿨을 때그림 10 capacitor을 제거했을 때회로4100 ... kΩ으로 바꿨을 때Cap 제거inputoutputinputoutputinputoutput7*************.1Cap를 다시 연결한 뒤에 캡쳐한 파형 :그림 11 그림 12 ... 출력과 3단 출력의 파형1.2 고찰사항(필수 X)(1) 다단 증폭기의 입력단과 출력단은 입려 임피던스, 출력 임피던스 측면에서 어떤 조건을 만족해야 하는가?: 입력 임피던스는 높

리포트 | 6페이지 | 1,000원 | 등록일 2018.12.15

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아주대학교 기초전기실험 A+ 예비보고서 AC6 - Frequency Response of the Series RC Network

가 모두 저항값에만 영향을 받으므로, 주파수에 대한 전압과 전류의 파형은 같은 특성을 가진다. 한편, 교류 회로에서 소자의 전압은 벡터적으로 연관되어 있다. 그렇지 않다면 전압 ... 임피던스의 위상각을 계산한다.[2] 실험 이론1. 임피던스 (Impedance) 직렬 RC 회로에서, 축전기 양단의 전압은 주파수에 따라 감소한다. 저항의 경우, 전압과 전류 ... 측정은 부정확할 것이며 KVL은 성립하지 않을 것이다. 입력 저항에 대한 위상각 또한 입력 주파수에 영향을 받는다. 저주파 대역에서, 용량성 리액턴스는 매우 크므로 회로는 용량성 회로가 된다.

리포트 | 3페이지 | 1,000원 | 등록일 2019.09.09 | 수정일 2022.12.21

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서강대학교 전자회로실험 - 실험 3. PSpice 사용법 및 시뮬레이션 실습 결과 보고서

처럼 저항2개와 DC 전압원, 접지, 그리고 OP-AMP이다.시뮬레이션 결과를 제시하세요.결과에 대해 서술하세요.이 실험의 회로는 inverting amplifier이다. 이득이 -R2 ... , 저항, 접지, VDC를 사용하였다.시뮬레이션 결과를 제시하세요.결과에 대해 서술하세요.위 회로에서는 saturation이 일어나게 된다. 따라서 출력 전압이 위 그래프와 같은 값 ... 하세요.VPULSE, 7404(inverter), 저항, 접지를 사용하였다.시뮬레이션 결과를 제시하세요.Rise time(, fall time( 측정Rise time( : 5.633ns

리포트 | 12페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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아주대학교 12판 물리학실험2 정류회로 결과보고서

결과보고서제목 : 정류회로[1] 측정값회로 특성 :C =10 mu FR _{L} =0.818k OMEGA다이오드의 특성 :순방향 저항R _{D} ^{f} `=`4.56m ... OMEGA역방향 저항R _{D} ^{r} `=` 측정불가실험 1 변압기의 특성변압기의 입력 및 출력 전압(피크 값, 진폭):입력전압v _{i n} ^{T} =4.971V출력전압v ... _{out```12} ^{T} =2.443Vv _{out```32} ^{T} =2.463V실험 2 반파정류회로v _{i n} ``:2.447Vv _{out} ``:1.885V* 파형

리포트 | 6페이지 | 1,000원 | 등록일 2019.01.24

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6th Differential, Integrator, Photo Detector

. 좀 더 실제적인 미분기는 그림과 같이 입력 축전기에 직렬로 저항R _{S}를 결합하여 고주파 이득을{R _{F}} over {R _{S}}로 감소시킨다.그림 1 미분기 회로이 ... - {R _{F}} over {R _{S}} 미분기 입력에 삼각파를 인가할 때 출력 파형은 그림과 같은 구형파가 된다. 단 삼각파형의 주파수가f _{c}보다 작은 경우이 ... 다.Integrator그림은 적분기 회로로써 미분기 회로에서 저항과 축전기를 서로 바꾸어 놓은 것인데, 즉 저항R _{1}은 입력소자이고 축전기 C는 궤한소자이다.그림 2 적분기 회로그림

리포트 | 13페이지 | 1,000원 | 등록일 2019.06.10

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아주대학교 정류회로 결과보고서 2019년 물실12판 작성 물리학실험2 소스

정류회로결과보고서조원:담당조교님:실험일:[1] 측정값회로 특성 :C=`10 mu FR _{L} =814 ohm 다이오드의 특성 :순방향 저항R _{D}^{f} `=`110.9`k ... ohm 역방향 저항R _{D}^{r} `=` INF ohm실험 1 변압기의 특성변압기의 입력 및 출력 전압(피크 값, 진폭):입력전압v _{i n} ^{T} = 4.977V출력 ... .884V* 파형의 그래프 첨부실험 3 전파정류회로* 파형의 그래프 첨부실험 4 필터회로f(Hz)60120300v _{out} (V)최대1.907V1.877V1.855V최소0.459

리포트 | 3페이지 | 1,000원 | 등록일 2019.06.08

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아주대학교 논리회로실험 실험10 예비보고서

_{4} ) 이다.R _{f}값을 2.7kΩ으로 바꾸고 출력파형을 그리고 또 4.5kΩ으로 바꾸고 출력파형을 그린다.V _{o}의 크기가 저항값에 크기에 비례하므로 2.7kΩ일 때 ... Ω일 때보다V _{o}의 크기가 줄어들어 출력될 것이다.실험 2위와 같은 회로를 구성한다.실험1회로의 출력에 비교기를 부가한다.아날로그 신호를 디지털 신호로 해석될 것이고 이 또한 저항의 변화에 따라 결과 파형이 변화할 것이다. ... onverter) : 아날로그 신호를 디지털 신호로 변환하는 회로를 의미한다.아래는 간단한 DAC이며, 전압 분압 방식 DAC 이다. 3bit DAC이다.아래는 2단 저항 분압 방식

리포트 | 7페이지 | 1,500원 | 등록일 2019.02.20

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[전기회로설계실습-설계실습 9 LPF와 HPF 설계] 중앙대학교 전자전기공학부 2-2 A+ 예비보고서

.3 위의 LPF에 주파수가 10kHz이고 크기가 1V인 정현파를 인가하였다. (a) 입력파형과 출력파형을 하나의 그래프에 그리고 (b) 출력의 크기와 입력에 대한 위상(각도 ... 와 시간)을 구하라.주파수가 10kHz이고 크기가 1V인 정현파를 수식으로 나타내면V _{in} =sin(2 pi TIMES10 ^{5} t)[V]이다.(a) 입력파형 (V1), 출력 ... 파형 (V2)의 그래프(b) LPF에서 출력은 C에 걸리는 전압이다.V _{C} = {V _{in}} over {sqrt {R ^{2} +( {1} over {WC} ) ^{2

리포트 | 6페이지 | 1,000원 | 등록일 2020.07.12

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2019학년도 3학년 1학기 중앙대 전자회로설계실습 10. Oscillator 설계 예비

에 따른 신호 파형에 대해 학습한다.2. 준비물 및 유의사항DC Power Supply(2channel): 1대Digital Multimeter (이하 DMM): 1대Digital ... : UA741CP: 2개저항 (1 ㏀, 1/2W): 4개가변저항 (5 ㏀, 1/2W): 2개세라믹 커패시터 (0.47 ㎌): 1개3. 설계실습 계획서3.1 OrCAD PSPICE를 사용 ... =968.34 Ω으로 설계하였다.(B) PSPICE를 이용하여 위에서 설계한 oscillator의 vo, v+, v-의 파형을 제출하라. 또한, T1, T2, VTH, VTL의 값

리포트 | 5페이지 | 1,000원 | 등록일 2019.09.21

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한국전력 1차 직무면접 완벽 대비 자료(합격자)

에 따라 직접접지방식, 저항접지방식, 소호리액터 접지방식 등이 있습니다.- 직접접지방식은 말 그대로 중성점을 직접 접지하는 방식이며 보호계전기 동작이 확실하며 지락 시에 건전상의 대지 ... 전압 상승이 거의 없다는 장점이 있습니다. 단점은 유도장해가 크다는 것입니다.- 저항접지방식은 중성점을 저항으로 접지하는 방법입니다. 저항 값이 너무 낮으면 유도장해가 커지 ... 고, 저항 값이 너무 커지면 건전상의 대지전압상승을 초래합니다.- 소호리액터 접지방식은 1선 지락전류를 거의 0으로 만들 수 있고 유도장해가 거의 없습니다. 하지만 직렬공진에 의한 이상

자기소개서 | 24페이지 | 15,000원 | 등록일 2019.11.16

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4. Clipper and Clamper

에 저항을 직렬로 연결하고 다이오드는 역방향 병렬로 연결하는 것은 특정 레벨 이하를 잘라내는 클리퍼이다. 정(+) 클리퍼는 출력 파형의 정(+)의 변화를 제거하거나 제한하고, 부( ... -)의 다이오드 클램퍼의 기본적인 동작을 조사한다.실험부품 및 사용기기1 0-15V 직류 전원공급장치 2 저항 15k, 10k1 브레드 보드 1 가변저항 5k1 신호발생기 1 ... Capacitor 10uF1 2현상 오실로스코프 1 다이오드 1N4001이론요약1) ClipperClipper는 입력되는 파형의 특성 레벨 이상이나 이하를 잘라내는 회로를 의미한다. 클리핑

리포트 | 11페이지 | 1,000원 | 등록일 2012.06.22

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[중앙대 전자회로설계실습]설계실습 10(Oscillator 설계) 예비보고서

로 설정해주면 된다.위에서 설계한 값들로 ORCAD를 이용하여 설계한 설계도는 다음과 같다.(B) 위 회로에서v _{o} ,v _{+} ,v _{-}의 파형은 다음과 같 ... -가 되면 출력전압은 다시 L+가 되며, 이 과정을 계속 반복하게 된다. 위의 파형에서도 볼 수 있듯이 출력전압 vo는 L+,L-의 크기를 갖는 구형파를 띄게 되고, v+는 βL+,β ... L-의 크기를 갖는 구형파를 띄며, v-는 βL+,βL-의 크기를 갖고, 시정수가 RC인 1차 RC회로의 파형을 띈다.3.2 Feedback factor β의 영향 분석(A) 위

리포트 | 4페이지 | 1,000원 | 등록일 2020.01.02

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3장 다이오드 정류 회로(결과)

)☞ 저항 : 1kΩ,2.2kΩ☞ 커패시터 : 330μF, 33μF2. 실험 방법 및 결과2.1 반파 정류 회로2.1.1 실험 회로도- PSPICE 반파 정류 회로- 실험 때 구성 ... 한 회로2.1.2 실험 방법1) 주어진 변압기를 이용하여 실험 회로 3-1(a)의 회로를 구성하고, 입력과 출력파형을 관찰하고 비교 설명하라. RL=1kΩ이다.2) 주어진 변압기를 이용 ... 하여 실험 회로3-1(b)의 회로를 구성하고, 입력과 출력파형을 관찰하고 비교 설명하라. C=330μF,RL=1kΩ이다.3) 실험 회로 3-1(b)의 회로에서 C=330μF,33μ

리포트 | 26페이지 | 4,000원 | 등록일 2020.06.16

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Labview를 이용한 통신 시스템 시뮬레이션(Function Generator, 오실로스코프) 보고서

의 Labview로 제어하는 기능에 대해 조사하시오.(AFG3021B)[1. Tektronix AFG 3000 Series Standard Waveform.vi]기능 : 일반적인 파형 ... ) Configure분만을 나타낸다.4) Trigger : 비주기적으로 발생하는 동일 파형을 관측하기 위한 장치. 반복적인 신호, 단발적인 신호 및 랜덤 신호 모두의 경우에 관측하고자 하는 파형 ... 을 연속 또는 비연속적으로 화면상에 보여준다.3. L, C, R 소자가 주파수에 따라 어떤 임피던스 특성을 보이는지 조사하시오.- RCL소자의 임피던스 :1) Resistor : 저항

리포트 | 28페이지 | 3,000원 | 등록일 2019.09.07

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기초회로이론 설계과제

기초회로이론-설계과제 2-1. 제목1) 저항 R으로 구성된 회로 설계2) op-amp를 이용한 증폭기회로 설계2. 목적회로 설계 및 시뮬레이션 방법을 익히고 간단한 저항 소자 ... 들을 배열하여 주어진 제한조건을 만족하는 개별회로를 구현하는 것을 목적으로 한다.3. 설계우선, 첫번째 설계인 저항 R으로 구성된 회로 설계에서 주어진 소자는 다음과 같다.-주어진 ... 할 수 있었다.단, 이번 회로에서 출력되는 전압은 저항 로서, 오른쪽에 위치하고 있다.다음은 두번째 설계이다. 두번째 설계인 op-amp를 이용한 증폭기 설계 회로에 사용되는 소자

리포트 | 7페이지 | 2,000원 | 등록일 2019.09.03

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전기전자실험 - 가산증폭기

를 인가하여 입력파형과 출력파형을 각각 비교해본다.2. 이론(1) 가산증폭기(Summing Amplifier)위의 그림과 같이 여러개의 입력저항을 동시에 OP-AMP의 반전입력(-)단자 ... 제목 : 가산증폭기(Summing Amplifier)1. 목적- 가산증폭기를 이용하여 반전가산회로의 출력파형을 확인한다.- Function Generator을 이용해 정현파 ... _{f}와 입력저항R _{1},R _{2},R _{3}를 모두 같게하면 다음 식과 같이 된다.->V _{0} =-(V _{1} +V _{2} +V _{3} )한편 궤환저항 값

리포트 | 6페이지 | 1,000원 | 등록일 2018.11.20 | 수정일 2018.11.26

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