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전자회로실험 클램퍼 회로 rlc 직렬공진 회로 MOSFET 기본 특성 공통이미터증폭기 전자공학실험2 BJT 기본 특성

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"전자회로실험" 검색결과 2,661-2,680 / 19,310건

서강대학교 전자회로실험 1주차 결과보고서 - 오실로스코프 등 실험관련 계측기의 사용법 실습 실험

REPORT과 목 명전자회로실험학 과전자공학과성 명20101551 윤주승성 명20101579 정영문1. 제목오실로스코프 등 실험관련 계측기의 사용법 실습 실험2. 도입첫 번 ... 와 같은 질량이 매우 작은 전자의 운동 궤적을 형광면에 나타나게 하는 것이므로 관성의 영향을 거의 받지 않아 높은 주파수의 파형까지도 측정 가능하다. 그림 2는 오실로스코프의 회로구성 ... 째 실험에서는 디지털멀티미터를 이용하여 실효전압을 측정하며 오실로스코프를 이용하여 전압의 파형을 관찰하고 크기를 측정한다. 두 번째 실험에서는 오실로스코프를 이용하여 두 함수발생기

리포트 | 12페이지 | 1,000원 | 등록일 2014.11.30

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서강대학교 고급전자회로실험 15주차 예비보고서

실험 10. 데이터 변환기 (예비)분반학번이름조1. 시뮬레이션 결과실험 1. 디지털-아날로그 변환기실험회로 1.이진수로 가중된 저항을 이용한 DAC 회로는 디지털 입력 (b1 ... 고 있다.전류와 피드백 저항 Rf를 곱하면 아날로그 출력전압을 얻을 수 있으며 다음과 같이 표현된다.이는 DAC에 해당한다.실험회로 2.이진수로 가중된 저항 열의 경우에는 각 저항 ... 도와 같은 R-2R Ladder를 이용한 DAC의 회로를 사용하는 것이 좋다. 그 이유는, 저항 가중치에 의한 오차의 비선형성을 줄일 수 있기 때문이다.실험 2. 아날로그-디지털

리포트 | 4페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 9주차 결과보고서

에서 동작을 알아보는 실험이었다. 자유 발진 모드는 VCO의 lock범위를 벗어나는 주파수가 들어올 때 VCO의 회로 소자값에 의해 주파수를 결정하는 모드를 말한다. 신호발생기 ... 실험8 . PLL (Phase Locked Loop) 실험분반학번이름조담당교수제출일자2012.11.071. 실험 결과1) 자유발진 주파수전위차계 []fcalc, kHzfmeas ... , kHz06.386.581K5.265.392K4.484.603K3.904.014K3.453.565k3.093.24표 8.1 자유발진모드 실험.분석 : 이번 실험은 자유 발진 모드

리포트 | 3페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 6주차 결과보고서

으며 실험상으로는 약-31dB/decade정도의 기울기를 갖는 것을 확인할 수 있다. 이는 이득이 작아지면서 오피엠프의 출력전압이 매우 작아지게 되는데 출력이 매우 작을 경우 회로 ... 실험 17. OP앰프 특성 실험 (결과)실험 20. 능동 필터분반학번이름조담당교수제출일자1. 실험결과실험 17. OP앰프 특성 실험[실험 1 : 입력 바이어스 전류]반전비반전첫 ... .148 nA두 번째 OP앰프(LF356N)0.149nA표 17-2. 계산된 바이어스 전류OPAMP의 직류 입력전압을 실험적으로 측정하여 구해보고 입력 바이어스 전류를 계산

리포트 | 6페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 2주차 결과보고서

고급전자회로실험실험2. 결과보고서제 출 일 : 2012. 09. 19.학 과 :성 명 :실험 2. 공통소오스증폭기분반학번이름조1. 실험 결과실험 1.1[1.1] Vsig를 1 V ... .090.090.090.08표 2-1 실험 회로 1의 Vsig 변화에 따른 VD 측정 값[1.2] [1.1]을 바탕으로 출력-입력(VD-VG) 그래프를 그림 2-1에 그리시오. VG ... 에 따라 트랜지스터의동작 영역이 어떻게 바뀌는지 설명하라.VD(V)VG(V)그림 2-1 출력-입력(VD-VG) 그래프- 동작 영역 변화 : 실험회로 1에서 드레인 전압이다. 그런데

리포트 | 5페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 5주차 결과보고서

.1635.492.0924.614.1535.56실험과정(6)R(CB) = 20 ohmR(AB) = 1.02 kohm표 11-1. 주파수 응답 회로 측정 결과.실험1 : 오디오 증폭기 주파 ... 때문에 컨덕턴스가 더 낮아졌기 때문이다. 즉 공통 이미터 증폭기의 경우가 되는데 이때 이미터에 저항이 연결되면, 이득은가 된다. 이때 위 실험 회로에서가된다. 다음은 주파수 ... 으로 이 회로가 대칭적으로 동작한다는 것을 실험적으로 확인할 수 있었다.(2)차동 모드그림파형(50mVp-p)그림파형(50.08mVp-p)그림파형(7.319Vp-p)그림,파형(7

리포트 | 9페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 3주차 예비보고서

고급전자회로실험실험3. 예비보고서제 출 일 : 2012. 09. 19.학 과 :성 명 :실험 2. 차동 증폭기분반학번이름조실험 1.1[1.1] Vx = 6 V 로 고정 ... 었다. 그리고 Vx가 증가할수록 전류는 세지지만 일정 정도를 넘어서면 전류가 일정하였다. Vx가 0.8V부터는 ISS가 일정한 값을 가진다.실험1.2[2.1] 회로 구성 후, IREF ... )66665.815.615.615.615.615.615.615.615.61VS(V)00000.100.521.021.522.022.523.023.524.02---실험1.3[3.1] 회로

리포트 | 8페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험_2주차_예비보고서

고급전자회로실험실험2 예비보고서제 출 일 : 2012. 09. 12.학 과 :성 명 :실험 2. 공통 소오스 증폭기분반학번이름조1. NMOS의 소신호 등가회로에 대해서 설명 ... . )2. PSPICE 시뮬레이션실험회로 1: 전달함수[1.1] Vsig를 1 V에서 0.1 V간격으로 4 V까지 증가시키면서 드레인 전압(VD)을 측정하여 표 2-1에 기록하라 ... 그래프(직선)를 이전 실험에서 측정한 DCIV 그래프 위에 그리시오.실험회로 2: 바이어스 회로실험회로 2(a) 실험회로2(b)[2.1] 드레인 전류가 10 mA가 되도록 RGG

리포트 | 10페이지 | 1,000원 | 등록일 2013.04.12

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[전자회로실험] 전압제어 발진기 회로 (결과)

: 2.2㏀, 4.7㏀5) 캐패시터 : 0.022㎌3. 실험방법 및 결과1) 실험방법1) 그림 8-3의 회로를 구성한다.▶ 그림 8-3 VCO의 경우2) CONT 단자에 5V ... 하여 그래프에 그린다.6) CONT 단자의 전압값을 변화시켜 가면서 출력의 주파수를 측정한다.2) 실험결과구성한 회로▶ VCONT = 2 V▶ VCext = 1.75 VP-P▶ f ... 1. 실험목표555 타이머를 이용하여 VCO로 동작시키는 방법과 사용법을 이해한다.2. 실험 장비 및 부품1) 오실로스코프2) 직류가변전원 × 23) 555타이머 IC4) 저항

리포트 | 4페이지 | 1,500원 | 등록일 2009.03.23

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서강대학교 고급전자회로실험 15주차 결과보고서

실험 10. 데이터 변환기(결과)분반학번이름조1. 실험 결과실험 1. 디지털-아날로그 변환기[1.1] [실험회로 1-1]을 구성하고, 디지털-아날로그 변환기의 입력코드를 “000 ... 시오. 또한 디지털-아날로그 변환기의 입력-출력 특성 곡선을 바탕으로 [실험회로 1-1]의 DNL, INL, 오프셋, 이득 오차 특성을 구하시오.디지털 입력0 ... 인 0.625와의 차이로 계산하였다.[1.2] [실험회로 1-2]를 구성하고, 디지털-아날로그 변환기의 입력코드를 “000”부터 “111”까지 단계적으로 증가시키면서 아날로그 출력

리포트 | 3페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 9주차 예비보고서

실험8 . PLL (Phase Locked Loop) 실험(예비)분반학번이름조담당교수제출일자2012.10.301. 이론정리1. Oscillator (발진기)발진기란 원하는 주파수 ... 의 정현파 신호를 발생시키는 회로이다. 이때 원하는 주파수 성분만 출력되는 것이 아니라 잡음이 섞여서 나오게 되는데, 이것을 주파수 축에서 보게 되면 완전한 임펄스의 파형이 나오 ... 어내는 회로가 PLL(Phase Locked Loop)이다. [1]2. PLL의 각 블록의 역할① VCO (Voltage Controlled Oscillator)입력전압에 따라

리포트 | 2페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 6주차 예비보고서

실험 6. OP앰프 특성, 능동 필터 (예비)분반학번이름조시뮬레이션 결과 및 분석1) 실험 1. 입력 바이어스 전류회로도- 분석: 이번 실험은 3가지의 오피엠프에 대해서 바이어 ... 스를 결정하고 그 전류를 측정하는 실험이다. 회로를 그림과 같이 연결하고 DC바이어스와 DC전류를 측정한 결과 위와 같이 나왔다. 이상적인 오피엠프는 입력단에 전류가 흐르지 않 ... 지만 위 회로에서는 매우 작은 전류가 흐르는 것을 확인할 수 있으며, 출력쪽에서도 전류가 흐른다.2) 실험 2. 출력 오프셋 전압회로도- 분석: 위 회로는 부궤환 회로를 연결하여 반전

리포트 | 4페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 4주차 결과보고서

때문에 평균전류는 DC Bias전류와 같게 된다.실험 2[2.1] 그림 10-10의 회로를 연결하고 전원 VCC를 0V로 고정하라. Rin은 최소 출력을 얻을 수 있도록 접지 ... .4mV0.9mV1.6VppIc1300uA1.03mAIc2285uA1.27mA표 10-. 푸시풀 증폭기 실험결과.2. 검토 및 보고 사항1. 음성출력 증폭기 실험회로 그림 10-9 ... 실험 4. A급 음성증폭기 및 푸쉬풀 증폭기(결과)분반학번이름조1. 실험 결과실험 1실험과정실험결과(1)음성코일 저항 = 8.88 Ω(2)VR1=298mVIR1=298mV/10

리포트 | 3페이지 | 1,000원 | 등록일 2013.04.12

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전기전자 기초실험 23장 선형 연산 증폭기 회로 응답 예비, 결과

전기전자공학 기초실험chapter23. 선형 연산 증폭기 회로?실험목적? 선형 연산 증폭기에서 DC와 AC 전압을 측정한다.?이론? 연산증폭기는 반전 및 비반전 입력을 가지 ... 로워이론값실험값D. 가산증폭기이론값실험값전기전자공학 기초실험chapter23. 선형 연산 증폭기 회로?실험결과파형이론값실험값V _{i}=2.2VV _{0}=-10.1VA _{v ... -2의 회로로 주어지고, 출력전압은 다음과 같다.V _{o} =(1+ {R _{o}} over {R _{i}} ) TIMES V _{i}그림 23-3에서처럼 출력을 반전입력에 연결

리포트 | 6페이지 | 1,000원 | 등록일 2014.06.30

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서강대학교 고급전자회로실험 10주차 결과보고서

실험9 . 741 OPAMP 회로해석분반학번이름조담당교수제출일자2012.11.141. 실험 결과분석1) 741 OPAMP 회로해석(1) 실험 1. DC analysis시뮬레이션 ... 이상적일 수는 없겠지만 거의 이상적인 특성에 가깝게 만들어진 것을 확인할 수 있었다.(3) 실험 3. Transient Analysis회로도시뮬레이션결과입력전압2Vpp (1kHz)R ... 결과 - DC Voltage시뮬레이션 결과 ? DC CurrentDC bias이론값0.733mA19.0uA10.5uA16.2uA530mV152uA실험값0.735mA19.4uA10

리포트 | 6페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 7주차 결과보고서

실험7. 발진기와 신호 발생기 (결과)분반학번이름조담당교수제출일자2012.10.311. 실험결과실험1.1. 빈 브리지 발진기 회로R4[]측정된 발진 주파수[kHz]출력의 크기 ... 었으나, 전압이 그 이상으로 증가되지는 않았다.실험1.2. 구형파 발생기 회로R[k]C[nF]측정된 출력 주파수[kHz]출력의 크기[Vp-p]이론적 출력 주파수[kHz]1kΩ200nF4 ... 해 볼 수 있다.[1]실험1.3. 삼각파 및 구형파 발생기 회로R[k]C[uF]측정된 출력 주파수[Hz]출력의 크기[Vp-p]구형파/삼각파이론적 출력 주파수[Hz]10kΩ200uF

리포트 | 4페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 7주차 예비보고서

실험7. 발진기와 신호 발생기분반학번이름조담당교수제출일자2012.10.241. 시뮬레이션 및 분석실험1.1. 빈 브리지 발진기 회로회로도Vo 파형(위:시간축, 아래:주파수 축 ... 회로의 발진 주파수 =Hz이다.실험1.2. 구형파 발생기 회로회로도Vo 파형 (주파수 : 469Hz)반전 입력단 파형 및 비반전 입력단 파형(구형파 : 비반전, 삼각파 : 반전 ... )구형파 발생기에서는인 주기를 갖는 구형파가 생성된다.∴f=1/T=493Hz이다.실험1.3. 삼각파 및 구형파 발생기 회로회로도삼각파 : v1, 구형파 : v2 / 주파수 : 364Hz삼각파 및 구형파 발생기에서는 OP 앰프 두 개를 이용하여 각각의 출력단에서

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서강대학교 고급전자회로실험 5주차 예비보고서

실험 5. 증폭기 주파수응답 및 차동증폭기(예비)분반학번이름조(1) 실험 1 : 오디오 증폭기 주파수 응답회로를 보면 BJT들의 에미터에 모두 저항이 달려있고 병렬로 캐패시터 ... 으나, Sensitivity는 감소하는 장점이 있음을 확인할 수 있다.[10]제거 : 처음 회로와 큰 변화가 없음을 확인할 수 있다.(2) 실험 2 : 차동 증폭기[2]①②Gain ... 가 있다. 따라서 낮은 주파수의 신호에서는 캐패시터의 임피던스가 커져 에미터에 저항이 달린 부궤환 회로가 되어 저항이 없는 일반적인 공통 에미터 증폭기보다 이득이 작게 된다

리포트 | 6페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 4주차 예비보고서

실험 10. A급 음성증폭기 및 푸쉬풀 증폭기 (예비)분반학번이름조1) 실험 10. A급 음성 증폭기회로도시뮬레이션회로도시뮬레이션분석 : A급 음성 증폭기의 스피커 및 출력 변압 ... 전압은 915.6mVP-P가 나왔다.이므로 권선비를 계산하면 권선비는 2.240 : 1이다.2) 실험 10-1 증폭기 실험회로도콜렉터 전압 : 1.96Vpp출력 전압 : 10.16 ... 과 Q2는 모두 saturation 영역에서 동작하는 것을 왼쪽 회로도의 DC 바이어스를 통해 알 수 있다. 이때 출력전압은 10.16mVpp가 나온 것을 확인할 수 있다.3) 실험

리포트 | 2페이지 | 1,000원 | 등록일 2013.04.12

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서강대학교 고급전자회로실험 3주차 결과보고서

.031.5표 3-1 실험 회로 1의 VX 변화에 따른 ISS 측정 값ISS(mA)VX(V)그림 3-1 ISS-VX 그래프- ISS-VX 그래프를 살펴보면 Vx가 0.6V 이하인 지점 ... 하라.- 출력 저항 ro = ΔVx/ΔIss = 3V/29mA = 1.67kΩ으로 계산된다.실험1.2[2.1] 회로 구성 후, IREF = 20 mA (± 2mA)가 되는지 확인하라 ... 이 범위 안에서 Vin이 변하면 결국 ID1도 증가하게 된다.실험1.3[3.1] 회로 구성 후 (Vsig를 인가하지 않은 상태), IREF = 20 mA인지 확인하고 각 노드

리포트 | 3페이지 | 1,000원 | 등록일 2013.04.12

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