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전자회로 실험 예비 보고서(전압제어 발진기 회로)

1. 전압제어 발진기 회로 이론 (피스파이스 사진 첨부) NE 555 pin 배치 기본타이밍 개념 실험1.VCO 출력 특성 (시뮬레이션, 피스파이스 또는 워크밴치 캡쳐 사진 모두 첨부) 오실로 스코프 파형 첨부 및 분석 실험2.전압 값의 변화에 따른 출력 단의 주파수와 양단의 전압 (시뮬레이션, 피스파이스 또는 워크밴치 캡쳐 사진 모두 첨부) 오실로 스코프 파형 첨부 및 분석
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한컴오피스
최초등록일 2008.09.09 최종저작일 2008.09
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전자회로 실험 예비 보고서(전압제어 발진기 회로)
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    소개

    1. 전압제어 발진기 회로

    이론 (피스파이스 사진 첨부)
    NE 555

    pin 배치

    기본타이밍 개념

    실험1.VCO 출력 특성
    (시뮬레이션, 피스파이스 또는 워크밴치 캡쳐 사진 모두 첨부)
    오실로 스코프 파형 첨부 및 분석

    실험2.전압 값의 변화에 따른 출력 단의 주파수와 양단의 전압
    (시뮬레이션, 피스파이스 또는 워크밴치 캡쳐 사진 모두 첨부)
    오실로 스코프 파형 첨부 및 분석

    목차

    1. 목 적
    2. 이 론
    1) NE 555
    3. 시뮬레이션
    ▼실험1 : VCO 출력 특성
    ▼실험2 : 전압 값의 변화에 따른 출력 단의 주파수와 Cext양단의 전압

    본문내용

    1. 목 적
    ○ 555 타이머를 이용하여 VCO(Voltage controled oscillator)로 동작시키는 방법과 사용법을 이해한다.

    2. 이 론
    1) NE 555
    ○ Logic Diagram

    : 뛰어난 타이머 IC가 있지만 사용이 편리하고 구입이 쉬운 555 타이머가 많이 사용되고 있다.5V 이상에서 작동하며 10S에서 100초 정도의 시간을 구현 할 수 있다. 콘덴서와 저항에 의한 시정수로 타이머 시간을 설정하는 아날로그적 방법을 사용하므로 양질의 콘덴서를 사용하면 장시간 타이머도 실현될 수 있다. 또 한 출력 전류가 150 mA 까지 (출력 전압은 좀 떨어지지만) 낼 수 있는 특징이 있으며 소비 전류가 약간 큰 편이나 요즘은 소비 전력이 적은 CMOS 형 555도 나와 있다.

    ○ pin 배치
    1) GND : 마이너스 전원.
    2) TRIGGER (TG) : - 전원 전압의 1/3 보다 낮은 전압이 되면 기동.
    3) OUTPUT(OUT) : 출력으로 정지 시는 L, 타이머 기동중은 H가 된다.
    4) RESET(RES) : 타이머 출력을 정시시켜 L로 한다.
    5) CONTROLVOLTAGE (FM) : 6번 핀의 THRESHOLE (Th) 전압을 제어하며 Th 단자의 비교 전압은 내부에서 저항에 의해 전원 전압의 2/3으로 분할되어 있지만 이 분할 점을 외부로 RJsos 것이 FM단자이다. 통상은 개방 상태로 사용 하지만 이 때에는 FM단자에 전원전압의 2/3의 값이 나오며 이 단자 전압을 강제로 가변하여 콘트롤 한다. 이 FM단자전압을 1/2로 분할한 전압이 2번 핀 TRIGGER(TG)의 유효 판정 전압이
    된다. FM단자의 전압을 가변시키면 타이머의 시간과 트리거 감도도 변화 된다.
    6) THRESHOLD (Th) : 이 단자의 전압이 전원 전압의 2/3을 넘으면 타이머 시간 종료.
    7) DISCHAREGE (DIS) : 콘덴서를 방전한다.
    8) +VCC: 플러스 전원.

    ※ 555타이머는 기본적으로 이상 발진기, 2개의 비교기, RS 플립플롭, 방전 트랜지스터로 구성된다.

    참고자료

    · 없음
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