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광운대학교 전기공학실험 실험6. 논리조합회로의 설계 예비레포트2024.12.311. 논리회로의 단순화 논리게이트의 조합을 통해 복잡한 논리적 함수관계를 구현할 수 있다. 진리표, 부울대수, 논리회로도를 사용하여 논리회로를 표현할 수 있으며, 이 세 가지 방법은 서로 1:1 대응관계가 있다. 논리회로를 설계할 때는 진리표를 작성하고, 이를 논리식으로 표현한 뒤 부울대수 법칙을 적용하여 단순화하는 과정을 거친다. Karnaugh-map(K-map)을 활용하면 논리식을 더욱 효율적으로 단순화할 수 있다. 2. Karnaugh-map을 통한 논리회로 단순화 Karnaugh-map(K-map)은 진리표를 2차원적으로 ...2024.12.31
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디지털 회로 실험 및 설계 - 74LS47 Driver를 이용한 7-Segment 실험 22025.05.161. 디지털 회로 실험 및 설계 이 보고서는 디지털 회로 실험 및 설계 과정에서 수행한 74LS47 Driver를 이용한 7-Segment 구동 실험에 대한 내용을 다루고 있습니다. 실험에서는 Sink 방식과 Source 방식의 회로를 구성하고, 전압과 전류를 측정하여 이론값과 실험결과를 비교 분석하였습니다. 또한 74LS47 소자를 이용한 BCD to 7-Segment Decoder Driver 회로를 구현하여 그 효과를 설명하고 있습니다. 마지막으로 실험 결과와 이론 분석 간의 오차 발생 원인을 전류 측정의 어려움, 점퍼선의 저...2025.05.16
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[논리회로설계실험] Mux, Demux (dataflow/gatelevel modeling) (성균관대)2025.01.211. MUX MUX는 멀티플렉서라고도 하며 다수의 정보 장치를 소수의 채널이나 선을 통하여 전송하는 것을 의미한다. MUX는 여러 입력선 중에서 하나를 선택하여 출력선에 연결하는 '조합 논리 회로'로 선택선의 값에 따라 한 입력선을 선택한다. 일반적으로 입력선이 n개 있을 때 선택선은 log2n개가 필요하다. 2. DEMUX DEMUX는 디멀티플렉서라고도 하며 하나의 입력선을 여러 개의 출력선 중 하나에 연결하는 '조합 논리 회로'이다. 선택선의 값에 따라 하나의 출력선이 활성화되고 나머지 출력선은 비활성화된다. 일반적으로 출력선이...2025.01.21
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기초실험 XOR, XNOR 결과보고서(틴커캐드)2025.05.031. XOR 게이트 XOR 게이트는 2개의 입력을 가지며, 입력이 A, B일 때 출력은 AB'+A'B가 된다. XOR 게이트는 입력 중 1이 짝수개인 경우 0이 출력되고 1이 홀수개인 경우 1을 출력하는 특성을 가진다. 실험 결과 XOR 게이트의 입출력 특성이 이론과 일치하는 것을 확인할 수 있었다. 2. XNOR 게이트 XNOR 게이트는 XOR 게이트의 출력에 NOT을 붙인 것과 같은 형태로, 2개의 입력을 가지는 XNOR 게이트는 (AB)'=AB+A'B'으로 정리할 수 있다. 실험 결과 XNOR 게이트의 입출력 특성은 XOR 게...2025.05.03
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[A+] 일반 논리게이트 응용 예비보고서2025.05.131. 일반 논리 게이트 실험 목적은 OR Gate, AND Gate, NOT Gate, NAND Gate, NOR Gate, XOR Gate와 같은 논리회로의 기본 게이트들의 기본 논리, 이론, 동작 원리를 공부하고 이해하는 것입니다. 특히 NAND Gate, NOR Gate, XOR Gate에 대해 집중적으로 실험하고 동작 원리를 이해하는 것이 목적입니다. 또한 이러한 논리 게이트들을 이용하여 논리식을 구현하고 진리표를 작성하며 동작을 확인하고 특성을 알아보는 것입니다. 2. 양의 논리와 음의 논리 부울 논리에서 1과 0은 조건을...2025.05.13
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RS-Latch 및 D-Latch 실험 결과보고서2025.11.161. RS-Latch RS-Latch는 NOR gate 또는 NAND gate를 사용하여 구성되는 기본적인 메모리 소자입니다. NOR gate로 구성된 RS-Latch는 R(Reset)과 S(Set) 입력에 따라 출력 Q와 Q'의 상태가 결정되며, NAND gate로 구성된 경우 입력 논리가 반전됩니다. Enable 신호를 추가하면 특정 시간에만 입력을 받아들일 수 있습니다. 실험에서 진리표와 타이밍 다이어그램을 통해 각 입력 조합에 따른 출력 변화를 관찰했습니다. 2. D-Latch D-Latch는 NOR gate, AND gat...2025.11.16
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교류및전자회로실험 실험3 순차 논리 회로 기초 예비보고서2025.01.171. 플립플롭 플립플롭은 전원이 공급되면 1 또는 0의 출력이 유지되는 디지털 회로이다. 출력이 두가지 상태 중 하나로 안정되기 때문에 쌍안정 멀티바이브레이터라고도 한다. 이와 같은 특성을 이용하여 플립플롭은 메모리로도 많이 활용된다. 플립플롭은 대표적인 순서 논리회로이다. 순서 논리회로는 출력을 입력쪽에 연결한 궤환(feedback) 회로를 가지고 있으며, 이를 통해 출력이 논리 동작에 영향을 미친다. 플립플롭에는 RS 플립플롭, D 플립플롭, JK 플립플롭, T 플립플롭 등이 있다. 2. D 플립플롭 D 플립플롭은 1개의 입력과...2025.01.17
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[A+, 에리카] 2022-1학기 논리설계및실험 Breadboard 및 기본 논리 게이트 실험 결과보고서2025.05.011. 브레드보드 사용법 브레드보드의 사용법을 숙지하고 소자를 통해 기본 논리게이트의 작동을 확인할 수 있다. 2. 논리게이트 ED-1000B + Breadboard를 이용하여 7segment의 좌측과 우측으로 각각 나뉘어 output값을 출력하는 실험을 진행하였다. Boolean Algebra의 기본 논리 연산인 AND, OR, NOT 게이트의 동작을 확인하였고, 범용 게이트인 NAND, NOR 게이트의 특성도 살펴보았다. 3. 논리회로 설계 XOR, XNOR 게이트와 드모르간의 법칙을 통해 논리회로 설계의 기본 원리를 이해할 수 ...2025.05.01
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4주차 결과 보고서 18장 기본 논리 소자2025.05.031. AND 게이트 AND 게이트의 경우 입력 중 하나라도 0이 있으면 출력은 항상 0이다. 즉 입력이 모두 1일 때만 1을 출력하게 된다. 또한 입력의 경우 2V까지는 출력값이 5V일 때와 같은 것을 보아 꼭 입력이 서로 같아야 출력이 입력값이 나오는 것이 아니다. 또한 0.8V보다 아래일 때 갑자기 0V로 떨어지는 실험결과 AND게이트의 경우 최소 2V까지는 5V와 같은 실험결과가 나오고 최대 0.8V까지는 출력값이 나오나 그 보다 적은 입력값인 경우는 출력값이 0이 나온다는 것을 유추할 수 있다. 2. OR 게이트 OR게이트의...2025.05.03
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트랜지스터 스위치 특성 실험 결과보고서2025.11.121. 트랜지스터 스위치 특성 트랜지스터를 전자스위치로 활용하는 기본 원리와 특성을 다루는 실험입니다. 트랜지스터의 ON/OFF 동작 특성, 포화 영역과 차단 영역에서의 동작 메커니즘, 그리고 스위칭 속도 및 효율성을 측정하고 분석합니다. 이는 디지털 회로 설계의 기초가 되는 중요한 개념입니다. 2. 전자스위치 응용 트랜지스터를 이용한 전자스위치는 현대 전자기기의 핵심 구성요소입니다. 전력 제어, 신호 선택, 논리 회로 구현 등 다양한 응용 분야에서 사용되며, 실험을 통해 실제 스위칭 동작의 특성과 한계를 이해하고 최적의 설계 방법을...2025.11.12
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